JPH10199745A - 表面実装型電子部品及び回路基板並びに実装方法 - Google Patents

表面実装型電子部品及び回路基板並びに実装方法

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JPH10199745A
JPH10199745A JP366397A JP366397A JPH10199745A JP H10199745 A JPH10199745 A JP H10199745A JP 366397 A JP366397 A JP 366397A JP 366397 A JP366397 A JP 366397A JP H10199745 A JPH10199745 A JP H10199745A
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mounting
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electrode terminals
electronic component
wiring board
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JP366397A
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Takaaki Toma
孝顕 遠間
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Sony Corp
Original Assignee
Sony Corp
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    • HELECTRICITY
    • H05ELECTRIC TECHNIQUES NOT OTHERWISE PROVIDED FOR
    • H05KPRINTED CIRCUITS; CASINGS OR CONSTRUCTIONAL DETAILS OF ELECTRIC APPARATUS; MANUFACTURE OF ASSEMBLAGES OF ELECTRICAL COMPONENTS
    • H05K3/00Apparatus or processes for manufacturing printed circuits
    • H05K3/30Assembling printed circuits with electric components, e.g. with resistors
    • H05K3/32Assembling printed circuits with electric components, e.g. with resistors electrically connecting electric components or wires to printed circuits
    • H05K3/34Assembling printed circuits with electric components, e.g. with resistors electrically connecting electric components or wires to printed circuits by soldering
    • H05K3/341Surface mounted components
    • H05K3/3431Leadless components
    • H05K3/3442Leadless components having edge contacts, e.g. leadless chip capacitors, chip carriers

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  • Electric Connection Of Electric Components To Printed Circuits (AREA)

Abstract

(57)【要約】 【課題】本発明は、熱的信頼性を確保すると共に高密度
実装を実現し得る表面実装型電子部品及び回路基板並び
に実装方法を実現しようとするものである。 【解決手段】表面実装型電子部品及び回路基板並びに実
装方法において、表面実装型電子部品の各電極端子を本
体部よりも実装方向に対する幅が狭くなるように形成し
たことにより、表面実装型電子部品及び配線基板間の間
隙の高さを実用上十分確保して当該間隙にかかる熱スト
レスを十分に分散及び緩和することができ、この結果、
熱的信頼性を確保すると共に高密度実装を実現すること
ができる。

Description

【発明の詳細な説明】
【0001】
【目次】以下の順序で本発明を説明する。
【0002】発明の属する技術分野 従来の技術(図12〜図13(B)) 発明が解決しようとする課題(図14(A)及び
(B)) 課題を解決するための手段 発明の実施の形態 (1)第1実施例(図1〜図2(B)) (2)第2実施例(図3〜図4(B)) (3)他の実施例(図5〜図11) 発明の効果
【0003】
【発明の属する技術分野】本発明は表面実装型電子部品
及び回路基板並びに実装方法に関し、例えば、抵抗器や
セラミツクコンデンサ等の超小型化されたチツプ部品に
適用して好適なものである。
【0004】
【従来の技術】近年、パーソナルデイジタルセルラホ
ン、VCR(Video Cassette Recorder)及び地上波又
は衛星放送用のチユーナ等の電子機器においては、信号
伝送、信号処理及び信号記録のデジタル化が進行すると
共に、取り扱われる情報量も増大し、またシステムクロ
ツクも増加する傾向にある。
【0005】さらに電子機器においては、セルラ電話、
ISDN(Integrated Services Digital Network )及
びパーソナルコンピユータ(PC)等の情報通信(ネツ
トワーク)技術の進展により、様々な機器に対して高周
波ブロツクや高速シリアルインタフエイス等が搭載され
るようになされている。
【0006】このようなデジタル化及び信号の高速化と
いつたシステムの変化に伴い、近年ではノイズの減少や
電子機器の小型化が要請されている。このため電子部品
や半導体チツプのチツプ化が進められ、実装領域が微細
化されると共に高密度実装が要求されつつある。
【0007】ここで表面実装技術として、抵抗器やセラ
ミツクコンデンサ等のチツプ部品と呼ばれるリードレス
部品の実装について説明する。図12に示すようにチツ
プ部品1は、絶縁材料でなる本体部2内に抵抗体、コン
デンサ又はインダクタ等の電子部品(図示せず)が収納
され、本体2の両端には当該本体2よりも大きい外部電
極3が形成されている。
【0008】図13(A)及び(B)に示すように、こ
のチツプ部品1が実装されたプリント回路基板5におい
て、配線基板6の実装面6Aには例えばウエツトエツチ
ング法によつて所定パターンでランド7が形成され、当
該ランド7に対応してチツプ部品1の各外部電極3がは
んだ材でなるフイレツト(裾引き状部分)8を介して導
通接続されている。
【0009】この場合、チツプ部品1の各外部電極3は
本体部2よりも配線基板6側に突出していると共に、配
線基板6の実装面6Aに形成されたランド7が各外部電
極3よりも広い面積で形成されていることから、接合時
のチツプ部品1の配線基板6に対する機械的強度は、各
外部電極3及び対応するランド7間に介挿されたフイレ
ツト8のみによつて実用上十分得られていた。
【0010】
【発明が解決しようとする課題】ところが、高密度実装
の要請に基づき、チツプ部品の集積度が上がるのに伴つ
て、当該チツプ部品の外部電極の数が増加することか
ら、これに反比例して配線基板の実装面に形成されるラ
ンドのピツチは減少することとなる。
【0011】このため図13との対応部分に同一符号を
付した図14に示すプリント回路基板10において、配
線基板6の実装面6Aに形成されるランド11が各外部
電極3とほぼ同じ面積で形成されるようになると、接合
時のチツプ部品1の配線基板6に対する機械的強度は、
各外部電極3及び対応するランド11間に介挿されたフ
イレツト8のみによつては不十分となる問題があつた。
【0012】さらに各外部電極3及び対応するランド1
1間に介挿されるフイレツト8は、実装後に受ける環境
変化のうち特に温度サイクルに対して影響が及ぼされ易
いという問題があつた。すなわちプリント回路基板10
におけるチツプ部品1及び配線基板6間の接続の熱的信
頼性は、チツプ部品1と配線基板6との間の空間部(以
下、これを接合層スペースと呼ぶ)S1 にかかる熱スト
レスの大きさによつて決定される。
【0013】この熱ストレスεFは、配線基板6の熱膨
張係数α2とチツプ部品1の熱膨張係数α1との差Δα
(=α2−α1)、チツプ部品1のサイズ2×Lc、熱
サイクルの温度差T、接合層スペースS1 の半径r、高
さh及び体積V並びに配線基板6の材料に固有な定数β
等の物理的構造によつて決定され、次式
【0014】
【数1】
【0015】で表される。従つて、熱的信頼性を確保す
るには、一般に接合層スペースS1 の高さhを高く、配
線基板6の断面積を大きくとるようにすれば良い。
【0016】また低価格なガラスエポキシ樹脂でなる配
線基板6の熱膨張係数に対してチツプ部品1の熱膨張係
数は非常に小さいことから、機械的強度のみならず熱的
信頼性の向上をも図るべく、チツプ部品1及び配線基板
6間をフイレツト8を介して接合しているが、図14
(B)に示すように十分な量のフイレツト8が与えられ
ないときには、接合層スペースS1 にかかる熱ストレス
を分散及び緩和することが困難となる問題があつた。
【0017】実際上、はんだ材でなるフイレツト8を用
いると共に、安価なガラスエポキシ基板を配線基板6と
して用いる場合、チツプ部品1及び配線基板6間の接合
層スペースS1 の高さの最適値は50〜 300〔μm〕であ
り、図14(B)に示すプリント回路基板10のように
接合層スペースS1 の高さが10〜30〔μm〕程度では熱
ストレスが分散及び緩和されることなく、この結果、は
んだ材でなるフイレツト8内部にクラツクが生じ、さら
には当該フイレツト8が断裂するおそれがあつた。
【0018】本発明は以上の点を考慮してなされたもの
で、熱的信頼性を確保すると共に高密度実装を実現し得
る表面実装型電子部品及び回路基板並びに実装方法を提
案しようとするものである。
【0019】
【課題を解決しようとする手段】かかる課題を解決する
ため本発明においては、本体部の両端にそれぞれ電極端
子が形成された表面実装型電子部品において、各電極端
子を本体部よりも実装方向に対する幅が狭くなるように
形成する。
【0020】また本発明においては、本体部の両端にそ
れぞれ形成された電極端子に対応して実装面上にそれぞ
れランドが形成されてなる配線基板の実装面に、各電極
端子及び対応する各ランド間が金属ペースト又は導電性
接着剤を介して導通接続するように表面実装型電子部品
が実装された回路基板において、表面実装型電子回路の
各電極端子を、電子部品本体よりも実装方向に対する幅
が狭くなるように形成する。
【0021】さらに本発明においては、本体部の両端に
それぞれ形成された電極端子に対応して実装面上にそれ
ぞれランドが形成されてなる配線基板の実装面に、各電
極端子及び対応する各ランド間が金属ペースト又は導電
性接着剤を介して導通接続するように表面実装型電子部
品を回路基板に実装する実装方法において、表面実装型
電子回路の各電極端子を、電子部品本体よりも実装方向
に対する幅が狭くなるように形成しておき、表面実装型
電子部品の各電極端子を配線基板の各ランドに位置合わ
せした後、表面実装型電子部品を金属ペースト又は導電
性接着剤を介して配線基板の実装面に搭載する。続いて
表面実装型電子部品を配線基板の実装面にリフロー又は
熱圧着するようにして実装するようにする。
【0022】このようにして表面実装型電子部品及び配
線基板間の間隙の高さを実用上十分確保することがで
き、この結果、当該間隙にかかる熱ストレスを十分に分
散及び緩和することができる。
【0023】
【発明の実施の形態】以下図面において、本発明の一実
施例を詳述する。
【0024】(1)第1実施例 図1に示すようにチツプ部品20は、絶縁材料でなる本
体部21内に抵抗体、コンデンサ又はインダクタ等の電
子部品(図示せず)が収納され、本体部21の両端には
当該本体部21よりも実装方向に対して幅が狭い外部電
極22が形成されている。
【0025】図14(A)及び(B)との対応部分に同
一符号を付して示す図2(A)及び(B)に、チツプ部
品20が実装されたプリント回路基板25を示す。この
プリント回路基板25には、配線基板6の実装面6Aに
形成されたランド11に対応してチツプ部品20の各外
部電極22がはんだ材でなるフイレツト8を介して導通
接続されている。
【0026】この場合、チツプ部品20の各外部電極2
2は本体部21よりも実装方向に対して幅が狭くなるよ
うに形成されているため、当該本体部21の下端面21
Aを基準面として配線基板6の実装面6Aに塗布された
レジスト膜23に当接させることにより、チツプ部品2
0を配線基板6に対して位置固定することができる。こ
のときのチツプ部品20及び配線基板6間の接合層スペ
ースS2 の高さは、チツプ部品20の本体部21及び外
部電極22の実装方向に対する幅の差と、レジスト膜2
3の高さとの和であるが、レジスト膜23の高さは予め
所定厚で塗布されているため、フイレツト8にかかる熱
的信頼性を確保し得る程度にチツプ部品20の本体部2
1及び外部電極22の実装方向に対する幅の差を拡げる
必要がある。従つて、このチツプ部品20では、本体部
21と外部電極22との実装方向に対する幅の差を考慮
して、予め外部電極22のサイズが設定されている。
【0027】因みに、特に各外部電極22及び対応する
ランド11間に介挿するフイレツト8のリフロー工程に
おいて、チツプ部品20の一方が外れると他方の接合し
ている溶融状態のはんだの表面張力によつてチツプ部品
20を持ち上げ、立たせてしまうマンハツタン現象や、
外部電極22と共に本体部21も浮き上がつてしまうロ
ーリング現象が生じるおそれがあるが、リフローの前段
階でチツプ部品20が配線基板6に対して位置決めされ
ているため、マンハツタン現象やローリング現象が生じ
るのを有効に防止することができる。
【0028】以上の構成によれば、チツプ部品20の本
体部21よりも実装方向に対する幅が狭い外部電極22
を当該本体部21の両端に形成したことにより、プリン
ト回路基板25において、チツプ部品20及び配線基板
6間の接合層スペースS2 の高さを実用上十分確保する
ことができ、この結果、当該接合層スペースS2 にかか
る熱ストレスを十分に分散及び緩和することができる。
かくして熱的信頼性を確保すると共に高密度実装を実現
し得るプリント回路基板25を得ることができる。
【0029】(2)第2実施例 図3はチツプ部品30を示し、絶縁材料でなる本体部3
1内に、コンデンサ又はインダクタ等の電子部品32
と、本体部31よりも実装方向に対して幅が狭い円柱形
状の各外部電極33とが収納された構成からなる。この
チツプ部品30の本体部31は、実装方向に対する断面
がほぼ正方形でなり、従来のチツプ部品と外形寸法がほ
ぼ同じとなるように本体部31のサイズが予め設定され
ている。
【0030】この本体部31では、中央内部に電子部品
32が被覆されると共に、両側所定位置には実装方向に
沿つて所定の大きさでなる開口部33Aが貫通形成さ
れ、当該開口部33A内で各外部電極33が露出するよ
うになされている。また本体部31の開口部33Aを形
成する両側壁部31Bの実装方向に対する幅は、本体部
31とほぼ同じ幅でなり、さらに本体部31の両端の側
壁部31Bの内面には、それぞれ外部電極33の端部が
若干埋め込まれている。
【0031】このチツプ部品20が実装されたプリント
回路基板35は、図2(A)及び(B)との対応部分に
同一符号を付した図4(A)及び(B)のように示され
る。このプリント回路基板35には、配線基板6の実装
面6Aに形成されたランド11に対応してチツプ部品3
0の各外部電極33がフイレツト8を介して導通接続さ
れている。
【0032】この場合、チツプ部品30の各外部電極3
3は本体部31よりも実装方向に対して幅が狭くなるよ
うに形成されているため、当該本体部31の下端面31
Cを基準面として配線基板6の実装面6Aに塗布された
レジスト膜23に例えば熱硬化性でなる接着剤34を介
して当接させることにより、第1実施例の場合よりも強
固にチツプ部品20を配線基板6に対して位置固定する
ことができる。
【0033】このときのチツプ部品30及び配線基板6
間の接合層スペースS3 の高さは、チツプ部品30の本
体部31及び外部電極33の実装方向に対する幅の差
と、レジスト膜23及び接着剤34の高さとの和であ
る。従つて第1実施例の場合と同様に、このチツプ部品
30では、本体部31と外部電極33との実装方向に対
する幅の差を考慮して予め外部電極33のサイズを設定
しておくことにより、チツプ部品30の本体部31及び
外部電極33の実装方向に対する幅の差を実用上十分に
拡げることができ、この結果、フイレツト8にかかる熱
的信頼性を確保することができる。
【0034】さらにチツプ部品30の本体部31では、
各外部電極33の実装方向に対する両側が開口部31A
を介して開放されていることから、接合時に流入される
フイレツト8は開口部31A内部で充填される。この結
果、フイレツト8がリフロー工程の段階で対象となるラ
ンド11からはみ出して隣接するランド11側に流れ出
すのを回避することができる。さらに通常必要とされる
量のフイレツト8で、通常よりも各外部電極33との接
触部分を広く確保することができ、より一層熱ストレス
を分散及び緩和することができる。
【0035】以上の構成によれば、チツプ部品30の本
体部31よりも実装方向に対する幅が狭い外部電極33
を当該本体部31の両端に形成すると共に、各外部電極
33を本体部31内に絶縁状態で内包して実装方向のみ
開放させるようにしたことにより、プリント回路基板3
5において、チツプ部品30及び配線基板6間の接合層
スペースS3 の高さを実用上十分確保することができる
と共に、チツプ部品30の各外部電極33を実装方向以
外に対して絶縁状態とすることができる。
【0036】この結果、接合層スペースS3 にかかる熱
ストレスを十分に分散及び緩和することができると共
に、隣接するチツプ部品間で短絡が生じるのを回避する
ことができる。かくして熱的信頼性を確保すると共に高
密度実装を実現し得るプリント回路基板35を得ること
ができる。
【0037】(3)他の実施例 なお上述の実施例においては、金属ペーストとしてはん
だ材でなるフイレツト8を適用した場合について述べた
が、本発明はこれに限らず、はんだ材以外にも種々の金
属ペーストを用いるようにしても良い。さらに金属ペー
スト以外にも例えば異方性導電接着剤などの導電性接着
剤を用いるようにしても良い。この場合、導電性接着剤
としては、粘度が比較的高くかつ接着層厚も比較的厚
く、電気抵抗が十分低くなるように調整された材質を選
定すれば良い。これにより導電性接着剤の接合層内の熱
応力が分散されて良好な導電状態を保つことができる。
【0038】また第1実施例においては、チツプ部品2
0として、図1に示すように本体部21の両端に形成す
る各外部電極22を、当該本体部21よりも実装方向に
対してのみ幅が狭くなるように形成した場合について述
べたが、本発明はこれに限らず、図5に示すように、本
体部41よりも実装方向以外の全ての他面に対しても幅
が狭くなるように各外部電極42が形成されてなるチツ
プ部品40を用いるようにしても良い。
【0039】この場合、図6に示すような本体部の実装
方向に対する断面がほぼ正方形でなるチツプ部品45に
とつては非常に有効である。このチツプ部品45も、本
体部46よりも実装方向以外の全ての他面に対しても幅
が狭くなるように各外部電極47が形成されているた
め、全ての面を基準面とすることができ、この結果マウ
ントの誤りを回避することができる。
【0040】さらにチツプ部品の本体部の両端に形成す
る各外部電極は、種々の形状であつても本発明を適用し
得る。例えば図7に示すように各外部電極52の形状が
円柱形状でなるチツプ部品50を用いるようにしても良
い。要は、チツプ部品50において、各外部電極52が
本体部51よりも少なくとも実装方向に対して幅が狭く
なるように形成されていれば、当該各外部電極の形状を
種々の形状に選定して良い。
【0041】さらに第2実施例においては、チツプ部品
30として、図3に示すように本体部31の実装方向に
対する断面がほぼ正方形でなると共に、本体部31の両
端に形成された各外部電極33を当該本体部31内で内
包して実装方向のみ開放させるようにした場合について
述べたが、本発明はこれに限らず、図8に示すように本
体部31の実装方向に対する断面が長方形でなるチツプ
部品55を用いるようにしても良い。このチツプ部品5
5も、本体部56の両端に形成された各外部電極57が
当該本体部56内で内包されて実装方向のみ開放される
ようにすれば良い。
【0042】さらに第2実施例においては、チツプ部品
30として、図3に示すように本体部31の開口部31
Aを形成する側壁部31Bの実装方向に対する幅を本体
部31とほぼ同じ幅でなるようにした場合について述べ
たが、本発明はこれに限らず、図9に示すようにチツプ
部品60において、本体61の開口部61Aを形成する
側壁部61Bの実装方向に対する幅を、第1実施例の場
合のように、本体部61よりも狭くするようにしても良
い。
【0043】さらに第2実施例においては、図3に示す
ようにチツプ部品30の本体部31の両端に形成する各
外部電極33を円柱形状でなるようにした場合について
述べたが、本発明はこれに限らず、チツプ部品の本体部
の両端に形成する各外部電極は、種々の形状であつても
良い。例えば図10に示すチツプ部品65のように、本
体部66の各外部電極67の形状を四角柱形状としても
良い。この場合、各外部電極67は本体部66よりも実
装方向に対して幅が狭くなるように形成すれば良い。
【0044】また図11に示すチツプ部品70のよう
に、本体部71よりも実装方向以外の全ての他面に対し
ても幅が狭くなるように四角柱形状でなる各外部電極7
2を形成するようにしても良い。要は、チツプ部品にお
いて、各外部電極が本体部よりも少なくとも実装方向に
対して幅が狭くなるように形成されていれば、当該各外
部電極の形状を種々の形状に選定して良い。
【0045】さらに第2実施例においては、熱硬化性で
なる接着剤34を介してチツプ部品30の本体部31を
配線基板6に実装するようにした場合について述べた
が、本発明はこれに限らず、接着剤としては種々の材質
のものを用いるようにしても良い。すなわち接着剤とし
ては、接着層厚が比較的薄くてかつ機械的強度の高い絶
縁性でなる熱硬化性や光硬化性の材質のものを選定すれ
ば良い。
【0046】
【発明の効果】上述のように本発明によれば、表面実装
型電子部品及び回路基板において、表面実装型電子部品
の各電極端子を本体部よりも実装方向に対する幅が狭く
なるように形成したことにより、表面実装型電子部品及
び配線基板間の間隙の高さを実用上十分確保して当該間
隙にかかる熱ストレスを十分に分散及び緩和することが
でき、この結果、熱的信頼性を確保すると共に高密度実
装を実現し得る表面実装型電子部品及び回路基板を実現
し得る。
【0047】また本発明によれば、表面実装型電子回路
の各電極端子を、電子部品本体よりも実装方向に対する
幅が狭くなるように形成しておき、表面実装型電子部品
の各電極端子を配線基板の各ランドに位置合わせした
後、表面実装型電子部品を金属ペースト又は導電性接着
剤を介して配線基板の実装面に搭載し、表面実装型電子
部品を配線基板の実装面にリフロー又は熱圧着するよう
にして実装するようにしたことにより、表面実装型電子
部品及び配線基板間の間隙の高さを実用上十分確保して
当該間隙にかかる熱ストレスを十分に分散及び緩和する
ことができ、この結果、熱的信頼性を確保すると共に高
密度実装を実現し得る実装方法を実現し得る。
【図面の簡単な説明】
【図1】第1実施例によるチツプ部品の外観構成を示す
略線的斜視図である。
【図2】第1実施例によるプリント回路基板の構成を示
す上面図及び部分的断面図である。
【図3】第2実施例によるチツプ部品の外観構成を示す
略線的斜視図である。
【図4】第2実施例によるプリント回路基板の構成を示
す上面図及び部分的断面図である。
【図5】他の実施例によるチツプ部品の外観構成を示す
略線的斜視図である。
【図6】他の実施例によるチツプ部品の外観構成を示す
略線的斜視図である。
【図7】他の実施例によるチツプ部品の外観構成を示す
略線的斜視図である。
【図8】他の実施例によるチツプ部品の外観構成を示す
略線的斜視図である。
【図9】他の実施例によるチツプ部品の外観構成を示す
略線的斜視図である。
【図10】他の実施例によるチツプ部品の外観構成を示
す略線的斜視図である。
【図11】他の実施例によるチツプ部品の外観構成を示
す略線的斜視図である。
【図12】従来のチツプ部品の外観構成を示す略線的斜
視図である。
【図13】従来のプリント回路基板の構成を示す上面図
及び部分的断面図である。
【図14】従来のプリント回路基板の構成を示す上面図
及び部分的断面図である。
【符号の説明】
1、20、30、40、45、50、55、60、6
5、70……チツプ部品、2、21、31、41、4
6、51、56、61、66、71……本体部、3、2
2、33、42、47、52、57、67、72……外
部電極、5、25、35……プリント回路基板、6……
配線基板、6A……実装面、7、11……ランド、8…
…フイレツト、21A、31C……下端面、23……レ
ジスト膜、31A、61A……開口部、31B、61B
……側壁部、34……接着剤、S1 、S2 、S3 ……接
合層スペース。

Claims (6)

    【特許請求の範囲】
  1. 【請求項1】本体部の両端にそれぞれ電極端子が形成さ
    れた表面実装型電子部品において、 上記各電極端子は、上記本体部よりも実装方向に対する
    幅が狭いことを特徴とする表面実装型電子部品。
  2. 【請求項2】上記本体部の両端にそれぞれ設けられ、上
    記各電極端子を実装方向のみ開放する開口が形成される
    と共に、上記各電極端子を上記実装方向を除いて絶縁状
    態で内包する絶縁枠壁を具えたことを特徴とする請求項
    1に記載の表面実装型電子部品。
  3. 【請求項3】本体部の両端にそれぞれ形成された電極端
    子に対応して実装面上にそれぞれランドが形成されてな
    る配線基板の上記実装面に、上記各電極端子及び対応す
    る上記各ランド間が金属ペースト又は導電性接着剤を介
    して導通接続するように上記表面実装型電子部品が実装
    された回路基板において、 上記表面実装型電子回路の上記各電極端子は、上記電子
    部品本体よりも実装方向に対する幅が狭いことを特徴と
    する回路基板。
  4. 【請求項4】上記表面実装型電子回路は、 上記本体部の両端にそれぞれ設けられ、上記各電極端子
    を実装方向のみ開放する開口が形成されると共に、上記
    各電極端子を上記実装方向を除いて絶縁状態で内包する
    絶縁枠壁を具え、上記金属ペースト又は上記導電性接着
    剤が上記開口内に充填されることを特徴とする請求項3
    に記載の回路基板。
  5. 【請求項5】本体部の両端にそれぞれ形成された電極端
    子に対応して実装面上にそれぞれランドが形成されてな
    る配線基板の上記実装面に、上記各電極端子及び対応す
    る上記各ランド間が金属ペースト又は導電性接着剤を介
    して導通接続するように上記表面実装型電子部品を回路
    基板に実装する実装方法において、 上記表面実装型電子回路の上記各電極端子を、上記電子
    部品本体よりも実装方向に対する幅が狭くなるように形
    成する第1の工程と、 上記表面実装型電子部品の上記各電極端子を上記配線基
    板の上記各ランドに位置合わせした後、上記表面実装型
    電子部品を上記金属ペースト又は上記導電性接着剤を介
    して上記配線基板の上記実装面に搭載する第2の工程
    と、 上記表面実装型電子部品を上記配線基板の上記実装面に
    リフロー又は熱圧着するようにして実装する第3の工程
    とを具えることを特徴とする実装方法。
  6. 【請求項6】上記第1の工程では、 上記本体部の両端に上記各電極端子を実装方向のみ開放
    する開口が形成された絶縁枠壁をそれぞれ設け、当該各
    絶縁枠壁によつて上記各電極端子を上記実装方向を除い
    て絶縁状態で内包し、 上記第3の工程では、 リフロー又は熱圧着するときに、上記金属ペースト又は
    上記導電性接着剤を上記絶縁枠壁に形成された上記開口
    内に充填させることを特徴とする請求項5に記載の実装
    方法。
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Cited By (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2015046421A (ja) * 2013-08-27 2015-03-12 Tdk株式会社 セラミック電子部品
JP2015046422A (ja) * 2013-08-27 2015-03-12 Tdk株式会社 セラミック電子部品
JP2016105488A (ja) * 2015-12-16 2016-06-09 Tdk株式会社 セラミック電子部品のはんだ実装構造

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