JPH10200602A - マスター／スレーブ通信システム - Google Patents
マスター／スレーブ通信システムInfo
- Publication number
- JPH10200602A JPH10200602A JP9001949A JP194997A JPH10200602A JP H10200602 A JPH10200602 A JP H10200602A JP 9001949 A JP9001949 A JP 9001949A JP 194997 A JP194997 A JP 194997A JP H10200602 A JPH10200602 A JP H10200602A
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- Japan
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- microprocessor
- slave
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Abstract
(57)【要約】
【課題】 信頼性および通信速度が改善されたマスター
／スレーブ通信システムを提供するにある。 【解決手段】 マイクロプロセッサの司令により動作す
るモデムと、マイクロプロセッサとモデムとの動作を制
御する通信制御部と、通信開始から終了までの時間を計
時しタイムアウトした場合に該通信を強制終了するバス
タイマーとを有するマスター通信装置と、複数のスレー
ブ通信装置とを具備するマスター／スレーブ通信システ
ムにおいて、前記バスタイマーからのタイムアウト信号
をラッチ記憶し通信開始時の前記通信制御部に通知する
と共に通信が開始された後にバスタイマーがタイムアウ
トした場合にはラッチ記憶して前記通信制御部と前記マ
イクロプロセッサとにタイムアウト信号を通知する故障
情報記憶部を有するマスター通信装置を具備したことを
特徴とするマスター／スレーブ通信システムである。
／スレーブ通信システムを提供するにある。 【解決手段】 マイクロプロセッサの司令により動作す
るモデムと、マイクロプロセッサとモデムとの動作を制
御する通信制御部と、通信開始から終了までの時間を計
時しタイムアウトした場合に該通信を強制終了するバス
タイマーとを有するマスター通信装置と、複数のスレー
ブ通信装置とを具備するマスター／スレーブ通信システ
ムにおいて、前記バスタイマーからのタイムアウト信号
をラッチ記憶し通信開始時の前記通信制御部に通知する
と共に通信が開始された後にバスタイマーがタイムアウ
トした場合にはラッチ記憶して前記通信制御部と前記マ
イクロプロセッサとにタイムアウト信号を通知する故障
情報記憶部を有するマスター通信装置を具備したことを
特徴とするマスター／スレーブ通信システムである。
Description
【０００１】
【発明の属する技術分野】本発明は、マスターとなる通
信装置と複数のスレーブとなる通信装置とのマスター／
スレーブ通信システムにおいて、通信障害発生を考慮し
た際の、信頼性および通信速度が改善されたマスター／
スレーブ通信システムに関するものである。
信装置と複数のスレーブとなる通信装置とのマスター／
スレーブ通信システムにおいて、通信障害発生を考慮し
た際の、信頼性および通信速度が改善されたマスター／
スレーブ通信システムに関するものである。
【０００２】
【従来の技術】図４は従来より一般に使用されている従
来例の構成説明図である。図において、１はマスター通
信装置、２は複数のスレーブ通信装置である。３は、マ
スター通信装置１内のマイクロプロセッサ（ＭＰＵ）で
ある。４は、マイクロプロセッサ（ＭＰＵ）の司令によ
り動作するモデムである。
来例の構成説明図である。図において、１はマスター通
信装置、２は複数のスレーブ通信装置である。３は、マ
スター通信装置１内のマイクロプロセッサ（ＭＰＵ）で
ある。４は、マイクロプロセッサ（ＭＰＵ）の司令によ
り動作するモデムである。
【０００３】５は、マイクロプロセッサ（ＭＰＵ）３と
モデム４との動作を制御する通信制御部である。６は、
通信開始から終了までの時間を計時しタイムアウトした
場合に通信制御部５とマイクロプロセッサ（ＭＰＵ）３
とに通知するバスタイマーである。
モデム４との動作を制御する通信制御部である。６は、
通信開始から終了までの時間を計時しタイムアウトした
場合に通信制御部５とマイクロプロセッサ（ＭＰＵ）３
とに通知するバスタイマーである。
【０００４】以上の構成において、マスター通信装置１
がスレーブ通信装置２に対して通信を行う場合、スレー
ブ通信装置２の応答時間が遅いため、以下のような制御
をする必要がある。
がスレーブ通信装置２に対して通信を行う場合、スレー
ブ通信装置２の応答時間が遅いため、以下のような制御
をする必要がある。
【０００５】マスター通信装置１内のマイクロプロセッ
サ（ＭＰＵ）３が、スレーブ通信装置２に対する通信起
動命令を実行すると、通信制御部５は、ＷＡＩＴＸ＝Ｌ
を出力し、モデム４をイネーブルにすると共に、マイク
ロプロセッサ（ＭＰＵ）３に現在の状態で待つように司
令する。ＷＡＩＴＸ＝Ｌの間、モデム４はスレーブ通信
装置２に対して通信を行い、マイクロプロセッサ（ＭＰ
Ｕ）３は現在の状態で待ち続ける。
サ（ＭＰＵ）３が、スレーブ通信装置２に対する通信起
動命令を実行すると、通信制御部５は、ＷＡＩＴＸ＝Ｌ
を出力し、モデム４をイネーブルにすると共に、マイク
ロプロセッサ（ＭＰＵ）３に現在の状態で待つように司
令する。ＷＡＩＴＸ＝Ｌの間、モデム４はスレーブ通信
装置２に対して通信を行い、マイクロプロセッサ（ＭＰ
Ｕ）３は現在の状態で待ち続ける。
【０００６】通信が終了すると、通信制御部５は、ＷＡ
ＩＴＸ＝Ｈを出力し、モデム４は停止し、マイクロプロ
セッサ（ＭＰＵ）３は次の命令を実行する。この制御を
行う際、従来より、マスター通信装置１とスレーブ通信
装置２間の故障検出するためにバスタイマー６を広く用
いている。
ＩＴＸ＝Ｈを出力し、モデム４は停止し、マイクロプロ
セッサ（ＭＰＵ）３は次の命令を実行する。この制御を
行う際、従来より、マスター通信装置１とスレーブ通信
装置２間の故障検出するためにバスタイマー６を広く用
いている。
【０００７】バスタイマー６は、通信の開始から終了ま
での時間を計時し、ある規定時間以上に達した（タイム
アウトした）場合、通信制御部５とマイクロプロセッサ
（ＭＰＵ）３とに通知し、通信制御部５が、通信を強制
終了するものである。従って、スレーブ通信装置２の内
の１台が故障した場合、マスター通信装置１も動作する
ことができなくなるのを防ぐことができる。
での時間を計時し、ある規定時間以上に達した（タイム
アウトした）場合、通信制御部５とマイクロプロセッサ
（ＭＰＵ）３とに通知し、通信制御部５が、通信を強制
終了するものである。従って、スレーブ通信装置２の内
の１台が故障した場合、マスター通信装置１も動作する
ことができなくなるのを防ぐことができる。
【０００８】
【発明が解決しようとする課題】この様な装置において
は、マスター通信装置１がスレーブ通信装置２に対し
て、ある規定回数連続して通信を行う際、スレーブ通信
装置２の内の１台が故障し、通信不能になった場合に、
マスター通信装置１内のバスタイマー６がタイムアウト
し、該当通信は強制終了される。
は、マスター通信装置１がスレーブ通信装置２に対し
て、ある規定回数連続して通信を行う際、スレーブ通信
装置２の内の１台が故障し、通信不能になった場合に、
マスター通信装置１内のバスタイマー６がタイムアウト
し、該当通信は強制終了される。
【０００９】しかしながら、この様な装置においては、
特別な手段を持たない場合、その後も故障したスレーブ
通信装置２に対し繰り返し通信を起動し、タイムアウト
を待つことになる。このタイムアウトの時間は、通常状
態での通信に要する時間に比べて長く設定されているた
め、非常に時間が掛かり、規定時間内に全てのスレーブ
通信装置２に対する通信を行う事が出来なくなる場合が
あった。また、故障したスレーブ通信装置２に対して何
度も通信を起動し、誤データを取得する可能性もあっ
た。
特別な手段を持たない場合、その後も故障したスレーブ
通信装置２に対し繰り返し通信を起動し、タイムアウト
を待つことになる。このタイムアウトの時間は、通常状
態での通信に要する時間に比べて長く設定されているた
め、非常に時間が掛かり、規定時間内に全てのスレーブ
通信装置２に対する通信を行う事が出来なくなる場合が
あった。また、故障したスレーブ通信装置２に対して何
度も通信を起動し、誤データを取得する可能性もあっ
た。
【００１０】これを避けるために、マイクロプロセッサ
（ＭＰＵ）３は、通信の都度、毎回バスタイマ６のタイ
ムアウトをチェックし、タイムアウトが発生していた場
合は、次の通信を起動しないようにファームウェアで制
御する必要があった。
（ＭＰＵ）３は、通信の都度、毎回バスタイマ６のタイ
ムアウトをチェックし、タイムアウトが発生していた場
合は、次の通信を起動しないようにファームウェアで制
御する必要があった。
【００１１】例えば、図２のフローチャートのように、
通信を制御する必要があった。図２において、マイクロ
プロセッサ（ＭＰＵ）３が通信起動命令を実行すると、
通信制御部５はＷＡＩＴＸ＝Ｌを出力し、モデム４は通
信を開始すると共に、マイクロプロセッサ（ＭＰＵ）３
は、ＷＡＩＴＸ＝Ｈになるまで待ち続ける。
通信を制御する必要があった。図２において、マイクロ
プロセッサ（ＭＰＵ）３が通信起動命令を実行すると、
通信制御部５はＷＡＩＴＸ＝Ｌを出力し、モデム４は通
信を開始すると共に、マイクロプロセッサ（ＭＰＵ）３
は、ＷＡＩＴＸ＝Ｈになるまで待ち続ける。
【００１２】通信が正常に終了した場合は、通信制御部
５はＷＡＩＴＸ＝Ｈを出力する。例えば、スレーブ通信
装置２が故障し、通信が不能になった場合は、バスタイ
マー６のタイムアウトが、通信制御部５とマイクロプロ
セッサ（ＭＰＵ）３に通知され、通信制御部５はＷＡＩ
ＴＸ＝Ｈを出力する。
５はＷＡＩＴＸ＝Ｈを出力する。例えば、スレーブ通信
装置２が故障し、通信が不能になった場合は、バスタイ
マー６のタイムアウトが、通信制御部５とマイクロプロ
セッサ（ＭＰＵ）３に通知され、通信制御部５はＷＡＩ
ＴＸ＝Ｈを出力する。
【００１３】次に、モデム４は停止すると共に、マイク
ロプロセッサ（ＭＰＵ）３はバスタイマー６のタイムア
ウトをチェックし、タイムアウトしていた場合は通信異
常終了としてその後、異常処理を行う。
ロプロセッサ（ＭＰＵ）３はバスタイマー６のタイムア
ウトをチェックし、タイムアウトしていた場合は通信異
常終了としてその後、異常処理を行う。
【００１４】タイムアウトしていない場合は、スレーブ
通信装置２への通信が規定回数行われるまで、繰り返し
通信を実行する。このような、ファームウェアでの制御
では、通信の都度、バスタイマ６のタイムアウトをチェ
ックしなければならないため、通信速度の低下を招いて
いた。
通信装置２への通信が規定回数行われるまで、繰り返し
通信を実行する。このような、ファームウェアでの制御
では、通信の都度、バスタイマ６のタイムアウトをチェ
ックしなければならないため、通信速度の低下を招いて
いた。
【００１５】本発明は、この問題点を、解決するもので
ある。本発明の目的は、信頼性および通信速度の向上を
図り得るマスター／スレーブ通信システムを提供するに
ある。
ある。本発明の目的は、信頼性および通信速度の向上を
図り得るマスター／スレーブ通信システムを提供するに
ある。
【００１６】
【課題を解決するための手段】この目的を達成するため
に、本発明は、マイクロプロセッサの司令により動作す
るモデムと、マイクロプロセッサとモデムとの動作を制
御する通信制御部と、通信開始から終了までの時間を計
時しタイムアウトした場合に該通信を強制終了するバス
タイマーとを有するマスター通信装置と、複数のスレー
ブ通信装置とを具備するマスター／スレーブ通信システ
ムにおいて、前記バスタイマーからのタイムアウト信号
をラッチ記憶し通信開始時の前記通信制御部に通知する
と共に通信が開始された後にバスタイマーがタイムアウ
トした場合にはラッチ記憶して前記通信制御部と前記マ
イクロプロセッサとにタイムアウト信号を通知する故障
情報記憶部を有するマスター通信装置を具備したことを
特徴とするマスター／スレーブ通信システムを構成した
ものである。
に、本発明は、マイクロプロセッサの司令により動作す
るモデムと、マイクロプロセッサとモデムとの動作を制
御する通信制御部と、通信開始から終了までの時間を計
時しタイムアウトした場合に該通信を強制終了するバス
タイマーとを有するマスター通信装置と、複数のスレー
ブ通信装置とを具備するマスター／スレーブ通信システ
ムにおいて、前記バスタイマーからのタイムアウト信号
をラッチ記憶し通信開始時の前記通信制御部に通知する
と共に通信が開始された後にバスタイマーがタイムアウ
トした場合にはラッチ記憶して前記通信制御部と前記マ
イクロプロセッサとにタイムアウト信号を通知する故障
情報記憶部を有するマスター通信装置を具備したことを
特徴とするマスター／スレーブ通信システムを構成した
ものである。
【００１７】
【作用】以上の構成において、マイクロプロセッサ（Ｍ
ＰＵ）が通信起動命令を実行すると、通信制御部は、故
障情報記憶部の出力を受け、以前にタイムアウトがなか
った場合は、通信を開始するように、ＷＡＩＴＸ＝Ｌを
出力し、モデムは通信を開始すると共に、マイクロプロ
セッサ（ＭＰＵ）は、ＷＡＩＴＸ＝Ｈになるまで待ち続
ける。例えば、スレーブ通信装置が故障し、タイムアウ
トがあった場合は、通信制御部は、通信を開始せず、Ｗ
ＡＩＴＸ＝Ｈを保つ。
ＰＵ）が通信起動命令を実行すると、通信制御部は、故
障情報記憶部の出力を受け、以前にタイムアウトがなか
った場合は、通信を開始するように、ＷＡＩＴＸ＝Ｌを
出力し、モデムは通信を開始すると共に、マイクロプロ
セッサ（ＭＰＵ）は、ＷＡＩＴＸ＝Ｈになるまで待ち続
ける。例えば、スレーブ通信装置が故障し、タイムアウ
トがあった場合は、通信制御部は、通信を開始せず、Ｗ
ＡＩＴＸ＝Ｈを保つ。
【００１８】次に、正常に通信が終了した場合、通信制
御部は、ＷＡＩＴＸ＝Ｈを出力し、モデムは停止すると
共に、マイクロプロセッサ（ＭＰＵ）は次の命令を実行
できるようになる。
御部は、ＷＡＩＴＸ＝Ｈを出力し、モデムは停止すると
共に、マイクロプロセッサ（ＭＰＵ）は次の命令を実行
できるようになる。
【００１９】通信が開始されてからバスタイマーがタイ
ムアウトした場合、故障情報記憶部がタイムアウトをラ
ッチ記憶し、通信制御部およびマイクロプロセッサ（Ｍ
ＰＵ）に対して、通知する。通信制御部は、ＷＡＩＴＸ
＝Ｈを出力し、通信を強制終了する。
ムアウトした場合、故障情報記憶部がタイムアウトをラ
ッチ記憶し、通信制御部およびマイクロプロセッサ（Ｍ
ＰＵ）に対して、通知する。通信制御部は、ＷＡＩＴＸ
＝Ｈを出力し、通信を強制終了する。
【００２０】以上の動作を、スレーブ通信装置への通信
が規定回数になるまで繰り返す。このように、マイクロ
プロセッサ（ＭＰＵ）は、次の通信起動命令を実行する
が、故障情報記憶部にラッチ記憶がある限り、通信制御
部はスレーブ通信装置に対する通信を開始せず、マイク
ロプロセッサ（ＭＰＵ）の余計な待ち時間は発生しな
い。以下、実施例に基づき詳細に説明する。
が規定回数になるまで繰り返す。このように、マイクロ
プロセッサ（ＭＰＵ）は、次の通信起動命令を実行する
が、故障情報記憶部にラッチ記憶がある限り、通信制御
部はスレーブ通信装置に対する通信を開始せず、マイク
ロプロセッサ（ＭＰＵ）の余計な待ち時間は発生しな
い。以下、実施例に基づき詳細に説明する。
【００２１】
【発明の実施の形態】図１は、本発明の一実施例の要部
構成説明図、図２は図１の具体的要部詳細図、図３は図
１の動作説明図である。図において、図４と同一記号の
構成は同一機能を表わす。以下、図４と相違部分のみ説
明する。
構成説明図、図２は図１の具体的要部詳細図、図３は図
１の動作説明図である。図において、図４と同一記号の
構成は同一機能を表わす。以下、図４と相違部分のみ説
明する。
【００２２】図において、１１は、マスター通信装置１
内に設けられ、バスタイマー６からのタイムアウト信号
をラッチ記憶し、通信開始時の通信制御部５に通知する
と共に、通信が開始された後にバスタイマー６がタイム
アウトした場合には、ラッチ記憶して、通信制御部５と
マイクロプロセッサ（ＭＰＵ）とにタイムアウト信号を
通知する故障情報記憶部である。
内に設けられ、バスタイマー６からのタイムアウト信号
をラッチ記憶し、通信開始時の通信制御部５に通知する
と共に、通信が開始された後にバスタイマー６がタイム
アウトした場合には、ラッチ記憶して、通信制御部５と
マイクロプロセッサ（ＭＰＵ）とにタイムアウト信号を
通知する故障情報記憶部である。
【００２３】以上の構成において、マイクロプロセッサ
（ＭＰＵ）３が通信起動命令を実行すると、通信制御部
５は、故障情報記憶部１１の出力を受け、以前にタイム
アウトがなかった場合は、通信を開始するように、ＷＡ
ＩＴＸ＝Ｌを出力し、モデム４は通信を開始すると共
に、マイクロプロセッサ（ＭＰＵ）３は、ＷＡＩＴＸ＝
Ｈになるまで待ち続ける。例えば、スレーブ通信装置２
が故障し、タイムアウトがあった場合は、通信制御部５
は、通信を開始せず、ＷＡＩＴＸ＝Ｈを保つ。
（ＭＰＵ）３が通信起動命令を実行すると、通信制御部
５は、故障情報記憶部１１の出力を受け、以前にタイム
アウトがなかった場合は、通信を開始するように、ＷＡ
ＩＴＸ＝Ｌを出力し、モデム４は通信を開始すると共
に、マイクロプロセッサ（ＭＰＵ）３は、ＷＡＩＴＸ＝
Ｈになるまで待ち続ける。例えば、スレーブ通信装置２
が故障し、タイムアウトがあった場合は、通信制御部５
は、通信を開始せず、ＷＡＩＴＸ＝Ｈを保つ。
【００２４】次に、正常に通信が終了した場合、通信制
御部５は、ＷＡＩＴＸ＝Ｈを出力し、モデム４は停止す
ると共に、マイクロプロセッサ（ＭＰＵ）３は次の命令
を実行できるようになる。
御部５は、ＷＡＩＴＸ＝Ｈを出力し、モデム４は停止す
ると共に、マイクロプロセッサ（ＭＰＵ）３は次の命令
を実行できるようになる。
【００２５】通信が開始されてからバスタイマー６がタ
イムアウトした場合、故障情報記憶部１１がタイムアウ
トをラッチ記憶し、通信制御部５およびマイクロプロセ
ッサ（ＭＰＵ）３に対して、通知する。通信制御部５
は、ＷＡＩＴＸ＝Ｈを出力し、通信を強制終了する。
イムアウトした場合、故障情報記憶部１１がタイムアウ
トをラッチ記憶し、通信制御部５およびマイクロプロセ
ッサ（ＭＰＵ）３に対して、通知する。通信制御部５
は、ＷＡＩＴＸ＝Ｈを出力し、通信を強制終了する。
【００２６】以上の動作を、スレーブ通信装置２への通
信が規定回数になるまで繰り返す。このように、マイク
ロプロセッサ（ＭＰＵ）は、次の通信起動命令を実行す
るが、故障情報記憶部１１にラッチ記憶がある限り、通
信制御部５はスレーブ通信装置２に対する通信を開始せ
ず、マイクロプロセッサ（ＭＰＵ）３の余計な待ち時間
は発生しない。
信が規定回数になるまで繰り返す。このように、マイク
ロプロセッサ（ＭＰＵ）は、次の通信起動命令を実行す
るが、故障情報記憶部１１にラッチ記憶がある限り、通
信制御部５はスレーブ通信装置２に対する通信を開始せ
ず、マイクロプロセッサ（ＭＰＵ）３の余計な待ち時間
は発生しない。
【００２７】なお、故障情報のチェックは、図４従来例
では通信の規定回数行う必要があったが、本発明によれ
ば、通信の最後に１回行えば良い。
では通信の規定回数行う必要があったが、本発明によれ
ば、通信の最後に１回行えば良い。
【００２８】マイクロプロセッサ（ＭＰＵ）３が、故障
情報記憶部１１に対して、ラッチ記憶のクリアを司令す
れば、タイムアウトのラッチ記憶はクリアされる。
情報記憶部１１に対して、ラッチ記憶のクリアを司令す
れば、タイムアウトのラッチ記憶はクリアされる。
【００２９】要するに、本発明は、マスタ通信装置１と
複数のスレーブ通信装置２からなる通信装置において、
マスタ通信装置１とスレーブ通信装置２間の故障時の動
作を考慮し、バスタイマー６のタイムアウトの故障情報
記憶部１１を設け、この故障記憶情報により、スレーブ
通信装置２に対する通信制御をハードウェアにより行う
ようにしたものである。
複数のスレーブ通信装置２からなる通信装置において、
マスタ通信装置１とスレーブ通信装置２間の故障時の動
作を考慮し、バスタイマー６のタイムアウトの故障情報
記憶部１１を設け、この故障記憶情報により、スレーブ
通信装置２に対する通信制御をハードウェアにより行う
ようにしたものである。
【００３０】この結果、 （１）スレーブ通信装置２の故障発生時に、一度バスタ
イマ６のタイムアウトにより故障を検出すれば、故障し
たスレーブ通信装置２に対し、通信を繰り返し実行し
て、タイムアウトを待つことがないので、パフォーマン
スを低下させることがないマスター／スレーブ通信シス
テムが得られる。
イマ６のタイムアウトにより故障を検出すれば、故障し
たスレーブ通信装置２に対し、通信を繰り返し実行し
て、タイムアウトを待つことがないので、パフォーマン
スを低下させることがないマスター／スレーブ通信シス
テムが得られる。
【００３１】（２）また、故障したスレーブ通信装置２
に対して、何度も通信を起動し、誤データを取得する危
険性が減り、信頼性が向上されたマスター／スレーブ通
信システムが得られる。
に対して、何度も通信を起動し、誤データを取得する危
険性が減り、信頼性が向上されたマスター／スレーブ通
信システムが得られる。
【００３２】（３）このような通信制御は、従来マイク
ロプロセッサ（ＭＰＵ）３のファームによって実現可能
であったが、本発明は、マイクロプロセッサ（ＭＰＵ）
３のファームに頼らずに行うことを可能にしたものであ
り、通信速度の高速化を図ることを可能にし得るマスタ
ー／スレーブ通信システムが得られる。
ロプロセッサ（ＭＰＵ）３のファームによって実現可能
であったが、本発明は、マイクロプロセッサ（ＭＰＵ）
３のファームに頼らずに行うことを可能にしたものであ
り、通信速度の高速化を図ることを可能にし得るマスタ
ー／スレーブ通信システムが得られる。
【００３３】（４）故障情報のチェックは、従来例では
通信の規定回数行う必要があったが、本発明によれば、
通信の最後に１回行えば良い利点を有する。
通信の規定回数行う必要があったが、本発明によれば、
通信の最後に１回行えば良い利点を有する。
【００３４】
【発明の効果】以上詳細に説明したように、本発明によ
れば、 （１）スレーブ通信装置の故障発生時に、一度バスタイ
マのタイムアウトにより故障を検出すれば、故障したス
レーブ通信装置に対し、通信を繰り返し実行して、タイ
ムアウトを待つことがないので、パフォーマンスを低下
させることがないマスター／スレーブ通信システムが得
られる。
れば、 （１）スレーブ通信装置の故障発生時に、一度バスタイ
マのタイムアウトにより故障を検出すれば、故障したス
レーブ通信装置に対し、通信を繰り返し実行して、タイ
ムアウトを待つことがないので、パフォーマンスを低下
させることがないマスター／スレーブ通信システムが得
られる。
【００３５】（２）また、故障したスレーブ通信装置に
対して、何度も通信を起動し、誤データを取得する危険
性が減り、信頼性が向上されたマスター／スレーブ通信
システムが得られる。
対して、何度も通信を起動し、誤データを取得する危険
性が減り、信頼性が向上されたマスター／スレーブ通信
システムが得られる。
【００３６】（３）このような通信制御は、従来マイク
ロプロセッサ（ＭＰＵ）のファームによって実現可能で
あったが、本発明は、マイクロプロセッサ（ＭＰＵ）の
ファームに頼らずに行うことを可能にしたものであり、
通信速度の高速化を図ることを可能にし得るマスター／
スレーブ通信システムが得られる。
ロプロセッサ（ＭＰＵ）のファームによって実現可能で
あったが、本発明は、マイクロプロセッサ（ＭＰＵ）の
ファームに頼らずに行うことを可能にしたものであり、
通信速度の高速化を図ることを可能にし得るマスター／
スレーブ通信システムが得られる。
【００３７】（４）故障情報のチェックは、従来例では
通信の規定回数行う必要があったが、本発明によれば、
通信の最後に１回行えば良い利点を有する。
通信の規定回数行う必要があったが、本発明によれば、
通信の最後に１回行えば良い利点を有する。
【００３８】従って、本発明によれば、信頼性および通
信速度が改善されたマスター／スレーブ通信システムを
実現することが出来る。
信速度が改善されたマスター／スレーブ通信システムを
実現することが出来る。
【図１】本発明の一実施例の要部構成説明図である。
【図２】図１の要部詳細説明図である。
【図３】図１の動作のフローチャート説明図である。
【図４】従来より一般に使用されている従来例の構成説
明図である。
明図である。
【図５】図４の動作のフローチャート説明図である。
１ マスター通信装置 ２ スレーブ通信装置 ３ マイクロプロセッサ（ＭＰＵ） ４ モデム ５ 通信制御部 ６ バスタイマー １１ 故障情報記憶部
Claims (1)
- 【請求項１】マイクロプロセッサの司令により動作する
モデムと、マイクロプロセッサとモデムとの動作を制御
する通信制御部と、通信開始から終了までの時間を計時
しタイムアウトした場合に該通信を強制終了するバスタ
イマーとを有するマスター通信装置と、複数のスレーブ
通信装置とを具備するマスター／スレーブ通信システム
において、 前記バスタイマーからのタイムアウト信号をラッチ記憶
し通信開始時の前記通信制御部に通知すると共に通信が
開始された後にバスタイマーがタイムアウトした場合に
はラッチ記憶して前記通信制御部と前記マイクロプロセ
ッサとにタイムアウト信号を通知する故障情報記憶部を
有するマスター通信装置を具備したことを特徴とするマ
スター／スレーブ通信システム。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9001949A JPH10200602A (ja) | 1997-01-09 | 1997-01-09 | マスター／スレーブ通信システム |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9001949A JPH10200602A (ja) | 1997-01-09 | 1997-01-09 | マスター／スレーブ通信システム |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPH10200602A true JPH10200602A (ja) | 1998-07-31 |
Family
ID=11515868
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9001949A Pending JPH10200602A (ja) | 1997-01-09 | 1997-01-09 | マスター／スレーブ通信システム |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH10200602A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009071750A (ja) * | 2007-09-18 | 2009-04-02 | Kowa Co | シリアルデータ通信システム、及びシリアルデータ通信方法 |
| US8972638B2 (en) | 2007-09-18 | 2015-03-03 | Kowa Company, Ltd. | Serial data communication system and serial data communication method |
-
1997
- 1997-01-09 JP JP9001949A patent/JPH10200602A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2009071750A (ja) * | 2007-09-18 | 2009-04-02 | Kowa Co | シリアルデータ通信システム、及びシリアルデータ通信方法 |
| US8972638B2 (en) | 2007-09-18 | 2015-03-03 | Kowa Company, Ltd. | Serial data communication system and serial data communication method |
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