JPH11284199A5 - - Google Patents
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- JPH11284199A5 JPH11284199A5 JP1998100643A JP10064398A JPH11284199A5 JP H11284199 A5 JPH11284199 A5 JP H11284199A5 JP 1998100643 A JP1998100643 A JP 1998100643A JP 10064398 A JP10064398 A JP 10064398A JP H11284199 A5 JPH11284199 A5 JP H11284199A5
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前記TFTのチャネル形成領域は主たる配向面が[111]面であるポリシリコン膜からなり、
前記ポリシリコン膜中には1×1014〜1×1020atoms/cm3の濃度でゲルマニウムが存在し、当該ポリシリコン膜中のスピン密度が5×1017spins/cm3以下であることを特徴とする半導体装置。A semiconductor device having a TFT formed on a highly heat-resistant substrate,
a channel forming region of the TFT is made of a polysilicon film whose main orientation plane is the [111] plane;
A semiconductor device characterized in that germanium is present in the polysilicon film at a concentration of 1×10 14 to 1×10 20 atoms/cm 3 , and the spin density in the polysilicon film is 5×10 17 spins/cm 3 or less.
前記ゲイト電極上にゲイト絶縁膜を形成し、
前記ゲイト絶縁膜上にアモルファスシリコン膜を形成し、
前記アモルファスシリコン膜上にゲルマニウム膜を形成し、
前記アモルファスシリコン膜に対して600℃を超えない第1の加熱処理を施してポリシリコン膜に変化させ、
前記ポリシリコン膜に対して700℃を超える第2の加熱処理を施すことを特徴とする半導体装置の作製方法。 A gate electrode is formed on a highly heat-resistant substrate,
forming a gate insulating film on the gate electrode;
forming an amorphous silicon film on the gate insulating film ;
forming a germanium film on the amorphous silicon film ;
a first heat treatment at a temperature not exceeding 600° C. to convert the amorphous silicon film into a polysilicon film ;
a second heat treatment at a temperature exceeding 700° C. on the polysilicon film ;
前記ゲイト電極上にゲイト絶縁膜を形成し、forming a gate insulating film on the gate electrode;
前記ゲイト絶縁膜上にアモルファスシリコン膜を形成し、forming an amorphous silicon film on the gate insulating film;
前記アモルファスシリコン膜上に、スピンコート法によりゲルマニウムを含む溶液を塗布し、a solution containing germanium is applied onto the amorphous silicon film by spin coating;
前記アモルファスシリコン膜に対して600℃を超えない第1の加熱処理を施してポリシリコン膜に変化させ、a first heat treatment at a temperature not exceeding 600° C. to convert the amorphous silicon film into a polysilicon film;
前記ポリシリコン膜に対して700℃を超える第2の加熱処理を施すことを特徴とする半導体装置の作製方法。a second heat treatment at a temperature exceeding 700° C. on the polysilicon film;
前記ゲイト電極上にゲイト絶縁膜を形成し、forming a gate insulating film on the gate electrode;
前記ゲイト絶縁膜上にアモルファスシリコン膜を形成し、forming an amorphous silicon film on the gate insulating film;
前記アモルファスシリコン膜に対して、イオンプランテーション法、プラズマドーピング法、またはレーザードーピング法によりゲルマニウムを添加し、adding germanium to the amorphous silicon film by ion implantation, plasma doping, or laser doping;
前記アモルファスシリコン膜に対して600℃を超えない第1の加熱処理を施してポリシリコン膜に変化させ、a first heat treatment at a temperature not exceeding 600° C. to convert the amorphous silicon film into a polysilicon film;
前記ポリシリコン膜に対して700℃を超える第2の加熱処理を施すことを特徴とする半導体装置の作製方法。a second heat treatment at a temperature exceeding 700° C. on the polysilicon film;
前記ゲイト電極上にゲイト絶縁膜を形成し、forming a gate insulating film on the gate electrode;
前記ゲイト絶縁膜上に、ゲルマンを混合したガスを用いてアモルファスシリコン膜を形成し、forming an amorphous silicon film on the gate insulating film using a gas containing germane;
前記アモルファスシリコン膜に対して600℃を超えない第1の加熱処理を施してポリシリコン膜に変化させ、a first heat treatment at a temperature not exceeding 600° C. to convert the amorphous silicon film into a polysilicon film;
前記ポリシリコン膜に対して700℃を超える第2の加熱処理を施すことを特徴とする半導体装置の作製方法。a second heat treatment at a temperature exceeding 700° C. on the polysilicon film;
前記下地膜上にゲイト電極を形成し、forming a gate electrode on the base film;
前記ゲイト電極上にゲイト絶縁膜を形成し、forming a gate insulating film on the gate electrode;
前記ゲイト絶縁膜上にアモルファスシリコン膜を形成し、forming an amorphous silicon film on the gate insulating film;
前記アモルファスシリコン膜上にゲルマニウム膜を形成し、forming a germanium film on the amorphous silicon film;
前記アモルファスシリコン膜に対して600℃を超えない第1の加熱処理を施してポリシリコン膜に変化させ、a first heat treatment at a temperature not exceeding 600° C. to convert the amorphous silicon film into a polysilicon film;
前記ゲルマニウム膜を除去し、removing the germanium film;
前記ポリシリコン膜に対して700℃を超える第2の加熱処理を施し、subjecting the polysilicon film to a second heat treatment at a temperature exceeding 700° C.;
前記ポリシリコン膜上にパターニングされた絶縁層を形成し、forming a patterned insulating layer on the polysilicon film;
前記ポリシリコン膜をパターニングして活性層を形成し、patterning the polysilicon film to form an active layer;
前記活性層及び前記パターニングされた絶縁層を覆う層間絶縁膜を形成し、forming an interlayer insulating film covering the active layer and the patterned insulating layer;
前記層間絶縁膜上に、コンタクトホールを介して前記活性層と接続するソース配線及びドレイン配線を形成することを特徴とする半導体装置の作製方法。a source wiring and a drain wiring connected to the active layer through contact holes are formed on the interlayer insulating film;
前記下地膜上にゲイト電極を形成し、forming a gate electrode on the base film;
前記ゲイト電極上にゲイト絶縁膜を形成し、forming a gate insulating film on the gate electrode;
前記ゲイト絶縁膜上に第1のアモルファスシリコン膜を形成し、forming a first amorphous silicon film on the gate insulating film;
前記第1のアモルファスシリコン膜上にゲルマニウム膜を形成し、forming a germanium film on the first amorphous silicon film;
前記第1のアモルファスシリコン膜に対して600℃を超えない第1の加熱処理を施してポリシリコン膜に変化させ、a first heat treatment at a temperature not exceeding 600° C. to convert the first amorphous silicon film into a polysilicon film;
前記ゲルマニウム膜を除去し、removing the germanium film;
前記ポリシリコン膜に対して700℃を超える第2の加熱処理を施し、subjecting the polysilicon film to a second heat treatment at a temperature exceeding 700° C.;
前記ポリシリコン膜をパターニングして活性層を形成し、patterning the polysilicon film to form an active layer;
前記活性層上にパターニングされた絶縁層を形成し、forming a patterned insulating layer on the active layer;
前記活性層及び前記パターニングされた絶縁層上に第2のアモルファスシリコン膜を形成し、forming a second amorphous silicon film on the active layer and the patterned insulating layer;
前記第2のアモルファスシリコン膜上に微結晶シリコン膜を形成し、forming a microcrystalline silicon film on the second amorphous silicon film;
前記微結晶シリコン膜上に導電膜を形成し、当該導電膜をパターニングしてソース配線及びドレイン配線を形成し、forming a conductive film on the microcrystalline silicon film, and patterning the conductive film to form source wiring and drain wiring;
前記ソース配線及び前記ドレイン配線をマスクとして、前記第2のアモルファスシリコン膜及び前記微結晶シリコン膜をエッチングすることを特徴とする半導体装置の作製方法。a step of etching the second amorphous silicon film and the microcrystalline silicon film using the source wiring and the drain wiring as a mask;
Priority Applications (2)
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|---|---|---|---|
| JP10064398A JP4115585B2 (en) | 1998-03-27 | 1998-03-27 | Method for manufacturing semiconductor device |
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Applications Claiming Priority (1)
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|---|---|---|---|
| JP10064398A JP4115585B2 (en) | 1998-03-27 | 1998-03-27 | Method for manufacturing semiconductor device |
Publications (3)
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- 1998-03-27 JP JP10064398A patent/JP4115585B2/en not_active Expired - Fee Related
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