JPH11289089A5 - - Google Patents
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- JPH11289089A5 JPH11289089A5 JP1999029969A JP2996999A JPH11289089A5 JP H11289089 A5 JPH11289089 A5 JP H11289089A5 JP 1999029969 A JP1999029969 A JP 1999029969A JP 2996999 A JP2996999 A JP 2996999A JP H11289089 A5 JPH11289089 A5 JP H11289089A5
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- 第1導電型の半導体基板上にゲート絶縁膜を介して形成されたゲート電極と、金属電極からなり前記半導体基板との界面にショットキーバリアを形成するソース・ドレインとを具備してなる電界効果トランジスタを含む半導体装置であって、
少なくともソース側の前記金属電極の下部に、前記ゲート電極側の該金属電極の端から離れて第2導電型の不純物拡散層が形成されていることを特徴とする半導体装置。 - 凸部を有する第1導電型の半導体基板と、前記半導体基板の凸部の頭頂部にゲート絶縁膜を介して形成されたゲート電極と、前記凸部の底部に形成された第2導電型の不純物層と、金属電極からなり前記半導体基板との界面にショットキーバリアを形成するソース・ドレインとを具備してなる電界効果トランジスタを含む半導体装置であって、
少なくともソース側の前記金属電極の下部に、前記ゲート電極側の該金属電極の端から離れて第2導電型の不純物拡散層が形成されていることを特徴とする半導体装置。 - 前記ゲート電極側の前記金属電極の端と前記不純物拡散層との間の距離は、前記半導体基板と該不純物拡散層との接合部に形成される空乏層の広がり以下であることを特徴とする請求項1又は2に記載の半導体装置。
- 前記半導体基板はSOI基板であり、前記電界効果トランジスタが形成された領域の該SOI基板の半導体層と電気的に接続する半導体層上に電極が形成されていることを特徴とする請求項1又は2に記載の半導体装置。
- 第1導電型の半導体基板上にゲート絶縁膜を介して形成されたゲート電極と、金属電極からなり前記半導体基板との界面にショットキーバリアを形成するソース・ドレインとを具備してなる電界効果トランジスタを含む半導体装置であって、
ドレイン側の前記金属電極の下部に、前記ゲート電極側の該ドレイン側の金属電極の端から離れて第2導電型の不純物拡散層が形成され、ソース側の前記金属電極を内包するように第2導電型の不純物拡散層が形成されていることを特徴とする半導体装置。 - 半導体基板上にゲート絶縁膜を介して形成されたゲート電極と、金属電極からなり前記半導体基板との界面にショットキーバリアを形成するソース・ドレインとを具備してなる電界効果トランジスタを含む半導体装置であって、
ソース側及びドレイン側の少なくとも一方の金属電極と前記半導体基板との界面に、正孔又は電子に対して、前記半導体基板と金属電極とのショットキーバリアより低いバリアを形成する変調領域が設けられていることを特徴とする半導体装置。 - 前記半導体基板がシリコン基板で構成され、前記変調領域がSiGeで構成されていることを特徴とする請求項6に記載の半導体装置。
- 第1導電型の半導体基板上にゲート絶縁膜を介して形成されたゲート電極と、金属電極からなり前記半導体基板との界面にショットキーバリアを形成するソース・ドレインとを具備してなる電界効果トランジスタを含む半導体装置の製造方法であって、
第1導電型の半導体基板にゲート絶縁膜及びゲート電極を形成する工程と、
前記ゲート絶縁膜をマスクにソースとなる側から不純物を斜めイオン注入し、前記半導体基板に第2導電型の拡散層を形成する工程と、
少なくともソース及びドレインとなる領域に選択的に前記金属電極を形成する工程とを含むことを特徴とする半導体装置の製造方法。
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Family Applications (1)
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