JPH11345767A - 半導体薄膜および半導体装置 - Google Patents
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Abstract
用いた高性能な半導体装置を提供する。 【解決手段】 非晶質半導体薄膜を触媒元素を利用して
結晶化させた後、ハロゲン元素を含む雰囲気中で加熱処
理を行い、前記触媒元素を除去する。こうして得られる
結晶性半導体薄膜は概略{110}配向を示す。また、
この半導体薄膜は個々の結晶粒の配向性がほぼ等しいた
め結晶粒界が実質的に存在せず、単結晶または実質的に
単結晶と見なせる結晶性を有している。
Description
絶縁表面を有する基板上に形成された半導体薄膜および
それを活性層とする半導体装置に関する。特に、半導体
薄膜として珪素(シリコン)を主成分とする材料を利用
する場合の構成に関する。
で構成された半導体回路および電気光学装置並びにそれ
らを搭載した電子機器の構成に関する。
タ、半導体回路、電気光学装置および電子機器を全て
「半導体装置」に範疇に含めて扱う。即ち、半導体特性
を利用して機能しうる装置全てを半導体装置と呼ぶ。従
って、上記特許請求の範囲に記載された半導体装置は、
薄膜トランジスタ等の単体素子だけでなく、それを集積
化した半導体回路や電気光学装置およびそれらを部品と
して搭載した電子機器をも包含する。
れた半導体薄膜(厚さ数十〜数百nm程度)を用いて薄膜
トランジスタ(TFT)を構成する技術が注目されてい
る。薄膜トランジスタは特に画像表示装置(例えば液晶
表示装置)のスイッチング素子としての開発が急がれて
いる。
ス状に配列された画素領域を個々に制御する画素マトリ
クス回路、画素マトリクス回路を制御する駆動回路、さ
らに外部からのデータ信号を処理するロジック回路(演
算回路、メモリ回路、クロックジェネレータなど)等の
あらゆる電気回路にTFTを応用する試みがなされてい
る。
膜(アモルファスシリコン膜)を用いたTFTが実用化
されているが、駆動回路やロジック回路などの様に、さ
らなる高速動作性能を求められる電気回路には、結晶性
珪素膜(ポリシリコン膜等)を利用したTFTが必要と
される。
成する方法としては、本出願人による特開平7-130652号
公報、特開平8-78329 号公報に記載された技術が公知で
ある。これらの公報記載の技術は、非晶質珪素膜の結晶
化を助長する触媒元素を利用することにより、500 〜60
0 ℃、4時間程度の加熱処理によって結晶性の優れた結
晶性珪素膜を形成することを可能とするものである。
上記技術を応用して基板面とほぼ平行な結晶成長を行わ
すものであり、発明者らは形成された結晶化領域を特に
横成長領域(またはラテラル成長領域)と呼んでいる。
を構成してもまだまだ要求される性能を完全に満たすに
は及ばない。特に、メガヘルツからギガヘルツにかけて
の極めて高速な動作を要求する高速ロジック回路を従来
のTFTで構成することは不可能なのが現状である。
で結晶粒界を有する結晶性珪素膜(ポリシリコン膜と呼
ばれる)の結晶性を向上させるために様々な思考錯誤を
繰り返してきた。セミアモルファス半導体(特開昭57-1
60121 号公報等)やモノドメイン半導体(特開平8-1390
19号公報等)などが挙げられる。
念は、結晶粒界の実質的な無害化にある。即ち、結晶粒
界を実質的になくし、キャリア(電子または正孔)の移
動を円滑に行わせることが最大の課題であった。
体膜をもってしてもロジック回路が要求する高速動作を
行うには不十分と言える。即ち、ロジック回路を内蔵し
たシステム・オン・パネルを実現するためには、従来に
ない全く新しい材料の開発が求められているのである。
あり、従来のTFTでは作製不可能であった様な高速ロ
ジック回路を構成しうる極めて高性能な半導体装置を実
現するための半導体薄膜を提供することを課題とする。
また、その様な半導体薄膜を利用した半導体装置を提供
することを課題とする。
の構成は、珪素を主成分とする複数の棒状または偏平棒
状結晶の集合体からなる半導体薄膜であって、主たる配
向面は概略{110}面であり、膜中に存在するC(炭
素)及びN(窒素)の濃度が 5×1017atoms/cm3 以下、
O(酸素)の濃度が 1×1018atoms/cm3 以下であり、前
記複数の棒状または偏平棒状結晶は互いに回転角をもっ
て接しており、且つ、当該回転角の絶対値が3°以内で
あることを特徴とする。
の電子線回折パターンには{110}配向による特定の
規則性が観測され、当該電子線回折パターンの任意の回
折スポットは概略円状であり、前記回折スポットの短軸
の長さ(a)と長軸の長さ(b)との比(a/b)が1
/1(円形)〜1/1.5 であることを特徴とする。
の電子線回折パターンには{110}配向による特定の
規則性が観測され、当該電子線回折パターンの任意の回
折スポットは、電子線照射エリアの中心点に対して同心
円状の広がりを有し、前記電子線照射エリアの中心点か
ら前記回折スポットに対して引いた接線と、前記電子線
照射エリアの中心点と前記回折スポットの中心点とを結
ぶ線分と、がなす角は±1.5 °以内であることを特徴と
する。
以下に示す実施例をもって詳細な説明を行うこととす
る。
半導体薄膜およびそれを活性層とした半導体装置(具体
的にはTFT)の作製工程について説明する。
ン基板501を準備する。シリコン基板501は水素熱
処理を施して脱酸素化した基板を用いる。そして、シリ
コン基板501に対してハロゲン化物ガス(本実施例で
はHCl)を含有する雰囲気での熱酸化処理を行い、熱
酸化膜502を形成する。
極めて平坦性に優れているという特徴を有する。本実施
例では熱酸化条件を最適化することで、凹部と凸部との
差の平均値が5nm以下(代表的には3nm以下、好ましく
は2nm以下)、或いは100個の凹凸を調べれば、10
0個全ての凹凸の差が10nm以下で、且つ、その内の90
個の凹凸の差が5nm以下である様な熱酸化膜を得られ
る。
な絶縁表面を有する基板が得られる。この優れた平坦性
が本願発明の半導体薄膜を形成するにあたって重要な役
割を果たす。
晶質珪素膜503は最終的な膜厚(熱酸化後の膜減りを
考慮した膜厚)が10〜75nm(好ましくは15〜45nm)とな
る様に調節する。本実施例では成膜を減圧熱CVD法で
行い、下記条件に従って形成する。 成膜温度:465 ℃ 成膜圧力:0.5torr 成膜ガス:He(ヘリウム)300sccm Si2 H6 (ジシラン)250sccm
理を徹底的に行うことが重要である。本実施例の場合、
非晶質珪素膜503中では結晶化を阻害する不純物であ
るC(炭素)及びN(窒素)の濃度はいずれも 5×1018
atoms/cm3 未満(代表的には5×1017atoms/cm3 以下、
好ましくは 2×1017atoms/cm3 以下)、O(酸素)は1.
5×1019atoms/cm3 未満(代表的には 1×1018atoms/cm3
以下、好ましくは 5×1017atoms/cm3 以下)となる様
に管理する。なぜならば各不純物がこれ以上の濃度で存
在すると、後の結晶化の際に悪影響を及ぼし、結晶化後
の膜質を低下させる原因となるからである。
素膜中の不純物濃度をSIMS(質量二次イオン分析)
で調べた結果を図13に示す。なお、試料はシリコンウ
ェハー上に0.5 μmの膜厚の非晶質珪素膜を成膜したも
のを用いた。その結果、図13に示す様にC、N、Oい
ずれの元素も上記濃度範囲内に収まることが確認され
た。ただし、本明細書中において膜中の元素濃度は、S
IMSの測定結果における最小値で定義される。
圧熱CVD炉は定期的にドライクリーニングを行い、成
膜室の清浄化を図っておくことが望ましい。ドライクリ
ーニングは、 200〜400 ℃程度に加熱した炉内に 100〜
300sccm のClF3 (フッ化塩素)ガスを流し、熱分解
によって生成したフッ素によって成膜室のクリーニング
を行えば良い。
300 ℃とし、ClF3 (フッ化塩素)ガスの流量を300s
ccm とした場合、約2μm厚の付着物(主に珪素を主成
分する)を4時間で完全に除去することができる。
非常に重要なパラメータであり、水素含有量を低く抑え
た方が結晶性の良い膜が得られる様である。そのため、
非晶質珪素膜503の成膜は減圧熱CVD法であること
が好ましい。なお、成膜条件を最適化することでプラズ
マCVD法を用いることも可能である。
行う。結晶化の手段としては本発明者による特開平7-13
0652号公報記載の技術を用いる。同公報の実施例1およ
び実施例2のどちらの手段でも良いが、本願発明では実
施例2に記載した技術内容(特開平8-78329 号公報に詳
しい)を利用するのが好ましい。
触媒元素の添加領域を選択するマスク絶縁膜504を形
成する。そして、非晶質珪素膜503の結晶化を助長す
る触媒元素としてニッケル(Ni)を含有した溶液をス
ピンコート法により塗布し、Ni含有層505を形成す
る。(図5(B))
も、コバルト(Co)、鉄(Fe)、パラジウム(P
d)、白金(Pt)、銅(Cu)、金(Au)、ゲルマ
ニウム(Ge)、鉛(Pb)、インジウム(In)等を
用いることができる。
ート法に限らず、レジストマスクを利用したイオン注入
法またはプラズマドーピング法を用いることもできる。
この場合、添加領域の占有面積の低減、横成長領域の成
長距離の制御が容易となるので、微細化した回路を構成
する際に有効な技術となる。
450 ℃1時間程度の水素出しの後、不活性雰囲気、水素
雰囲気または酸素雰囲気中において 500〜700 ℃(代表
的には 550〜650 ℃)の温度で 4〜24時間の加熱処理を
加えて非晶質珪素膜503の結晶化を行う。本実施例で
は窒素雰囲気で570 ℃14時間の加熱処理を行う。
ッケルを添加した領域506で発生した核から優先的に
進行し、基板501の基板面に対してほぼ平行に成長し
た結晶領域507が形成される。本発明者らはこの結晶
領域507を横成長領域と呼んでいる。横成長領域は比
較的揃った状態で個々の結晶が集合しているため、全体
的な結晶性に優れるという利点がある。(図5(C))
スク絶縁膜504を除去してパターニングを行い、横成
長領域507のみでなる島状半導体層(活性層)508
を形成する。次に、珪素を含む絶縁膜でなるゲイト絶縁
膜509を形成する。ゲイト絶縁膜509の膜厚は後の
熱酸化工程による増加分も考慮して20〜250nm の範囲で
調節すれば良い。また、成膜方法は公知の気相法(プラ
ズマCVD法、スパッタ法等)を用いれば良い。
ッケル)を除去または低減するための加熱処理(触媒元
素のゲッタリングプロセス)を行う。この加熱処理は処
理雰囲気中にハロゲン元素を含ませ、ハロゲン元素によ
る金属元素のゲッタリング効果を利用するものである。
果を十分に得るためには、上記加熱処理を700 ℃を超え
る温度で行なうことが好ましい。この温度以下では処理
雰囲気中のハロゲン化合物の分解が困難となり、ゲッタ
リング効果が得られなくなる恐れがある。そのため加熱
処理温度を好ましくは800 〜1000℃(代表的には950
℃)とし、処理時間は 0.1〜 6hr、代表的には 0.5〜 1
hrとする。
して塩化水素(HCl)を0.5 〜10体積%(本実施例で
は3体積%)の濃度で含有させた雰囲気中において、95
0 ℃、30分の加熱処理を行えば良い。HCl濃度を上記
濃度以上とすると、活性層508の表面に膜厚程度の凹
凸が生じてしまうため好ましくない。
Clガス以外にもHF、NF3 、HBr、Cl2 、Cl
F3 、BCl3 、F2 、Br2 等のハロゲン元素を含む
化合物から選ばれた一種または複数種のものを用いるこ
とが出来る。
ケルが塩素の作用によりゲッタリングされ、揮発性の塩
化ニッケルとなって大気中へ離脱して除去される。そし
て、この工程により活性層508中のニッケルの濃度は
5×1017atoms/cm3 以下(代表的には 2×1017atoms/cm
3 以下)にまで低減される。なお、本発明者らの経験に
よれば、ニッケル濃度が 1×1018atoms/cm3 以下(好ま
しくは 5×1017atoms/cm3 以下)であればTFT特性に
悪影響はでない。
外の他の金属元素にも効果的である。珪素膜中に混入し
うる金属元素としては、主に成膜チャンバーの構成元素
(代表的にはアルミニウム、鉄、クロム等)が考えられ
るが、上記ゲッタリング処理を行なえば、それら金属元
素の濃度も 5×1017atoms/cm3 以下(好ましくは 2×10
17atoms/cm3 以下)にすることが可能である。
性層508中にはゲッタリング処理に使用したハロゲン
元素が 1×1015〜 1×1020atoms/cm3 の濃度で残存す
る。
ゲイト絶縁膜509の界面では熱酸化反応が進行し、熱
酸化膜の分だけゲイト絶縁膜509の膜厚は増加する。
この様にして熱酸化膜を形成すると、非常に界面準位の
少ない半導体/絶縁膜界面を得ることができる。また、
活性層端部における熱酸化膜の形成不良(エッジシニン
グ)を防ぐ効果もある。
処理を施した後に、窒素雰囲気中で950 ℃ 1時間程度の
加熱処理を行なうことで、ゲイト絶縁膜509の膜質の
向上を図ることも有効である。
グ工程は、結晶化工程とゲイト絶縁膜の成膜工程との間
に行うこともできる。
する金属膜を成膜し、パターニングによって後のゲイト
電極の原型510を形成する。本実施例では2wt% のス
カンジウムを含有したアルミニウム膜を用いる。なお、
これ以外にもタンタル膜、導電性を有する珪素膜等を用
いることもできる。(図5(E))
公報記載の技術を利用する。同公報には、陽極酸化によ
り形成した酸化膜を利用して自己整合的にソース/ドレ
イン領域と低濃度不純物領域とを形成する技術が開示さ
れている。以下にその技術について簡単に説明する。
用したレジストマスク(図示せず)を残したまま3%シ
ュウ酸水溶液中で陽極酸化処理を行い、多孔性の陽極酸
化膜511を形成する。この膜厚が後に低濃度不純物領
域の長さになるのでそれに合わせて膜厚を制御する。
た後、エチレングリコール溶液に3%の酒石酸を混合し
た電解溶液中で陽極酸化処理を行う。この処理では緻密
な無孔性の陽極酸化膜512が形成される。膜厚は70〜
120 nmで良い。
後に残ったアルミニウム膜513が実質的にゲイト電極
として機能する。(図6(A))
膜511をマスクとしてゲイト絶縁膜509をドライエ
ッチング法によりエッチングする。そして、多孔性の陽
極酸化膜511を除去する。こうして形成されるゲイト
絶縁膜514の端部は多孔性の陽極酸化膜511の膜厚
分だけ露出した状態となる。(図6(B))
加工程を行う。不純物元素としてはN型ならばP(リ
ン)またはAs(砒素)、P型ならばB(ボロン)また
はIn(インジウム)を用いれば良い。
高加速電圧で行い、n- 領域を形成する。この時、加速
電圧が80keV 程度と高いので不純物元素は露出した活性
層表面だけでなく露出したゲイト絶縁膜の端部の下にも
添加される。さらに、2回目の不純物添加を低加速電圧
で行い、n+ 領域を形成する。この時は加速電圧が10ke
V 程度と低いのでゲイト絶縁膜はマスクとして機能す
る。
+ 領域がソース領域515、ドレイン領域516とな
り、n- 領域が一対の低濃度不純物領域(LDD領域と
も呼ばれる)517となる。また、ゲイト電極直下の領
域は不純物元素が添加されず、真性または実質的に真性
なチャネル形成領域518となる。(図6(C))
ーネスアニール、レーザーアニール、ランプアニール等
の組み合わせによって不純物元素の活性化を行う。それ
と同時に添加工程で受けた活性層の損傷も修復される。
形成する。層間絶縁膜519としては酸化珪素膜、窒化
珪素膜、酸化窒化珪素膜、有機性樹脂膜、或いはそれら
の積層膜を用いることができる。
ース電極520、ドレイン電極521を形成する。最後
に、基板全体を350 ℃の水素雰囲気で1〜2時間加熱
し、素子全体の水素化を行うことで膜中(特に活性層
中)のダングリングボンド(不対結合手)を終端する。
以上の工程によって、図6(D)に示す様な構造のTF
Tを作製することができる。
薄膜に関する技術であるので、その他の構造および構成
は何ら本願発明を限定するものではない。従って、本願
発明は本実施例以外の構造および構成を有するTFTに
対しても容易に適用することが可能である。
見)本実施例の活性層(半導体薄膜)には結晶化を阻害
する元素であるC(炭素)、N(窒素)及びO(酸素)
が存在しない、或いは実質的に存在しない点に特徴があ
る。これは徹底的な不純物(汚染物)管理によってなし
うる構成である。
たってC(炭素)、N(窒素)及びO(酸素)の混入を
徹底的に避けるので、必然的に最終的な半導体膜中に存
在するC(炭素)及びN(窒素)の濃度は少なくとも 5
×1018atoms/cm3 未満(代表的には 5×1017atoms/cm3
以下、好ましくは 2×1017atoms/cm3 以下)、O(酸
素)の濃度は少なくとも 1.5×1019atoms/cm3 未満(代
表的には 1×1018atoms/cm3 以下、好ましくは 5×1017
atoms/cm3 以下)となる。
は珪素の濃度が約 5×1022atoms/cm 3 であるので、例え
ば 5×1018atoms/cm3 の不純物元素は約0.01atomic% の
濃度で存在することに相当する。
在するC(炭素)、N(窒素)及びO(酸素)の濃度を
SIMS分析における検出下限以下、さらに望ましくは
完全に存在しない状態とすることが優れた結晶性を得る
ためには必要である。
C、N、Oの濃度がいずれも上記濃度範囲を満たす非晶
質珪素膜を出発膜として用いた場合、完成したTFTの
活性層中に含まれるC、N、Oの濃度も上記濃度範囲を
満たすことが判明している。
製工程に従って形成した活性層は、微視的に見れば複数
の棒状(または偏平棒状)結晶が互いに概略平行に特定
方向への規則性をもって並んだ結晶構造を有する。この
ことはTEM(透過型電子顕微鏡法)による観察で容易
に確認することができる。
晶粒界を 800万倍に拡大したHR−TEM写真を図17
に示す。なお、本明細書中において結晶粒界とは、棒状
または偏平棒状結晶が接した境界に形成される粒界を指
すものと定義する。従って、例えば横成長領域がぶつか
りあって形成される様なマクロな意味あいでの粒界とは
区別して考える。
過型電子顕微鏡法)とは、試料に対して垂直に電子線を
照射し、透過電子や弾性散乱電子の干渉を利用して原子
・分子配列を評価する手法である。
子縞として観察することが可能である。従って、結晶粒
界を観察することで、結晶粒界における原子同士の結合
状態を推測することができる。なお、格子縞は白と黒の
縞模様となって現れるが、コントラストの相違であって
原子の位置を示すものではない。
珪素膜の代表的なTEM写真であり、異なる二つの結晶
粒が写真左上から右下にかけて見られる結晶粒界で接し
た状態が観察されている。この時、二つの結晶粒は結晶
軸に多少のずれが含まれているものの概略{110}配
向であった。
果、殆ど全てが概略{110}配向であることをX線回
折や電子線回折によって確認している。なお、多数観察
した中には(011)面や(200)面などもあるはず
だが、それら等価な面はまとめて{110}面と表すこ
とにする。
面内には{111}面、{100}面に対応する格子縞
が観察されている。なお、{111}面に対応する格子
縞とは、その格子縞に沿って結晶粒を切断した場合に断
面に{111}面が現れる様な格子縞を指している。格
子縞がどの様な面に対応するかは、簡易的に格子縞と格
子縞の間隔から確認できる。
方に差が見られるのは、結晶粒の微妙な傾きの違いによ
るものである。即ち、片方の結晶粒の結晶面に垂直に電
子線が照射される様に設定すると、他方の結晶粒は僅か
に斜めから電子線が照射される状態になるため、格子縞
の見え方が変わるのである。
目する。図17(A)において粒界を挟んで上側の結晶
粒の{111}面に対応する格子縞は、下側の結晶粒の
{111}面に対応する格子縞と約70°(正確には70.5
°)の角度をなして交わっている。
造)は、結晶粒界において異なる二つの結晶粒が極めて
整合性よく接合していることを示している。即ち、結晶
粒界において結晶格子が連続的に連なり、結晶欠陥等に
起因するトラップ準位を非常に作りにくい構成となって
いる。換言すれば、結晶粒界において結晶格子に連続性
があるとも言える。
膜のHRーTEM写真を図17(B)に示す。図17
(B)の場合、後述するが結晶面に規則性がなく、{1
10}面が主体となる配向ではなかった。ただし、ここ
では図17(A)と比較するために{111}面に対応
する格子縞が現れる様な結晶粒を観察した。
中において矢印で示す様に、結晶粒界では格子縞が途切
れた部分が多数確認できる。この様な部分では未結合手
(結晶欠陥と呼べる)が存在することになる、トラップ
準位としてキャリアの移動を阻害する可能性が高い。
も図17(B)に示した様な未結合手は存在する。これ
は本願発明の結晶性珪素膜が多結晶である以上しかたの
ないことである。しかしながら、本願発明の結晶性珪素
膜を広範囲に渡って詳細にTEM観察した結果、その様
な未結合手はごく僅かであることが判明している。
以上(典型的には95%以上)の結晶粒界に結晶格子の
連続性が見られ、図17(B)に示した様な未結合手は
殆ど見つけることができなかった。この事からも本願発
明の結晶性珪素膜は従来の高温ポリシコンとは明らかに
異なる半導体膜であると言えよう。
によって調べた結果を図1(A)に示す。また、リファ
レンスとして従来の高温ポリシリコン膜の電子線回折パ
ターンを図1(B)に示す。なお、図1(A)、(B)
において電子線の照射エリアの径はそれぞれ4.25μm、
1.35μmである。本実施例では複数箇所を測定したうち
の代表的な写真を示す。
する回折スポット(回折斑点)が比較的きれいに現れて
おり、電子線の照射エリア内では殆ど全ての結晶粒が
{110}配向していることが確認できる。
号公報に記載した手法に従ってX線回折を行い、本願発
明の半導体薄膜について配向比率を算出した。同公報で
は下記数1に示す様な算出方法で配向比率を定義してい
る。
で調べた結果、X線回折パターンには(220)面に相
当するピークが現れた。勿論、(220)は{110}
と等価であることは言うまでもない。この測定の結果、
{110}面が主たる配向面であり、配向比率は0.7 以
上(典型的には0.9 以上)であることが判明した。
リコン膜の場合、回折スポットには明瞭な規則性が見ら
れず、ほぼランダムに配向している、換言すれば{11
0}面以外の面方位の結晶粒が不規則に混在することが
判明した。
を僅かにもっているが、これは結晶軸を中心にある程度
の回転角の分布をもつためと予想される。この事につい
て以下に説明する。
一部を模式的に図2(A)に示す。図2(A)におい
て、201で示される複数の揮点は〈110〉入射に対
応する回折スポットである。複数の回折スポット201
は照射エリアの中心点202を中心にして同心円状に分
布している。
したものを図2(B)に示す。図2(B)に示す様に、
図1(A)に示す電子線回折パターンを詳細に観察する
と、照射エリアの中心点202に対して回折スポット2
01が約±1.5 °の広がり(ゆらぎ)を持っていること
が判る。
ら回折スポット201に対して引いた接線204と、電
子線照射エリアの中心点202と回折スポットの中心点
205とを結ぶ線分と、がなす角(回転角の1/2に相
当する)は1.5 °以下となることを意味している。この
時、接線は2本引けるので、回折スポット201の広が
りは結局±1.5 °以内の範囲に収まることになる。
パターンの全域で見受けられ、全体としては±2.5 °以
内(典型的には±1.5 °以内、好ましくは±0.5 °以
内)に収まっている。前述の「各回折スポットは同心円
上の広がりを僅かにもっている」という言葉はこの事を
指している。
することで、回折スポット201の短軸の長さ(a)と
長軸の長さ(b)との比(a/b)を1/1(円形を意味
する)〜1/1.5 としうる。これは、回折スポットが円形
または実質的に円形になることを意味している。
結晶粒間に存在する回転角を非常に小さくしなければな
らない。単結晶の電子線回折パターンでは回折スポット
が完全に円形になることを考えれば、回折スポットが円
形になるという事は本願発明の半導体薄膜が限りなく単
結晶に近づくことに他ならない。
ある場合の結晶軸と、結晶面内に含まれる軸の関係を表
している。この様に、結晶面が{110}配向であれば
結晶軸は〈110〉軸であり、その結晶面内には〈11
1〉軸、〈100〉軸などが含まれる。
利用して上記棒状結晶の成長方向を調べた結果、概略
〈111〉軸方向に向かって成長することが確かめられ
ている(特開平7-321339号公報参照)。従って、本願発
明の半導体薄膜の一部を拡大すると図3(B)の様にな
っていると考えられる。
れぞれ異なる棒状結晶であり、個々の結晶粒の結晶軸は
概略〈110〉軸である。また、結晶成長は平均的には
概略〈111〉軸方向に向かって進行するので、棒状結
晶の延在する方向と〈111〉軸方向とはほぼ一致す
る。なお、点線で示されるのは結晶粒界である。
れる〈111〉軸304を基準軸とすると、近傍に存在
する他の棒状結晶302、303の面内に含まれる〈1
11〉軸305、306は、基準軸304に一致する
か、若しくはそれぞれ僅かづつずれて基準軸304に対
してある程度の角度を持つ様になる。本明細書中ではこ
の角度を回転角と呼んでいる。
5 °以内(典型的には±1.5 °以内、好ましくは±0.5
°以内)に収まっているという事は、換言すれば回転角
の絶対値が5°以内(典型的には3°以内、好ましくは
1°以内)に収まっているという事と同義である。
ると、本願発明の半導体薄膜では軸305が基準軸30
4となす角(α)および軸306が基準軸304となす
角(β)が回転角である。そして、この回転角が少なく
とも5°以内に収まっているのである。
有する個々の結晶粒はそれぞれ異なる回折スポットとし
て電子線回折パターン上に現れる。例えば、結晶粒30
2、303の回折スポットは、結晶粒301の回折スポ
ットから回転角α、β分だけ同心円上にずれて現れる。
粒が存在すれば、同心円上に複数の結晶粒に対応する回
折スポットが連続的に並ぶことになり、回折スポットは
見かけ上、楕円に近い形状を示す様になる。これが図1
(A)の電子線回折パターンに回折スポットの広がりが
見られた理由である。
記しているが、その中には[111]や[1−11]な
ど等価な複数の軸が含まれる(マイナス記号は反転を意
味する)。即ち、等価な軸全てに対応して回折スポット
が現れ、その結果として図1(A)の様な電子線回折パ
ターンを形成しているので、結晶粒が回転角分だけ回転
すれば電子線回折パターンも全体的に回転角分だけ回転
する。そのため、全ての回折スポットが同心円上に広が
りを持つ。
線回折で調べた結果として図1(A)の様な回折パター
ンが得られたのは、電子線の照射エリア内に複数の棒状
結晶が存在し、それぞれが僅かに異なる回転角を有する
ためと解釈できる。また、その回折スポットの広がり具
合から、回転角の絶対値は5°以内(典型的には3°以
内、好ましくは1°以内)と考えられる。
全結晶粒のうち、最も大きな回転角を有する二つの結晶
粒間においても、任意の基準軸のずれが少なくとも5°
以内に収まっていることを意味している。
分類に乗っ取り、本願発明の半導体薄膜における各種結
晶粒界の存在度について説明する。次に示す表は、本願
発明の半導体薄膜に関するデータを考慮したものであ
る。
線回折、HR−TEM、断面TEM等を駆使することで
識別が可能であり、さらにはより詳細な情報を得ること
ができる。なお、本明細書で取り扱う回転角の値は、上
記手法を組み合わせて様々な角度から結晶粒界を解析す
ることで測定している。
まれる方位についての回転」であるので小傾角粒界に含
まれる。この様なを結晶粒界を形成する場合、模式的に
は図4(A)に示す様な関係で二つの結晶粒は接してい
る。この場合、二つの結晶粒の接する面が粒界面であ
る。しかしながら、本願発明の半導体薄膜では結晶軸ま
わりの回転角が±2.5 °以内と極めて小さいので図4
(A)の様な粒界は殆ど存在しないと見なすことができ
る。。
な場合もある。図4(B)の形態の場合、回転軸となる
軸が図4(A)とは異なっている。しかし、粒界面に含
まれる軸を中心にして二つの結晶粒がある回転角を有す
る関係にある点は図4(A)と同様である。本願発明の
半導体薄膜では、この場合の回転角も±2.5 °以内(典
型的には±1.5 °以内、好ましくは0.5 °以内)である
ので、この様な結晶粒界も殆ど存在しないと見なすこと
ができる。
粒界とは区別されるが、同じ低角粒界の分類にねじれ粒
界と呼ばれる形態がある。これは図4(C)に示す様
に、粒界面に垂直な方位について回転した場合に相当す
る。
有する関係にある点は小傾角粒界と同様であり、本願発
明の半導体薄膜では回転角が±2.5 °以内(典型的には
±1.5 °以内、好ましくは0.5 °以内)に収まってい
る。即ち、ねじれ粒界も殆ど存在しないと見なすことが
できる。
般的に低角粒界と呼ばれる電気的に活性な結晶粒界がな
い又は実質的にないと考えられる。なお、「電気的に活
性」とはキャリアにとってトラップとして機能しうるこ
とを意味している。
m平方の範囲に含まれる結晶粒界を調べた時に、該当す
る粒界(例えば低角粒界等)が、観察されても1つや2
つである様な場合を指す。
他の対応粒界とがあるが、本願発明の半導体薄膜の殆ど
がこの双晶粒界であることが確認されている。この対応
粒界は例え存在しても電気的に不活性(キャリアのトラ
ップとして機能しない)であることが判っている。
粒界({111}双晶粒界)が全体の90%以上(典型
的には95%以上)を占めており、極めて整合性の良い
結晶粒界が形成されていることが広い範囲において証明
されている。
す指針となるパラメータであり、Σ値が小さいほど整合
性の良い結晶粒界であることが知られている。Σ値の定
義については「材料評価のための高分解能電子顕微鏡
法;進藤大輔,平賀賢二共著,pp.54 〜60,共立出版株
式会社,1996」に詳しい。
おいて、両方の結晶の面方位が{110}である場合、
{111}面に対応する格子縞がなす角をθとすると、
θ=70.5°の時にΣ3の対応粒界となることが知られて
いる。
た結晶粒界では、隣接する結晶粒の各格子縞が70.5°の
角度で連続しており、この結晶粒界は{111}双晶粒
界であると容易に推察することができる。
界となるが、この様な他の対応粒界も若干ながら存在し
た。
間にしか形成されない。即ち、本願発明の半導体薄膜は
面方位が概略{110}で揃っているからこそ、広範囲
に渡ってこの様な対応粒界を形成しうるのである。この
特徴は、面方位が不規則な他のポリシリコン膜ではあり
得ることではない。
関係を持たずに不規則な方位の結晶粒が並んだだけの半
導体薄膜に見られる粒界であり、従来の高温ポリシリコ
ンなどの様な半導体薄膜に多く見られる。本願発明の半
導体薄膜では、当然、高角粒界は殆ど存在しない。
界の双方がない又は極めてその数が少ない場合、活性な
結晶粒界は存在しないと見なせる。即ち、その様な結晶
構造を有する半導体薄膜は実質的に結晶粒界のない単結
晶又は実質的な単結晶と見なすことができる。
膜を構成する個々の結晶粒(棒状結晶)が互いに完全に
一致する方位関係にあるか、ある程度の回転角を有した
関係にある。そして、その回転角は±2.5 °以内という
非常に小さなものであり、実質的に活性な結晶粒界を形
成しないと見なして良いレベルである。
れた理由として、下地の平坦性を重要視している。本発
明者らの経験では、下地に凹凸があるとそれが結晶成長
の際に大きく影響する。即ち、下地の凹凸等によって結
晶粒にひずみ等が発生し、結晶軸のずれなどを引き起こ
すことになる。
た様な方法で形成された非常に平坦性の高い下地膜上に
形成されている。従って、結晶成長を阻害する要因を極
力排除した状態で成長させることができるため、非常に
高い結晶性を維持したまま結晶粒同士が接合する。その
結果として、前述の様に実質的に単結晶と見なせる結晶
性を有する半導体薄膜が得られたものと考えられる。
たって結晶化温度以上の温度でのアニール工程(本実施
例の場合、図5(D)に示す工程)は、結晶粒内の欠陥
低減に関して重要な役割を果たしている。その事につい
て説明する。
工程までを終了した時点での結晶シリコン膜を25万倍
に拡大したTEM写真であり、結晶粒内(黒い部分と白
い部分はコントラストの差に起因して現れる)に矢印で
示される様なジグザグ状に見える欠陥が確認される。
面の原子の積み重ね順序が食い違っている積層欠陥であ
るが、転位などの場合もある。図14(A)は{11
1}面に平行な欠陥面を有する積層欠陥と思われる。そ
の事は、ジグザグ状に見える欠陥が約70°の角をなし
て折れ曲がっていることから推測できる。
見た本発明の結晶シリコン膜は、結晶粒内には殆ど積層
欠陥や転位などに起因する欠陥が見られず、非常に結晶
性が高いことが確認できる。この傾向は膜面全体につい
て言えることであり、欠陥数をゼロにすることは現状で
は困難であるが、実質的にゼロと見なせる程度にまで低
減することができる。
は結晶粒内の欠陥が殆ど無視しうる程度にまで低減さ
れ、且つ、結晶粒界が高い連続性によってキャリア移動
の障壁になりえないため、単結晶または実質的に単結晶
と見なせる。
示した結晶シリコン膜は結晶粒界はほぼ同等の連続性を
有しているが、結晶粒内の欠陥数には大きな差がある。
本発明の結晶シリコン膜が図14(A)に示した結晶シ
リコン膜よりも遙に高い電気特性を示す理由はこの欠陥
数の差によるところが大きい。
こる現象について次の様なモデルを考えている。まず、
図14(A)に示す状態では結晶粒内の欠陥(主として
積層欠陥)には触媒元素(代表的にはニッケル)が偏析
している。即ち、Si-Ni-Siといった形の結合が多数存在
していると考えられる。
ロセスを行うことで欠陥に存在するNiが除去されると、
Si-Ni 結合は切れる。そのため、シリコンの余った結合
手はすぐにSi-Si 結合を形成して安定する。こうして欠
陥が消滅する。
晶シリコン膜中の欠陥が消滅することは知られている
が、本発明ではニッケルとの結合が切れて未結合手が多
く発生するためシリコンの再結合がさらにスムーズに行
われると推測できる。
る際に発生する余剰シリコン原子が欠陥へと移動し、Si
-Si 結合の生成に大きく寄与していると考えられる。こ
の概念はいわゆる高温ポリシリコン膜の結晶粒内に欠陥
が少ない理由として知られている。
(代表的には 700〜1100℃)で加熱処理を行うことで結
晶シリコン膜とその下地との間が固着し、密着性が高ま
ることで欠陥が消滅するというモデルを考えている。
とでは、熱膨張係数に10倍近くの差がある。従って、
非晶質シリコン膜から結晶シリコン膜に変成した段階
(図14(A))では、結晶シリコン膜が冷却される時
に非常に大きな応力が結晶シリコン膜にかかる。
る。図15(A)は結晶化工程後の結晶シリコン膜にか
かる熱履歴を示している。まず、温度(t1 )で結晶化
された結晶シリコン膜は冷却期間(a)を経て室温まで
冷やされる。
(a)にある時の結晶シリコン膜であり、30は石英基
板、31は結晶シリコン膜である。この時、結晶シリコ
ン膜31と石英基板30との界面32における密着性は
あまり高くなく、それが原因となって多数の粒内欠陥を
発生していると考えられる。
た結晶シリコン膜31は石英基板30上で非常に動きや
すく、引っ張り応力などの力によって積層欠陥や転位な
どの欠陥33を容易に生じてしまうと考えられる。
(A)に示した様な状態となるのである。そしてその
後、図15(A)に示す様に温度(t2 )で触媒元素の
ゲッタリング工程が施され、その結果、結晶シリコン膜
中の欠陥が前述の理由によって消滅する。
グ工程が行われると同時に結晶シリコン膜石英基板に固
着され、石英基板との密着性が高まる点である。即ち、
このゲッタリング工程は結晶シリコン膜と石英基板(下
地)との固着工程を兼ねていると考えられる。
ると冷却期間(b)を経て室温まで冷やされる。ここで
結晶化工程の後の冷却期間(a)と異なる点は、石英基
板30とアニール後の結晶シリコン膜34との界面35
が非常に密着性の高い状態となっている点である。(図
15(C))
して結晶シリコン膜34が完全に固着されるので、結晶
シリコン膜の冷却段階において結晶シリコン膜に応力が
加わっても欠陥を発生するには至らない。即ち、再び欠
陥が発生する様なことを防ぐことができる。
温まで下げるプロセスを例にとっているが、結晶化が終
了したらそのまま温度を上げてゲッタリング+固着工程
を行うこともできる。その様なプロセスを経ても本発明
の結晶シリコン膜を得ることは可能である。
(図14(B))は、単に結晶化を行っただけの結晶シ
リコン膜(図14(A))に較べて格段に結晶粒内の欠
陥数が少ないという特徴を有している。
ectron Spin Resonance :ESR)によってスピン密度
の差となって現れる。現状では本発明の結晶シリコン膜
のスピン密度は少なくとも 5×1017spins/cm3 以下(好
ましくは 3×1017spins/cm3以下)であることが判明し
ている。ただし、この測定値はは現存する測定装置の検
出限界に近いので、実際のスピン密度はさらに低いと予
想される。
シリコン膜を、本出願人は連続粒界結晶シリコン(Cont
inuous Grain Silicon:CGS)と呼んでいる。
な対応粒界は、同一面方位の結晶粒間にしか形成されな
い。即ち、本願発明の半導体薄膜は面方位が概略{11
0}で揃っているからこそ、広範囲に渡ってこの様な対
応粒界を形成しうるのである。この特徴は、面方位が不
規則な他のポリシリコン膜ではあり得ることではない。
倍に拡大したTEM写真(暗視野像)を図18(A)に
示す。白く見える領域と黒く見える領域とが存在する
が、同色に見える部分は配向性が同一であることを示し
ている。
囲の暗視野像において、白く見える領域がかなりの割合
で連続的にまとまっている点である。これは配向性の同
じ結晶粒がある程度の方向性をもって存在し、隣接する
結晶粒同士で殆ど同一の配向性を有していることを意味
している。
千倍に拡大したTEM写真(暗視野像)を図18(B)
に示す。従来の高温ポリシリコン膜では同一面方位の部
分はばらばらに点在するのみであり、図18(A)に示
す様な方向性のあるまとまりは確認できない。これは隣
接する結晶粒同士の配向性が全く不規則であるためと考
えられる。
のゲッタリング処理を行った本願発明の半導体薄膜を明
視野で観察した場合のTEM写真を図19に示す。ま
た、図19中においてPoint 1を30万倍に拡大した写
真を図20(A)に、200万倍に拡大した写真を図2
0(B)に示す。なお、図20(A)内において四角で
囲まれた領域が図20(B)に相当する。また、Point
1における電子線回折パターン(スポット径 1.7μm
φ)を図20(C)に示す。
とPoint 3を観察した。Point 2の観察結果を図21
(A)、図21(B)、図21(C)に、Point 3の観
察結果を図22(A)、図22(B)、図22(C)に
示す。
おいて結晶格子に連続性が保たれており、平面状粒界が
形成されていることが判る。なお、本出願人はここに示
した測定点以外にも多数の領域に渡って観察と測定を繰
り返し、TFTを作製するのに十分な広い領域におい
て、結晶粒界における結晶格子の連続性が確保されてい
ることを確認している。
下地を得るために、シリコン基板をハロゲン化物(例え
ばHCl)を含む雰囲気中で熱酸化する例を示した。本
実施例では他の基板を利用する例を示す。
石英基板を用意する。次に、その石英基板をCMP(化
学機械研磨)等の手法により理想状態(凹凸部の差の平
均値が5nm以内、代表的には3nm以内、好ましくは2nm
以内)にまで研磨する。
によって優れた平坦性を有する絶縁性基板として利用す
ることができる。石英基板を用いると非常に下地が緻密
となるので下地/半導体薄膜界面の安定度が高い。ま
た、基板からの汚染の影響も殆どないので非常に利用価
値が高い。
珪素膜を用いる例を示したが、SiX Ge1-X (0<X
<1、好ましくは0.05≦X≦0.95)で示される様にゲル
マニウムを1〜10%含有した珪素膜を用いることも有
効である。
型TFTおよびP型TFTを作製した際にしきい値電圧
を小さくできる。また、電界効果移動度(モビリティと
呼ばれる)を大きくすることができる。
助長する触媒元素をゲッタリングする工程においてハロ
ゲン元素を用いる例を示した。本願発明では、触媒元素
のゲッタリング工程にリン元素を用いることも可能であ
る。
以外の領域にリンを添加し、 400〜1050℃(好ましくは
600〜750 ℃)の温度で、1min 〜20hr(典型的には30
min〜3hr)の加熱処理を行えば良い。この加熱処理に
よりリンを添加した領域に触媒元素がゲッタリングされ
るので、活性層中の触媒元素の濃度は 5×1017atoms/cm
3 以下にまで低減される。
ンを添加した領域以外の領域を利用して活性層を形成す
る。後は、実施例1の工程に従えば実施例1と同じ特徴
を有する半導体装置が得られる。
する際にハロゲン元素を含む雰囲気中で加熱処理を行え
ば、本実施例のリン元素によるゲッタリング効果とハロ
ゲン元素によるゲッタリング効果との相乗効果が得られ
る。
た半導体装置を利用して反射型液晶パネルを構成する場
合の例を示す。図7に示すのはアクティブマトリクス型
液晶パネルの断面図であり、ドライバー回路やロジック
回路を構成する領域にはCMOS回路を、画素マトリク
ス回路を構成する領域には画素TFTを示している。
ャネル型TFTとを相補的に組み合わせて作製する。C
MOS回路を構成する個々のTFTの構成および作製方
法は実施例1で説明したので省略する。
成するTFTにさらに工夫を加える必要がある。図7に
おいて701は窒化珪素膜であり、CMOS回路のパッ
シベーション膜を兼ねると同時に、補助容量を構成する
絶縁体として機能する。
形成され、チタン膜702とドレイン電極703との間
で補助容量が形成される。この時、絶縁体は比誘電率の
高い窒化珪素膜であるので、容量を大きくすることがで
きる。また、反射型では開口率を考慮する必要がないの
で、図7の様な構造としても問題がない。
縁膜であり、本実施例ではポリイミドを用いている。こ
の層間絶縁膜704は膜厚を2μm程度と厚くして十分
な平坦性を確保しておくことが好ましい。こうすること
で、優れた平坦性を持つ画素電極705を形成すること
ができる。
ミニウムを主成分とする材料で構成する。なるべく反射
率の高い材料を用いる方が良い。また、優れた平坦性を
確保しておくことで画素電極表面での乱反射損失を低減
することができる。
成する。配向膜706はラビングによって配向力を持た
せる。以上がTFT側基板(アクティブマトリクス基
板)の構成に関する説明である。
に透明導電膜708、配向膜709を形成して構成され
る。これ以外にも必要に応じてブラックマスクやカラー
フィルターを設けることもできる。
った後、液晶層710を封入して図7に示す様な構造の
反射型液晶パネルが完成する。液晶層710は液晶の動
作モード(ECBモード、ゲストホストモード等)によ
って自由に選定することができる。
を構成するアクティブマトリクス基板の外観を図8に簡
略化して示す。図8において、801は実施例1の工程
に従って熱酸化膜を設けたシリコン基板、802は画素
マトリクス回路、803はソースドライバー回路、80
4はゲイトドライバー回路、805はロジック回路であ
る。
構成される論理回路全てを含むが、ここでは従来から画
素マトリクス回路、ドライバー回路と呼ばれている回路
と区別するため、それ以外の信号処理回路(メモリ、D
/Aコンバータ、クロックジェネレータ等)を指す。
外部端子としてFPC(Flexible Print Circuit)端子
が取り付けられる。一般的に液晶モジュールと呼ばれる
のはFPCを取り付けた状態の液晶パネルである。
た半導体装置を利用して透過型液晶パネルを構成する例
を図9に示す。ただし、基本的な構造は実施例4に示し
た反射型液晶パネルと同じであるので、構成の異なる点
を特に説明する。
ックマスク901の構成が反射型液晶パネルと大きく異
なる。即ち、透過型では開口率を稼ぐ必要があるのでT
FT部および配線部以外は極力ブラックマスク901が
重ならない様な構成とすることが重要である。
レイン電極902が重なる様に形成しておき、その上で
ブラックマスク901との間に補助容量を形成する。こ
の様に、広い面積を占めやすい補助容量をTFTの上に
形成することで開口率を広くすることが可能である。
である。透明導電膜903としてはITOが最も多用さ
れるが、他の材料(酸化スズ系など)を用いても良い。
部分に注目した上面図を図23(A)に示す。図23
(A)において、51は活性層、52はソース線、53
はゲイト線、54はドレイン電極、55はブラックマス
ク、56はドレイン電極54と画素電極57とを接続す
るためのコンタクトホールである。
いてドレイン電極54とブラックマスク55との間で補
助容量を形成する点にある。
破線で切断した時に見られる断面構造を図23(B)に
示す。なお、図23(A)と図23(B)には共通の符
号を用いている。さらに、図23(B)に相当する断面
を実際に撮影したTEM写真を図24に示す。
でドレイン電極55が形成され、誘電体58を挟んで対
向するブラックマスク55との間に補助容量が形成され
ている。なお、本実施例ではドレイン電極55としてチ
タン膜をアルミニウム膜で挟んだ三層構造を採用してい
る。
した後で窒化珪素膜/酸化珪素膜/アクリル膜の三層構
造でなる層間絶縁膜を形成し、その上にブラックマスク
55を形成する。
後に補助容量となる領域のアクリル膜のみを除去して開
口部を形成しておく。すると、開口部の底には酸化珪素
膜と窒化珪素膜しか残らず、この二層構造でなる絶縁層
が補助容量の誘電体58として機能するのである。
て導電性を有する珪素膜を用いた、いわゆるシリコンゲ
イトTFTに適用した場合の例である。基本的な構成は
実施例1で作製したTFTとほぼ同様であるので、相違
点のみに着目して説明する。
Tのゲイト電極、12はPチャネル型TFTのゲイト電
極、13は画素TFTのゲイト電極である。ゲイト電極
11〜13はリンまたは砒素を添加したN型ポリシリコ
ン膜、或いはボロンまたはインジウムを添加したP型ポ
リシリコンを用いる。
TにN型ポリシリコンゲイトを用い、Pチャネル型TF
TにP型ポリシリコンゲイトを用いたデュアルゲイト型
CMOS回路を構成しても良い。
利点としては、耐熱性が高いこと、珪素膜であるので扱
いが容易であることなどが挙げられる。また、金属膜と
の反応を利用してサリサイド構造(ポリサイド構造も含
む)をとることができる。
成した後にサイドウォール14〜16を形成する。そし
て、チタン、タングステン等の金属膜(図示せず)を成
膜し、加熱処理を行って金属シリサイド17〜19を形
成する。金属シリサイド17〜19はソース/ドレイン
領域およびゲイト電極の一部に形成される。
合的に金属シリサイドを形成する構造をサリサイド構造
と呼ぶ。この様な構造とすると取り出し電極(ソース/
ドレイン電極等)とのオーミック接触が良好なものとな
るので有効である。
結晶化に際して触媒元素としてゲルマニウムを用いる場
合について図16を用いて説明する。まず、基板41と
して石英基板を用意する。必要に応じて酸化珪素膜等の
絶縁膜を下地として設けても良い。
ン)膜42を形成する。非晶質珪素膜の成膜は減圧熱C
VD法で行い、成膜ガスとしてはジシラン(Si2H6 )を
用いる。また、本実施例では非晶質珪素膜の膜厚を75nm
とする。
う。本実施例では非晶質珪素膜の結晶化に際して、結晶
化を助長する触媒元素としてゲルマニウムを用いる。本
実施例の場合、まず成膜した非晶質珪素膜42上にプラ
ズマCVD法によりゲルマニウム膜43を形成する。
を水素又はヘリウムで5〜10倍に希釈したものを用い
る。そして、 100〜300 ℃の成膜温度で、20〜50mW/cm2
で放電して 1〜50nm(代表的には 10 〜20nm)の膜厚の
ゲルマニウム膜を成膜することができる。
圧熱CVD法で行うことも可能である。ゲルマンは非常
に分解しやすいガスであるので、450 ℃程度の低温で容
易に分解してゲルマニウム膜を形成することができる。
次に、 450〜650 ℃(好ましくは 500〜550 ℃)の加熱
処理を行い、非晶質珪素膜42を結晶化させる。 600℃
を上限としたのは、これを超えると自然核発生が増加し
てしまい、ゲルマニウムを核とした結晶と混在して結晶
性が乱れるからである。(図16(B))
ル、ランプアニール、レーザーアニールのいずれの手段
を用いても良い。本実施例では形成された膜の均質性を
重視してファーネスアニールを用いる。
コン膜またはポリシリコン膜)44は 500℃程度の低温
で形成されたにも拘わらず、優れた結晶性を有してい
る。
マニウム膜を硫酸過水溶液(H2SO4:H2O2=1:1)で
除去した後、結晶シリコン膜44に対して少なくとも前
述の結晶化の際の温度よりも高い温度(代表的には 800
〜1050℃)での熱処理工程を行う。本実施例ではこの熱
処理工程を酸化性雰囲気で行う。(図16(C))
助長する触媒元素としてゲルマニウムを用いる場合、特
にゲルマニウムをゲッタリングして除去する必要はな
い。ゲルマニウムはシリコンと同族の半導体であり、互
いに相性が良いのでシリコンの半導体特性に悪影響を与
えないと考えられる。
る結晶性珪素膜45が形成される。また、結晶性珪素膜
45上には熱処理工程によって熱酸化膜46が形成され
る。この熱酸化膜46はTFT作製時にそのままゲイト
絶縁膜として利用することも可能である。
を行うこともできるが、その場合は高い濃度で膜中にゲ
ルマニウムが存在した状態となる。いずれにしてもこの
熱処理工程を終えた結晶性珪素膜45中には拡散によっ
て 1×1014〜 5×1019atoms/cm3 (代表的には 1×1015
〜 1×1016atoms/cm3 )の濃度でゲルマニウムが存在す
る。
膜45の表面近傍はシリコン原子とゲルマニウム原子が
置換された結合を多く含み、SiX Ge1-X (0<X<1 )で表
されるシリコンゲルマニウム半導体に近い半導体薄膜に
なると考えられる。
素膜上における酸化シリコンの異常成長が全く起こらな
いという利点がある。即ち、本実施例のプロセスで形成
された結晶シリコン膜45は、酸化性雰囲気中に触れた
状態で熱酸化されても酸化シリコンの異常成長が発生し
ない。
ッケルを用いた場合、その後の熱処理条件によっては酸
化シリコンの異常成長を生じることが確認されている。
これは結晶シリコン膜中に存在するニッケルシリサイド
が集中的に酸化されることに起因する。本実施例ではそ
の様な異常成長が起こらないのである。
工程によって結晶シリコン膜44の内部に存在していた
粒内欠陥をほぼ完全に除去することができる。結晶化を
終えた状態、即ち図16(B)に示した状態の結晶シリ
コン膜44は、結晶粒内に多くの欠陥(積層欠陥や転位
欠陥など)を含んでいる。ところが、図16(C)の工
程後に得られた結晶シリコン膜45は、結晶粒内に殆ど
欠陥を含まない。
1で説明したモデルと同様のことが起こっているのであ
ろうと推測している。ただし、触媒元素にニッケルを用
いていないので、欠陥が消滅するのはもっぱら熱酸化に
よって生じた余剰シリコン原子の影響によるところが大
きいと思われる。
とで、結晶性珪素膜の異常酸化が防止されるため結晶性
珪素膜の熱処理に際して工程を煩雑にすることがない。
また、結晶性珪素膜中の粒内欠陥が除去され、非常に結
晶性の高い結晶性珪素膜を得ることができる。
には 800〜1050℃( 好ましくは 850〜900 ℃)の温度で
あり、その様な高い温度で熱処理を行う点に特徴があ
る。この工程では熱酸化機構が粒内欠陥の低減に大きく
寄与すると思われるので、熱酸化が起こりやすい条件で
あることが望ましい。
下限温度は 800℃が好ましく、上限は基板(本実施例で
は石英)の耐熱性を考慮して 1050 ℃が好ましい。ただ
し、ゲルマニウムの融点が 930〜940 ℃であるので、よ
り好ましくは 900℃を上限とすると良い。
ことが好ましいが、不活性雰囲気であっても構わない。
酸化性雰囲気とする場合、ドライ酸素(O2)雰囲気、ウ
ェット酸素(O2+H2)雰囲気、ハロゲン元素を含む雰囲
気(O2+HCl 等)のいずれかとすれば良い。
うと、ハロゲン元素のゲッタリング効果により結晶性珪
素膜の格子間に存在する余分なゲルマニウムが揮発性の
GeCl4 の形で除去される。そのため、格子歪みの少ない
結晶性珪素膜を得るためには有効な手段である。
合わせることができる。
単結晶と見なせる半導体薄膜を活性層として利用してい
るため、単結晶シリコンを用いたMOSFETに匹敵す
る電気特性を示す。本発明者らが試作したTFTからは
次に示す様なデータが得られている。
オフ動作の切り換えの俊敏性)の指標となるサブスレッ
ショルド係数が、Nチャネル型TFTおよびPチャネル
型TFTともに60〜100mV/decade(代表的には60〜85mV
/decade )と小さい。 (2)TFTの動作速度の指標となる電界効果移動度
(μFE)が、Nチャネル型TFTで200 〜650cm2/Vs
(代表的には250 〜300cm2/Vs )、Pチャネル型TFT
で100 〜300cm2/Vs (代表的には150 〜200cm2/Vs )と
大きい。 (3)TFTの駆動電圧の指標となるしきい値電圧(V
th)が、Nチャネル型TFTで-0.5〜1.5 V、Pチャネ
ル型TFTで-1.5〜0.5 Vと小さい。
めて優れたスイッチング特性および高速動作特性を有し
ている。そのため、これまでMOSFETで構成されて
きたLSIなどの集積化回路をTFTで構成することが
可能となる。
かして三次元構造の半導体装置(半導体回路)を構成す
ることも可能となる。
FTを用いた三次元構造の半導体回路の一例を示してい
る。図11(A)は下側にTFT層、上側にイメージセ
ンサを積層した三次元回路である。また、図11(B)
は上層及び下層にTFT層を配置した三次元回路であ
る。
であり非晶質珪素膜等を用いることができる。その上に
は上部電極(透明導電膜)22が設けられ、光を受光し
て電気信号に変換する受光部を構成している。
説明したので省略する。また、三次元回路を構成するた
めの積層技術は、公知の手段を用いれば良い。ただし、
上側のTFT層を形成する場合、下層のTFTの耐熱性
を考慮する必要がある。
し、上層を従来の低温形成のTFTとする構成でも良
い。また、下層のTFTを耐熱性の高い材料で形成して
おき、上層に本願発明のTFTを形成する様な構造とし
ても良い。
だけで構成した下層のTFTで上層の受光部を制御する
構成としても良い。
コンゲイト構造を用いたTFT層であり、上層はシリコ
ンゲイト構造または他の金属膜(アルミニウムを主成分
とする膜等)をゲイト電極として用いた構造のTFT層
である。なお、図11(B)もTFT構造の説明は省略
する。
形成する際に下層のTFTの耐熱性を十分の考慮した上
で作製することが必要である。
下層のTFTを形成した後に厚めに層間絶縁膜23、2
4を形成し、それをCMP(化学機械研磨)等で研磨し
て平坦化した後に上層のTFTを形成することが望まし
い。
次元構造の半導体回路を構成することで、非常に機能性
に富んだ半導体回路を構成することが可能である。な
お、本明細書中において、半導体回路とは半導体特性を
利用して電気信号の制御、変換を行う電気回路という意
味で用いている。
ライバ回路や携帯機器用の高周波回路(MMIC:マイ
クロウェイブ・モジュール・IC)などを構成すること
もできる。即ち、本願発明のTFTを用いることで従来
のICチップやLSIチップをTFTで作製することが
可能である。
外にも、アクティブマトリクス型のEL(エレクトロル
ミネッセンス)表示装置やEC(エレクトロクロミク
ス)表示装置等の他の電気光学装置を作製することも可
能である。また、イメージセンサやCCDを作製するこ
とも可能である。
信号に変換する装置またはその逆を行う装置という意味
で用いている。
用した電気光学装置を利用する電子機器(応用製品)の
一例を図12に示す。なお、電子機器とは半導体回路お
よび/または電気光学装置を搭載した製品のことを意味
している。
デオカメラ、電子スチルカメラ、プロジェクター、ヘッ
ドマウントディスプレイ、カーナビゲーション、パーソ
ナルコンピュータ、携帯情報端末(モバイルコンピュー
タ、携帯電話、PHS(パーソナルハンディフォンシス
テム)等)などが挙げられる。
01、音声出力部2002、音声入力部2003、表示
装置2004、操作スイッチ2005、アンテナ200
6で構成される。本願発明は音声出力部2002、音声
出力部2003、表示装置2004等に適用することが
できる。
2101、表示装置2102、音声入力部2103、操
作スイッチ2104、バッテリー2105、受像部21
06で構成される。本願発明は表示装置2102、音声
入力部2103、受像部2106等に適用することがで
きる。
ービルコンピュータ)であり、本体2201、カメラ部
2202、受像部2203、操作スイッチ2204、表
示装置2205で構成される。本願発明はカメラ部22
02、受像部2203、表示装置2205等に適用でき
る。
イであり、本体2301、表示装置2302、バンド部
2303で構成される。本発明は表示装置2302に適
用することができる。
り、本体2401、光源2402、表示装置2403、
偏光ビームスプリッタ2404、リフレクター240
5、2406、スクリーン2407で構成される。本発
明は表示装置2403に適用することができる。
であり、本体2501、光源2502、表示装置250
3、光学系2504、スクリーン2505で構成され
る。本発明は表示装置2503に適用することができ
る。
広く、あらゆる分野の電子機器に適用することが可能で
ある。また、電気光学装置や半導体回路を必要とする製
品であれば全てに適用できる。
的に単結晶と見なせる結晶性を有する半導体薄膜を形成
することができる。そして、その様な半導体薄膜を利用
することで単結晶上に作製したMOSFETに匹敵す
る、或いは凌駕しうる高い性能を有したTFTを実現す
ることができる。
体回路や電気光学装置およびそれらを搭載した電子機器
は、極めて高い性能を有し、機能性、携帯性、信頼性の
面で非常に優れた製品となる。
真。
図。
図。
図。
図。
真。
明するための図。
写真。
写真。
写真。
Claims (10)
- 【請求項1】珪素を主成分とする複数の棒状または偏平
棒状結晶の集合体からなる半導体薄膜であって、 主たる配向面は概略{110}面であり、 膜中に存在するC(炭素)及びN(窒素)の濃度が 5×
1017atoms/cm3 以下、O(酸素)の濃度が 1×1018atom
s/cm3 以下であり、 前記複数の棒状または偏平棒状結晶は互いに回転角をも
って接しており、且つ、当該回転角の絶対値が3°以内
であることを特徴とする半導体薄膜。 - 【請求項2】請求項1において、前記半導体薄膜の電子
線回折パターンには{110}配向による特定の規則性
が観測され、 当該電子線回折パターンの任意の回折スポットは概略円
状であり、 前記回折スポットの短軸の長さ(a)と長軸の長さ
(b)との比(a/b)が1/1(円形)〜1/1.5 である
ことを特徴とする半導体薄膜。 - 【請求項3】請求項1において、前記半導体薄膜の電子
線回折パターンには{110}配向による特定の規則性
が観測され、 当該電子線回折パターンの任意の回折スポットは、電子
線照射エリアの中心点に対して同心円状の広がりを有
し、 前記電子線照射エリアの中心点から前記回折スポットに
対して引いた接線と、前記電子線照射エリアの中心点と
前記回折スポットの中心点とを結ぶ線分と、がなす角は
±1.5 °以内であることを特徴とする半導体薄膜。 - 【請求項4】請求項1において、前記半導体薄膜の下地
となる絶縁層は、凹部と凸部との差の平均値が5nm以下
であることを特徴とする半導体薄膜。 - 【請求項5】少なくともチャネル形成領域が、珪素を主
成分とする複数の棒状または偏平棒状結晶の集合体から
なる半導体薄膜で構成される半導体装置であって、 前記半導体薄膜は主たる配向面が概略{110}面であ
り、 当該半導体薄膜中に存在するC(炭素)及びN(窒素)
の濃度が 5×1017atoms/cm3 以下、O(酸素)の濃度が
1×1018atoms/cm3 以下であり、 前記複数の棒状または偏平棒状結晶は互いに回転角をも
って接しており、且つ、当該回転角の絶対値が3°以内
であることを特徴とする半導体装置。 - 【請求項6】請求項5において、前記半導体薄膜の電子
線回折パターンには{110}配向による特定の規則性
が観測され、 当該電子線回折パターンの任意の回折スポットは概略円
状であり、 前記回折スポットの短軸の長さ(a)と長軸の長さ
(b)との比(a/b)が1/1(円形)〜1/1.5 である
ことを特徴とする半導体装置。 - 【請求項7】請求項5において、前記半導体薄膜の電子
線回折パターンには{110}配向による特定の規則性
が観測され、 当該電子線回折パターンの任意の回折スポットは、電子
線照射エリアの中心点に対して同心円状の広がりを有
し、 前記電子線照射エリアの中心点から前記回折スポットに
対して引いた接線と、前記電子線照射エリアの中心点と
前記回折スポットの中心点とを結ぶ線分と、がなす角は
±1.5 °以内であることを特徴とする半導体装置。 - 【請求項8】請求項5において、前記半導体薄膜の下地
となる絶縁層は、凹部と凸部との差の平均値が5nm以下
であることを特徴とする半導体装置。 - 【請求項9】請求項5乃至請求項8に記載の半導体装置
を集積化して構成されることを特徴とする半導体装置。 - 【請求項10】請求項9に記載の半導体装置を有するビ
デオカメラ、電子スチルカメラ、プロジェクター、ヘッ
ドマウントディスプレイ、カーナビゲーション、パーソ
ナルコンピュータ、携帯情報端末機器(モバイルコンピ
ュータ、携帯電話、PHSを含む)から選ばれた一つで
あることを特徴とする半導体装置。
Priority Applications (11)
| Application Number | Priority Date | Filing Date | Title |
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| JP15230898A JP4318768B2 (ja) | 1997-07-23 | 1998-05-16 | 半導体装置の作製方法 |
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| US12/849,964 US8384084B2 (en) | 1997-07-23 | 2010-08-04 | Semiconductor thin film and semiconductor device |
Applications Claiming Priority (5)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9-212428 | 1997-07-23 | ||
| JP21242897 | 1997-07-23 | ||
| JP10855298 | 1998-04-03 | ||
| JP10-108552 | 1998-04-03 | ||
| JP15230898A JP4318768B2 (ja) | 1997-07-23 | 1998-05-16 | 半導体装置の作製方法 |
Publications (3)
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| JPH11345767A true JPH11345767A (ja) | 1999-12-14 |
| JPH11345767A5 JPH11345767A5 (ja) | 2005-09-29 |
| JP4318768B2 JP4318768B2 (ja) | 2009-08-26 |
Family
ID=27311251
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
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| JP15230898A Expired - Fee Related JP4318768B2 (ja) | 1997-07-23 | 1998-05-16 | 半導体装置の作製方法 |
Country Status (5)
| Country | Link |
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| US (6) | US6087679A (ja) |
| JP (1) | JP4318768B2 (ja) |
| KR (1) | KR100536523B1 (ja) |
| DE (2) | DE19833237B4 (ja) |
| TW (1) | TW418435B (ja) |
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- 1998-07-22 US US09/120,290 patent/US6087679A/en not_active Expired - Lifetime
- 1998-07-23 KR KR1019980029598A patent/KR100536523B1/ko not_active Expired - Fee Related
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| US9673223B2 (en) | 1999-11-19 | 2017-06-06 | Semiconductor Energy Laboratory Co., Ltd. | Electroluminescence display device |
| US7560734B2 (en) | 1999-11-19 | 2009-07-14 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device and manufacturing method thereof |
| US6646287B1 (en) | 1999-11-19 | 2003-11-11 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device with tapered gate and insulating film |
| US7008828B2 (en) | 1999-11-19 | 2006-03-07 | Semiconductor Energy Laboratory Co., Ltd. | Method of manufacturing semiconductor device |
| US8830217B2 (en) | 2000-01-31 | 2014-09-09 | Semiconductor Energy Laboratory Co., Ltd. | Adhesion type area sensor and display device having adhesion type area sensor |
| JP2005101621A (ja) * | 2000-01-31 | 2005-04-14 | Semiconductor Energy Lab Co Ltd | 表示装置の作製方法 |
| US8456459B2 (en) | 2000-01-31 | 2013-06-04 | Semiconductor Energy Laboratory Co., Ltd. | Adhesion type area sensor and display device having adhesion type area sensor |
| US6690068B2 (en) * | 2000-06-12 | 2004-02-10 | Semiconductor Energy Laboratory Co., Ltd. | Thin film transistors and semiconductor device |
| US7307282B2 (en) * | 2000-06-12 | 2007-12-11 | Semiconductor Energy Laboratory Co., Ltd. | Thin film transistors and semiconductor device |
| US6956235B2 (en) | 2000-06-19 | 2005-10-18 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device |
| US6787807B2 (en) | 2000-06-19 | 2004-09-07 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device |
| US8242508B2 (en) | 2001-02-28 | 2012-08-14 | Semiconductor Energy Laboratory Co., Ltd. | Method of manufacturing a semiconductor device |
| US8017951B2 (en) | 2001-02-28 | 2011-09-13 | Semiconductor Energy Laboratory Co., Ltd. | Semiconductor device including a conductive film having a tapered shape |
| US6979603B2 (en) | 2001-02-28 | 2005-12-27 | Semiconductor Energy Laboratory Co., Ltd. | Method of manufacturing a semiconductor device |
| US7531839B2 (en) | 2001-02-28 | 2009-05-12 | Semiconductor Energy Laboratory Co., Ltd. | Display device having driver TFTs and pixel TFTs formed on the same substrate |
| JP2011109116A (ja) * | 2003-01-08 | 2011-06-02 | Semiconductor Energy Lab Co Ltd | 半導体装置の作製方法 |
| JP2007013106A (ja) * | 2005-05-31 | 2007-01-18 | Semiconductor Energy Lab Co Ltd | 半導体装置及びその作製方法 |
| JP2020087993A (ja) * | 2018-11-16 | 2020-06-04 | 東京エレクトロン株式会社 | ポリシリコン膜の形成方法及び成膜装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| US7297978B2 (en) | 2007-11-20 |
| DE19833237A1 (de) | 1999-01-28 |
| DE19861495B3 (de) | 2014-09-04 |
| US6822262B2 (en) | 2004-11-23 |
| US7928438B2 (en) | 2011-04-19 |
| US8384084B2 (en) | 2013-02-26 |
| DE19833237B4 (de) | 2011-10-06 |
| US20050092997A1 (en) | 2005-05-05 |
| KR19990014087A (ko) | 1999-02-25 |
| JP4318768B2 (ja) | 2009-08-26 |
| US6087679A (en) | 2000-07-11 |
| US20030102480A1 (en) | 2003-06-05 |
| TW418435B (en) | 2001-01-11 |
| US6495886B1 (en) | 2002-12-17 |
| US20080087894A1 (en) | 2008-04-17 |
| US20100295046A1 (en) | 2010-11-25 |
| KR100536523B1 (ko) | 2006-02-28 |
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| FPAY | Renewal fee payment (event date is renewal date of database) |
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