JPS58116580A - パタ−ン表示方式 - Google Patents
パタ−ン表示方式Info
- Publication number
- JPS58116580A JPS58116580A JP21373281A JP21373281A JPS58116580A JP S58116580 A JPS58116580 A JP S58116580A JP 21373281 A JP21373281 A JP 21373281A JP 21373281 A JP21373281 A JP 21373281A JP S58116580 A JPS58116580 A JP S58116580A
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- JP
- Japan
- Prior art keywords
- output
- circuit
- signal
- display
- pattern
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
０１、発明の技術分野
本発明はドツト形式で表示される縦線、斜線を拡幅して
表示しうるパターン表示方式に関する。
表示しうるパターン表示方式に関する。
（２）、技術の背景
ディスプレイ装置には、文字尋をドツト形式で表示する
ものがある。この方式においては、その電気回路とこれ
にょシ制御されるブラウン管の特性との相違から、表示
される縦線、斜線の線幅が縮幅する傾向を有するのでそ
の改曽方が要望されている。
ものがある。この方式においては、その電気回路とこれ
にょシ制御されるブラウン管の特性との相違から、表示
される縦線、斜線の線幅が縮幅する傾向を有するのでそ
の改曽方が要望されている。
（３）、従来技術と問題点
即ち、従来のラスク式で縦線、斜線をドツト表示すると
、その電気回路によってドラ）＆示時間を所定の時間に
設定しても、ブラウン管の螢光体＋２）ｅ性が原因とな
って螢光体に実際に表示されているその表示時間が短く
なり、それらの線は横線に比べて暗くなシ、看者による
その視虻をしに〈＼するという不具合がある。また、１
・ そのリバース表示においても、同じ理由蛇周囲の発光ド
ツトの光学的作用４重畳して来るため、暗ドツト部が縮
小させられてその視認をしに〈＼するという欠点を有す
る。
、その電気回路によってドラ）＆示時間を所定の時間に
設定しても、ブラウン管の螢光体＋２）ｅ性が原因とな
って螢光体に実際に表示されているその表示時間が短く
なり、それらの線は横線に比べて暗くなシ、看者による
その視虻をしに〈＼するという不具合がある。また、１
・ そのリバース表示においても、同じ理由蛇周囲の発光ド
ツトの光学的作用４重畳して来るため、暗ドツト部が縮
小させられてその視認をしに〈＼するという欠点を有す
る。
（４）０発明の目的
本発明は上述のような不具合に鑑みて創案されたもので
、その目的は明部の表示をしたい部分には所要の明部化
を生じさせ、暗部の表示をしたい部分には所要の暗部化
を生じさせて表示されるパターンの視認を容具にするパ
ターン表示方式を提供することにある。
、その目的は明部の表示をしたい部分には所要の明部化
を生じさせ、暗部の表示をしたい部分には所要の暗部化
を生じさせて表示されるパターンの視認を容具にするパ
ターン表示方式を提供することにある。
（５）０発明の構成
そして、この目的はラスク式表示装置の表示面にパター
ンを表わすためのビットに直続して２以上の反転ビット
の受信に応答して上記ビットの表示時間を予め決められ
た時間だけ延長させることによって達成される。
ンを表わすためのビットに直続して２以上の反転ビット
の受信に応答して上記ビットの表示時間を予め決められ
た時間だけ延長させることによって達成される。
（６１０発明の実施例
以下、添付図面を参照しながら本発明の実施９Ａ＋をし
明する。
明する。
８１図は本発明の実施例回路を示す。ｌはＤ−ＦＦで、
そのＣ入力にドツトクロックが接続され％ Ｄ １人力
にディジタルビデオ信号発生回路の出力が接続されてい
る。ｔた、Ｄ２２人力は％Ｑ１出力が接続されている。
そのＣ入力にドツトクロックが接続され％ Ｄ １人力
にディジタルビデオ信号発生回路の出力が接続されてい
る。ｔた、Ｄ２２人力は％Ｑ１出力が接続されている。
２Ｆｉナンド回路で、これら回路の一方の入力へゲイジ
タルヒデオ信号発生回路の出力が接続きｊている。ナン
ド回路２の他方の入力へＤ−ｐｐｔのＱ２出カカｗｉ！
続さレテぃ２＋。
タルヒデオ信号発生回路の出力が接続きｊている。ナン
ド回路２の他方の入力へＤ−ｐｐｔのＱ２出カカｗｉ！
続さレテぃ２＋。
ナンド回路２の出力はナンド回路３の一方）入力へ接続
されておシ、皺ナンド回路の他方の入力はＤ−ＦＦＩの
Ｑ２出カへ接続されている。
されておシ、皺ナンド回路の他方の入力はＤ−ＦＦＩの
Ｑ２出カへ接続されている。
ナンド回路３の出力は遅延回路４を経てナンド回路５の
一方のλカへ接続され、紡ナンド回路５の他方の入力Ｖ
ｉＤ−ＦＦＩのＱ２出カへ接続されている。
一方のλカへ接続され、紡ナンド回路５の他方の入力Ｖ
ｉＤ−ＦＦＩのＱ２出カへ接続されている。
上述の構成を有して本発明を実施するディスプレイ装置
の動作を説明する。
の動作を説明する。
ディスプレイ装置のディジタルビデオ信号発生器からＤ
−ＦＦＩのＤ１１人力ディジタルビデオ信号（ビットパ
ターン） （第２図）（２−１）参照）が供給されると
共にドツトクロック信号がＤ−ＦＦＩのＣ人力へ供給さ
れて１ドツトクロツク後にＱｌ出カに第２図の（２−２
）に示されるような出力信号が現われる。Ｑ１出力の出
力信号がＤ−ＦＦＩのＤ２２人力供給すれるから、１ド
ツトクロツク後に。２出力ニ第２図の（２−３）に示さ
れる出方信号が発生されると共にＱ２出力に第２図の（
２−４）に示される出力信号が現われる。
−ＦＦＩのＤ１１人力ディジタルビデオ信号（ビットパ
ターン） （第２図）（２−１）参照）が供給されると
共にドツトクロック信号がＤ−ＦＦＩのＣ人力へ供給さ
れて１ドツトクロツク後にＱｌ出カに第２図の（２−２
）に示されるような出力信号が現われる。Ｑ１出力の出
力信号がＤ−ＦＦＩのＤ２２人力供給すれるから、１ド
ツトクロツク後に。２出力ニ第２図の（２−３）に示さ
れる出方信号が発生されると共にＱ２出力に第２図の（
２−４）に示される出力信号が現われる。
Ｑ２出力からの出力信号とディジタルビデオ信号とを受
けるナンド回路２からは、第２図の（２−５）に示すよ
うな信号が発生する。即ち、ディジタルビデオ信号（ビ
ットパターン）の′１′″のビット（ドツト）間に′″
０′ｍのビット（スペース）が２以上あるときにはその
ドツト期間を含めて高レベルの信号がナンド回路２から
発生されるが、ドツト間に１つのスペースがある場合に
は、ナンド回路２からはその次のドツト期間低レベルの
信号が発生する。
けるナンド回路２からは、第２図の（２−５）に示すよ
うな信号が発生する。即ち、ディジタルビデオ信号（ビ
ットパターン）の′１′″のビット（ドツト）間に′″
０′ｍのビット（スペース）が２以上あるときにはその
ドツト期間を含めて高レベルの信号がナンド回路２から
発生されるが、ドツト間に１つのスペースがある場合に
は、ナンド回路２からはその次のドツト期間低レベルの
信号が発生する。
このナンド回路２からの信号ム１及びＤ−ＦＦ１のＱ２
出力の信号を受けるナンド回路３の出力からは＄２図の
（２−６）に示すような出力信号Ａ２が発生する。そし
て、その信号は遅延回路４で予め決められた時間（τ）
即ち、ドツト期間の延長に生ぜしめる時間だけ遅延され
て（第２図の（２−７）参照）ナンド回路５へ供給され
る。
出力の信号を受けるナンド回路３の出力からは＄２図の
（２−６）に示すような出力信号Ａ２が発生する。そし
て、その信号は遅延回路４で予め決められた時間（τ）
即ち、ドツト期間の延長に生ぜしめる時間だけ遅延され
て（第２図の（２−７）参照）ナンド回路５へ供給され
る。
また、ナンド回路５にＦｉＱ２出力からの信号が供給さ
れているから、ナンド回路５の出力からは第２図の（２
−８）で示すような信号、つまり、１ドツト期間の持続
時間が長くさｔ、た信号が出力される。この信号はブラ
ウン管の映倫増幅回路へ供給されて電子ビームがブラウ
ン管螢光体に衝突している時間を長くするから、その表
示は第３図に示すように縦線の線幅を拡幅して表示され
る。従って、ブラウン管の螢光体の特性に起因して生ず
る不具合は解消される。
れているから、ナンド回路５の出力からは第２図の（２
−８）で示すような信号、つまり、１ドツト期間の持続
時間が長くさｔ、た信号が出力される。この信号はブラ
ウン管の映倫増幅回路へ供給されて電子ビームがブラウ
ン管螢光体に衝突している時間を長くするから、その表
示は第３図に示すように縦線の線幅を拡幅して表示され
る。従って、ブラウン管の螢光体の特性に起因して生ず
る不具合は解消される。
このような効果はリバース文字をブラウン管に表示した
い場合にも同等に得られる（第４図参照）。その斜線部
が明部、白地が暗部である。
い場合にも同等に得られる（第４図参照）。その斜線部
が明部、白地が暗部である。
これは第１図のナンド回路５の出力信号を反１回路６を
通してアンド回路７へ供給し、その出力信号を上述の映
像増幅回路へ供給することによって達成される。アンド
回路７にはリバース文字表示期間中そのゲート信号が線
８を経て供給されるように構成されている。
通してアンド回路７へ供給し、その出力信号を上述の映
像増幅回路へ供給することによって達成される。アンド
回路７にはリバース文字表示期間中そのゲート信号が線
８を経て供給されるように構成されている。
上記実施例においては、ディジタルビデオ信号をＤ−Ｆ
Ｆで１ドツトクロツク及び２ドットクロック遅延させて
いるが、他の遅延回路、例えば遅延線を用いて同様の遅
延を生じさせること屯出来る。また、その他の機能を生
じさせる回路部分も本発明の範囲内で蜜更しうる。
Ｆで１ドツトクロツク及び２ドットクロック遅延させて
いるが、他の遅延回路、例えば遅延線を用いて同様の遅
延を生じさせること屯出来る。また、その他の機能を生
じさせる回路部分も本発明の範囲内で蜜更しうる。
（７）０発明の効果
以上の説明から明らかなように、本発明によれば、ドツ
トを明部として表示させる場合にも、またそのリバース
パターンで表示する場合にも、それらの表示時間を通常
の表示期間よりも長く表示させているから、縦線等が暗
く見オるまたはつぶれてみえる、換言すればそれらが細
線化してし遣うのを防止しつる。従ってそれらパターン
の視認を容易にする。
トを明部として表示させる場合にも、またそのリバース
パターンで表示する場合にも、それらの表示時間を通常
の表示期間よりも長く表示させているから、縦線等が暗
く見オるまたはつぶれてみえる、換言すればそれらが細
線化してし遣うのを防止しつる。従ってそれらパターン
の視認を容易にする。
第１図は本発明の実施例回路図、罪２図は第１因回路を
説明するための信号波形図、第３図は通常の表示態様で
文字Ｈをディスプレイ装置の表示向に表示したその状態
図、第４図はリバース表示態様で文字Ｈをディスプレイ
装置の表示面に表示したその状Ｉｗｌ−である。 ４は遅延回路、６Ｆ１反転回路、７Ｆｉアンド回路であ
る。 特許出願人 富士通株式会社 第１図 第２図 （２−５） （２−８）
説明するための信号波形図、第３図は通常の表示態様で
文字Ｈをディスプレイ装置の表示向に表示したその状態
図、第４図はリバース表示態様で文字Ｈをディスプレイ
装置の表示面に表示したその状Ｉｗｌ−である。 ４は遅延回路、６Ｆ１反転回路、７Ｆｉアンド回路であ
る。 特許出願人 富士通株式会社 第１図 第２図 （２−５） （２−８）
Claims (1)
- ビット直列のディジタルビデオ信号を受けて表示面上に
ドツト形式でパターンを表示するパターン表示方式にお
いて、上記パターンを表わすためのビットに直続して２
以上の骸ビットの反転ビットが続いていることに応答し
て上記ビットの表示時間を予め決められた時間だけ延長
することを特徴とするパターン表示方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21373281A JPS58116580A (ja) | 1981-12-29 | 1981-12-29 | パタ−ン表示方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP21373281A JPS58116580A (ja) | 1981-12-29 | 1981-12-29 | パタ−ン表示方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS58116580A true JPS58116580A (ja) | 1983-07-11 |
Family
ID=16644076
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP21373281A Pending JPS58116580A (ja) | 1981-12-29 | 1981-12-29 | パタ−ン表示方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS58116580A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60126968A (ja) * | 1983-12-14 | 1985-07-06 | Oki Electric Ind Co Ltd | ドツトプリンタの文字パタ−ン反転印字方式 |
| JPS60208795A (ja) * | 1984-04-02 | 1985-10-21 | インタ−ナショナル ビジネス マシ−ンズ コ−ポレ−ション | 表示装置 |
| JPS6135486A (ja) * | 1984-07-27 | 1986-02-19 | 株式会社ピーエフユー | 文字および図形デ−タ変換方式 |
-
1981
- 1981-12-29 JP JP21373281A patent/JPS58116580A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60126968A (ja) * | 1983-12-14 | 1985-07-06 | Oki Electric Ind Co Ltd | ドツトプリンタの文字パタ−ン反転印字方式 |
| JPS60208795A (ja) * | 1984-04-02 | 1985-10-21 | インタ−ナショナル ビジネス マシ−ンズ コ−ポレ−ション | 表示装置 |
| JPS6135486A (ja) * | 1984-07-27 | 1986-02-19 | 株式会社ピーエフユー | 文字および図形デ−タ変換方式 |
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