JPH0429074B2 - - Google Patents
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- JPH0429074B2 JPH0429074B2 JP60191687A JP19168785A JPH0429074B2 JP H0429074 B2 JPH0429074 B2 JP H0429074B2 JP 60191687 A JP60191687 A JP 60191687A JP 19168785 A JP19168785 A JP 19168785A JP H0429074 B2 JPH0429074 B2 JP H0429074B2
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- Japan
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- signal
- video
- circuit
- character
- blank
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-
- G—PHYSICS
- G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
- G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
- G09G1/00—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data
- G09G1/06—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using single beam tubes, e.g. three-dimensional or perspective representation, rotation or translation of display pattern, hidden lines, shadows
- G09G1/14—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using single beam tubes, e.g. three-dimensional or perspective representation, rotation or translation of display pattern, hidden lines, shadows the beam tracing a pattern independent of the information to be displayed, this latter determining the parts of the pattern rendered respectively visible and invisible
- G09G1/16—Control arrangements or circuits, of interest only in connection with cathode-ray tube indicators; General aspects or details, e.g. selection emphasis on particular characters, dashed line or dotted line generation; Preprocessing of data using single beam tubes, e.g. three-dimensional or perspective representation, rotation or translation of display pattern, hidden lines, shadows the beam tracing a pattern independent of the information to be displayed, this latter determining the parts of the pattern rendered respectively visible and invisible the pattern of rectangular co-ordinates extending over the whole area of the screen, i.e. television type raster
- G09G1/165—Details of a display terminal using a CRT, the details relating to the control arrangement of the display terminal and to the interfaces thereto
- G09G1/167—Details of the interface to the display terminal specific for a CRT
Landscapes
- Engineering & Computer Science (AREA)
- Radar, Positioning & Navigation (AREA)
- Remote Sensing (AREA)
- Physics & Mathematics (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Controls And Circuits For Display Device (AREA)
Description
【発明の詳細な説明】
（産業上の利用分野）
本発明は、CRTでリバース表示を行うために
必要なインターフエース回路に関し、例えば日本
語ワードプロセツサに利用される。
必要なインターフエース回路に関し、例えば日本
語ワードプロセツサに利用される。
（従来の技術）
CRTでリバース表示を行う場合、画面に「ふ
ちａ」が存在するため、画面の最も外側にキヤラ
クタを表示すると文字パターンが「ふちａ」にか
かり、見苦しい表示となる（第７図参照）。
ちａ」が存在するため、画面の最も外側にキヤラ
クタを表示すると文字パターンが「ふちａ」にか
かり、見苦しい表示となる（第７図参照）。
従来、このような不具合を解消するために、前
記「ふちａ」近傍を、文字を表示させないデツド
エリアｂに設定していた。そして、このデツドエ
リアｂの設定にはソフトウエアによる領域設定が
行われていた。
記「ふちａ」近傍を、文字を表示させないデツド
エリアｂに設定していた。そして、このデツドエ
リアｂの設定にはソフトウエアによる領域設定が
行われていた。
第５図は従来用いられているラスタースキヤン
方式のCRTインターフエース回路の一般的な回
路構成を示し、第６図は同回路におけるタイミン
グを示すタイミングチヤートを示している。
方式のCRTインターフエース回路の一般的な回
路構成を示し、第６図は同回路におけるタイミン
グを示すタイミングチヤートを示している。
CRTコントロール回路（図示省略）より出力
された表示アドレスはビデオRAMfに入力され、
ビデオRAMfからはｎビツトで構成されたパラレ
ル表示データがパラレル／シリアル変換器ｃに出
力されている。
された表示アドレスはビデオRAMfに入力され、
ビデオRAMfからはｎビツトで構成されたパラレ
ル表示データがパラレル／シリアル変換器ｃに出
力されている。
このパラレル表示データは、実際に表示される
文字フオントに関するデータではなく、コントロ
ール回路に起因するハードウエア構成上の文字単
位であり、第６図においては水平方向をｍ文字と
し、各文字が４ドツトで構成されている。
文字フオントに関するデータではなく、コントロ
ール回路に起因するハードウエア構成上の文字単
位であり、第６図においては水平方向をｍ文字と
し、各文字が４ドツトで構成されている。
パラレル／シリアル変換器ｃはロード信号LD
及びドツト・クロツク（DOTCLK）により入出
力制御され、前記パラレル表示データはロード信
号LDのタイミングに合わせてこのパラレル／シ
リアル変換器ｃにロードされ、ドツト・クロツク
（DOTCLK）により、シリアルデータに変換さ
れて出力される。このシリアルデータはインバー
タｄによつてリバース表示用として反転出力さ
れ、帰線消去を行うANDゲートｅの一方の端子
に入力されている。
及びドツト・クロツク（DOTCLK）により入出
力制御され、前記パラレル表示データはロード信
号LDのタイミングに合わせてこのパラレル／シ
リアル変換器ｃにロードされ、ドツト・クロツク
（DOTCLK）により、シリアルデータに変換さ
れて出力される。このシリアルデータはインバー
タｄによつてリバース表示用として反転出力さ
れ、帰線消去を行うANDゲートｅの一方の端子
に入力されている。
このANDゲートｅの他方の端子にはブランク
信号BLANKが入力され、このブランク信号によ
り帰線時間中の出力が消されて、ビデオ信号
VIDEOとしてCRTモニター（図示省略）に出力
されている。
信号BLANKが入力され、このブランク信号によ
り帰線時間中の出力が消されて、ビデオ信号
VIDEOとしてCRTモニター（図示省略）に出力
されている。
（発明が解決しようとする問題点）
しかしながら、上記のようにしてリバース表示
を行つていたのでは、ハードウエア上実際に用意
されたビデオRAMの容量よりも少ない容量が結
果的に情報の表示に使用されることになる。この
ため、ビデオRAMのデツドエリアが存在し、同
一容量のビデオRAMであつても、多くの情報を
表示できないという問題があつた。
を行つていたのでは、ハードウエア上実際に用意
されたビデオRAMの容量よりも少ない容量が結
果的に情報の表示に使用されることになる。この
ため、ビデオRAMのデツドエリアが存在し、同
一容量のビデオRAMであつても、多くの情報を
表示できないという問題があつた。
本発明はかかる点に鑑み、水平方向ビデオ
RAMに関係なく、ドツトONする領域をハード
ウエア構成によつて設けることにより、ビデオ
RAMのデツドエリアを減少し、同一容量でより
多くの情報を表示できるインターフエース回路を
提供することを目的とする。
RAMに関係なく、ドツトONする領域をハード
ウエア構成によつて設けることにより、ビデオ
RAMのデツドエリアを減少し、同一容量でより
多くの情報を表示できるインターフエース回路を
提供することを目的とする。
（課題を解決するための手段）
本発明は、シリアル信号に変換されたビデオ信
号を所定期間スキユーさせる第１スキユー回路
と、 帰線期間を決めるブランク信号を前記所定期間
の２倍の期間スキユーさせるとともに、このスキ
ユーされたブランク信号と元のブランク信号との
合成信号を作成する第２スキユー回路と、 この第２スキユー回路の出力信号を前記第１ス
キユー回路の出力信号に加えることにより、所定
期間スキユーされたビデオ信号の前後にそれぞれ
所定期間の疑似ビデオ信号を付加する論理回路と
を備えた構成とする。
号を所定期間スキユーさせる第１スキユー回路
と、 帰線期間を決めるブランク信号を前記所定期間
の２倍の期間スキユーさせるとともに、このスキ
ユーされたブランク信号と元のブランク信号との
合成信号を作成する第２スキユー回路と、 この第２スキユー回路の出力信号を前記第１ス
キユー回路の出力信号に加えることにより、所定
期間スキユーされたビデオ信号の前後にそれぞれ
所定期間の疑似ビデオ信号を付加する論理回路と
を備えた構成とする。
（作用）
第１スキユー回路によつて、例えば１文字分
（ハードウエア上の文字単位）スキユーされたシ
リアル信号であるビデオ信号を作成する。
（ハードウエア上の文字単位）スキユーされたシ
リアル信号であるビデオ信号を作成する。
また、第２スキユー回路によつて、ブランク信
号BLANKを例えば２文字分スキユーさせるとと
もに、このスキユーさせたブランク信号
BLANK2と元のブランク信号BLANKとの合成
信号DISPEDGを作成する。
号BLANKを例えば２文字分スキユーさせるとと
もに、このスキユーさせたブランク信号
BLANK2と元のブランク信号BLANKとの合成
信号DISPEDGを作成する。
論理回路では、第２スキユー回路の出力信号を
第１スキユー回路の出力信号に加えることによ
り、１文字分スキユーされたビデオ信号の前後の
それぞれに、１文字分の疑似ビデオ信号を付加す
る。これにより、CRTの水平方向に一定間隔
（１文字分）の「ふち」が形成されることになる。
第１スキユー回路の出力信号に加えることによ
り、１文字分スキユーされたビデオ信号の前後の
それぞれに、１文字分の疑似ビデオ信号を付加す
る。これにより、CRTの水平方向に一定間隔
（１文字分）の「ふち」が形成されることになる。
（実施例）
以下、本発明の実施例について図面を参照して
説明する。
説明する。
第１図は、本発明に係るリバース表示用CRT
インターフエース回路を示し、第２図は同回路に
おけるタイミングを示すタイミングチヤートを示
している。
インターフエース回路を示し、第２図は同回路に
おけるタイミングを示すタイミングチヤートを示
している。
なお、以下説明する中で、「文字」として説明
するのは、すでに述べたように実際に表示される
文字フオントに対応するものでなく、コントロー
ル回路に起因するハードウエア上の文字単位を意
味している。
するのは、すでに述べたように実際に表示される
文字フオントに対応するものでなく、コントロー
ル回路に起因するハードウエア上の文字単位を意
味している。
第１図において、ビデオRAM１は２文字分一
度にパラレルに読み出せるものである。そして、
２文字分のパラレルデータはそれぞれ2nビツド
を扱うパラレル／シリアル変換器２に入力され
る。
度にパラレルに読み出せるものである。そして、
２文字分のパラレルデータはそれぞれ2nビツド
を扱うパラレル／シリアル変換器２に入力され
る。
このパラレル／シリアル変換器２にはロード信
号LDとドツト・クロツクDOTCLKとがそれぞれ
入力されており、これらの信号によつて前記ビデ
オRAM１から出力されるｎビツトのデータが交
互にシリアル信号に変換されて出力されることに
なる。
号LDとドツト・クロツクDOTCLKとがそれぞれ
入力されており、これらの信号によつて前記ビデ
オRAM１から出力されるｎビツトのデータが交
互にシリアル信号に変換されて出力されることに
なる。
このため、CRTコントロール回路（図示省略）
からの表示アドレスのカウントスピードは１文字
分を読み出せる構成のビデオRAM（従来例参照）
に比べ1/2で済むことになり、しかし、パラレ
ル／シリアル変換器２から出力されるシリアル信
号は１文字分スキユーして出力されるよう設定す
ることが可能となる。
からの表示アドレスのカウントスピードは１文字
分を読み出せる構成のビデオRAM（従来例参照）
に比べ1/2で済むことになり、しかし、パラレ
ル／シリアル変換器２から出力されるシリアル信
号は１文字分スキユーして出力されるよう設定す
ることが可能となる。
この１文字分のスキユーされたシリアル出力は
ANDゲート４の一方の端子に入力される。
ANDゲート４の一方の端子に入力される。
ANDゲート４は１文字分スキユーされたブラ
ンク信号BLANK1により、帰線時間中の入力を
消去するためのゲートであり、他方の端子には後
述するＤ−フリツプフロツプ５ａで１文字分スキ
ユーされたブランク信号BLANK1が入力されて
いる。そして、このANDゲート４からは元ビデ
オ信号OVIDEOが出力され、この元ビデオ信号
OVIDEOはインバータ３によりリバース表示用
として反転されたOVIDEO信号となる。
ンク信号BLANK1により、帰線時間中の入力を
消去するためのゲートであり、他方の端子には後
述するＤ−フリツプフロツプ５ａで１文字分スキ
ユーされたブランク信号BLANK1が入力されて
いる。そして、このANDゲート４からは元ビデ
オ信号OVIDEOが出力され、この元ビデオ信号
OVIDEOはインバータ３によりリバース表示用
として反転されたOVIDEO信号となる。
特に第２図においては水平方向にｍ文字表示す
る場合のタイミングを示しており、各文字がｎド
ツト（本例ではｎ＝４）によつて構成されている
ので、前記OVIDEO信号はｎ×ｍドツトの信号
が形成されていることになる。
る場合のタイミングを示しており、各文字がｎド
ツト（本例ではｎ＝４）によつて構成されている
ので、前記OVIDEO信号はｎ×ｍドツトの信号
が形成されていることになる。
一方、前記ブランク信号BLANKは、キヤラク
タクロツクCCLKによつてタイミングがとられる
２つのＤ−フリツプフロツプ５ａ，５ｂによつて
２文字分スキユーされた信号BLANK2に変換さ
れ、この信号BLANK2は、前記ブランク信号
BLANKとでORゲート６を介して論理和がとら
れた信号DISPEDGに変換されている。この
DISPEDG信号は、前記OVIDEO信号が存在する
期間の前後１文字分が「Ｈ」レベルとなされた信
号で、これらの信号がANDゲート７において論
理積がとられてビデオ信号VIDEOとしてCRTモ
ニターに出力される。
タクロツクCCLKによつてタイミングがとられる
２つのＤ−フリツプフロツプ５ａ，５ｂによつて
２文字分スキユーされた信号BLANK2に変換さ
れ、この信号BLANK2は、前記ブランク信号
BLANKとでORゲート６を介して論理和がとら
れた信号DISPEDGに変換されている。この
DISPEDG信号は、前記OVIDEO信号が存在する
期間の前後１文字分が「Ｈ」レベルとなされた信
号で、これらの信号がANDゲート７において論
理積がとられてビデオ信号VIDEOとしてCRTモ
ニターに出力される。
このようにして形成されたビデオ信号は、第２
図に示すように、ビデオRAM１による表示信号
の前後に１文字分ずつのドツトON部分（疑似ビ
デオ信号）８ａ，８ｂが付加されたことになる。
このため、CRTモニター側の水平ドツト数は２
文字分を加えた設定にする必要がある。
図に示すように、ビデオRAM１による表示信号
の前後に１文字分ずつのドツトON部分（疑似ビ
デオ信号）８ａ，８ｂが付加されたことになる。
このため、CRTモニター側の水平ドツト数は２
文字分を加えた設定にする必要がある。
第３図及び第４図は、以上の構成からなるリバ
ース表示用CRTインターフエース回路によつて
CRT画面に表示されるデツドエリアについて例
示している。
ース表示用CRTインターフエース回路によつて
CRT画面に表示されるデツドエリアについて例
示している。
第３図において斜線で示した領域１０が本例の
回路構成によつてビデオRAM１に関係なくドツ
トONとなされた領域であり、その他の領域１１
はビデオRAM１による表示エリアを示してい
る。
回路構成によつてビデオRAM１に関係なくドツ
トONとなされた領域であり、その他の領域１１
はビデオRAM１による表示エリアを示してい
る。
また、第４図において斜線で示した領域１２
が、本例の回路構成によつても結果的にデツドエ
リアとして存在することになり、従来のデツドエ
リア（第８図領域ｂ参照）に比べて、デツドエリ
アが少なくなつている。
が、本例の回路構成によつても結果的にデツドエ
リアとして存在することになり、従来のデツドエ
リア（第８図領域ｂ参照）に比べて、デツドエリ
アが少なくなつている。
（発明の効果）
以上述べたように本発明によれば、ビデオ
RAMのデツドエリアを減少し、同一容量で多く
の情報をリバース表示できる。
RAMのデツドエリアを減少し、同一容量で多く
の情報をリバース表示できる。
第１図は本発明に係るリバース表示用CRTイ
ンターフエース回路の実施例を示す回路図、第２
図は同回路図における各部の信号のタイミングを
示すタイミングチヤート、第３図はドツトON領
域を示すCRT画面の正面図、第４図はデツドエ
リアを示すCRT画面の正面図、第５図は従来例
を示す回路図、第６図は従来の回路におけるタイ
ミングを示すタイミングチヤート、第７図及び第
８図は従来のデツドエリアを説明するCRT画面
の正面図である。 １…ビデオRAM、２…パラレル／シリアル変
換器、５ａ，５ｂ…Ｄ−フリツプフロツプ。
ンターフエース回路の実施例を示す回路図、第２
図は同回路図における各部の信号のタイミングを
示すタイミングチヤート、第３図はドツトON領
域を示すCRT画面の正面図、第４図はデツドエ
リアを示すCRT画面の正面図、第５図は従来例
を示す回路図、第６図は従来の回路におけるタイ
ミングを示すタイミングチヤート、第７図及び第
８図は従来のデツドエリアを説明するCRT画面
の正面図である。 １…ビデオRAM、２…パラレル／シリアル変
換器、５ａ，５ｂ…Ｄ−フリツプフロツプ。
Claims (1)
- 【特許請求の範囲】 １ シリアル信号に変換されたビデオ信号を所定
期間スキユーさせる第１スキユー回路と、 帰線期間を決めるブランク信号を前記所定期間
の２倍の期間スキユーさせるとともに、このスキ
ユーされたブランク信号と元のブランク信号との
合成信号を作成する第２スキユー回路と、 この第２スキユー回路の出力信号を前記第１ス
キユー回路の出力信号に加えることにより、所定
期間スキユーされたビデオ信号の前後にそれぞれ
所定期間の疑似ビデオ信号を付加する論理回路と
を備えたことを特徴とするリバース表示用CRT
インターフエース回路。
Priority Applications (4)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60191687A JPS6250795A (ja) | 1985-08-29 | 1985-08-29 | リバ−ス表示用ｃｒｔインタ−フェ−ス回路 |
| DE19863629015 DE3629015A1 (de) | 1985-08-29 | 1986-08-27 | Videodaten-interface fuer eine anzeigeeinrichtung |
| US06/900,685 US4804952A (en) | 1985-08-29 | 1986-08-27 | Display device interface circuit |
| GB8620930A GB2180129B (en) | 1985-08-29 | 1986-08-29 | Display device interface circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60191687A JPS6250795A (ja) | 1985-08-29 | 1985-08-29 | リバ−ス表示用ｃｒｔインタ−フェ−ス回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6250795A JPS6250795A (ja) | 1987-03-05 |
| JPH0429074B2 true JPH0429074B2 (ja) | 1992-05-15 |
Family
ID=16278786
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60191687A Granted JPS6250795A (ja) | 1985-08-29 | 1985-08-29 | リバ−ス表示用ｃｒｔインタ−フェ−ス回路 |
Country Status (4)
| Country | Link |
|---|---|
| US (1) | US4804952A (ja) |
| JP (1) | JPS6250795A (ja) |
| DE (1) | DE3629015A1 (ja) |
| GB (1) | GB2180129B (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4965563A (en) * | 1987-09-30 | 1990-10-23 | Hitachi, Ltd. | Flat display driving circuit for a display containing margins |
Family Cites Families (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US3984828A (en) * | 1975-05-23 | 1976-10-05 | Rca Corporation | Character generator for television channel number display with edging provisions |
| US4352100A (en) * | 1980-11-24 | 1982-09-28 | Ncr Corporation | Image formatting apparatus for visual display |
| JPS57136686A (en) * | 1981-02-19 | 1982-08-23 | Ricoh Kk | Inverse indication control system of crt display device |
| JPS57145475A (en) * | 1981-03-05 | 1982-09-08 | Canon Inc | Digital image reproducer |
| US4437092A (en) * | 1981-08-12 | 1984-03-13 | International Business Machines Corporation | Color video display system having programmable border color |
| GB2105156A (en) * | 1981-08-12 | 1983-03-16 | Ibm | Data processing system for controlling the border colour of a cathode ray tube display |
| US4412244A (en) * | 1981-11-20 | 1983-10-25 | Rca Corporation | Switching circuit for television receiver on-screen display |
| JPS59101367A (ja) * | 1982-12-01 | 1984-06-11 | Canon Inc | 記録装置 |
| JPS59206882A (ja) * | 1983-05-11 | 1984-11-22 | キヤノン株式会社 | 画像処理装置 |
| JPS60134284A (ja) * | 1983-12-23 | 1985-07-17 | 株式会社ピーエフユー | 画面反転表示方式 |
| US4571619A (en) * | 1984-08-03 | 1986-02-18 | General Electric Company | Programmable video mask generator |
-
1985
- 1985-08-29 JP JP60191687A patent/JPS6250795A/ja active Granted
-
1986
- 1986-08-27 DE DE19863629015 patent/DE3629015A1/de active Granted
- 1986-08-27 US US06/900,685 patent/US4804952A/en not_active Expired - Lifetime
- 1986-08-29 GB GB8620930A patent/GB2180129B/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6250795A (ja) | 1987-03-05 |
| GB2180129B (en) | 1990-02-14 |
| GB8620930D0 (en) | 1986-10-08 |
| US4804952A (en) | 1989-02-14 |
| DE3629015A1 (de) | 1987-03-05 |
| DE3629015C2 (ja) | 1990-11-29 |
| GB2180129A (en) | 1987-03-18 |
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