JPS5834492A - 液晶表示素子の駆動回路 - Google Patents
液晶表示素子の駆動回路Info
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- JPS5834492A JPS5834492A JP13278081A JP13278081A JPS5834492A JP S5834492 A JPS5834492 A JP S5834492A JP 13278081 A JP13278081 A JP 13278081A JP 13278081 A JP13278081 A JP 13278081A JP S5834492 A JPS5834492 A JP S5834492A
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- Japan
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- crystal display
- scanning
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、液晶表示原子の駆動回路、僧に、液晶表示原
子を電圧平均化法によシ時分割駆動する回路に関するも
のである。
子を電圧平均化法によシ時分割駆動する回路に関するも
のである。
従来よシ、液晶表示素子を時分割駆動する方法として電
圧平均化法が知られている。
圧平均化法が知られている。
これは、液晶表示素子の点灯セグメントに′ｙＩｉ、
ＥＥを印加した時に非点灯セグメントにも一定の均一な
バイアス電圧が加わるようにすることによって、液晶表
示素子を時分割駆動した場合に発生するクロストーク電
圧を均一化するものである。このようにすることによシ
、高時分割、駆動でクロスト〜りが発生１７ても、特に
グラフィックディスプレイ用等の画面全面に画素を配置
１−た構造の液晶表示素子においては、クロストークが
均一な背景とみなせるために、表示品質はさほど劣化し
ない。
ＥＥを印加した時に非点灯セグメントにも一定の均一な
バイアス電圧が加わるようにすることによって、液晶表
示素子を時分割駆動した場合に発生するクロストーク電
圧を均一化するものである。このようにすることによシ
、高時分割、駆動でクロスト〜りが発生１７ても、特に
グラフィックディスプレイ用等の画面全面に画素を配置
１−た構造の液晶表示素子においては、クロストークが
均一な背景とみなせるために、表示品質はさほど劣化し
ない。
第１図に、この種の液晶表示原子の駆動回路の一例を示
す。同図において、ｌｌ（１＝１−１ｎ）は走査電極、
２ｊ（ｊ”ｌ〜ｎ）は信号電極、３は走否側駆動回路、
４は信号側駆動回路、５はタイミング回路、６は表示メ
モ１ハ γは交流電源、８は電圧レベル発生用の電蝕回
路を示す。
す。同図において、ｌｌ（１＝１−１ｎ）は走査電極、
２ｊ（ｊ”ｌ〜ｎ）は信号電極、３は走否側駆動回路、
４は信号側駆動回路、５はタイミング回路、６は表示メ
モ１ハ γは交流電源、８は電圧レベル発生用の電蝕回
路を示す。
上記構成を有する液晶表示素子において、各走査面１極
１１および信号型、律２ｊに、それぞれ第２図に示すよ
うな走査電圧ｘ１卦よび信号電圧Ｙｊを印加することに
より、各走を霜５極１１と信号電極２ｊとの交点に形成
される各画素には第３図に示すような％′１圧Ｘ１−Ｙ
ｊが印加される。第２図において、（ａ）。
１１および信号型、律２ｊに、それぞれ第２図に示すよ
うな走査電圧ｘ１卦よび信号電圧Ｙｊを印加することに
より、各走を霜５極１１と信号電極２ｊとの交点に形成
される各画素には第３図に示すような％′１圧Ｘ１−Ｙ
ｊが印加される。第２図において、（ａ）。
（ｂ） 、 （ｃ） 、 （ｄ） 、 （ｅ） 、 （
ｆ） 、 （ｇ）はそれぞれＸＩ 、Ｘ２１Ｘ８．Ｙ２
１Ｙ８．Ｙ４．Ｙ９を示す。また、第３図において（ａ
） 、 （ｈ）は非点灯、（０） 、 （ｄ）は点灯状
態の画素に加わる電圧を示し、それぞれ（ａ）はＸＩ−
Ｙｇ、（ｂ）はＸａ−Ｙｓ、（ｏ）はＸａ−Ｙｇ、（ｄ
）はＸａ−Ｙｅに対応する。。
ｆ） 、 （ｇ）はそれぞれＸＩ 、Ｘ２１Ｘ８．Ｙ２
１Ｙ８．Ｙ４．Ｙ９を示す。また、第３図において（ａ
） 、 （ｈ）は非点灯、（０） 、 （ｄ）は点灯状
態の画素に加わる電圧を示し、それぞれ（ａ）はＸＩ−
Ｙｇ、（ｂ）はＸａ−Ｙｓ、（ｏ）はＸａ−Ｙｇ、（ｄ
）はＸａ−Ｙｅに対応する。。
ここで、走査電圧、信号電圧波形を棺・成する各し、バ
イアス比ａ−証＋ｉ、Ｎは時分割数）で示される値が最
適であり、この時に最大の動作マージンが得られる。こ
れらの重圧レベルは、第４図に示すよう々抵抗分割回路
によって発生している。
イアス比ａ−証＋ｉ、Ｎは時分割数）で示される値が最
適であり、この時に最大の動作マージンが得られる。こ
れらの重圧レベルは、第４図に示すよう々抵抗分割回路
によって発生している。
同図において、１１はスキャナ、１２．１３は選択スイ
ッチ、１４はデータ・ラッチ、１５はシフト・レジスタ
、１６はトランスミッション・ゲートを示す。また、Ｓ
ｌは走査信号、Ｓ２は交流信月、Ｄはデータを示す。同
図から明らかなように、電源電圧ＶＯから抵抗分割によ
って上述したような６レベルの電圧Ｖａ〜■ｆを得てい
る。
ッチ、１４はデータ・ラッチ、１５はシフト・レジスタ
、１６はトランスミッション・ゲートを示す。また、Ｓ
ｌは走査信号、Ｓ２は交流信月、Ｄはデータを示す。同
図から明らかなように、電源電圧ＶＯから抵抗分割によ
って上述したような６レベルの電圧Ｖａ〜■ｆを得てい
る。
しかし彦から、このよう々駆動回路によって液晶表示素
子を駆動］７た場合、実際には、特に高時分割駆動にお
いて駆動波形に歪が生じ、そのためにクロストーク電圧
が均一と々らず、表示むらが発生する。この表示むらは
、グラフィックディスプレイ、テレビ用など画面全面に
画素を配？１７（〜だ液晶表示素子においては特に顕著
であシ、表示品質を著しく劣化させる。
子を駆動］７た場合、実際には、特に高時分割駆動にお
いて駆動波形に歪が生じ、そのためにクロストーク電圧
が均一と々らず、表示むらが発生する。この表示むらは
、グラフィックディスプレイ、テレビ用など画面全面に
画素を配？１７（〜だ液晶表示素子においては特に顕著
であシ、表示品質を著しく劣化させる。
本発明は、以上のような状況に鑑みてなされたものであ
り、その目的は、液晶表示素子を飴、圧平均化法で１．
５分割駆動する場合に駆動波形の怪に起因（−で発生す
る表示むらを容易に消去し得る液晶表示素子の駆動回路
を提供することにある。
り、その目的は、液晶表示素子を飴、圧平均化法で１．
５分割駆動する場合に駆動波形の怪に起因（−で発生す
る表示むらを容易に消去し得る液晶表示素子の駆動回路
を提供することにある。
このよう力目的を達成するために、本発明は、電源電圧
を分圧して各重圧レベルを発生する分圧回路を走査側と
信号側とに分離し、走査側の２レベルの電圧の出力端子
間に可変インピーダンスを払・続１−で当該両電圧のレ
ベルを同貼にかつ互に逆向きに変化できるようにしたも
のである。
を分圧して各重圧レベルを発生する分圧回路を走査側と
信号側とに分離し、走査側の２レベルの電圧の出力端子
間に可変インピーダンスを払・続１−で当該両電圧のレ
ベルを同貼にかつ互に逆向きに変化できるようにしたも
のである。
即ち、前述したよう々表示むらは、液晶表示素子が咎価
的に容ガｔとみ々せるのに対１／、駆動回路が内部抵抗
を有することから、各駆動電圧のパルス波形が第２図に
示したような理想的ガ矩形状から第５図に実線で示した
波形のように崩れて来ることによる。この場合、同図に
示すようにこの波形歪は走査側で著しく、これに対して
信七（ｕｌｌでは殆んど無視し得る程度である。これｄ
：、液晶表示素子を時分割駆動する場合、時分割泌７の
増大は容易に行なえ々いところから、一般にできる限シ
走食電極数を少なく抑えることによる。このため、信号
電極に比べて走査電極数が少なく、従って個々の走査電
極に加わる負荷が大きくなるために、波形歪も大きくな
るものである。
的に容ガｔとみ々せるのに対１／、駆動回路が内部抵抗
を有することから、各駆動電圧のパルス波形が第２図に
示したような理想的ガ矩形状から第５図に実線で示した
波形のように崩れて来ることによる。この場合、同図に
示すようにこの波形歪は走査側で著しく、これに対して
信七（ｕｌｌでは殆んど無視し得る程度である。これｄ
：、液晶表示素子を時分割駆動する場合、時分割泌７の
増大は容易に行なえ々いところから、一般にできる限シ
走食電極数を少なく抑えることによる。このため、信号
電極に比べて走査電極数が少なく、従って個々の走査電
極に加わる負荷が大きくなるために、波形歪も大きくな
るものである。
このような走査電圧の波形歪により、駆１ｌＩＩｌ電川
の波形も第３図に示した理想的彦状態から第６図に実線
で示すように歪む。第６図において、（ａ）。
の波形も第３図に示した理想的彦状態から第６図に実線
で示すように歪む。第６図において、（ａ）。
（ｂ）で示される電圧Ｘ１−Ｙｇ １ Ｘｌ−Ｙｓが印
加された各画素は、本来第１図から明らかなように共に
非点灯状態にあシ、同じ明るさを示すべき画素であると
ころ、Ｘｌ−Ｙｓの波形の方がＸｓ−Ｙｇの波形の一′
、圧よシ実効値がわずかに大きくなるために、第１図に
示１−たようにＸＩ−Ｙｇの電圧が印加した画素の方が
Ｘａ−Ｙｇの画素よジわずかに暗くなる。この結果、背
景の均一性が失われて表示むらとなる。
加された各画素は、本来第１図から明らかなように共に
非点灯状態にあシ、同じ明るさを示すべき画素であると
ころ、Ｘｌ−Ｙｓの波形の方がＸｓ−Ｙｇの波形の一′
、圧よシ実効値がわずかに大きくなるために、第１図に
示１−たようにＸＩ−Ｙｇの電圧が印加した画素の方が
Ｘａ−Ｙｇの画素よジわずかに暗くなる。この結果、背
景の均一性が失われて表示むらとなる。
このように、高時分割駆動液晶表示素子の駆動波形の歪
による表示むらは、駆動回路系のインピーダンスが原因
であるから、このインピーダンスを少々くすることによ
り、表示むらが少々〈力ることＵ明らかである。１−か
しながら、駆動回路系のインピーダンスは、電源のイン
ピーダンス、駆動ＴＪＳ工のインピーダンス、駆動回路
と液晶表示素子との接続部のインピーダンス、更に、液
晶セル内部の配線のインピーダンスなど非常に多くの要
素か６；ｌ、Ｌかもこれら各要素それぞれの波形イエへ
の影響の程度は十分に解析できてい々い現状である。こ
れらの各インピーダンスをすべて十分に低（設計すれば
表示むらは少々くなると考えられるが、これはコストの
増大をもたらすものであって、容易に採用することはで
きない。
による表示むらは、駆動回路系のインピーダンスが原因
であるから、このインピーダンスを少々くすることによ
り、表示むらが少々〈力ることＵ明らかである。１−か
しながら、駆動回路系のインピーダンスは、電源のイン
ピーダンス、駆動ＴＪＳ工のインピーダンス、駆動回路
と液晶表示素子との接続部のインピーダンス、更に、液
晶セル内部の配線のインピーダンスなど非常に多くの要
素か６；ｌ、Ｌかもこれら各要素それぞれの波形イエへ
の影響の程度は十分に解析できてい々い現状である。こ
れらの各インピーダンスをすべて十分に低（設計すれば
表示むらは少々くなると考えられるが、これはコストの
増大をもたらすものであって、容易に採用することはで
きない。
これに対して本発明は、液晶が実効電圧依存性を有する
ことから、駆ｕｒ電圧の波形歪による実効値のずれを補
償すれば、実質的に企を消去１．たと等価に力ること、
バイアスｉｉｉ ＦＪＥ構成用の６電圧レベルを変化さ
せて行なうことにより、交３（ｉ、駆動の榮件を変える
こと在しに歪を消去できること、電圧の調整精度は目の
感度に対１．て十分に高いため、表示むらを消去するた
めのＤｉ整が等易に行なえること、等の観点から、電蝕
電圧を分圧１．て前ｈ「１各電圧レベルを発生する抵抗
分割回路にボリュームを入れたものである。以下、実施
例について説明する。
ことから、駆ｕｒ電圧の波形歪による実効値のずれを補
償すれば、実質的に企を消去１．たと等価に力ること、
バイアスｉｉｉ ＦＪＥ構成用の６電圧レベルを変化さ
せて行なうことにより、交３（ｉ、駆動の榮件を変える
こと在しに歪を消去できること、電圧の調整精度は目の
感度に対１．て十分に高いため、表示むらを消去するた
めのＤｉ整が等易に行なえること、等の観点から、電蝕
電圧を分圧１．て前ｈ「１各電圧レベルを発生する抵抗
分割回路にボリュームを入れたものである。以下、実施
例について説明する。
第７図は、本発明による液晶表示素子の駆動回路の一実
施例を示し、第４図と同一部分りま同一記号を用いてそ
の詳細説明を省略する。第７ｊツ１において、電流電圧
Ｖｏを分割して電圧Ｖａ＝Ｖｆをイ１する抵抗分割回路
を、走査側の４レベルＶａ＝Ｖａ ＋ Ｖｈ ＋ Ｖｅ
＋Ｖｆ＝Ｏを得る回路と、信号側の４レベルＶａ ｒ
Ｖｏ ＋ ｖｄ、 ＋Ｗｅを得る回路とに分離ｊ−１
かつ走査側の２レベルＶｂ 、 Ｖｅの出力端子間の抵
抗を〒ｉ］変措抗Ｒｖ＝（ａ−２）Ｒ＋ΔＲとしである
。従って谷乾１子に出力される電Ｖｃ＝ （１−’）Ｖ
ｏ 、ｖａ＝−ｖｏ 、Ｖｅ＝−Ｌｖｏ−ΔＶ、Ｖｆ＝
０とａ ａ ａな
り、第４図の回路に比較して走査側のｖｂおよびＶｅが
そわぞれΔＶだけ増減している。
施例を示し、第４図と同一部分りま同一記号を用いてそ
の詳細説明を省略する。第７ｊツ１において、電流電圧
Ｖｏを分割して電圧Ｖａ＝Ｖｆをイ１する抵抗分割回路
を、走査側の４レベルＶａ＝Ｖａ ＋ Ｖｈ ＋ Ｖｅ
＋Ｖｆ＝Ｏを得る回路と、信号側の４レベルＶａ ｒ
Ｖｏ ＋ ｖｄ、 ＋Ｗｅを得る回路とに分離ｊ−１
かつ走査側の２レベルＶｂ 、 Ｖｅの出力端子間の抵
抗を〒ｉ］変措抗Ｒｖ＝（ａ−２）Ｒ＋ΔＲとしである
。従って谷乾１子に出力される電Ｖｃ＝ （１−’）Ｖ
ｏ 、ｖａ＝−ｖｏ 、Ｖｅ＝−Ｌｖｏ−ΔＶ、Ｖｆ＝
０とａ ａ ａな
り、第４図の回路に比較して走査側のｖｂおよびＶｅが
そわぞれΔＶだけ増減している。
このため、これらの軍、圧レベルによって構成される矩
査霜１圧にｊ：、第５図に破線で示すように補正される
。この結果、第６図に示すように、非点灯画累に印加す
る電圧のうち、Ｘｌ−Ｙ２の実効値を上げると四囲にｘ
ｔ−ｙａの実効値を下げることにょシ、両者の実効ｍ′
ｉｉ＋、ｒ□圧を等しくすることができる。この場合、
第６図から明らかなように、駆動１ｂ２圧には直流成分
は残らず、従って、液晶に直流電、圧が加わって液晶を
労作させることも々い。調整にあたっては、液晶表示素
子をダ３際に７７７４動し、その表示を見々がら、表示
むらが最小に力るように可変抵抗Ｒｖを調整して駆動箱
１圧を変化させればよい。
査霜１圧にｊ：、第５図に破線で示すように補正される
。この結果、第６図に示すように、非点灯画累に印加す
る電圧のうち、Ｘｌ−Ｙ２の実効値を上げると四囲にｘ
ｔ−ｙａの実効値を下げることにょシ、両者の実効ｍ′
ｉｉ＋、ｒ□圧を等しくすることができる。この場合、
第６図から明らかなように、駆動１ｂ２圧には直流成分
は残らず、従って、液晶に直流電、圧が加わって液晶を
労作させることも々い。調整にあたっては、液晶表示素
子をダ３際に７７７４動し、その表示を見々がら、表示
むらが最小に力るように可変抵抗Ｒｖを調整して駆動箱
１圧を変化させればよい。
１だ、波形歪のばらつきが小さい場合には、予め一定の
補正電圧を決めて調整１−てもよい。
補正電圧を決めて調整１−てもよい。
以」＝説明ｌ−だように、本発明によれは、走簀電。
■−を桔″成する２つの電圧レベルを互に逆向きに同時
に変化させることによ）、走査電圧の波形歪による実効
値のずれを補正１．て電圧平均化法上必要々本来の実効
値電圧を確保することができるため、クロストーク電圧
の不均一による表示むらの発生を防＋ｈすることができ
るという優れた効果を有する。
に変化させることによ）、走査電圧の波形歪による実効
値のずれを補正１．て電圧平均化法上必要々本来の実効
値電圧を確保することができるため、クロストーク電圧
の不均一による表示むらの発生を防＋ｈすることができ
るという優れた効果を有する。
第１図は液晶表示素子の駆動回路の構成を示す説明図、
第２図および妃３図は、それぞれ重圧平均化法上理想的
々走査電圧、信七電圧および駆動電圧を示す波形図、第
４図は従来の抵抗分割回路を示す回路図、第５図および
第６図は、それぞれ実際の走査電圧、信号電圧および駆
動箱１圧の波形歪と本発明によるその補正例とを示す波
形図、第７図は本発明の一実施例を示す回路図である。 １・・・・走査電極、２・・・・信号側１極、１１・・
・・スキャナ、１２．１３・・・・選択スイッチ、１４
・・・・データ・ラッチ、１５・・・・シフト・レジス
タ、１６・・・・トランスミッションゲート、臼１・・
・・走査信号、ｓ２・・・・交流信号、Ｄ・・・・デー
タ、ｖｏ・・・・’Ｋ Ｘｔ電圧、Ｒｖ・・・・可変抵
抗。
第２図および妃３図は、それぞれ重圧平均化法上理想的
々走査電圧、信七電圧および駆動電圧を示す波形図、第
４図は従来の抵抗分割回路を示す回路図、第５図および
第６図は、それぞれ実際の走査電圧、信号電圧および駆
動箱１圧の波形歪と本発明によるその補正例とを示す波
形図、第７図は本発明の一実施例を示す回路図である。 １・・・・走査電極、２・・・・信号側１極、１１・・
・・スキャナ、１２．１３・・・・選択スイッチ、１４
・・・・データ・ラッチ、１５・・・・シフト・レジス
タ、１６・・・・トランスミッションゲート、臼１・・
・・走査信号、ｓ２・・・・交流信号、Ｄ・・・・デー
タ、ｖｏ・・・・’Ｋ Ｘｔ電圧、Ｒｖ・・・・可変抵
抗。
Claims (1)
- 電源電圧を分圧１〜て走査電圧および信号電圧を構成す
る各電圧レベルを発生する分圧回路を備え、液晶表示原
子を電圧平均化法によって時分割駆動する駆動回路にお
いて、前記分圧回路を短資側と信号側とに分Ｎ１．を−
で設け、走査側の２電圧レベルを取出す２出力端子間に
可変インピーダンスを接続して当該２電圧レベルを互に
逆向きに同時に変化できるようにしたととを特徴とする
液晶表示素子の駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13278081A JPS5834492A (ja) | 1981-08-26 | 1981-08-26 | 液晶表示素子の駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13278081A JPS5834492A (ja) | 1981-08-26 | 1981-08-26 | 液晶表示素子の駆動回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5834492A true JPS5834492A (ja) | 1983-02-28 |
Family
ID=15089368
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13278081A Pending JPS5834492A (ja) | 1981-08-26 | 1981-08-26 | 液晶表示素子の駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5834492A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6093487A (ja) * | 1983-10-27 | 1985-05-25 | 富士通株式会社 | 液晶表示装置用電源回路 |
| JPS6167893A (ja) * | 1984-09-12 | 1986-04-08 | 松下電器産業株式会社 | 表示素子駆動回路 |
| JPS6190197A (ja) * | 1984-10-09 | 1986-05-08 | 旭硝子株式会社 | マトリツクス型液晶表示装置の駆動方法 |
| JPS6225730A (ja) * | 1985-07-26 | 1987-02-03 | Mitsubishi Electric Corp | 液晶表示装置 |
| JPH03126988A (ja) * | 1989-10-12 | 1991-05-30 | Matsushita Electric Ind Co Ltd | 液晶パネルの駆動方法ならびに駆動回路 |
-
1981
- 1981-08-26 JP JP13278081A patent/JPS5834492A/ja active Pending
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6093487A (ja) * | 1983-10-27 | 1985-05-25 | 富士通株式会社 | 液晶表示装置用電源回路 |
| JPS6167893A (ja) * | 1984-09-12 | 1986-04-08 | 松下電器産業株式会社 | 表示素子駆動回路 |
| JPS6190197A (ja) * | 1984-10-09 | 1986-05-08 | 旭硝子株式会社 | マトリツクス型液晶表示装置の駆動方法 |
| JPS6225730A (ja) * | 1985-07-26 | 1987-02-03 | Mitsubishi Electric Corp | 液晶表示装置 |
| JPH03126988A (ja) * | 1989-10-12 | 1991-05-30 | Matsushita Electric Ind Co Ltd | 液晶パネルの駆動方法ならびに駆動回路 |
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