JPS5840601A - アナログ制御装置 - Google Patents
アナログ制御装置Info
- Publication number
- JPS5840601A JPS5840601A JP13769781A JP13769781A JPS5840601A JP S5840601 A JPS5840601 A JP S5840601A JP 13769781 A JP13769781 A JP 13769781A JP 13769781 A JP13769781 A JP 13769781A JP S5840601 A JPS5840601 A JP S5840601A
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- JP
- Japan
- Prior art keywords
- output
- analog
- transistor
- control
- voltage
- Prior art date
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- Pending
Links
Classifications
-
- G—PHYSICS
- G05—CONTROLLING; REGULATING
- G05B—CONTROL OR REGULATING SYSTEMS IN GENERAL; FUNCTIONAL ELEMENTS OF SUCH SYSTEMS; MONITORING OR TESTING ARRANGEMENTS FOR SUCH SYSTEMS OR ELEMENTS
- G05B7/00—Arrangements for obtaining smooth engagement or disengagement of automatic control
- G05B7/02—Arrangements for obtaining smooth engagement or disengagement of automatic control electric
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Automation & Control Theory (AREA)
- Feedback Control In General (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明はアナログ制御出力の２重化に関する４のであり
脣にアナログメモリを設けて制御出力の高儒ａｍ化を図
るようにし九アナログ制御装置に関するものである。
脣にアナログメモリを設けて制御出力の高儒ａｍ化を図
るようにし九アナログ制御装置に関するものである。
従来、アナログ出力０２重化は水銀リレーによる出力を
診断回路の結果に基づｂて切替える回路が採用されて暑
た。これをｊＩ１図に示す、１はｌ゛す費グＯ制御回路
でＴｏ４．２および３はアナログ出力回路である。アナ
ログ出力１ｄｌｌ＆２，３の出力線水銀リレー４の接点
５および６によシ相反的にいずれか１方の出力のみが出
力線７に伝えられる様になっている。出カーフはアナロ
グ制御回路１に入力されて本来出ているべき出力と比＃
照合される様になっておｐ、比較の結果これらが異なっ
ている場合、自己診断出力によ〉水銀リレー４が働き、
そのｂＩ１点２および１接点６によ〉今壕、でとは反対
の出力が出される。すなわち今壕でアナログ出力回路２
からの出力であればアナログ出力回路゛３からの出力と
なり、３であれば２の出力が出力−１７に得られる様に
なる。しかしながらこの様な従来の方法では、出力異常
が検出されてから切替ｐが行われる壇でリレーの動作時
間分の遅れが人や、この間誤出力を許容しなければなら
ない不都合があった。
診断回路の結果に基づｂて切替える回路が採用されて暑
た。これをｊＩ１図に示す、１はｌ゛す費グＯ制御回路
でＴｏ４．２および３はアナログ出力回路である。アナ
ログ出力１ｄｌｌ＆２，３の出力線水銀リレー４の接点
５および６によシ相反的にいずれか１方の出力のみが出
力線７に伝えられる様になっている。出カーフはアナロ
グ制御回路１に入力されて本来出ているべき出力と比＃
照合される様になっておｐ、比較の結果これらが異なっ
ている場合、自己診断出力によ〉水銀リレー４が働き、
そのｂＩ１点２および１接点６によ〉今壕、でとは反対
の出力が出される。すなわち今壕でアナログ出力回路２
からの出力であればアナログ出力回路゛３からの出力と
なり、３であれば２の出力が出力−１７に得られる様に
なる。しかしながらこの様な従来の方法では、出力異常
が検出されてから切替ｐが行われる壇でリレーの動作時
間分の遅れが人や、この間誤出力を許容しなければなら
ない不都合があった。
本発明は、仁の点を改良するもので切替の時間を値かく
し実質上誤出力のないア九ログ＃ＪＩｌ装置を得ること
を目的とする。
し実質上誤出力のないア九ログ＃ＪＩｌ装置を得ること
を目的とする。
以下１本発明の一実施例を説明する。第２図にνいて１
はアナログ制御回路でめシ、２１および３１はアナログ
出力を行う・ためのｌル′テージフォロワである。ボル
テージフォロワの出力には保護抵抗５１および６１を介
して、出力用トランジスタ９．ｌＯが接続されている。
はアナログ制御回路でめシ、２１および３１はアナログ
出力を行う・ためのｌル′テージフォロワである。ボル
テージフォロワの出力には保護抵抗５１および６１を介
して、出力用トランジスタ９．ｌＯが接続されている。
出力線２０は各々ボルテージフォロワ２１．３１に嘩還
されている。この回路はこのｉｔでは単なる高値優先回
路となってしまう。本発明のは出力トランジスタ９．１
０ のベースに出力阻止用のトランジスタ７．８を追
加したことにある。アナログの田カー２０はアナログ制
御回路ｌ、に入力されて本米出゛Ｃいるべき出力と比較
Ａ甘される。もし異っている場合、自己診断出力が信号
２２に出されこれがトランジスタ７をαＮすると共にイ
ンバータ４１にも加えられこれを’Ｊｋ’？させる。ト
ランジスタ７は常時Ｏｂ”？で高イ／ピーダンス状−に
６３＞ボルテジ７オロワ２１が出力トランジスタ９を制
御することを許しておりこの時トランジスタ８ハＯＮで
トランジスタｌＯのベースをＯ■に固定することによ如
ボルテジ７オロワ３１がトランジスタ１０−を制御する
のを禁じてお〉、異常が検出され丸場合これが反転する
。
されている。この回路はこのｉｔでは単なる高値優先回
路となってしまう。本発明のは出力トランジスタ９．１
０ のベースに出力阻止用のトランジスタ７．８を追
加したことにある。アナログの田カー２０はアナログ制
御回路ｌ、に入力されて本米出゛Ｃいるべき出力と比較
Ａ甘される。もし異っている場合、自己診断出力が信号
２２に出されこれがトランジスタ７をαＮすると共にイ
ンバータ４１にも加えられこれを’Ｊｋ’？させる。ト
ランジスタ７は常時Ｏｂ”？で高イ／ピーダンス状−に
６３＞ボルテジ７オロワ２１が出力トランジスタ９を制
御することを許しておりこの時トランジスタ８ハＯＮで
トランジスタｌＯのベースをＯ■に固定することによ如
ボルテジ７オロワ３１がトランジスタ１０−を制御する
のを禁じてお〉、異常が検出され丸場合これが反転する
。
このｍ迦制御はトランジスタ７．８のコレクタ、ＸＺツ
タ間飽飽和電圧トランジスタ９．１０（１）ベースエミ
ッタ電圧より常に低くでき乙ことにより可能となってい
る。
タ間飽飽和電圧トランジスタ９．１０（１）ベースエミ
ッタ電圧より常に低くでき乙ことにより可能となってい
る。
この方式による出力の切換えはトランジスタの応答がリ
レーに比べて格段に早いため出力が異常となっている時
間がほとんど無視でき外部に擾乱を与えることなく２重
系切換を行うことができる。
レーに比べて格段に早いため出力が異常となっている時
間がほとんど無視でき外部に擾乱を与えることなく２重
系切換を行うことができる。
アナログ制御回路は通常制御における連続性が要求され
るため第１図の１０ 、４２図の３００嫌にアナログメ
モリを付加することが多く制御回路故障時にアナログメ
モリだけでＩ′ｌＪ御を依待できる様にしている。しか
しこのアナログメモリはかな）の部品を必要とし信頼性
を依持する目的より上記の様なバンクアップが有効とな
。。
るため第１図の１０ 、４２図の３００嫌にアナログメ
モリを付加することが多く制御回路故障時にアナログメ
モリだけでＩ′ｌＪ御を依待できる様にしている。しか
しこのアナログメモリはかな）の部品を必要とし信頼性
を依持する目的より上記の様なバンクアップが有効とな
。。
尚以上の実施例では正の信号のみ扱うアナログ出力にて
説明したが第３図の様に負の信号の出カド２ンジスタ１
６とこれを阻止するインバータ７１゜トランジスタ８１
を追加すれば容易に両極性のアナログ制御回路にも適用
しうるう ４３図においてｌはアナログ制御回路、２１はボルテジ
フオロワ、 １３．１４は保鏝用抵抗、１５．１６は出
力用トランジスタ、７１はイ／パータ、１８．１９は１
５．１６のトランジスタの動作を禁止するトランジスタ
、１０１は２重系を構成した場合他系への自己診断出力
を出すインバータでめる。
説明したが第３図の様に負の信号の出カド２ンジスタ１
６とこれを阻止するインバータ７１゜トランジスタ８１
を追加すれば容易に両極性のアナログ制御回路にも適用
しうるう ４３図においてｌはアナログ制御回路、２１はボルテジ
フオロワ、 １３．１４は保鏝用抵抗、１５．１６は出
力用トランジスタ、７１はイ／パータ、１８．１９は１
５．１６のトランジスタの動作を禁止するトランジスタ
、１０１は２重系を構成した場合他系への自己診断出力
を出すインバータでめる。
尚本発明によるアナログ出力回路は出力点同志を単にワ
イヤードＯＲしたのみで２重化できることより、アナロ
グ制御回路の使用目的により２出力形とすることも２重
化ｌ出力形とすることも可能でおる点にも注意されたい
。
イヤードＯＲしたのみで２重化できることより、アナロ
グ制御回路の使用目的により２出力形とすることも２重
化ｌ出力形とすることも可能でおる点にも注意されたい
。
縞１図は従来例を示し九回路図、４２図および１ｍ３図
は本発明の一実施例を示す回路図である。 ｌ・・・ アナログ制御回路 ２．３・・ アナログ出
力回路４・・・水銀リレー １７．２０・ 出力線
ζ
は本発明の一実施例を示す回路図である。 ｌ・・・ アナログ制御回路 ２．３・・ アナログ出
力回路４・・・水銀リレー １７．２０・ 出力線
ζ
Claims (1)
- アナ目グ制御を行う制、御装置において、トランジスタ
を最終段出力として備え、アナログメモリ出力とこれの
バックアップとしてのアナログ出力を備え、自己診断回
路の出力によｊ）ランジスタの、ベースをコンシロール
することによｐ２つのアナログ出力を切替え制御が連続
的に行われることを特徴とするアナログ制御装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13769781A JPS5840601A (ja) | 1981-09-03 | 1981-09-03 | アナログ制御装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13769781A JPS5840601A (ja) | 1981-09-03 | 1981-09-03 | アナログ制御装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5840601A true JPS5840601A (ja) | 1983-03-09 |
Family
ID=15204689
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13769781A Pending JPS5840601A (ja) | 1981-09-03 | 1981-09-03 | アナログ制御装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5840601A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007298073A (ja) * | 2006-04-28 | 2007-11-15 | Hokuto Kenki Service Kk | 油圧駆動装置及び同装置を備えた挟み処理装置 |
-
1981
- 1981-09-03 JP JP13769781A patent/JPS5840601A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2007298073A (ja) * | 2006-04-28 | 2007-11-15 | Hokuto Kenki Service Kk | 油圧駆動装置及び同装置を備えた挟み処理装置 |
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