JPS5846882A - トランジスタチヨツパベ−ス電流制御回路 - Google Patents
トランジスタチヨツパベ−ス電流制御回路Info
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- JPS5846882A JPS5846882A JP56142239A JP14223981A JPS5846882A JP S5846882 A JPS5846882 A JP S5846882A JP 56142239 A JP56142239 A JP 56142239A JP 14223981 A JP14223981 A JP 14223981A JP S5846882 A JPS5846882 A JP S5846882A
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- Japan
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- circuit
- transistor
- diode
- capacitor
- series
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
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-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02P—CONTROL OR REGULATION OF ELECTRIC MOTORS, ELECTRIC GENERATORS OR DYNAMO-ELECTRIC CONVERTERS; CONTROLLING TRANSFORMERS, REACTORS OR CHOKE COILS
- H02P7/00—Arrangements for regulating or controlling the speed or torque of electric DC motors
- H02P7/06—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual DC dynamo-electric motor by varying field or armature current
- H02P7/18—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual DC dynamo-electric motor by varying field or armature current by master control with auxiliary power
- H02P7/24—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual DC dynamo-electric motor by varying field or armature current by master control with auxiliary power using discharge tubes or semiconductor devices
- H02P7/28—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual DC dynamo-electric motor by varying field or armature current by master control with auxiliary power using discharge tubes or semiconductor devices using semiconductor devices
- H02P7/2805—Arrangements for regulating or controlling the speed or torque of electric DC motors for regulating or controlling an individual DC dynamo-electric motor by varying field or armature current by master control with auxiliary power using discharge tubes or semiconductor devices using semiconductor devices whereby the speed is regulated by measuring the motor speed and comparing it with a given physical value
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Control Of Direct Current Motors (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
本発明は、電力用トランジスタチョッパ（装置に係り、
特にベース電流通電のための電源に関するものである。
特にベース電流通電のための電源に関するものである。
トランジスタチョッパのベース電流を流すのに、スイッ
チングレギュレータを用いる方法が採られているが、使
用部品が多くその構成が複雑であるとともに高価である
という欠点があった。
チングレギュレータを用いる方法が採られているが、使
用部品が多くその構成が複雑であるとともに高価である
という欠点があった。
本発明は構成が簡単でかつ安価なトランジスタチョッパ
ベース電圧検出回路を提供するにある。
ベース電圧検出回路を提供するにある。
このような目的を達成するために、本発明は、−コンデ
ンサを直列にして充電し、放電するときは並列にして行
なうことにより充電電流より放電電流を大きくするよう
に構成したものである。
ンサを直列にして充電し、放電するときは並列にして行
なうことにより充電電流より放電電流を大きくするよう
に構成したものである。
以下、実施例を用いて本発明の詳細な説明する。
−第１図は本発明によるトランジスタチョッパベース電
流制御回路の一実施例を示す回路図である。。
流制御回路の一実施例を示す回路図である。。
電源１間にはその電源供給側からモータ４、電流検出セ
ンサ５およびトランジスタチョッパ回路６の直列回路が
接続されている。また電源１はキースイッチに、８Ｗを
介して定電圧回路８に供給され、その定電圧は電圧検出
回路１２に供給されるようになっている。
ンサ５およびトランジスタチョッパ回路６の直列回路が
接続されている。また電源１はキースイッチに、８Ｗを
介して定電圧回路８に供給され、その定電圧は電圧検出
回路１２に供給されるようになっている。
一方、アクセル１０の出力は、通流率制御回路１１に入
力され、この通流率制御回路１１の出力はスイッチング
トランジスタＴ Ｒ２をオン・オフ制御し、後述するコ
ンデンサＣ３の電荷を前記スイッチングトランジスタＴ
Ｒ，、、抵抗Ｒ，＋ｌ 、 Ｒ，−２を介して、前記ト
ランジスタチョッパ回路６に入力させ、モータ４の速度
を加減するようになつぞいる。
力され、この通流率制御回路１１の出力はスイッチング
トランジスタＴ Ｒ２をオン・オフ制御し、後述するコ
ンデンサＣ３の電荷を前記スイッチングトランジスタＴ
Ｒ，、、抵抗Ｒ，＋ｌ 、 Ｒ，−２を介して、前記ト
ランジスタチョッパ回路６に入力させ、モータ４の速度
を加減するようになつぞいる。
一方、電流検出センサ５とトランジスタチョッパ回路６
との接続点と電源１の接地側との間には、コンデンサと
ダイオードで構成されたモジュール回路Ｍｓ 、Ｍｔが
接続され、ダイオードＤ１、抵抗Ｒ２を介した電荷がそ
れぞれモジュール回路Ｍ、、Ｍ２に蓄積されるようにな
っている。
との接続点と電源１の接地側との間には、コンデンサと
ダイオードで構成されたモジュール回路Ｍｓ 、Ｍｔが
接続され、ダイオードＤ１、抵抗Ｒ２を介した電荷がそ
れぞれモジュール回路Ｍ、、Ｍ２に蓄積されるようにな
っている。
モジュール回路Ｍ１は、コンデンサＣ１とダイオードＤ
６ との直列回路およびダイオードＤｙとコンデンサＣ
！との直列回路が並列接続され、かつコンデンサＣ３と
ダイオードＤ６の接続点とダイオードＤ、とコンデンサ
Ｃ１の接続点との間にダイオードＤ、が接続されて構成
されている。なお、ダイオードＤ、とコンデンサＣ２の
接続点と電源１の接地側にはダイオードＤ、が介在され
ている。
６ との直列回路およびダイオードＤｙとコンデンサＣ
！との直列回路が並列接続され、かつコンデンサＣ３と
ダイオードＤ６の接続点とダイオードＤ、とコンデンサ
Ｃ１の接続点との間にダイオードＤ、が接続されて構成
されている。なお、ダイオードＤ、とコンデンサＣ２の
接続点と電源１の接地側にはダイオードＤ、が介在され
ている。
ま斥、モジュール回路Ｍ２は、コンデンサＣ３とダイオ
ードＤ８との直列回路およびダイオードＤ、とコンデン
サＣ４との直列回路が並列接続され、かつコンデンサＣ
３とダイオードＤ６の接続点とダイオードＤ、とコンデ
ンサＣ４の接続点と−の間にダイオードＤ４が接続され
て構成されている。なお−コンデンサＣ３とダイオード
Ｄ、の接続点と抵抗Ｒ２とモジュール回路Ｍ１の接続点
にはダイオードＩ）ｔｏが接続されている。さらに、ダ
イオードＤｓとコンデンサＣ２の接続点およびダイオー
ドＤＩｏトコンデンサＣ３の接続点との間にはダ、イオ
ードＤ、が接続されている。
ードＤ８との直列回路およびダイオードＤ、とコンデン
サＣ４との直列回路が並列接続され、かつコンデンサＣ
３とダイオードＤ６の接続点とダイオードＤ、とコンデ
ンサＣ４の接続点と−の間にダイオードＤ４が接続され
て構成されている。なお−コンデンサＣ３とダイオード
Ｄ、の接続点と抵抗Ｒ２とモジュール回路Ｍ１の接続点
にはダイオードＩ）ｔｏが接続されている。さらに、ダ
イオードＤｓとコンデンサＣ２の接続点およびダイオー
ドＤＩｏトコンデンサＣ３の接続点との間にはダ、イオ
ードＤ、が接続されている。
このように接続されたモジュール回路Ｍ１．Ｍ２には電
源１からの電荷がキースイッチに、ＳＷおよび抵抗Ｒ８
を介し゛て蓄積されるようになっている。
源１からの電荷がキースイッチに、ＳＷおよび抵抗Ｒ８
を介し゛て蓄積されるようになっている。
キースイッチに、ＳＷおよび抵抗Ｒ３を介して前記モジ
ュール回路Ｍｓ 、Ｍｔに蓄積される電圧は、抵抗Ｒ８
とモジュール回路Ｍ＋ との接続点と電源１の接地側間
に直列接続された抵抗Ｒ３とツェナーダイオードＺＤ、
ｈこの°ツ手ナーダイオードＺＤ、間に並列接続された
コンデンサＣ３によって、一定電圧に保持されるように
なっている。
ュール回路Ｍｓ 、Ｍｔに蓄積される電圧は、抵抗Ｒ８
とモジュール回路Ｍ＋ との接続点と電源１の接地側間
に直列接続された抵抗Ｒ３とツェナーダイオードＺＤ、
ｈこの°ツ手ナーダイオードＺＤ、間に並列接続された
コンデンサＣ３によって、一定電圧に保持されるように
なっている。
とともに、電圧検出回路１２からの出力は、トランジス
タＴＲ，のペースに入力されこのトランジスタＴＲｓは
抵抗ＲｓＫ−並列に接続されてこのトモジュール回路Ｍ
ｔ 、Ｍｔに蓄積されている電荷を急速にトランジスタ
ＴＲ，に供給できるようになっている。なお、キースイ
ッチに、ＳＷと抵抗Ｒ８の接続点と、ダイオードＤ、。
タＴＲ，のペースに入力されこのトランジスタＴＲｓは
抵抗ＲｓＫ−並列に接続されてこのトモジュール回路Ｍ
ｔ 、Ｍｔに蓄積されている電荷を急速にトランジスタ
ＴＲ，に供給できるようになっている。なお、キースイ
ッチに、ＳＷと抵抗Ｒ８の接続点と、ダイオードＤ、。
とコンデンサＣ１の接続点間にはダイオードＤ１１と抵
抗Ｒ６の直列回路が接続され、コンデンサＣ１〜Ｃ４に
蓄えられた電圧が直流電源１の電圧よシ大きくならない
ようになっている。
抗Ｒ６の直列回路が接続され、コンデンサＣ１〜Ｃ４に
蓄えられた電圧が直流電源１の電圧よシ大きくならない
ようになっている。
このようにした構成において、コンデンサＣ１〜Ｃ４、
ダイオードＤ２〜ＤＩＧで構成されるモジュール回路Ｍ
、、Ｍ２は第２図に示すように充電される。そして、ア
クセル１０を踏み、通流率制御回ｑ １作動作、トラン
ジ；りＴＲ２がオンするとチョッパ回路６が導通し、ダ
イオードＤ、のアノード側・電圧がロー状態となる。
ダイオードＤ２〜ＤＩＧで構成されるモジュール回路Ｍ
、、Ｍ２は第２図に示すように充電される。そして、ア
クセル１０を踏み、通流率制御回ｑ １作動作、トラン
ジ；りＴＲ２がオンするとチョッパ回路６が導通し、ダ
イオードＤ、のアノード側・電圧がロー状態となる。
このため、モジュール回路Ｍ、、Ｍ、におけるコンデン
ｆＣ，〜Ｃ４の電荷は、第３図に示すように充電するよ
うになる。
ｆＣ，〜Ｃ４の電荷は、第３図に示すように充電するよ
うになる。
ここで用いられるコンデンサ０１〜Ｃ４の容量を同じも
のとしておくと、各コンデンサの充′成電圧は同じにな
り、図中点線で示すように放電するようになる。
のとしておくと、各コンデンサの充′成電圧は同じにな
り、図中点線で示すように放電するようになる。
そして、各コンデンサと直列に、２個のダイオードが接
続されるため、各放電量が均一になる。
続されるため、各放電量が均一になる。
今、トランジスタＴＲ２が導通すると、コンデンサＣｓ
の電荷が放電し、ツェナーダイオードＺＤ、のツェナ電
圧Ｖｚｏｌより小さくなる。どのとき電圧検出回路１２
が動作しトランジスタＴＲ３を導通させ、コンデンサ０
０〜Ｃ４の電荷を急速にトランジスタＴＲ２に供給する
ようになる。
の電荷が放電し、ツェナーダイオードＺＤ、のツェナ電
圧Ｖｚｏｌより小さくなる。どのとき電圧検出回路１２
が動作しトランジスタＴＲ３を導通させ、コンデンサ０
０〜Ｃ４の電荷を急速にトランジスタＴＲ２に供給する
ようになる。
コンデンサＣＩ−Ｃａは、充電時の電流より４倍の電流
を放電することが可能である。
を放電することが可能である。
このようにすれば、上述した説明から明らかなようにコ
ンデンサとダイオードとで構成されるため、従来のスイ
ッチングレギュレータを用いたものと比較して構成が極
めて簡単になる。
ンデンサとダイオードとで構成されるため、従来のスイ
ッチングレギュレータを用いたものと比較して構成が極
めて簡単になる。
また１、このようにすれば、チョッパ回路６がオフにな
ったとき、配線のインダクタンスＬ１の影響でトランジ
スタＴＲ，、、ＴＲ，２のコレクタ、電圧が大きく印加
されるのを、コンデンサ０１〜Ｃ４で吸収し得るため、
トランジスタＴ ＆ −＋ 、 Ｔ Ｒ１−２のコレク
タエミッタ間耐電圧を小さくすることができる効果を有
する。
ったとき、配線のインダクタンスＬ１の影響でトランジ
スタＴＲ，、、ＴＲ，２のコレクタ、電圧が大きく印加
されるのを、コンデンサ０１〜Ｃ４で吸収し得るため、
トランジスタＴ ＆ −＋ 、 Ｔ Ｒ１−２のコレク
タエミッタ間耐電圧を小さくすることができる効果を有
する。
第４図は本発明によるトランジスタチョッパペース電流
制御回路の他の実施例を示す構成図である。第１図と異
なる構成は、電流検出センサ５とトランジスタチョッパ
回路６の接続点と直流電源１の接地側間に、並列接続さ
れるモジュール回路を、モジュール回路Ｍ、、Ｍ、およ
びＭ、とじたことにある。
制御回路の他の実施例を示す構成図である。第１図と異
なる構成は、電流検出センサ５とトランジスタチョッパ
回路６の接続点と直流電源１の接地側間に、並列接続さ
れるモジュール回路を、モジュール回路Ｍ、、Ｍ、およ
びＭ、とじたことにある。
−このようにすれば、直流電源１からの充電電流より多
くの電流をペース電流に通電することができるようにな
る。
くの電流をペース電流に通電することができるようにな
る。
第５図は本発明によるトランジスタチョッパペース電流
制御回路の他の実施例を示す構成図である。同図におい
て、アクセル１０を最大に踏み込んだ際に、全開回路１
０が作動できるようになつ−ており、トランジスタＴＲ
１ｏが導通するにともないバイパスコンダクタ２１が動
作し、チョッパ回路６が短絡するようになっている。
制御回路の他の実施例を示す構成図である。同図におい
て、アクセル１０を最大に踏み込んだ際に、全開回路１
０が作動できるようになつ−ており、トランジスタＴＲ
１ｏが導通するにともないバイパスコンダクタ２１が動
作し、チョッパ回路６が短絡するようになっている。
また、抵抗Ｒ２とダイオードＤ１の直列回路と並列にツ
ェナーダイオードＺＤ２０％抵抗Ｒ２０、ダイオードＤ
、。の直列回路が設けられ、これによりチョッパ回路６
に流れるチョッパ電流が大きいときにコンデンサ０１〜
Ｃ４の充電が放電より大きくなるのを防止している。
ェナーダイオードＺＤ２０％抵抗Ｒ２０、ダイオードＤ
、。の直列回路が設けられ、これによりチョッパ回路６
に流れるチョッパ電流が大きいときにコンデンサ０１〜
Ｃ４の充電が放電より大きくなるのを防止している。
すなわちこのようにしておけば、第６図に示すようにチ
ョッパ回路６がオンになったとき点線で示したように放
電し、過大にコンデンサＣ１〜Ｃ４が充電されないこと
になる。
ョッパ回路６がオンになったとき点線で示したように放
電し、過大にコンデンサＣ１〜Ｃ４が充電されないこと
になる。
また、コンデンサ０１〜Ｃ４のそれぞれに、抵抗Ｒ５，
、およびツェナーダイオードＺ Ｄ３ｏ−＋ ｓ 抵抗
Ｒ８゜−２およびツェナーダイオードＺＤ３゜イ、抵抗
Ｒ３Ｇ−３およびツェナーダイオードＺＤ３０−３、抵
抗Ｒ３０−４およびツェナーダイオードＺＤ３０−４か
らなる直列回路を並列接続させて、チヨツ・（回路６が
オンになりすぐにオフになった場合、チョノノ（回路６
からの放電ができなくなるのを防止しｆいる。
、およびツェナーダイオードＺ Ｄ３ｏ−＋ ｓ 抵抗
Ｒ８゜−２およびツェナーダイオードＺＤ３゜イ、抵抗
Ｒ３Ｇ−３およびツェナーダイオードＺＤ３０−３、抵
抗Ｒ３０−４およびツェナーダイオードＺＤ３０−４か
らなる直列回路を並列接続させて、チヨツ・（回路６が
オンになりすぐにオフになった場合、チョノノ（回路６
からの放電ができなくなるのを防止しｆいる。
このようにすれば、第７図に示すように、コンデンサ０
１〜Ｃ４の電圧が大きくなると点線で示すように放電す
るようになる。
１〜Ｃ４の電圧が大きくなると点線で示すように放電す
るようになる。
ツェナ電圧Ｖ ｚ ｏ ３ ｏは、ＶＺＤ２０ より
大きくしておき、通常はツェナーダイオードＺＤ２０の
使用を多くシ、ツェナーダイオードＺ Ｄｓ。の使用を
少なくすることによシ、小容量のものが使用できるよ・
うにする。したがってこのようにすれば、低摩なツェナ
ーダイオードＺＤｓｏが使用できるという利点が得られ
る。
大きくしておき、通常はツェナーダイオードＺＤ２０の
使用を多くシ、ツェナーダイオードＺ Ｄｓ。の使用を
少なくすることによシ、小容量のものが使用できるよ・
うにする。したがってこのようにすれば、低摩なツェナ
ーダイオードＺＤｓｏが使用できるという利点が得られ
る。
以上述べたことから明らかなように、本発明によるトラ
ンジスタチョッパペース電流制御回路によれば、構成が
簡単で、かつ安価なものが得られる。
ンジスタチョッパペース電流制御回路によれば、構成が
簡単で、かつ安価なものが得られる。
第１図は本発明によるトランジスタチョツノくペース電
流制御回路の一実施例を示す回路図、第２図および第３
図は前記トランジスタチョツノくべ一゛ス電流制御回路
の動作を示す回路図、第４図は本発明によ為トランジス
タチョッパペ−ス電流制御回路の他の実施例を示す回路
図、第５図は本発明による。トランジスタチョツノくペ
ース電流制御回路の他の実施例を示す回路図、第６図お
よび第７図は第５図に示すトランジスタチョツノ（ベー
ス′電流制御回路の動作を示す回路図でおる。
流制御回路の一実施例を示す回路図、第２図および第３
図は前記トランジスタチョツノくべ一゛ス電流制御回路
の動作を示す回路図、第４図は本発明によ為トランジス
タチョッパペ−ス電流制御回路の他の実施例を示す回路
図、第５図は本発明による。トランジスタチョツノくペ
ース電流制御回路の他の実施例を示す回路図、第６図お
よび第７図は第５図に示すトランジスタチョツノ（ベー
ス′電流制御回路の動作を示す回路図でおる。
Claims (1)
- １、直流電源間に、モータ、トランジスタチョッパ回路
の直列回路が接続され、前記トランジスタチョッパ回路
のトランジスタがオフ時に生ずる電圧を蓄１回路に充電
し、この充電電荷を前記トランジスタチョッパ回路のベ
ース電流用心源として用いる速度制御装置において、前
記蓄電回路は、コンデンサおよびダイオード、を直列に
接続し、この直列回路に逆方向接続されたダイオードお
よびコンデンサの直列回路を並列接続させ、かつ容置列
回路のコンデンサとダイオードとの接続点をダイオード
を介して接続したモジュール回路としたことを特徴とす
るトランジスタチョッパベース電流制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56142239A JPS5846882A (ja) | 1981-09-11 | 1981-09-11 | トランジスタチヨツパベ−ス電流制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56142239A JPS5846882A (ja) | 1981-09-11 | 1981-09-11 | トランジスタチヨツパベ−ス電流制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5846882A true JPS5846882A (ja) | 1983-03-18 |
| JPS6227640B2 JPS6227640B2 (ja) | 1987-06-16 |
Family
ID=15310664
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56142239A Granted JPS5846882A (ja) | 1981-09-11 | 1981-09-11 | トランジスタチヨツパベ−ス電流制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5846882A (ja) |
-
1981
- 1981-09-11 JP JP56142239A patent/JPS5846882A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6227640B2 (ja) | 1987-06-16 |
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