JPS585146U - 入力盤電極 - Google Patents

入力盤電極

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JPS585146U
JPS585146U JP9653281U JP9653281U JPS585146U JP S585146 U JPS585146 U JP S585146U JP 9653281 U JP9653281 U JP 9653281U JP 9653281 U JP9653281 U JP 9653281U JP S585146 U JPS585146 U JP S585146U
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JP
Japan
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electrode
electrodes
input panel
matrix
panel electrode
Prior art date
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Application number
JP9653281U
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JPS592596Y2 (ja
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川北達次郎
長山忠洋
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NTT Inc
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Nippon Telegraph and Telephone Corp
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Publication date
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Publication of JPS585146U publication Critical patent/JPS585146U/ja
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Expired legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図および第２図は従来のダブルマトリクス式タブレ
ット形入力盤の原理および電極構成を説明するための図
、第３図〜第５図は本考案の実施例を示す図である。 ａｌｌ、ａ、２．〜ａ１ｎ、ａ１（ｎ＋ｔ）ｓ　（ａよ
、）、’　（（ａ□１）・・・・・・端子Ａ□に接続さ
れた電極、ａ２１〜ａ２ｎ＋　ａ２（ｎ＋＋）・・・・
・・端子Ａ２に接続された電極、ｂ１１＋　ｂ１２〜ｂ
１ｎ＋　（ｂｌｌ）＋（ｂ□□）・・・・・・端子Ｂ１
に接続された電極、］）ｎｌ　−ｂｒ＋２〜ｂゼ・・・
・・端子Ｂｎに接続された電極、７，８・・・・・・髭
状電極。

Claims (1)

    【実用新案登録請求の範囲】
  1. 第１の電極ａ１１　ｅ　３１２ｍ　”・ａｍｎ（Ｅ第２
    の電極ｂ１１゜ｂ工２＋　ｂｎｍを有し、第１の電極を
    行に、第２の電極を列に対応させ、第１の電極と第２の
    電極をマトリクス状に配置した電極の組ａＩｂ　ｂ１１
    ＊　ａ、　１２＊　ｂ２ｂ・・・ａｎ□、　ａ、、、ｎ
    を備えた第１の電極群と、これと同一の構成の第２の電
    極群とを、その一方の電極群を′行とし、他方を列とし
    て配列して、電極の交叉点を二重のマトリクス状に構成
    したダブルマトリクス式タブレット形入力装置の入力盤
    電極において、第１の電極として更に追加の電極ａ１．
    （、ｎ＋１　）　、ａ２（ｎ＋ｔ　）、＊・・・ａｍ（
    ｎ＋１）を設け、すべての第２の電極が笹１の電極によ
    って挾まれる電極配置としたことを特徴どする入力盤電
    極。
JP9653281U 1981-06-29 1981-06-29 入力盤電極 Expired JPS592596Y2 (ja)

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JP9653281U JPS592596Y2 (ja) 1981-06-29 1981-06-29 入力盤電極

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JPS585146U true JPS585146U (ja) 1983-01-13
JPS592596Y2 JPS592596Y2 (ja) 1984-01-24

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ID=29891382

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Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS6160117A (ja) * 1984-08-31 1986-03-27 Pentel Kk タブレット入力装置
JPS6160116A (ja) * 1984-08-31 1986-03-27 Pentel Kk タブレット入力装置
JPS62105325A (ja) * 1985-10-31 1987-05-15 シャープ株式会社 メンブレンタツチパネル
JP2012508415A (ja) * 2008-11-11 2012-04-05 エーティーラブ・インコーポレーテッド タッチパネル及びこれを備える入力装置

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Publication number Publication date
JPS592596Y2 (ja) 1984-01-24

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