JPS5852231B2 - キヤラクタデイスプレイ - Google Patents

キヤラクタデイスプレイ

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JPS5852231B2
JPS5852231B2 JP53044035A JP4403578A JPS5852231B2 JP S5852231 B2 JPS5852231 B2 JP S5852231B2 JP 53044035 A JP53044035 A JP 53044035A JP 4403578 A JP4403578 A JP 4403578A JP S5852231 B2 JPS5852231 B2 JP S5852231B2
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JP
Japan
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良治 今関
精一 服部
豊 水野
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FUANATSUKU KK
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FUANATSUKU KK
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    • G09—EDUCATION; CRYPTOGRAPHY; DISPLAY; ADVERTISING; SEALS
    • G09G—ARRANGEMENTS OR CIRCUITS FOR CONTROL OF INDICATING DEVICES USING STATIC MEANS TO PRESENT VARIABLE INFORMATION
    • G09G5/00—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators
    • G09G5/22—Control arrangements or circuits for visual indicators common to cathode-ray tube indicators and other visual indicators characterised by the display of characters or indicia using display control signals derived from coded signals representing the characters or indicia, e.g. with a character-code memory
    • G09G5/24—Generation of individual character patterns
    • G09G5/26—Generation of individual character patterns for modifying the character dimensions, e.g. double width, double height

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  • Physics & Mathematics (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Theoretical Computer Science (AREA)
  • Controls And Circuits For Display Device (AREA)

Description

【発明の詳細な説明】 本発明は、陰極線管表示装置を用いたキャラクタディス
プレイに関するものである。
陰極線管表示装置（昼下ＣＲＴと称する）は、通常表示
文字の大きさが予め定められており、使用する都度その
表示文字の大きさを変換することができないのが一般的
である。
しかし、表示文字の数及びその重要度に応じて、その都
度表示文字の大きさを所望の倍率で拡大表示できると便
利である。
ＣＲＴに於ける表示文字の大きさを変更するには、横方
向については電子ビームの走査速度を変更し、縦方向に
ついては１走査当りの垂直偏向量を変更するによって、
原理的には可能である。
しかし、走査速度の変更や垂直偏向量の変更は容易では
ない。
又キャラクタゼネレータのドツトパターンを１文字につ
いて複数種類記憶させて、表示文字の拡大の要求に応じ
て、切換えて読出すことも考えられるが、キャラクタゼ
ネレータの構成が複雑となり、実用的でないものである
。
第１図は従来のキャラクタディスプレイのフロツク図で
あり、図示しないキーボードや処理装置からの表示文字
データがデータバスＤＢを介してリフレッシュメモリＲ
Ｍに加えられ、又表示文字の位置を示す書込アドレスが
アドレスバスＡＢを介してマルチプレクサＭＰＸに加え
られ、その書込アドレスにより指定されたリフレッシュ
メモリＲＭの領域に表示文字データが書込まれる。
この表示文字データは制御回路ＣＲＴＣからの読出アド
レスがマルチプレクサＭＰＸを介してリフレッシュメモ
リＲＭに加えられて読出される。
読出された表示文字データはキャラクタアドレスＣＡと
してキャラクタアドレス選択回路ＣＡＳに加えられる。
又キャラクタクロック発生器ＣＨＣからのキャラクタク
ロックが制御回路ＣＲＴＣに加えられ、このキャラクタ
クロックに同期して制御回路ＣＲＴＣからリフレッシュ
メモリＲＭの読出アドレスが出力される。
又データバスＤＢを介してパラメータメモリＰＲＭに、
１行当りの表示文字数ａ、１画面当りの表示行数す、１
文字当りの走査線数（ロウ数）Ｃのデータがセットされ
、制御回路ＣＲＴＣはこのパラメータメモリＰＲＭの内
容に応じてリフレシュメモリＲＭの読出アドレス、ロウ
アドレス歩進パルスの発生等の制御をキャラクタクロッ
クに同期して行うものである。
ロウアドレス選択回路ＲＡＳは、ロウアドレス歩進パル
スＲＡによりロウアドレスを順次歩進する。
通常は走査線毎に歩進されることになる。又キャラクタ
ゼネレータＣＧは、表示可能の総ての文字について文字
間隔及び行間隔分を含めて複数のロウのドツトデータと
して記憶しておくもので、キャラクタアドレス選択回路
ＣＡＳからのキャラクタアドレス及びロウアドレス選択
回路ＲＡＳからのロウアドレスにより選択された文字の
ドツトデータを並列ドツトデータとして出力する。
この並列ドツトデータは、ドツトクロック発生器ＤＯＴ
Ｃからのドツトクロックにより並列直列変換器ＰＳＣに
於て直列ドツトデータに変換され、その直列ドツトデー
タは表示制御回路ＣＲＭＣに加えられ、制御回路ＣＲＴ
Ｃからの制御信号に応じて、ビデオ信号ＶＩＤＥＯ１水
平同期信号Ｈ１垂直同期信号Ｖを出力し、ＣＲＴに加え
られて文字表示が行われるものである。
第２図に示すように、１文字を７×９ドツトで表示し、
文字間を３ドツト分として文字表示する場合、ＤＯＴＣ
をドツトクロック発生器からのドツトクロック、ＣＨＣ
をキャラクタクロック発生器からのキャラクタクロック
とすると、第１０つＲ１のロウアドレスがロウアドレス
選択回路ＲＡＳからキャラクタゼネレータＣＧに加えら
れ、又キャラクタクロックに同期してリフレッシュメモ
リＲＭから表示文字データ即ちキャラクタアドレスＣＡ
が読出されてキャラクタアドレス選択回路ＣＡＳに加え
られ、そのキャラクタアドレスがキャラクタゼネレータ
ＣＧに加えられる。
第１行の第１文字が“Ａ″の場合、リフレッシュメモＩ
ＪＲＭから“（Ａ ｊ”の表示文字データが読出される
ので、キャラクタゼネレータＣＧからは、その“Ａｌ１
の第１０つＲ１の文字間ドツトを含むドツトデータが並
列に読出されて、並列直列変換器ＰＳＣに加えられる。
並列直列変換器ＰＳＣではドツトクロックに従って直列
ドツトデータに変換して表示制御回路ＣＲＭＣに加える
ことになる。
又第１行の第２文字が“Ｂ′の場合、キャラクタクロッ
クに同期して制御回路ＣＲＴＣからリフレッシュメモリ
ＲＭの次の読出アドレスが出力されて、文字“Ｂ′の表
示文字データが読出され、キャラクタゼネレータＣＧか
らは文字“Ｂ′”の第１０つＲ１の文字間ドツトを含む
ドツトデータが読出されて並列直列変換器ＰＳＣに加え
られる。
以下同様にして第１行の表示文字の第１０つＲ１のドツ
トデータが読出される。
１行当りの表示文字数ａのキャラクタクロックを制御回
路ＣＲＴＣでカウントすると、ロウアドレス歩進パルス
ＲＡが出力され、ロウアドレス選択回路ＲＡＳはロウア
ドレスを歩進させ、第２０つＲ２のアドレスを出力する
。
又制御回路ＣＲＴＣは、リフレッシュメモリＲＭから再
び第１行の第１文字から読出す読出アドレスを出力し、
読出された第１文字の“Ａ”の第２０つＲ２の文字間ド
ツトを含むドツトデータがキャラクタゼネレータＣＧか
ら読出され、次に第２文字の“Ｂ ｎの第２０つＲ２の
文字間ドツトを含むドツトデータが読出される。
以下同様にして第１行の表示文字の第２０つＲ２のドツ
トデータが読出される。
第１行の表示文字の第９０つＲ９のドツトデータの読出
しが終了し、且つ行間隔を示すドツトデータ（空白を示
すドツトデータ）の読出が終了すると、制御回路ＣＲＴ
Ｃは第２行の第１文字を読出すリフレッシュメモリＲＭ
の読出アドレスを出力し、キャラクタゼネレータＣＧか
らは、第２行の表示文字の第１０つのドツトデータが読
出されることになる。
以下同様にして１画面当りの表示行数すの表示動作が終
了すると、最初に戻り、リフレッシュメモＩＪＲＭから
第１行の表示文字データの読出しが行われる。
表示文字の拡大を行わせる為に、例えば特開昭５０−１
４４３４１号公報に示されているように。
少なくとも１行分のデータを記憶できる循環レジスタを
設け、表示文字の倍率に対応してクロックを分周し、そ
の分周されたクロックにより循環読出しを複数回繰り返
し行わせる構成が知られている。
しかし、１行分のデータを記憶する循環レジスタを必要
とする欠点がある。
又特開昭５０−１０４８３４号公報に示されているよう
に、表示文字サイズを指定するビットを設け、拡大文字
については指定ビットによりリフレッシュメモリの１文
字領域を太きくし、又１行分のバッファメモリを設けた
構成により、表示文字を拡大表示することが知られてい
る。
しかし、文字サイズを指定するビットを必要とすると共
に１行分のバッファメモリを必要とする欠点がある。
本発明は、表示文字の大きさを任意に且つ容易に変更す
ることができるようにすることを目的とするものである
。
以下実施例について詳細に説明する。
第３図は本発明の実施例の表示文字の説明図であり、縦
、横の文字寸法をそれぞれ２倍にした場合についてのも
のである。
横方向についてはドツトクロックＤＴＯＣ１及びキャラ
クタクロックＣＨＣｌの周期を２倍とし、縦方向につい
てはロウ数を２倍とするもので、キャラクタゼネレータ
の１つのロウ例えばＲ１についてＲ１１，Ｒ１２のよう
に、ドツトデータを２回繰り返して読出すものである。
従って、走査線の速度が一定であっても、ドツトクロッ
クとキャラクタクロックの周期が２倍になることにより
、走査線上ではドツトパターンが横方向に２倍となり、
又縦方向が９０つＲ１−Ｒ９であったものが、２倍の１
８０つＲ１１，Ｒ１２〜Ｒ９１、Ｒ９２となるので、第
２図に比較して２倍の大きさの表示文字となる。
第４図は本発明の実施例のブロック図であり、ＡＢｌは
アドレスバス、ＤＢｌはデータバス、ＲＭＩはリフレッ
シュメモリ、ＭＰＸＩはマルチプレクサ、ＰＲＭＩはパ
ラメータメモリ、ＣＲＴＣＩは制御回路、ＨＭＭは横倍
率設定メモリ、ＶＭＭは縦倍率設定メモリ、ＤＯＴＣｌ
はドツトクロック発生器、ＣＨＣｌはキャラクタクロッ
ク発生器、ＤＶｌ、ＤＶ２は分周回路、ＣＡＳｌはキャ
ラクタアドレス選択回路、ＲＡＳｌはロウアドレス選択
回路、ＣＧ１はキャラクタゼネレータ、ＰＳＣＩは並列
直列変換器、ＣＲＭＣＩは表示制御回路、ＣＡ１はキャ
ラクタアドレス、ＲＡｌはロウアドレス歩進パルス、Ｖ
ＩＤＥＯｌはビデオ信号、Ｈｌは水平同期信号、■１は
垂直同期信号である。
横方向及び縦方向の倍率データをキーボードや処理装置
から入力し、データバスＤＢＩを介して横方向の倍率デ
ータを横倍率設定メモＩＪＨＭＭにセットし、縦方向の
倍率データを縦倍率設定メモリＶＭＭにセットすると、
その倍率データに従って第１及び第２の分周回路ＤＶＩ
、ＤＶ２０分周比が設定される。
例えば第３図に示すように、横方向を２倍、縦方向を２
倍とした文字を表示する場合は、第１の分周回路ＤＶＩ
はドツトクロック及びキャラクタクロックを１／２に分
周するように設定され、第２の分周回路ＤＶ２はロウア
ドレス歩進パルスＲＡ１を１／２に分周するように設定
される。
従って分周回路ＤＶＩの出力は、第３図のＤＯＴＣｌ及
びＣＨＣｌで示すように、第２図に比較して２倍の周期
のドツトクロック及びキャラクタクロックとなる。
なお倍率の設定に於て、１行当りの表示文字数ａ、１画
面当りの表示行数ｂ、１文字当りのロウ数Ｃが設定倍率
に応じてデータバスＤＢを介してパラメータメモリＰＲ
ＭＩに再設定される。
１行分の表示文字数ａ即ちキャラクタクロックのカウン
ト値がａとなると、次の走査線に移行することになるが
、ロウアドレス選択回路ＲＡＳ１には、分周回路ＤＶ２
からロウアドレス歩進パルスが分周されて加えられるの
で、キャラクタゼネレータＣＧ１からは、同一ロウのド
ツトデータが２回繰り返して読出されることになる。
例えば第１行の第１文字の“Ａ″の第１０つのドツトデ
ータがキャラクタゼネレータＣＧＩから読出され、次に
第２文字の“′Ｂ″の第１０つのドットデータがキャラ
クタゼネレータＣＧ１から読出され、第１行の表示文字
の第１０つのドツトデータの読出しが終了すると、ロウ
アドレス選択回路ＲＡＳＩはロウアドレスの歩進をしな
いので、リフレッシュメモＩＪＲＭＩから第１行の第１
文字“′Ａ″の読出しが行われた場合、キャラクタゼネ
レータＣＧ１から再び文字“Ａ １１の第１０つのドツ
トデータが読出されることになる。
２回目の第１０つのドツトデータの読出しが終了すると
、ロウアドレス選択回路ＲＡＳ１は分周回路ＤＶ２の分
周出力によりロウアドレスの歩進を行うので、次は第２
０つのドツトデータの読出しが行われることになる。
即ち各ロウのドツトデータは２回読出されることになる
。
従って、１文字の縦方向は１８０つＲ１１゜Ｒ１２，・
・・・・・・・・Ｒ９１，Ｒ９２となり、縦方向に２倍
の表示文字となる。
行間隔も第２図に示す場合に比較して２倍となる。
横方向はドツトデータが２倍の周期で表示制御回路ＣＲ
ＭＣ１に加えられるので、２倍の表示文字となる。
又リフレッシュメモＩＪＲＭ１から順次読出される表示
文字データ即ちキャラクタアドレスＣＡ１の更新周期も
２倍となる。
前述のように、横方向の倍率をｎ、縦方向の倍率をｍと
すると、第１の分周回路Ｄ■１は１／ｎの分周を行い、
第２の分周回路ＤＶ２は１／ｍの分周を行う構成にそれ
ぞれ設定され、キャラクタゼネレータＣＧ１から同一ロ
ウのドツトデータがｍ回繰り返し読出されることになり
、又ドツトクロック及びキャラクタクロックがｎ倍の周
期となるので、リフレッシュメモリＲＭ１からの表示文
字データ即ちキャラクタアドレスＣＡ１の読出し周期が
ｎ倍となり、又並列直列変換器ｐｓｃ１に於ける並列ド
ツトデータを直列トッドデータに変換する周期もｎ倍と
なるので、縦方向にｍ倍で横方向にｎ倍の文字を表示す
るビデオ信号 ＶＩＤＥＯ１が表示制御回路ＣＲＭＣＩから出力される
。
なお水平同期信号Ｈ１及び垂直同期信号Ｖ１は表示文字
の大きさに関係なく同一の周期であり、ＣＲＴには縦方
向ｍ倍、横方向ｎ倍の文字が表示されることになる。
以上説明したように、本発明によれば、簡単な構成の第
１及び第２の分周回路ＤＶＩ 、ＤＶ２を設け、倍率設
定メモ’ＪＨＭＭ、ＶＭＭに設定された倍率に応じて分
周比を設定することにより、キャラクタゼネレータＣＧ
ｉの内容を変更することなく、任意の大きさに文字を表
示することができ、従来例のように１行分のメモリの追
加等を必要としないので、経済的な構成となる利点があ
る。
また、リフレッシュメモリＲＭから情報を読出すタイミ
ングの周期も倍率に応じて分周しているため、リフレッ
シュメモリＲＭの内容を変更することなく拡大文字を表
示させることが可能となる。
【図面の簡単な説明】
第１図は従来のキャラクタディスプレイのフロック図、
第２図は表示文字の説明図、第３図は本発明による表示
文字の説明図、第４図は本発明の実施例のブロック図で
ある。 ＡＢＩはアドレスバス、ＤＢＩはデータバス、ＲＭｌは
リフレッシュメモリ、ＭＰＸｌはマルチプレクサ、ＰＲ
Ｍｌはパラメータメモリ、ＣＲＴＣＩは制御回路、ＨＭ
Ｍは横倍率設定メモリ、ＶＭＭは縦倍率設定メモリ、Ｄ
ＯＴＣｌはドツトクロック発生器、ＣＨＣｌはキャラク
タクロック発生器、ＤＶＩ、ＤＶ２は第１及び第２の分
周回路、ＣＡＳＩはキャラクタアドレス選択回路、ＲＡ
ＳＩはロウアドレス選択回路、ＣＧｉはキャラクタゼネ
レータ、ＰＳＣｌは並列直列変換器、ＣＲＭＣｌは表示
制御回路、ＣＡ１はキャラクタアドレス、ＲＡＩはロウ
アアドレス歩進ハルスである。

Claims (1)

    【特許請求の範囲】
  1. １ 表示文字データを１画面分記憶しておくリフレッシ
    ュメモリ、該リフレッシュメモリからキャラクタクロッ
    クに同期して読出された表示文字データをキャラクタア
    ドレスとして加えるキャラクタアドレス選択回路、１０
    つのドツトデータを１行分読出したことにより発生され
    るロウアドレス歩進パルスによりロウアドレスを歩進す
    るロウアドレス選択回路、各文字を複数のロウのドツト
    データとして記憶し且つ前記キャラクタアドレス選択回
    路からのキャラクタアドレス及び前記ロウアドレス選択
    回路からのロウアドレスにより選択された前記ドツトデ
    ータが読出されるキャラクタゼネレータ、該キャラクタ
    ゼネレータから読出された並列ドツトデータをドツトク
    ロックにより直列ドツトデータに変換する並列直列変換
    器、該並列直列変換器の出力をビデオ信号に変換して表
    示させる表示制御回路とを備えたキャラクタディスプレ
    イに於て、表示文字の横方向倍率を設定する横倍率設定
    メモリ、表示文字の縦方向倍率を設定する縦倍率設定メ
    モリ、前記横倍率設定メモリの設定倍率に応じて前記ド
    ツトクロック及び前記キャラクタクロックを分周する第
    １の分周回路、前記縦倍率設定メモリの設定倍率に応じ
    て前記ロウアドレス選択回路の歩進を複数走査線毎に行
    わせて、同一ロウアドレスのドツトデータを複数回読出
    させるようにロウアドレス歩進パルスを分周する第２の
    分周回路とを備えたことを特徴とするキャラクタディス
    プレイ。
JP53044035A 1978-04-14 1978-04-14 キヤラクタデイスプレイ Expired JPS5852231B2 (ja)

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DE19792915075 DE2915075A1 (de) 1978-04-14 1979-04-12 Schriftzeichenanzeigevorrichtung

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JPS54136233A JPS54136233A (en) 1979-10-23
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JP (1) JPS5852231B2 (ja)
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FR (1) FR2423018A1 (ja)
GB (1) GB2024574B (ja)

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