JPS5852595B2 - マトリスク型液晶表示装置の駆動方法 - Google Patents
マトリスク型液晶表示装置の駆動方法Info
- Publication number
- JPS5852595B2 JPS5852595B2 JP54003588A JP358879A JPS5852595B2 JP S5852595 B2 JPS5852595 B2 JP S5852595B2 JP 54003588 A JP54003588 A JP 54003588A JP 358879 A JP358879 A JP 358879A JP S5852595 B2 JPS5852595 B2 JP S5852595B2
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- Japan
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- liquid crystal
- display device
- voltage
- approximately
- electrode
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- Liquid Crystal Display Device Control (AREA)
Description
【発明の詳細な説明】
本発明はマトリクス型液晶文字表示装置の駆動方法に関
するもので、具体的には液晶文字表示装置の低電圧時分
割駆動として最適な駆動方法を提供するものである。
するもので、具体的には液晶文字表示装置の低電圧時分
割駆動として最適な駆動方法を提供するものである。
従来、スタティック駆動法によって液晶数字表示装置を
駆動することが知られているが、この方式によれば、例
えば7セグメント1小数点N桁の液晶数字表示装置では
外部接続端子数が8N+1本(1本は液晶のバック電極
)となり、桁数が増すと外部接続端子数も大幅に増加し
、駆動のための周辺回路が複雑となり、それだけ信頼性
も低下する原因となった。
駆動することが知られているが、この方式によれば、例
えば7セグメント1小数点N桁の液晶数字表示装置では
外部接続端子数が8N+1本(1本は液晶のバック電極
)となり、桁数が増すと外部接続端子数も大幅に増加し
、駆動のための周辺回路が複雑となり、それだけ信頼性
も低下する原因となった。
また周辺回路をLSI (大規模集積回路)化しよう
とした場合外部接続端子数が多いと本来1個のLSIで
済むところが2個となりそれだけ高価な駆動回路となっ
た。
とした場合外部接続端子数が多いと本来1個のLSIで
済むところが2個となりそれだけ高価な駆動回路となっ
た。
また、スタティック駆動法では外部端子数が多くなるの
で、この外部接続端子数を減らす目的で、例えば、「日
経エレクトロニクスJ(1972゜5.8)に示される
様に、複数のX電極と複数のY電極との交点である表示
点の組合せによって文字が表示されるマトリクス型液晶
表示装置を時分割駆動を行なう方法も提案されているが
、時分割駆動を行うとクロストークの問題が生じている
。
で、この外部接続端子数を減らす目的で、例えば、「日
経エレクトロニクスJ(1972゜5.8)に示される
様に、複数のX電極と複数のY電極との交点である表示
点の組合せによって文字が表示されるマトリクス型液晶
表示装置を時分割駆動を行なう方法も提案されているが
、時分割駆動を行うとクロストークの問題が生じている
。
クロストークをなくする方法としては電圧平均化法(表
示点に選択状態で±Vo、半選択状態および非選択状態
で士−voの電圧を印加する法)が知られているが、従
来の電圧平均化法では駆動回路の出力段のスイッチング
素子に2■oの耐圧が必要であり、これは駆動回路をI
C化或いはLSI化する場合の大きな障壁となっていた
。
示点に選択状態で±Vo、半選択状態および非選択状態
で士−voの電圧を印加する法)が知られているが、従
来の電圧平均化法では駆動回路の出力段のスイッチング
素子に2■oの耐圧が必要であり、これは駆動回路をI
C化或いはLSI化する場合の大きな障壁となっていた
。
本発明は以上の諸点に鑑み発明されたもので、その目的
とするところは、マトリクス型液晶文字表示装置に於い
て、低電圧時分割駆動のできる新規な駆動方法を提供す
るにある。
とするところは、マトリクス型液晶文字表示装置に於い
て、低電圧時分割駆動のできる新規な駆動方法を提供す
るにある。
本発明の特徴とするところは、複数のX電極と複数のY
電極との交点である表示点の組合せによって文字が表示
されるマトリクス型液晶表示装置において、上記X電極
にV。
電極との交点である表示点の組合せによって文字が表示
されるマトリクス型液晶表示装置において、上記X電極
にV。
、■1、■2およびは1
ぼO(但しVlはほぼ−vo、v2はほぼ一■。
)3
の電圧のうちの二つを適宜選択して、この二つの電圧の
一つを表示時間単位のほぼ半分の期間に、他の一つの電
圧を残りの期間に夫々与えるとともに、上記Y電極にも
V。
一つを表示時間単位のほぼ半分の期間に、他の一つの電
圧を残りの期間に夫々与えるとともに、上記Y電極にも
V。
、■い■2およびOの電圧のうちの二つを適宜選択して
、この二つの電圧の一つを表示時間単位のほぼ半分の期
間に、他の一つの電圧を残りの期間に夫々与え、表示時
間単位毎に選択状態にある表示点にはほぼ士■oの電圧
を印加し、非選択および半選択状態にある表示点にはほ
ぼ士−■。
、この二つの電圧の一つを表示時間単位のほぼ半分の期
間に、他の一つの電圧を残りの期間に夫々与え、表示時
間単位毎に選択状態にある表示点にはほぼ士■oの電圧
を印加し、非選択および半選択状態にある表示点にはほ
ぼ士−■。
の電圧を印加するようにしたことにある。
本発明の1つの特徴はX電極およびY電極に印加される
電圧の大きさを駆動回路に与えられるアドレスとクロッ
クの位相によって決定するようにしていることである。
電圧の大きさを駆動回路に与えられるアドレスとクロッ
クの位相によって決定するようにしていることである。
本発明の他の目的並びに特徴は以下の実施例に基づく説
明より明らかになるであろう。
明より明らかになるであろう。
第1図は本発明の一実施例構成図を示すもので、マトリ
クス型液晶文字表示装置は、X電極3とY電極4との交
点が表示点となり、4×8の表示点で文字表示を行なう
。
クス型液晶文字表示装置は、X電極3とY電極4との交
点が表示点となり、4×8の表示点で文字表示を行なう
。
一つの文字は複数のX電極と複数のY電極との交点であ
る表示点の組合せによって表示される。
る表示点の組合せによって表示される。
これらX電極3、Y電極4はそれぞれX駆動回路8、Y
駆動回路6に接続されて駆動される。
駆動回路6に接続されて駆動される。
4個のY駆動回路6および8個のX駆動回路8をそれぞ
れY駆動回路列5、X駆動回路列7と称する。
れY駆動回路列5、X駆動回路列7と称する。
Y駆動回路列5にはリングカウンタからなる走査回路9
の走査信号およびクロック発生回路14から発生する周
波数2fRのクロックが入力する。
の走査信号およびクロック発生回路14から発生する周
波数2fRのクロックが入力する。
なお、走査信号の走査周波数はクロック発生回路13か
ら発生する周波数fRのクロックに同期している。
ら発生する周波数fRのクロックに同期している。
一方、X駆動回路列γにはデコーダからなる文字発生回
路10の出力信号とクロック発生回路14からのクロッ
クとが入力される。
路10の出力信号とクロック発生回路14からのクロッ
クとが入力される。
クロック発生回路14からのクロックはインバータ15
によって位相に反転され、Y駆動回路列5に入力される
ようになっており、X駆動回路列7のクロックの位相と
Y駆動回路列5の位相は逆に反転している。
によって位相に反転され、Y駆動回路列5に入力される
ようになっており、X駆動回路列7のクロックの位相と
Y駆動回路列5の位相は逆に反転している。
文字発生回路10の出力信号はクロック発生回路13か
ら発生するクロックと同期し、Y電極の走査との同期を
とっている。
ら発生するクロックと同期し、Y電極の走査との同期を
とっている。
したがって、文字発生回路10の出力文字を決定する入
力信号は、各Y電極に表示する文字を記憶しているメモ
リー1から与えられ、メモリー1の出力信号はクロック
発生回路13から発生するクロックと同期し、Y電極の
走査との同期をとっている。
力信号は、各Y電極に表示する文字を記憶しているメモ
リー1から与えられ、メモリー1の出力信号はクロック
発生回路13から発生するクロックと同期し、Y電極の
走査との同期をとっている。
このようにしてメモリー1に与えられた表示文字の情報
は液晶文字表示装置1の駆動信号に変換されて、時分割
にて液晶文字表示装置に加えられて、これを点灯する。
は液晶文字表示装置1の駆動信号に変換されて、時分割
にて液晶文字表示装置に加えられて、これを点灯する。
このとき表示文字の書換え、すなわちメモリー1の書換
えは表示文字入力装置12にて行われ、これは卓上電子
計算機の場合には演算回路に、時計の場合には時計回路
などに接続している。
えは表示文字入力装置12にて行われ、これは卓上電子
計算機の場合には演算回路に、時計の場合には時計回路
などに接続している。
第2図は本発明による駆動波形の一例を示すもので、X
電極信号Vx、Y電極信号vy、表示信号Vx−Vyを
選択状態に分けて示している。
電極信号Vx、Y電極信号vy、表示信号Vx−Vyを
選択状態に分けて示している。
第2図において■。
は液晶の点灯電圧である。X電極信号Vxは表示時間単
位り内に選択時にV。
位り内に選択時にV。
2
→0、非選択時に−Vo→−v。
となり、Y電極信3
号vyは表示時間単位Tw内に選択時に0→■o、1
非選択時に一■。
→−Voどなっている。3
この結果表示点に加わる信号Vx−Vyは表示時間単位
Tw内に選択状態のとき士■o、半選択状態のとき士−
■。
Tw内に選択状態のとき士■o、半選択状態のとき士−
■。
、非選択状態のときに半選択状態と位相が逆になり、±
−Voの交流電圧が加わっている。
−Voの交流電圧が加わっている。
第2図に示すような信号によってデユーディ比17Nの
時分割駆動方式をとると、選択点(点灯される表示点)
の印加電圧の実効値vs1は、となる。
時分割駆動方式をとると、選択点(点灯される表示点)
の印加電圧の実効値vs1は、となる。
また、非選択点(点灯されない表示点)
電圧の実効値vS2は、
の印加
となる。
矩形波信号に対する点灯しきい値電圧の実効値をvth
とすると、クロストークを防止して液晶文字表示装置を
点灯するためには(1)、(2)式より次の関係が成り
立つ。
とすると、クロストークを防止して液晶文字表示装置を
点灯するためには(1)、(2)式より次の関係が成り
立つ。
vS2≦vth≦vs 1 =(3)(3)式に
(1)、(2)式を代入し、vo について整理すると
、 となる。
(1)、(2)式を代入し、vo について整理すると
、 となる。
いまN=4のとき、
き)(4)式は、
(デユーティ比1/4のと
、/’1vth≦Vo≦3Vth
・・・・・・・・・(5)
となり、N=8のとき、(デユーティ比1/8のとき)
(4)式は、 刀vth≦7・≦37比 ・・・・・・・・・(6) となる。
(4)式は、 刀vth≦7・≦37比 ・・・・・・・・・(6) となる。
したがって、N=4、Vth=6Vのときは、(5)式
は、10.4V≦Vo≦18V となり、低電圧駆動が
可能となることが理解できる。
は、10.4V≦Vo≦18V となり、低電圧駆動が
可能となることが理解できる。
N=4のときの選択点に加わる信号および非選択点に加
わる信号の波形を第3図A、Bに示している。
わる信号の波形を第3図A、Bに示している。
第2図のような信号を実現する具体的な駆動回路(第1
図の駆動回路6,8に相当)の例を第4図、第5図、第
6図に示している。
図の駆動回路6,8に相当)の例を第4図、第5図、第
6図に示している。
第4図において、Ql、Q2.Q3はスイッチングトラ
ンジスタ、R,2R,4Rは抵抗、22,23,24は
ノアゲート、21はインバータ、Aはアドレス、Cはク
ロックである。
ンジスタ、R,2R,4Rは抵抗、22,23,24は
ノアゲート、21はインバータ、Aはアドレス、Cはク
ロックである。
アドレスA、クロックCに対するスイッチングトランジ
スタQ1〜Q3のオン、オフ状態および出力電圧の関係
は第1表の通りである。
スタQ1〜Q3のオン、オフ状態および出力電圧の関係
は第1表の通りである。
第1表から明らかなごとく、アドレスA、クロツクCの
組合せにより任意の出力電圧〒■・、−V。
組合せにより任意の出力電圧〒■・、−V。
、0、voが得られるものである。第5図におけるアド
レスAとクロックCに対するスイッチングトランジスタ
Q1〜Q3のオン・オフ状態および出力電圧の関係は第
2表の通りである。
レスAとクロックCに対するスイッチングトランジスタ
Q1〜Q3のオン・オフ状態および出力電圧の関係は第
2表の通りである。
同じく第6図のものは第3表の通りである。
尚第5図、第6図においてR1,R2は抵抗、Dl。
D2はダイオード、31,34はインバータ、32.3
3はノアゲートである。
3はノアゲートである。
第5図と第6図の違いはダイオードD2の接続が違って
いるだけでその他は同じである。
いるだけでその他は同じである。
第4図〜第6図においてアドレスAは第1図の走査回路
9および文字発生回路の出力に相当する。
9および文字発生回路の出力に相当する。
第1図は第5図の駆動回路を用いてデユーティ比(N=
4)の場合について線順次走査のときの各部の動作波形
を示したものである。
4)の場合について線順次走査のときの各部の動作波形
を示したものである。
X電極信号をVx、XアドレスをAx、X電極のクロッ
クをCx、Y電極信号をvy、yアドレスをAy、Y電
極のクロックをCy、表示点信号をVx−Vy で示し
ている。
クをCx、Y電極信号をvy、yアドレスをAy、Y電
極のクロックをCy、表示点信号をVx−Vy で示し
ている。
X駆動回路ではクロック信号Cxを加え、Xアドレスに
は選択時に「1ルベル、非選択時には「0」レベルの信
号を加える。
は選択時に「1ルベル、非選択時には「0」レベルの信
号を加える。
このときX電極信号はVxのごとくなる。
Y駆動回路においても同様に、Cxと逆相のクロック信
号Cyを加えて、Yアドレスには選択時に「1」レベル
、非選択時に「0」レベルの信号を加える。
号Cyを加えて、Yアドレスには選択時に「1」レベル
、非選択時に「0」レベルの信号を加える。
このときのY電極信号はVyのごとくなる。
この結果、選択状態には±vo、半選択状態非選択状態
には±1−v。
には±1−v。
の信号がかかり、交流駆動電圧平均化法によってマトリ
クス型液晶文字表示装置の時分割駆動方法が実現される
。
クス型液晶文字表示装置の時分割駆動方法が実現される
。
尚以上の実施例では、点灯電圧■。
を−■o とVoに分割し、これらの組合せにより表示
点に選択状態では±vo、半選択状態および非選択状態
では士−■。
点に選択状態では±vo、半選択状態および非選択状態
では士−■。
の電圧を印加するようにしたので1 2
1 あるが、−Vo、−■。
1 あるが、−Vo、−■。
の意味は、−Vo=v2.3 3
3 3Vo=■1としたとき■。
3 3Vo=■1としたとき■。
〉■1〉■2〉0 であって、電圧V。
、接地電位、vl、V2O組合せにより表示点に加わる
電圧を選択状態に士■o、手選択状態および非選択状態
にほぼ士−■。
電圧を選択状態に士■o、手選択状態および非選択状態
にほぼ士−■。
の電圧が印加できるものであればよい。
このように本発明によれば、低電圧駆動が可能になり、
駆動回路に用いるスイッチング素子の耐圧はV。
駆動回路に用いるスイッチング素子の耐圧はV。
となり、またX、駆動回路およびY駆動回路は同じ回路
構成となり、その他の論理回路と合せて大規模集積回路
化が容易となる。
構成となり、その他の論理回路と合せて大規模集積回路
化が容易となる。
第1図は本発明の一実施例構成図、第2図、第3図は本
発明による駆動波形の一9’lJを示す図、第4〜6図
はそれぞれ本発明による1駆動回路の具体例を示す図、
第7図は本発明の動作説明用波形図、である。 1・・・・・・マトリクス型液晶文字表示装置、3・・
・・・・X電極、4・・・・・・Y電極、5・・・・・
・Y駆動回路列、6・・・・・・Y駆動回路、T・・・
・・・X駆動回路列、8・・・・・・X駆動回路、9・
・・・・・走査回路、10・・・・・・文字発生回路、
11・・・・・・メモリ。
発明による駆動波形の一9’lJを示す図、第4〜6図
はそれぞれ本発明による1駆動回路の具体例を示す図、
第7図は本発明の動作説明用波形図、である。 1・・・・・・マトリクス型液晶文字表示装置、3・・
・・・・X電極、4・・・・・・Y電極、5・・・・・
・Y駆動回路列、6・・・・・・Y駆動回路、T・・・
・・・X駆動回路列、8・・・・・・X駆動回路、9・
・・・・・走査回路、10・・・・・・文字発生回路、
11・・・・・・メモリ。
Claims (1)
- 【特許請求の範囲】 1 複数のX電極と複数のY電極との交点である表示点
の組合せによって文字が表示されるマトリクス型液晶表
示装置において、上記X電極に、■。 、■0、■2およびほぼO(但し■1はほぼ1 3■o、■2はほぼ一■。 )の電圧のうちの二つを適宜選択して、この二つの電圧
の一つを表示時間単位のほぼ半分の期間に、他の一つの
電圧を残りの期間に夫々与えるとともに、上記Y電極に
もvo、Vl、■2および0の電圧のうちの二つを適宜
選択して、この二つの電圧の一つを表示時間単位のほぼ
半分の期間に、他の一つの電圧を残りの期間に夫々与え
、表示時間単位毎に選択状態にある表示点にほぼ士■o
の電圧を印加し、非選択および半選択状態にある表示点
にほぼ士−■。 の電圧を印加するようにしたことを特徴とするマトリク
ス型液晶表示装置の駆動方法。 2 前記特許請求の範囲第1項記載のマトリクス型液晶
表示装置の駆動方法において、上記X電極および上記Y
電極に加えられる電圧はクロック信号に同期させて加え
るようにしたことを特徴とするマトリクス型液晶表示装
置の駆動方法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP54003588A JPS5852595B2 (ja) | 1979-01-08 | 1979-01-08 | マトリスク型液晶表示装置の駆動方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP54003588A JPS5852595B2 (ja) | 1979-01-08 | 1979-01-08 | マトリスク型液晶表示装置の駆動方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS55140887A JPS55140887A (en) | 1980-11-04 |
| JPS5852595B2 true JPS5852595B2 (ja) | 1983-11-24 |
Family
ID=11561612
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP54003588A Expired JPS5852595B2 (ja) | 1979-01-08 | 1979-01-08 | マトリスク型液晶表示装置の駆動方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5852595B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5945493A (ja) * | 1982-09-08 | 1984-03-14 | セイコーエプソン株式会社 | 液晶電気光学装置の駆動方法 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5311171B2 (ja) * | 1973-02-09 | 1978-04-19 |
-
1979
- 1979-01-08 JP JP54003588A patent/JPS5852595B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS55140887A (en) | 1980-11-04 |
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