JPS5854697B2 - ２線式デイジタル加入者装置 - Google Patents
２線式デイジタル加入者装置Info
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- JPS5854697B2 JPS5854697B2 JP54095413A JP9541379A JPS5854697B2 JP S5854697 B2 JPS5854697 B2 JP S5854697B2 JP 54095413 A JP54095413 A JP 54095413A JP 9541379 A JP9541379 A JP 9541379A JP S5854697 B2 JPS5854697 B2 JP S5854697B2
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04Q—SELECTING
- H04Q11/00—Selecting arrangements for multiplex systems
- H04Q11/04—Selecting arrangements for multiplex systems for time-division multiplexing
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Data Exchanges In Wide-Area Networks (AREA)
- Use Of Switch Circuits For Exchanges And Methods Of Control Of Multiplex Exchanges (AREA)
Description
【発明の詳細な説明】
この発明は時分割方向制御形伝送方式によるディジタル
通信において、２線式線路で伝送された情報を４線式伝
送路の情報に変換すると共に時分割的に集線、多重もし
くは交換することを可能とする加入者装置に関するもの
である。
通信において、２線式線路で伝送された情報を４線式伝
送路の情報に変換すると共に時分割的に集線、多重もし
くは交換することを可能とする加入者装置に関するもの
である。
ディジタル双方向情報を２線式線路で伝送する方法の１
つに時分割方向制御形伝送方式（例えば電子通信学会通
信方式研究会資料“全ディジタル電話加入者系の構成法
に関する考察”Ｃ３７８−２０参照）がある。
つに時分割方向制御形伝送方式（例えば電子通信学会通
信方式研究会資料“全ディジタル電話加入者系の構成法
に関する考察”Ｃ３７８−２０参照）がある。
第１図はこの従来の時分割方向制御形伝送方式の構成を
示す図であり、１は２線式線路との接続端子、２は２線
式線路と４線式線路とを接続する平衡−不平衡変換トラ
ンス、３は４線側送信情報入力端子、４は４線側受信信
号出力端子、５はトランス２を通じて２線式線路へ信号
を送出する送信器、６は入力端子３の情報を一時記憶し
て送信器５へ送出する送信一時記憶装置、Ｔはトランス
２よりの２線式線路よりの信号を受信する受信器、８は
受信器７の信号を一時記憶して出力端子４へ送出する受
信一時記憶装置である。
示す図であり、１は２線式線路との接続端子、２は２線
式線路と４線式線路とを接続する平衡−不平衡変換トラ
ンス、３は４線側送信情報入力端子、４は４線側受信信
号出力端子、５はトランス２を通じて２線式線路へ信号
を送出する送信器、６は入力端子３の情報を一時記憶し
て送信器５へ送出する送信一時記憶装置、Ｔはトランス
２よりの２線式線路よりの信号を受信する受信器、８は
受信器７の信号を一時記憶して出力端子４へ送出する受
信一時記憶装置である。
第２図は第１図の動作説明用のタイミング図であってＡ
は入力端子３への入力信号、Ｂは２線式線路接続端子１
における送受信信号、Ｃは出力端子４の出力信号、Ｔｆ
はフレーム周期、Ｔｂはバースト周期、５ｉ（ｉ＝ｏ、
１，２，３）はフレーム周期Ｔｆで区切られた送信信号
、Ｒｉ（ｉ＝ｏ、１，２，３）はフレーム周期Ｔｆで区
切られた受信信号である。
は入力端子３への入力信号、Ｂは２線式線路接続端子１
における送受信信号、Ｃは出力端子４の出力信号、Ｔｆ
はフレーム周期、Ｔｂはバースト周期、５ｉ（ｉ＝ｏ、
１，２，３）はフレーム周期Ｔｆで区切られた送信信号
、Ｒｉ（ｉ＝ｏ、１，２，３）はフレーム周期Ｔｆで区
切られた受信信号である。
第２図を用いて従来の伝送方式を説明する。
いまｎＫｂ／ｓを送信し、同時にｎＫｂ／ｓを受信する
とする。
とする。
入力端子３の送信信号はフレーム周期Ｔｆ毎に区分され
てＳｉなるブロックに分割され、送信一時記憶装置６に
書込まれる。
てＳｉなるブロックに分割され、送信一時記憶装置６に
書込まれる。
この書込まれたデ−タはこの記憶装置６から２ｎより早
い速度（速度＝１／ＴＢ）で続出され、送信器５から２
線式線路端子１へ送出される。
い速度（速度＝１／ＴＢ）で続出され、送信器５から２
線式線路端子１へ送出される。
受信動作は以上の逆の動作で行なわれる。
このようにして２線式線路を用いた双方向伝送は可能と
なる。
なる。
この従来技術では端子３，４の入力信号、出力信号は第
２図Ａ、Ｃに示す如＜ ｎＫＨｚの速度であるため、こ
の信号を多重化する場合、再度データ速度を所要の速度
に変換する操作、例えば直列並列変換を行なった後多重
化して並列−直列変換する等の操作が必要であった。
２図Ａ、Ｃに示す如＜ ｎＫＨｚの速度であるため、こ
の信号を多重化する場合、再度データ速度を所要の速度
に変換する操作、例えば直列並列変換を行なった後多重
化して並列−直列変換する等の操作が必要であった。
この発明は４線式線路において集線もしくは交換動作を
必要に応じて可能にするため送信もしくは受信２時記憶
装置の読出しもしくは書込み速度を集線、多重もしくは
交換に必要な速度に一致させ、更に２線式線路上でのフ
レーム構成とはフレーム周期も異なり、フレーム内の任
意の時間位置へ読出しもしくは当該時間位置から書込む
ようにしたものである。
必要に応じて可能にするため送信もしくは受信２時記憶
装置の読出しもしくは書込み速度を集線、多重もしくは
交換に必要な速度に一致させ、更に２線式線路上でのフ
レーム構成とはフレーム周期も異なり、フレーム内の任
意の時間位置へ読出しもしくは当該時間位置から書込む
ようにしたものである。
第３図はこの発明による加入者装置の実施例であって、
９は送信一時記憶装置６に対する書込みアドレス指定回
路、１０は受信一時記憶装置８に対する読出しアドレス
指定回路、その他の１〜８は第１図の同一符号と同じで
ある。
９は送信一時記憶装置６に対する書込みアドレス指定回
路、１０は受信一時記憶装置８に対する読出しアドレス
指定回路、その他の１〜８は第１図の同一符号と同じで
ある。
第４図は第３図に示した装置の動作説明用のタイミング
図であってＡは入力端子３への入力信号、Ｂは２線式線
路端子１における信号、Ｃは出力端子４での出力信号、
Ｔｇは端子３，４でのフレーム周期、ｋｉ（ｉ＝１〜５
）は端子３，４でのフレームを構成するタイムスロット
番号（こＸではに１〜に、までの５タイムスロツトとし
たが、これは説明上の便宜的な数であり、任意のタイム
スロット数でよい）その他の記号は第２図の同一記号と
同じである。
図であってＡは入力端子３への入力信号、Ｂは２線式線
路端子１における信号、Ｃは出力端子４での出力信号、
Ｔｇは端子３，４でのフレーム周期、ｋｉ（ｉ＝１〜５
）は端子３，４でのフレームを構成するタイムスロット
番号（こＸではに１〜に、までの５タイムスロツトとし
たが、これは説明上の便宜的な数であり、任意のタイム
スロット数でよい）その他の記号は第２図の同一記号と
同じである。
第３図に示す実施例を第４図の動作タイミングを使って
説明する。
説明する。
４線式の端子３，４でのフレーム周期Ｔｇと２線式の端
子１でのフレーム周期Ｔｆは互いに有理数の関係を満足
すれば、最小公倍数のフレーム周期毎に情報の出入量が
一致するためその情報量に一致する一時記憶装置を送受
信部に置けることにより、情報は伺ら欠損、余剰なく２
線端子１と４線端子３，４との間に伝搬することが可能
である。
子１でのフレーム周期Ｔｆは互いに有理数の関係を満足
すれば、最小公倍数のフレーム周期毎に情報の出入量が
一致するためその情報量に一致する一時記憶装置を送受
信部に置けることにより、情報は伺ら欠損、余剰なく２
線端子１と４線端子３，４との間に伝搬することが可能
である。
いま、端子３，４でのフレーム上でに２タイムスロツト
の情報を端子１へ送信もしくは端子１より受信する状態
を考える。
の情報を端子１へ送信もしくは端子１より受信する状態
を考える。
端子１からフレーム構成毎に到来する情報、例えば信号
Ｒ１＋Ｒ２は受信器７を経由して一時記憶装置８に一時
記憶される。
Ｒ１＋Ｒ２は受信器７を経由して一時記憶装置８に一時
記憶される。
アドレス指定回路１０ではこの一時記憶された情報を、
Ｔｇ周期のに２タイムスロツト位置において信号Ｒ１を
読出し、次のＴｇ周期に信号Ｒ２を読出す。
Ｔｇ周期のに２タイムスロツト位置において信号Ｒ１を
読出し、次のＴｇ周期に信号Ｒ２を読出す。
逆に入力端子３に二つのＴｇ周期の各に２タイムスロツ
ト位置で入力される二つの情報Ｓ１．Ｓ２はアドレス指
定回路９によって当該に２タイムスロツト時に順次一時
記憶装置６に書込まれ一時記憶装置６からはＴｆ周期で
その情報が二つづつ読出される。
ト位置で入力される二つの情報Ｓ１．Ｓ２はアドレス指
定回路９によって当該に２タイムスロツト時に順次一時
記憶装置６に書込まれ一時記憶装置６からはＴｆ周期で
その情報が二つづつ読出される。
この操作を繰返し行うことによって４線式端子３，４で
のフレーム上で任意タイムスロットに位置する情報と２
線式伝送路端子１との接続が可能となる。
のフレーム上で任意タイムスロットに位置する情報と２
線式伝送路端子１との接続が可能となる。
こ＼でアドレス指定回路９と１０は単独に設置してもよ
いし、また共用することも可能である。
いし、また共用することも可能である。
以上説明したようにこの発明によれば、２線式加入者線
伝送方式の２線式線路上のフレーム長と４線側のフレー
ム長を異ならすことができ、かつ４線側フレーム内の任
意タイムスロットの情報を２線式線路へ送信かつ受信す
ることができるのでこの効果を利用して４線側で多重、
集線、交換等の操作を時分割多重動作で行う場合、一時
記憶装置９，１０に対し直接アクセスすることにより多
重、集線もしくは交換動作が可能になる。
伝送方式の２線式線路上のフレーム長と４線側のフレー
ム長を異ならすことができ、かつ４線側フレーム内の任
意タイムスロットの情報を２線式線路へ送信かつ受信す
ることができるのでこの効果を利用して４線側で多重、
集線、交換等の操作を時分割多重動作で行う場合、一時
記憶装置９，１０に対し直接アクセスすることにより多
重、集線もしくは交換動作が可能になる。
またこの結果多重集線を行なう場合データ速度を所要の
速度に変換する操作が不要となる利点がある。
速度に変換する操作が不要となる利点がある。
第１図は従来の時分割方向制御形伝送方式を示す構成図
、第２図は第１図の動作例を示すタイミング図、第３図
はこの発明による２線式ディジタル加入者装置の一実施
例を示す構成図、第４図は第３図の動作例を示すタイミ
ング図である。 １：２線式線路との接続端子、２：平衡−不平衡変換ト
ランス、３：４線側送信情報入力端子、４：４線側受信
信号出力端子、５：送信器、６：送信一時記憶装置、７
：受信器、８：受信一時記憶装置。
、第２図は第１図の動作例を示すタイミング図、第３図
はこの発明による２線式ディジタル加入者装置の一実施
例を示す構成図、第４図は第３図の動作例を示すタイミ
ング図である。 １：２線式線路との接続端子、２：平衡−不平衡変換ト
ランス、３：４線側送信情報入力端子、４：４線側受信
信号出力端子、５：送信器、６：送信一時記憶装置、７
：受信器、８：受信一時記憶装置。
Claims (1)
- １２線式線路を介して４線式ディジタル情報を送信しか
つ受信するディジタル加入者装置において、一定周期毎
に４線側送信情報を速度変換して２線式線路に送出する
ための送信側一時記憶装置と、２線式線路から受信した
４線側受信情報を一定周期毎に４線側に速度変換して送
出する受信側一時記憶装置と、受信側一時記憶装置に記
憶されている情報を分割して４線側の多重チャネル構成
のフレームの特定のチャネルに読み出す読み出しアドレ
ス指定回路と、４線側の多重チャネル構成のフレームの
特定チャネルを送信側一時記憶装置に書込む書込みアド
レス指定回路とを具備する２線式ディジタル加入者線装
私
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP54095413A JPS5854697B2 (ja) | 1979-07-25 | 1979-07-25 | ２線式デイジタル加入者装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP54095413A JPS5854697B2 (ja) | 1979-07-25 | 1979-07-25 | ２線式デイジタル加入者装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5619261A JPS5619261A (en) | 1981-02-23 |
| JPS5854697B2 true JPS5854697B2 (ja) | 1983-12-06 |
Family
ID=14136985
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP54095413A Expired JPS5854697B2 (ja) | 1979-07-25 | 1979-07-25 | ２線式デイジタル加入者装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5854697B2 (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05232956A (ja) * | 1992-06-16 | 1993-09-10 | Casio Comput Co Ltd | 電子楽器 |
-
1979
- 1979-07-25 JP JP54095413A patent/JPS5854697B2/ja not_active Expired
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH05232956A (ja) * | 1992-06-16 | 1993-09-10 | Casio Comput Co Ltd | 電子楽器 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5619261A (en) | 1981-02-23 |
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