JPS5880156A - Capstan controlling method of vtr - Google Patents
Capstan controlling method of vtrInfo
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- JPS5880156A JPS5880156A JP56178315A JP17831581A JPS5880156A JP S5880156 A JPS5880156 A JP S5880156A JP 56178315 A JP56178315 A JP 56178315A JP 17831581 A JP17831581 A JP 17831581A JP S5880156 A JPS5880156 A JP S5880156A
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- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B15/00—Driving, starting or stopping record carriers of filamentary or web form; Driving both such record carriers and heads; Guiding such record carriers or containers therefor; Control thereof; Control of operating function
- G11B15/18—Driving; Starting; Stopping; Arrangements for control or regulation thereof
- G11B15/46—Controlling, regulating, or indicating speed
- G11B15/48—Starting; Accelerating; Decelerating; Arrangements preventing malfunction during drive change
Landscapes
- Motor And Converter Starters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。(57) [Summary] This bulletin contains application data before electronic filing, so abstract data is not recorded.
Description
【発明の詳細な説明】
本発明はＶＴＲに於ける直流モータを使用したキャプス
タン制御方法に関するものである。DETAILED DESCRIPTION OF THE INVENTION The present invention relates to a capstan control method using a DC motor in a VTR.
第１図にキャプスタン制御系の従来方法の系統図を示す
。この制御系の動作は２位相比較器２により基準信号１
とタコメータ１０で得られるＴＡＣＨ信号１１０位相差
に応じた位相誤差電圧を発生させ。FIG. 1 shows a system diagram of a conventional method of capstan control system. The operation of this control system is controlled by the reference signal 1
A phase error voltage is generated according to the phase difference between the TACH signal 110 and the TACH signal 110 obtained by the tachometer 10.
位相補償回路３全通して加算器４に供給される。The signal is supplied to the adder 4 through the entire phase compensation circuit 3.
一方、ＴＡＣＨ信号１１ヲ人力とする周波数弁別器１２
〜加算された誤差電圧５は、誤差電圧増幅器６．モータ
駆動増幅器７を経てモータ駆動信号８により直流モータ
９を駆動し、モータの回転を一定の速度でかつ所定の回
転位相を保つように制御するっこのキャプスタン制御系
は、ロックイン時間が極力短いことが要求されるが、第
３図に示す位相補償回路３．１３の構成が一般的であり
、キャプスタンの慣性モーメントの関係からＲ１の抵抗
値、ＣＩの容量が大きいため、Ｒ１，ＣＩによる時定数
が大きくなりロックイン時間が長くなる要因の一つとな
っている。ざらにモータの起動時に於て、モータ駆動電
圧はキャプスタンに加わる外乱トルクに耐えられるよう
に定常速度に於ける駆動電圧の約２倍程度にするのが普
通である。このため起動時の速度が上りすぎてロックイ
ンに影響を与える。On the other hand, the frequency discriminator 12 which makes the TACH signal 11 human-powered
~The added error voltage 5 is sent to the error voltage amplifier 6. This capstan control system drives a DC motor 9 using a motor drive signal 8 via a motor drive amplifier 7, and controls the rotation of the motor at a constant speed and a predetermined rotational phase.This capstan control system minimizes the lock-in time. Although required to be short, the configuration of the phase compensation circuit 3.13 shown in FIG. This is one of the reasons why the lock-in time becomes longer due to the larger time constant. Roughly speaking, when starting the motor, the motor drive voltage is normally set to about twice the drive voltage at steady speed so that it can withstand disturbance torque applied to the capstan. For this reason, the startup speed increases too much, which affects lock-in.
本発明しｔこれらの欠点を解決するため９位相補償回路
の時定数及び起動時に於けるモータ駆動電圧が過大とな
る影響を軽減してキャプスタン制御系のロックイン時間
を短縮することを目的とする。In order to solve these drawbacks, the present invention aims to shorten the lock-in time of the capstan control system by reducing the time constant of the 9-phase compensation circuit and the influence of excessive motor drive voltage at startup. do.
すなわち１本発明はＶＴＲのスタート時、キャプスタン
制御系がロックインする迄の時間９位相補償回路の時定
数を小さくすると同時に、誤差電圧をリミッタにより制
限して駆動電圧を押えることによりロックイン時間を短
縮するようにしだものである。In other words, the present invention reduces the lock-in time by reducing the time constant of the phase compensation circuit and at the same time limiting the error voltage with a limiter to suppress the drive voltage. It is designed to shorten the term.
第２図に本発明の系統図を示す。第１甲と同−信号のも
のは同一部分を示す。本発明は第１図の従来の系統図に
１４〜１Ｂで示す部分が付加されたものである。１４は
位相同期検出器、１５はアナログスイッチ駆動回路、１
６は補償回路の時定数切換回路。FIG. 2 shows a system diagram of the present invention. Items with the same signal as No. 1A indicate the same parts. In the present invention, sections 14 to 1B are added to the conventional system diagram shown in FIG. 1. 14 is a phase synchronization detector, 15 is an analog switch drive circuit, 1
6 is a time constant switching circuit of the compensation circuit.
１７は誤差電圧リミッタ回路、１８はタイミングパルス
発生回路である。17 is an error voltage limiter circuit, and 18 is a timing pulse generation circuit.
次にこの動作について説明する。ＶＴＲスタート時位相
同期検出器１４によりキャプスタン制御系が位相同期（
ロックイン）したか否かを検出する。Next, this operation will be explained. The capstan control system is phase synchronized (
lock-in).
この位相同期検出器１４は例えば電圧比較器を使用し、
位相同期した場合が位相誤差電圧はＯｖ＋１ｖ以下とす
れば２位相同期検出器１４の出力は約ＯＶ±１．５ｖ以
下では２，０”レベルを出力し、Ｏｖ±１．５Ｖより犬
の場合は、１”レベルを出力することによりロックした
か否かを検出する。位相同期検出器１４の出力はアナロ
グスイッチ駆動回路１５に供給され。This phase synchronization detector 14 uses, for example, a voltage comparator,
If the phase error voltage is Ov+1v or less in the case of phase synchronization, the output of the two-phase synchronization detector 14 will output a 2.0'' level when it is about OV±1.5v or less, and in the case of a dog from Ov±1.5V. , 1" level to detect whether or not the lock is locked. The output of the phase synchronization detector 14 is supplied to an analog switch drive circuit 15.
この出力により時定数切換回路１６を駆動する。この切
換回路１６は第３図に示すような回路で構成され９位相
同期検出器１４からの１，１”レベルの期間すｔ【わち
キャプスタン制御系がロックインする迄の期間はスイッ
チＳＷがＯＮとなり抵抗Ｒ１に並列にＲ３が接続される
。キャプスタン制御系がロックインすると位相同期検出
器１４からの・０パレベルによりスイッチＳＷはＯＦＦ
となりＲ３は切離される。This output drives the time constant switching circuit 16. This switching circuit 16 is composed of a circuit as shown in FIG. is turned ON, and R3 is connected in parallel to resistor R1. When the capstan control system is locked in, the switch SW is turned OFF by the 0 level from the phase synchronization detector 14.
Therefore, R3 is separated.
したがって２位相補償回路３，１３の時定数はキャプス
タン制御系がロックインする迄は小さくなり。Therefore, the time constants of the two-phase compensation circuits 3 and 13 become small until the capstan control system locks in.
ロックイン後は時定数は大きくなる。ここでロックイン
後の時定数は定常制御偏差すなわちジッタを押えるため
に大きな値が必要となる。（例えばＲ１キ１００にΩＣ
１キ４７μＦ）。一方、タイミングパルス発生回路１８
は位相同期検出器１４の出力が６０″から６１に変化す
るレベルによりトリガーされるタイミングパルス発生器
であり例えば約２秒の幅を持ったパルスを発生する。タ
イミングパルス発生器１８の出力信号が誤差電圧リミッ
タ回路１７に供給される。After lock-in, the time constant becomes larger. Here, the time constant after lock-in needs to have a large value in order to suppress steady control deviation, that is, jitter. (For example, R1 key 100 has ΩC
1 piece 47μF). On the other hand, the timing pulse generation circuit 18
is a timing pulse generator that is triggered by the level at which the output of the phase synchronization detector 14 changes from 60'' to 61, and generates a pulse with a width of about 2 seconds, for example.The output signal of the timing pulse generator 18 is It is supplied to the error voltage limiter circuit 17.
定常一度の場合のモータ駆動電圧が約５ｖとすれば。Assuming that the motor drive voltage in one steady state is approximately 5V.
従来起動時約１０Ｖのものをタイミングパルス発生器１
８にパルスが発生している約２秒間は約６ｖになるよう
に、誤差電圧リミッタ回路１７が誤差電圧増幅器６にリ
ミッタをかける。この結果、ＶＴＲがスタートしてから
ロックするまでの時間が短縮される。Conventional timing pulse generator 1 that generates about 10V at startup
The error voltage limiter circuit 17 applies a limiter to the error voltage amplifier 6 so that the voltage remains at about 6V for about 2 seconds while the pulse is generated at the voltage 8. As a result, the time from when the VTR starts until it locks is shortened.
以上説明したごとく本発明によれば、直流モータを使用
したキャプスタン制御系におけるロックイン時間が短縮
されＶＴＲの運用上有利となる。As described above, according to the present invention, the lock-in time in a capstan control system using a DC motor is shortened, which is advantageous for the operation of a VTR.
第１図は従来のキャプスタン制御系の系統図。
第２図は本発明の系統図、第３図は位相補償回路。
時定数切換ＳＷの実施例を示す。
１：基準信号、２：位相比較器、 ３．１３：位相補
償回路、６：’誤差電圧増幅器、７：モータ駆動増幅器
、９：キャプスタンモータ、１０：タコメータ。
１２：周波数弁別器、１４：位相同期検出器、１５：ア
ナログスイッチ駆動回路、１６二時定数切換回路。
１７：誤差電圧リミッタ回路、１８：タイミングパルス
発生回路。Figure 1 is a system diagram of a conventional capstan control system. FIG. 2 is a system diagram of the present invention, and FIG. 3 is a phase compensation circuit. An example of a time constant switching SW is shown. 1: Reference signal, 2: Phase comparator, 3.13: Phase compensation circuit, 6: Error voltage amplifier, 7: Motor drive amplifier, 9: Capstan motor, 10: Tachometer. 12: Frequency discriminator, 14: Phase synchronization detector, 15: Analog switch drive circuit, 16 Two time constant switching circuits. 17: Error voltage limiter circuit, 18: Timing pulse generation circuit.
Claims (1)
系に於て１位相補償回路の時定数を切換える時定数切換
ｐ路、起動時に於けるモータ駆動電圧の電位を制限する
ためのリミッタ回路を設け。 ＶＴＲをスタートしてからロックインするまでの間前記
時定数切換回路により位相補償回路の時定数を定常時の
場合より小さくシ、かつ任意時間（例えば２秒）前記リ
ミッタ回路によりモータ駆動電圧をほぼ定常時と同レベ
ルに押え如舎舎忰÷今モータの回転が必要以上に速くな
ることを防止することによりロックイン時間を短縮する
ようにしたことを特徴とするＶＴＲのキャプスタン制御
方法。[Claims] A time constant switching p-path for switching the time constant of a one-phase compensation circuit in a capstan control system using a DC motor in a VTR, for limiting the potential of the motor drive voltage at startup. Equipped with a limiter circuit. From when the VTR is started to when the VTR is locked in, the time constant switching circuit sets the time constant of the phase compensation circuit to a value smaller than that in the steady state, and the limiter circuit reduces the motor drive voltage to approximately 2 seconds. A capstan control method for a VTR, characterized in that the lock-in time is shortened by preventing the rotation of the motor from becoming faster than necessary by holding it down to the same level as in a steady state.
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56178315A JPS5880156A (en) | 1981-11-09 | 1981-11-09 | Capstan controlling method of vtr |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP56178315A JPS5880156A (en) | 1981-11-09 | 1981-11-09 | Capstan controlling method of vtr |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5880156A true JPS5880156A (en) | 1983-05-14 |
Family
ID=16046323
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP56178315A Pending JPS5880156A (en) | 1981-11-09 | 1981-11-09 | Capstan controlling method of vtr |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5880156A (en) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60237662A (en) * | 1984-05-11 | 1985-11-26 | Sanyo Electric Co Ltd | Video tape recorder |
| JPH0260937U (en) * | 1988-10-20 | 1990-05-07 |
-
1981
- 1981-11-09 JP JP56178315A patent/JPS5880156A/en active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60237662A (en) * | 1984-05-11 | 1985-11-26 | Sanyo Electric Co Ltd | Video tape recorder |
| JPH0260937U (en) * | 1988-10-20 | 1990-05-07 |
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