JPS588968U - 半導体素子用リ−ドフレ−ム - Google Patents

半導体素子用リ−ドフレ−ム

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Publication number
JPS588968U
JPS588968U JP1981103635U JP10363581U JPS588968U JP S588968 U JPS588968 U JP S588968U JP 1981103635 U JP1981103635 U JP 1981103635U JP 10363581 U JP10363581 U JP 10363581U JP S588968 U JPS588968 U JP S588968U
Authority
JP
Japan
Prior art keywords
lead frame
semiconductor devices
pedestal
lead
semiconductor
Prior art date
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Pending
Application number
JP1981103635U
Other languages
English (en)
Inventor
箕輪 文雄
五十嵐 巳喩輝
Original Assignee
日本インタ−ナシヨナル整流器株式会社
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
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Publication of JPS588968U publication Critical patent/JPS588968U/ja
Pending legal-status Critical Current

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    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00Interconnections or connectors in packages
    • H10W72/01Manufacture or treatment
    • H10W72/0198Manufacture or treatment batch processes
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W90/00Package configurations
    • H10W90/701Package configurations characterised by the relative positions of pads or connectors relative to package parts
    • H10W90/751Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires
    • H10W90/756Package configurations characterised by the relative positions of pads or connectors relative to package parts of bond wires between a chip and a stacked lead frame, conducting package substrate or heat sink

Landscapes

  • Wire Bonding (AREA)
  • Die Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第1図及び第2図は、従来の半導体素子用リードフレー
ムを有し、第1図は、平置き型リードフレームの平面図
、第2図は、縦型リードフレームの平面図、第3図及び
第4図は、本考案のリードフレームを示し、第3図は、
その一部切欠斜視図、第4図は、他の実施例を示す斜視
図である。 11・・・リードフレーム、12,14.15・・・短
冊片、12a、14a、15a・・・台座部、13・・
・半導体ペレット、16・・・金属細線、17・・・樹
脂モールド。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数の短冊片を有するように櫛歯状に形成したリードフ
    レームの先端を折り曲げて台座部を形成し、この台座部
    に半導体ペレットを塔載し得るようにしたことを特徴と
    する半導体素子用リードフレーム。
JP1981103635U 1981-07-13 1981-07-13 半導体素子用リ−ドフレ−ム Pending JPS588968U (ja)

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JP1981103635U JPS588968U (ja) 1981-07-13 1981-07-13 半導体素子用リ−ドフレ−ム

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Publication Number Publication Date
JPS588968U true JPS588968U (ja) 1983-01-20

Family

ID=29898242

Family Applications (1)

Application Number Title Priority Date Filing Date
JP1981103635U Pending JPS588968U (ja) 1981-07-13 1981-07-13 半導体素子用リ−ドフレ−ム

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS63244895A (ja) * 1987-03-31 1988-10-12 Mitsubishi Electric Corp 半導体レ−ザの組立方法

Cited By (1)

* Cited by examiner, † Cited by third party
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