JPS59100948A - 通信回線システム - Google Patents

通信回線システム

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Publication number
JPS59100948A
JPS59100948A JP57211872A JP21187282A JPS59100948A JP S59100948 A JPS59100948 A JP S59100948A JP 57211872 A JP57211872 A JP 57211872A JP 21187282 A JP21187282 A JP 21187282A JP S59100948 A JPS59100948 A JP S59100948A
Authority
JP
Japan
Prior art keywords
terminal
switching
signal
host processor
parallel
Prior art date
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Pending
Application number
JP57211872A
Other languages
English (en)
Inventor
Tetsushige Ihara
井原 哲茂
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Filing date
Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP57211872A priority Critical patent/JPS59100948A/ja
Publication of JPS59100948A publication Critical patent/JPS59100948A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G06COMPUTING OR CALCULATING; COUNTING
    • G06FELECTRIC DIGITAL DATA PROCESSING
    • G06F13/00Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
    • G06F13/38Information transfer, e.g. on bus
    • G06F13/40Bus structure
    • G06F13/4004Coupling between buses
    • G06F13/4022Coupling between buses using switching circuits, e.g. switching matrix, connection or expansion network

Landscapes

  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • General Engineering & Computer Science (AREA)
  • Theoretical Computer Science (AREA)
  • Mathematical Physics (AREA)
  • Computer Hardware Design (AREA)
  • General Physics & Mathematics (AREA)
  • Computer And Data Communications (AREA)
  • Small-Scale Networks (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (A)  発明の技術分野 本発明はホストコンピュータと複数の端末装置を通信回
線を介して接続した通信回線7ステムに関する。
(BJ  技術の背景 電子計鼻機の有効利用のだめに1つのポストプロセッサ
に複数の端末装置を接続し、これら端末装置との間で、
データの授受を行うことは広く行われている。
とくにファクシミリの分野では、ホストプロセッサと端
末装置とは通信回線を介して接続されておシ1通信回線
の有効利用を図ることが望まれる。
(0)  従来技術と問題点 第1図に示すように従来はホストプロセッサHに2系統
の通信回線と、これらに各々端末装置TM、、TM2 
が接続されている。
これら各通信回線には、通信回線アダプタA1゜A2.
モデムMI + Ml’ + M! t M、l が接
続されている。
端末装置TM、とホストプロセッサHの間のデータの授
受は、送受信されるべきデータの送受信操作開始及び停
止機能、パリティビット付与機能を有するアダプタAI
、データの変復調を行うモデムM12M1′を介して行
われる。
端末装置TM、とホストプロセッサHの間のデータの授
受は同様にアダプタA1.モデムM2 + M2’を介
して行われる。
しかしこのようなシステムでは、各端末装置ごとに通信
回線を設けるため、システムが大型化し、かつ通信回線
の有効な利用が図られない欠点があった。
(D)  発明の目的 本発明はかかる従来の欠点に鑑みなされたもので、通信
回線を共用して、複数の端末装置をホストコンビーータ
に切換え接続し得る通信回線システムを提供することを
目的とする。
(1)  発明の構成 そしてこの目的は本考案によれば、ホストプロセッサと
、該ホストプロセッサに通信回−を介して接続される複
数の端末装置とを備えている通信回線システムにおいて
、前記ホストプロセッサと複数の端末装置間に端末装置
接続切換装置を設け、該端末装置接続切換装置は、前記
通信回線を介して授受されるデータを格納するレジスタ
と、該レジスタに格納されるデータから端末切換用信号
を検出し、該端末切換用データによシ指定される端末装
置を判別する検出部と、該検出部の出力によシ前記回線
を切換接続する切換部とを有することを特徴とする通信
回線システムを提供することにより達成される。
(F)  発明の実施例 以下図面を参照して本発明の実施例を詳述する。
82図は本発明の実施例構成図であって、第1図と同等
部分には同一符号を付した。
第2図において、Aは通信回線アダプタ、楊。
M′はモデム、Kは端末切換部である。
端末装at TMt * TMtは表示装置および音声
合成装置である。
第3図は切換部にの構成図である。
モデムM′ を介してホストプロセッサから端子T1 
へ人力された端末指示信号およびデータ信号は、直並列
変換部spへ入力し、並列データ信号に変換される。
信号は第4図に示すように、端末指示信号gs。
とDo、又はDC,およびデータ信号DI+D!・・・
・・Dnからなる。
これらの信号ff1s O,DOn(n−1,2)、D
、、D2・・・・・Dmは並列に変侠されて、各々レジ
スタR1,R2に入力される。
このうちレジスタR,,,R2に端末指示信号FISe
Dom(n−1,2)が格納されると検出部Fで検出さ
れ、いずれの端末装置が選択されるべきかを判別し、切
換回路J1及び切換器J2に切換信号を送出する。
最初に、表示装置TM、  が選択されると、切換回路
J、を経由して、まず端末指示信号に続くデータ信号D
IがレジスタR8に入力され、レジスタR1にはデータ
信号D2 が入力される。なお端末指示信号は端末切換
部Kからは出力されない。
クロック周期単位にデータ信号が++*仄端末装置側へ
転送され、並直列変換部ps1で直列信号に変換されて
端子Tt に現れる。このデータ信号は表示装置TM、
へ入力されて表示に供される。
他方、切換器J2はこの場合、表示装置側の端子T3と
、モデムM′側の端子T4 が接続される如く、検出部
Fの制御によシ切換えられる。従ってオペレータはホス
トプロセッサHが出力されたデータ信号による表示に応
じて、新たな要求信号をキーボードを介してホストプロ
セッサHに端子T3+切換器J2r端子′I4 を経由
して入力できる。
ホストプロセッサHはこの端末装置側からの要求信号に
対応して新たなデータ信号を前述した操作により伝達す
る。
このようにして、ホストプロセッサHと表示装gTM、
との間の信号の授受が行われる。
なお、音声出力装置TM、とホストプロセッサHとを接
続する場合も同様の操作によって行うことができ、端末
指示信号[k30. Don(n=1 、2)として音
声出力装d’rm*を選択する信号を用いれば、レジス
タR,,R,に収納された信号は切換部J。
を介してレジスタR4+並直列変換部Pa、へ入力され
、ここで直列信号に変換されて、端子T、に現れる。
この信号は音声出力装置TM、へ入り、音声出力される
この場合、切換器J2 は、音声装置TM、側に接続さ
れており、音声出力の終了信号が端子T6.切mdiJ
21端子T4  を経由してホストプロセッサHに伝達
される。
なお、Lはクロック信号源、Nはクロック信号を受けて
、レジスタRl−R4+直並列変換回路SP。
並直列変換回路PS、 、 PB、における指示16号
、データ信号の転送制御を行う制御部である。
(G)  発明の詳細 な説明したよりに本発明に係る通信回緋シスデムは、ホ
ストプロセッサと端末装置との間で授受される信号によ
り、回線接続を切換え制御できるため、多数の端末装置
を同一回線を用いてホストプロセッサと接続でき、シス
テム構成が簡単なものとなる。
【図面の簡単な説明】
第1図は従来のシステム構成図、第2図は本発明の実施
例構成図、第3図は切換部の構成図、第4図は信号構成
図である。

Claims (1)

    【特許請求の範囲】
  1. ホストプロセッサと、該ホストプロセッサに通信回線を
    介して接続される複数の端末装置6とを備えている通信
    回線システムにおいて、前記ホストプロセッサと複数の
    端末装置の間に端末装置接続切換装置を設け、該端末装
    置接続切換装置は、前記通信回線を弁して、授受される
    データを格納するレジスタと、該レジスタに格納される
    データから端末切換用信号を恢出するとともに該端末切
    換用データによシ指定される端末装置を判別する検出部
    と、該検出部の出力により前記回線を切換接続する切換
    部とを有することを特徴とする通信回線システム。
JP57211872A 1982-12-02 1982-12-02 通信回線システム Pending JPS59100948A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP57211872A JPS59100948A (ja) 1982-12-02 1982-12-02 通信回線システム

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP57211872A JPS59100948A (ja) 1982-12-02 1982-12-02 通信回線システム

Publications (1)

Publication Number Publication Date
JPS59100948A true JPS59100948A (ja) 1984-06-11

Family

ID=16613008

Family Applications (1)

Application Number Title Priority Date Filing Date
JP57211872A Pending JPS59100948A (ja) 1982-12-02 1982-12-02 通信回線システム

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JP (1) JPS59100948A (ja)

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61246856A (ja) * 1985-03-27 1986-11-04 Fujitsu Ltd フアイル転送端末装置
JPS6364427A (ja) * 1986-09-05 1988-03-22 Nec Corp デ−タ送受信回路遠隔切換方式

Cited By (2)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS61246856A (ja) * 1985-03-27 1986-11-04 Fujitsu Ltd フアイル転送端末装置
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