JPS59108408A - 増幅器 - Google Patents
増幅器Info
- Publication number
- JPS59108408A JPS59108408A JP57218604A JP21860482A JPS59108408A JP S59108408 A JPS59108408 A JP S59108408A JP 57218604 A JP57218604 A JP 57218604A JP 21860482 A JP21860482 A JP 21860482A JP S59108408 A JPS59108408 A JP S59108408A
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- JP
- Japan
- Prior art keywords
- power supply
- amplification stage
- output
- signal
- stage
- Prior art date
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- Pending
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- Amplifiers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は、たとえばステレオ装置、ラジオ受信機等の音
響再生装置に好適な増幅器に関するものである。
響再生装置に好適な増幅器に関するものである。
従来例の構成とその問題点
一般に、大出力の増幅器としてはバランスド・トランス
フォーマ−・レス（以下ＢＴＬと云う）回路構成のもの
が知られている。
フォーマ−・レス（以下ＢＴＬと云う）回路構成のもの
が知られている。
第１図に従来のＢＴＬ構成の増幅器のブロック図を示す
。第１図において、１は入力端子、２は電源、３は増幅
度Ａを持つ第１の増幅段、４は増幅度Ａを持ち、位相が
第１の増幅段３と逆位相の第２の増幅段、６は第１の増
幅段３の出力端子、６は第２の増幅段４の出力端子、７
はその両端が第１の増幅段３の出力端子６と第２の増幅
段４の出力端子６に結ばれた負荷である。このような構
成において、入力端子１に入力された信号は第１の増幅
段３によってＡ倍に増幅され、負荷７の一つの端子６に
出力され、同様に第２の増幅段４からはＡ倍に増幅され
た上記第１の増幅段３と逆位相の信号が出力され、負荷
７の他の端子６に加えられる。この結果、負荷７の両端
に加えられる出力電圧は、電源２の電圧ｖＣＣの％電源
電圧を中点とし、第１の増幅段３および第２の増幅段４
がそれぞれ単独で得られる出力電圧の２倍となり、つま
り、４倍の出力が得られる。
。第１図において、１は入力端子、２は電源、３は増幅
度Ａを持つ第１の増幅段、４は増幅度Ａを持ち、位相が
第１の増幅段３と逆位相の第２の増幅段、６は第１の増
幅段３の出力端子、６は第２の増幅段４の出力端子、７
はその両端が第１の増幅段３の出力端子６と第２の増幅
段４の出力端子６に結ばれた負荷である。このような構
成において、入力端子１に入力された信号は第１の増幅
段３によってＡ倍に増幅され、負荷７の一つの端子６に
出力され、同様に第２の増幅段４からはＡ倍に増幅され
た上記第１の増幅段３と逆位相の信号が出力され、負荷
７の他の端子６に加えられる。この結果、負荷７の両端
に加えられる出力電圧は、電源２の電圧ｖＣＣの％電源
電圧を中点とし、第１の増幅段３および第２の増幅段４
がそれぞれ単独で得られる出力電圧の２倍となり、つま
り、４倍の出力が得られる。
しかし、上記２つの増幅段３，４の動作はＢ級動作であ
り、大出力が得られるものの、効率はＢ級と同じものし
か得られず、発熱量が多くなってしまうという欠点があ
った。
り、大出力が得られるものの、効率はＢ級と同じものし
か得られず、発熱量が多くなってしまうという欠点があ
った。
発明の目的
本発明はこのような従来の欠点を解消するものであり、
小出力時には低い電源電圧に切り換え電源効率を高める
ことによって発熱量を減少させることができる増幅器を
提供することを目的とするものである。
小出力時には低い電源電圧に切り換え電源効率を高める
ことによって発熱量を減少させることができる増幅器を
提供することを目的とするものである。
発明の構成
本発明の増幅器は、第１の電源と、この第１の電源より
低い第２の電源を備え、信号の大きさに応じてオン・オ
フされるＢＴＬ回路を構成する第１、第２の増幅段の電
源端子に挿入したスイッチング回路を信号の大きさを検
出するレベル検出回路により制御して上記第１．第２の
電源を上記第１、第２の増幅段に選択供給するように構
成したものである。
低い第２の電源を備え、信号の大きさに応じてオン・オ
フされるＢＴＬ回路を構成する第１、第２の増幅段の電
源端子に挿入したスイッチング回路を信号の大きさを検
出するレベル検出回路により制御して上記第１．第２の
電源を上記第１、第２の増幅段に選択供給するように構
成したものである。
実施例の説明
第２図に本発明の増幅器の一実施例のブロック図を示し
ており、第２図において、１１は入力端子、１２は第１
の電源、１３は第２の電源、１４は前置増幅段、１５は
電力増幅を行う増幅度Ａの第１の増幅段、１６は第１の
増幅段１５とは位相が反転した電力増幅を行う増幅度へ
の第２の増幅段、１了は前置増幅段１４の出力信号の大
きさが一定値以上であるかどうかを検出するレベル検出
回路、１８．１９は上記レベル検出回路１７の出力信号
により制御されるトランジスタおよびダイオード、２０
．２１はそれぞれ第１の増幅段１６゜第２増幅段１６の
出力端子、２２は上記出力端子２０．２１に接続された
負荷である。
ており、第２図において、１１は入力端子、１２は第１
の電源、１３は第２の電源、１４は前置増幅段、１５は
電力増幅を行う増幅度Ａの第１の増幅段、１６は第１の
増幅段１５とは位相が反転した電力増幅を行う増幅度へ
の第２の増幅段、１了は前置増幅段１４の出力信号の大
きさが一定値以上であるかどうかを検出するレベル検出
回路、１８．１９は上記レベル検出回路１７の出力信号
により制御されるトランジスタおよびダイオード、２０
．２１はそれぞれ第１の増幅段１６゜第２増幅段１６の
出力端子、２２は上記出力端子２０．２１に接続された
負荷である。
ここで、上記前置増幅段１４には第１の電源１２の電源
電圧ＶＢが常時供給されており、上記第１゜第２の増幅
段１６．１６には上記第１．第２の電源１２．１３から
電源電圧ＶＢ、ＫＶＢ が上記トランジスタ１８．１９
を介して選択的に供給されるようになっている。そして
、上記トランジスタ１８．１９は上記第１．第２の増幅
段１５．１６の各電源端子（図示せず）にレベル検出回
路１７の出力状況に応じて上記第１の電源１２の電源電
圧ＶＢ と上記第２の電源１３の電源電圧ＫＶＢ を切
換え供給するスフ１ソチング回路を構成している。
電圧ＶＢが常時供給されており、上記第１゜第２の増幅
段１６．１６には上記第１．第２の電源１２．１３から
電源電圧ＶＢ、ＫＶＢ が上記トランジスタ１８．１９
を介して選択的に供給されるようになっている。そして
、上記トランジスタ１８．１９は上記第１．第２の増幅
段１５．１６の各電源端子（図示せず）にレベル検出回
路１７の出力状況に応じて上記第１の電源１２の電源電
圧ＶＢ と上記第２の電源１３の電源電圧ＫＶＢ を切
換え供給するスフ１ソチング回路を構成している。
このような構成において、入力端子１１から入った信号
は前置増幅段１４．第１の増幅段１６および第２の増幅
段１６により、従来例と同様に増幅される。いま、信号
電圧の瞬時値が第２の電源１３の電位％以上に々った時
にレベル検出回路１７の出力によりトランジスタ１８が
導通するようにしておく。すると、信号電圧の瞬時値が
第２の電源１３の電位の％以下の時はトランジスタ１８
が遮断しているので、第１．第２の増幅段１５．１６へ
の電源供給はダイオード１９を通じて第２の電源１３か
ら行なわれる。一方、信号電圧の瞬時値が第２の電源１
３の電位の％以上になった時にはトランジスタ１８が導
通し、第２．第３の増幅段１５．１６には第１の電源１
２から電源供給が行なわれる。この時、ダイオード、１
９は逆バイアス状態になって遮断している。よって、本
実施例によれば、小信号時には出力段に低電圧電源が供
給され、大信号時には出力段に高電圧電源が供給される
ので、電源効率を高め、発熱を減少させることができる
。
は前置増幅段１４．第１の増幅段１６および第２の増幅
段１６により、従来例と同様に増幅される。いま、信号
電圧の瞬時値が第２の電源１３の電位％以上に々った時
にレベル検出回路１７の出力によりトランジスタ１８が
導通するようにしておく。すると、信号電圧の瞬時値が
第２の電源１３の電位の％以下の時はトランジスタ１８
が遮断しているので、第１．第２の増幅段１５．１６へ
の電源供給はダイオード１９を通じて第２の電源１３か
ら行なわれる。一方、信号電圧の瞬時値が第２の電源１
３の電位の％以上になった時にはトランジスタ１８が導
通し、第２．第３の増幅段１５．１６には第１の電源１
２から電源供給が行なわれる。この時、ダイオード、１
９は逆バイアス状態になって遮断している。よって、本
実施例によれば、小信号時には出力段に低電圧電源が供
給され、大信号時には出力段に高電圧電源が供給される
ので、電源効率を高め、発熱を減少させることができる
。
第３図に本実施例の詳細な回路図を示す。第３図におい
て、３１は入力端子、３２は第１の電源、３３は第２の
電源、３４は入力抵抗、３５． ３６はバイアス抵抗、
３７は結合コンデンサ、３８゜６５は負荷抵抗、３９，
４０は帰還抵抗、４１は初段のトランジスタ、４２，６
０，６７．６８はエミッタ抵抗、４３．６１はドライバ
のトランジスタ、４４，４５，４６，６２，６３．６４
はそれぞれ出力段のバイアス回路を構成するトランジス
タおよび抵抗、４７，５１，５３，４８，５２゜５４は
カレントミラー回路を構成するトランジスタおよび抵抗
、６９はバイパスコンデンサ、６５は結合コンデンサ、
７０． ４９． ７４． ７５゜７３．５０，７１．７
２はそれぞれ出力段の直流電位を安定させるだめのサー
ボ回路を構成する抵抗、トランジスタ、演算増幅器およ
びコンデンサ、６６は信号を反転させるだめのトランジ
スタ、７６゜７７はスイッチング素子のトランジスタお
よびダイオード、７８はレベル検出回路、７９．８０は
出力端子、８１は負荷である。
て、３１は入力端子、３２は第１の電源、３３は第２の
電源、３４は入力抵抗、３５． ３６はバイアス抵抗、
３７は結合コンデンサ、３８゜６５は負荷抵抗、３９，
４０は帰還抵抗、４１は初段のトランジスタ、４２，６
０，６７．６８はエミッタ抵抗、４３．６１はドライバ
のトランジスタ、４４，４５，４６，６２，６３．６４
はそれぞれ出力段のバイアス回路を構成するトランジス
タおよび抵抗、４７，５１，５３，４８，５２゜５４は
カレントミラー回路を構成するトランジスタおよび抵抗
、６９はバイパスコンデンサ、６５は結合コンデンサ、
７０． ４９． ７４． ７５゜７３．５０，７１．７
２はそれぞれ出力段の直流電位を安定させるだめのサー
ボ回路を構成する抵抗、トランジスタ、演算増幅器およ
びコンデンサ、６６は信号を反転させるだめのトランジ
スタ、７６゜７７はスイッチング素子のトランジスタお
よびダイオード、７８はレベル検出回路、７９．８０は
出力端子、８１は負荷である。
尚、上記実施例では２電源力式で説明したが、第２の電
源電圧ＫｖＢ をスイッチングレギュレータにより作り
出せば、１電源で大出力かつ高効率の増幅器が実現でき
ることは云う捷でもない。
源電圧ＫｖＢ をスイッチングレギュレータにより作り
出せば、１電源で大出力かつ高効率の増幅器が実現でき
ることは云う捷でもない。
発明の効果
以上、詳述したように本発明によれば、信号の大きさに
応じてオン、オフされるＢＴＬ回路を構成する第１．第
２の増幅段の電源端子に挿入したスイッチング回路を、
信号の大きさを検出するレベル検出回路の出力により切
換え制御し、第１の電源とこれより低い第２の電源を上
記第１．第２の増幅段に選択的に供給するように構成し
だので、電源効率を高め、発熱量を小さく抑えることが
でき、大出力かつ高効率のＢＴＬ回路構成の増幅器を提
供することができる。
応じてオン、オフされるＢＴＬ回路を構成する第１．第
２の増幅段の電源端子に挿入したスイッチング回路を、
信号の大きさを検出するレベル検出回路の出力により切
換え制御し、第１の電源とこれより低い第２の電源を上
記第１．第２の増幅段に選択的に供給するように構成し
だので、電源効率を高め、発熱量を小さく抑えることが
でき、大出力かつ高効率のＢＴＬ回路構成の増幅器を提
供することができる。
第１図は従来の増幅器のブロック図、第２図は本発明の
増幅器の一実施例を示すブロック図、第３図は同増幅器
の具体回路結線図である。 １２・・・・・第１の電源、１３・・・・第２の電源、
１５・・・・・・第１増幅段、１６・・・・・・第２の
増幅段、１７・・・・・レベル検出回路、１８．１９・
・・・・・スイッチング用トランジスタおよびダイオー
ド。
増幅器の一実施例を示すブロック図、第３図は同増幅器
の具体回路結線図である。 １２・・・・・第１の電源、１３・・・・第２の電源、
１５・・・・・・第１増幅段、１６・・・・・・第２の
増幅段、１７・・・・・レベル検出回路、１８．１９・
・・・・・スイッチング用トランジスタおよびダイオー
ド。
Claims (1)
- 第１の電源と、この第１の電源の電圧より低い第２の電
源を備えてなり、バランスド・トランスフォーマ−・レ
ス回路を構成する第１．第２の増幅段の電源端子のそれ
ぞれに上記第１．第２の電源からの電圧を切換え供給す
るスイッチング回路を設け、このスイッチング回路を信
号の大きさを検出するレベル検出回路の出力によって相
補的に切換えるように構成してなる増幅器。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57218604A JPS59108408A (ja) | 1982-12-13 | 1982-12-13 | 増幅器 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57218604A JPS59108408A (ja) | 1982-12-13 | 1982-12-13 | 増幅器 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59108408A true JPS59108408A (ja) | 1984-06-22 |
Family
ID=16722555
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57218604A Pending JPS59108408A (ja) | 1982-12-13 | 1982-12-13 | 増幅器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59108408A (ja) |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61144904A (ja) * | 1984-12-19 | 1986-07-02 | Nec Corp | スイツチオン時シヨツク音防止回路を備えた増幅回路 |
| US5586194A (en) * | 1994-03-31 | 1996-12-17 | Peavey Electronics Corporation | Augmentation amplifier |
| US5604463A (en) * | 1992-03-16 | 1997-02-18 | Zero Impedance Systems | Coupling circuit |
-
1982
- 1982-12-13 JP JP57218604A patent/JPS59108408A/ja active Pending
Cited By (4)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61144904A (ja) * | 1984-12-19 | 1986-07-02 | Nec Corp | スイツチオン時シヨツク音防止回路を備えた増幅回路 |
| US5604463A (en) * | 1992-03-16 | 1997-02-18 | Zero Impedance Systems | Coupling circuit |
| US5770972A (en) * | 1992-03-16 | 1998-06-23 | Zero Impedance Systems, Inc. | Coupling circuit |
| US5586194A (en) * | 1994-03-31 | 1996-12-17 | Peavey Electronics Corporation | Augmentation amplifier |
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