JPS5913993B2 - 感熱記録装置 - Google Patents
感熱記録装置Info
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- JPS5913993B2 JPS5913993B2 JP52080603A JP8060377A JPS5913993B2 JP S5913993 B2 JPS5913993 B2 JP S5913993B2 JP 52080603 A JP52080603 A JP 52080603A JP 8060377 A JP8060377 A JP 8060377A JP S5913993 B2 JPS5913993 B2 JP S5913993B2
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- JP
- Japan
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- recording
- speed
- head
- circuit
- signal
- Prior art date
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- Expired
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Classifications
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
- B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
- B41J2/35—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads providing current or voltage to the thermal head
- B41J2/355—Control circuits for heating-element selection
- B41J2/36—Print density control
- B41J2/365—Print density control by compensation for variation in temperature
Landscapes
- Electronic Switches (AREA)
- Fax Reproducing Arrangements (AREA)
Description
【発明の詳細な説明】
本発明は感熱ヘッドの駆動時間を記録速度に応じて変化
させる感熱記録装置に関する。
させる感熱記録装置に関する。
多数の発熱抵抗体素子を配列した感熱ヘッドお５ よび
その駆動回路は一般に第１図のように構成される。
その駆動回路は一般に第１図のように構成される。
同図において、１０１は感熱ヘッドであり、主走査方向
に複数の発熱抵抗体素子１０１ａ、１０１ａ、・・・を
配列している。発熱抵抗体素子１０１ａ、１０１ａ、・
・・の一端は５素子をブロツ１０ クとして共通接続さ
れブロックドライバ１０３ａ、１０３ｂ、・・・、１０
３ｎにそれぞれ接続されている。また、発熱抵抗体素子
１０１ａ、１０１ａ、・・・の他端は逆流防止用のダイ
オード１０２、１０２、・・・を介して各ブロック中で
同位置にあるもの同志１５を共通接続して、そ！１、ぞ
れビットドライバ１０５ａ〜１０５ｅに接続されている
。ビットドライバ１０５ａ〜１０５ｅに対しては画素信
号レジスタ１０６から画素信号が供給される。ブロック
ドライバ１０３ａ〜１０３ｎは選択回路１０４によりク
０ 順次主走査方向へ選択される。ブ頭ノクドライバ１
０３ｉ（ｉ＝ａ−ｎ）は第２図に示すように構成され、
選択回路１０４から端子４へＴＴＬレベルで゛゛Ｈ’’
の信号を受けるとトランジスタＴＲ１がオンとなつてダ
ーリントン接ク５ 続されたトランジスタＴＲ２、ＴＲ
３がオフになり発熱抵抗体素子１０１ａへの通電路を断
つ。
に複数の発熱抵抗体素子１０１ａ、１０１ａ、・・・を
配列している。発熱抵抗体素子１０１ａ、１０１ａ、・
・・の一端は５素子をブロツ１０ クとして共通接続さ
れブロックドライバ１０３ａ、１０３ｂ、・・・、１０
３ｎにそれぞれ接続されている。また、発熱抵抗体素子
１０１ａ、１０１ａ、・・・の他端は逆流防止用のダイ
オード１０２、１０２、・・・を介して各ブロック中で
同位置にあるもの同志１５を共通接続して、そ！１、ぞ
れビットドライバ１０５ａ〜１０５ｅに接続されている
。ビットドライバ１０５ａ〜１０５ｅに対しては画素信
号レジスタ１０６から画素信号が供給される。ブロック
ドライバ１０３ａ〜１０３ｎは選択回路１０４によりク
０ 順次主走査方向へ選択される。ブ頭ノクドライバ１
０３ｉ（ｉ＝ａ−ｎ）は第２図に示すように構成され、
選択回路１０４から端子４へＴＴＬレベルで゛゛Ｈ’’
の信号を受けるとトランジスタＴＲ１がオンとなつてダ
ーリントン接ク５ 続されたトランジスタＴＲ２、ＴＲ
３がオフになり発熱抵抗体素子１０１ａへの通電路を断
つ。
逆に、端子４に゛゛Ｌ’’の信号を受けるとトランジス
タＴＲ１がオフとなり、トランジスタＴＲ２、ＴＲ３が
オンとなるので、同時に駆動されるビットドライ３０バ
１０５ａ〜１０５ｅ側でオンになつているトランジスタ
Ｔルに対応した発熱抵抗体素子１０１ａに電流が流れ、
同発熱抵抗体素子１０１ａにより記録がなされる。ビッ
トドライバ１０５ｉは第２図に示すように３５ノアゲー
ト２０１とその出力でスイッチング動作する駆動トラン
ジスタＴＲ４とからなる。
タＴＲ１がオフとなり、トランジスタＴＲ２、ＴＲ３が
オンとなるので、同時に駆動されるビットドライ３０バ
１０５ａ〜１０５ｅ側でオンになつているトランジスタ
Ｔルに対応した発熱抵抗体素子１０１ａに電流が流れ、
同発熱抵抗体素子１０１ａにより記録がなされる。ビッ
トドライバ１０５ｉは第２図に示すように３５ノアゲー
ト２０１とその出力でスイッチング動作する駆動トラン
ジスタＴＲ４とからなる。
ノアゲート２０１の一方の入力端子５へは画信号レジス
タ１０６から記録楕報に応じでＬ゛（記録する）もしく
は６Ｈ゛（記録しない）の信号が供給される。また、他
方の入力端子３へは発熱抵抗体素子１０１ａの加熱通電
時間を規定する信号が供給され、通電時にばＬ―非通電
時にばＨ゛となつている。
タ１０６から記録楕報に応じでＬ゛（記録する）もしく
は６Ｈ゛（記録しない）の信号が供給される。また、他
方の入力端子３へは発熱抵抗体素子１０１ａの加熱通電
時間を規定する信号が供給され、通電時にばＬ―非通電
時にばＨ゛となつている。
トランジスタＴＲ４はノアゲート２０１の出力が゛Ｈ１
のとき、つまり入力端子５，３が共に“Ｌ”の場合のみ
オンとなる。上記構成の感熱記録装置では、プロツクド
ライバ１０３１とビツトドライバ１０５１の双方がオン
となつている交点の発熱抵抗体素子１０１ａのみに選択
的に通電されるので、プロツクドライバ１０３１を１０
３ａ，１０３ｂ，・・・と順次切替駆動すると同時に、
ビツトドライバ１０５１を画素情報に応じて、同時に駆
動すれば、発熱抵抗体素子列１０１ａ，１０１ａ，・・
・の５素子ずつを１プロツクとして感熱記録紙面を一方
向に順次過熱することができる。
のとき、つまり入力端子５，３が共に“Ｌ”の場合のみ
オンとなる。上記構成の感熱記録装置では、プロツクド
ライバ１０３１とビツトドライバ１０５１の双方がオン
となつている交点の発熱抵抗体素子１０１ａのみに選択
的に通電されるので、プロツクドライバ１０３１を１０
３ａ，１０３ｂ，・・・と順次切替駆動すると同時に、
ビツトドライバ１０５１を画素情報に応じて、同時に駆
動すれば、発熱抵抗体素子列１０１ａ，１０１ａ，・・
・の５素子ずつを１プロツクとして感熱記録紙面を一方
向に順次過熱することができる。
そして、紙面の記録すべき端部までヘツドを駆動すると
、ｌスライス情報の記録を終了したことになるので、次
のスライスの記録を行なうために記録紙を１スライス分
歩進させる。記録情報が数字、アルフアベツト等の文字
の場合には、通信回線或いは電子計算機から一般にＡＳ
ＣＩＩ等のコード系によつて定められた符号が入力情報
として与えられる。入力情報の速度は一般に時間によつ
て大幅に変動する。従つて入力情報に対応した数字、文
字等の記録出力速度も時間的に大幅に変動する。一方、
感熱ヘツド１０１では、発熱抵抗体素子１０１ａで発生
した熱の中で記録紙側へ伝達された熱以外の大部分が、
ヘツド基板に蓄熱され、感熱ヘツド１０１全体の温度を
上昇させている。感熱ヘツド１０１の温度変化は記録濃
度の変化として現われ、ヘツド基板の温度上昇の度合に
よつては記録情報のない部分まで発色してしまう。感熱
ヘツドの温度は、記録情報の内容と記録速度によつて変
化し、記録情報に黒部分が多い程また記録速度が速い程
、ヘツドの温度は上昇する。第３図は従来の感熱記録装
置の一例を示すプロツク図であり、３０１は入カバツフ
ア、３０２は文字信号発生器、３０３はヘツド駆動回路
、３０４はタイミング発生制御回路、３０５は発振器、
３０６はパルスモータ駆動回路、３０７は感熱記録紙移
送用のパルスモータである。
、ｌスライス情報の記録を終了したことになるので、次
のスライスの記録を行なうために記録紙を１スライス分
歩進させる。記録情報が数字、アルフアベツト等の文字
の場合には、通信回線或いは電子計算機から一般にＡＳ
ＣＩＩ等のコード系によつて定められた符号が入力情報
として与えられる。入力情報の速度は一般に時間によつ
て大幅に変動する。従つて入力情報に対応した数字、文
字等の記録出力速度も時間的に大幅に変動する。一方、
感熱ヘツド１０１では、発熱抵抗体素子１０１ａで発生
した熱の中で記録紙側へ伝達された熱以外の大部分が、
ヘツド基板に蓄熱され、感熱ヘツド１０１全体の温度を
上昇させている。感熱ヘツド１０１の温度変化は記録濃
度の変化として現われ、ヘツド基板の温度上昇の度合に
よつては記録情報のない部分まで発色してしまう。感熱
ヘツドの温度は、記録情報の内容と記録速度によつて変
化し、記録情報に黒部分が多い程また記録速度が速い程
、ヘツドの温度は上昇する。第３図は従来の感熱記録装
置の一例を示すプロツク図であり、３０１は入カバツフ
ア、３０２は文字信号発生器、３０３はヘツド駆動回路
、３０４はタイミング発生制御回路、３０５は発振器、
３０６はパルスモータ駆動回路、３０７は感熱記録紙移
送用のパルスモータである。
入カバツフア３０１へは電子計算機等からＡＳＣＩｌコ
ード等で入力情報が与えられる。スライス毎に記録する
装置では、１行分の文字情報が入カバツフア３０１に読
込まれてから記録出力が開始される。つまり、入カバツ
フア３０１にｌ行分以上の情報が記録されると、タイミ
ング発生制御回路３０４からの指令により、入カバツフ
ア３０１から順次情報を読み出し、文字信号発生器３０
２により文字信号に変換してヘツド駆動回路３０３を経
て感熱ヘツド１０１を駆動する。
ード等で入力情報が与えられる。スライス毎に記録する
装置では、１行分の文字情報が入カバツフア３０１に読
込まれてから記録出力が開始される。つまり、入カバツ
フア３０１にｌ行分以上の情報が記録されると、タイミ
ング発生制御回路３０４からの指令により、入カバツフ
ア３０１から順次情報を読み出し、文字信号発生器３０
２により文字信号に変換してヘツド駆動回路３０３を経
て感熱ヘツド１０１を駆動する。
この動作を、パルスモータ駆動回路３０６によるパルス
モータ３０７の給紙動作と併せて、全スライスにわたり
繰り返し、１行分の記録を終了すると、次の行の情報が
入カバツフア３０１に入力される。この種の記録装置で
は、最大記録速度は入力情報の転送速度が十分に速い場
合であり、記録装置自体の最大記録速度にほぼ一致する
。
モータ３０７の給紙動作と併せて、全スライスにわたり
繰り返し、１行分の記録を終了すると、次の行の情報が
入カバツフア３０１に入力される。この種の記録装置で
は、最大記録速度は入力情報の転送速度が十分に速い場
合であり、記録装置自体の最大記録速度にほぼ一致する
。
最小記録速度は入力情報のない場合である。現実の記録
速度はこれらの間で変化するが、ヘツドの駆動条件を一
定とすると、ヘツド基板の温度上昇の要因であるヘツド
の発生熱量は現実の記録速度にほぼ比例して変化する。
例えば、記録速度が１行／秒で５ジユール／秒の熱量を
発生する感熱ヘツドを５行／秒の記録速度で使用すれば
、ほぼ２５ジユール／秒の熱量を発生する。ヘツド基板
の温度上昇は発生した熱量にほぼ比例するので、記録速
度が１行／秒の時基板温度が５℃上昇したとすると、５
行／秒ではほぼ２５℃上昇することになる。このため、
周囲温度が一定であるとすると、記録速度が１行／秒の
時と５行／秒の時とでは２０℃の温度差を生じ、記録濃
度の変化として現われる。本発明は上記した点に鑑みな
されたもので、記録速度に応じてヘツドの駆動時間を制
御することにより、記録速度の変化に起因するヘツド基
板の温度変化に応じて変動しようとする記録濃度を、記
録速度によらず均一化することができる感熱記録装置を
提供することを目的とする。以下第４図を参照して本発
明の一実施例を説明する。
速度はこれらの間で変化するが、ヘツドの駆動条件を一
定とすると、ヘツド基板の温度上昇の要因であるヘツド
の発生熱量は現実の記録速度にほぼ比例して変化する。
例えば、記録速度が１行／秒で５ジユール／秒の熱量を
発生する感熱ヘツドを５行／秒の記録速度で使用すれば
、ほぼ２５ジユール／秒の熱量を発生する。ヘツド基板
の温度上昇は発生した熱量にほぼ比例するので、記録速
度が１行／秒の時基板温度が５℃上昇したとすると、５
行／秒ではほぼ２５℃上昇することになる。このため、
周囲温度が一定であるとすると、記録速度が１行／秒の
時と５行／秒の時とでは２０℃の温度差を生じ、記録濃
度の変化として現われる。本発明は上記した点に鑑みな
されたもので、記録速度に応じてヘツドの駆動時間を制
御することにより、記録速度の変化に起因するヘツド基
板の温度変化に応じて変動しようとする記録濃度を、記
録速度によらず均一化することができる感熱記録装置を
提供することを目的とする。以下第４図を参照して本発
明の一実施例を説明する。
尚、第３図と同一部分には同一符号が付してある。第４
図において、４０１は発振器３０５の出力を受けて基本
クロツクを発生する基本クロツク発生回路、４０２はア
ツプダウン・カウンタ、４０３はカウンタ４０２の計数
内容をチエツクする検出回路である。基本クロツク発生
回路４０１の発生する基本クロツクは、最大記録速度と
最小記録速度の間で設定した基準速度を示す信号Ａであ
り、アツプダウン・カウンタ４０２へダウン値入力とし
て供給される。アツプダウン・カウンタ４０２のアツプ
側入力は、タイミング発生制御回路３０４により発生さ
れている現在の記録速度を示す信号（クロツク）Ｂであ
る。尚、アツプダウン・カウンタ４０２は、桁上げ、桁
下げを示すキヤリ一出力、ボロ一出力でそれぞれ内容が
再セツトされるように構成されており、内容が最大値（
通常全桁゛１゛）もしくは最小値（通常全桁“０゛）へ
到達した以後は、同方向への内容変化は生じない。即ち
、アツプダウン・カウンタ４０２はフルビツトカウント
後現在の記録速度を示すクロツク信号が入力されてもフ
ルカウント状態を維持するものである。検出回路４０３
は、例えば基準値を出力するメモリと、上記アツプダウ
ン・カウンタ４０２の出力値を上記メモリの基準値と比
較する比較器とから構成され、この比較器の出力をヘツ
ド駆動時間を指定する制御信号Ｃとしてタイミング発生
制御回路３０４へ送出する。またタイミング発生制御回
路３０４は、例えば第５図に示す如く、長さの異なる２
種類の通電時間を設定する２個の単安定マルチバイブレ
ータ（モノマルチ）４１，４２を有し、これらのモノマ
ルチ４１，４２の出力を、ゲート回路４３を前記検出回
路４０３からの制御信号Ｃで開閉制御することにより択
一的にヘツド駆動回路３０３へ送出するものとなつてい
る。しかして、このタイミング発生制御回路３０４によ
り、前記検出回路４０３からの制御信号Ｃに従つて、記
録速度が速い時は通電時間を短かく、逆に記録速度が遅
い時は通電時間を長くするようにヘツド駆動時間を制御
することは可能である。上記動作を具体例で示せば以下
のようになる。
図において、４０１は発振器３０５の出力を受けて基本
クロツクを発生する基本クロツク発生回路、４０２はア
ツプダウン・カウンタ、４０３はカウンタ４０２の計数
内容をチエツクする検出回路である。基本クロツク発生
回路４０１の発生する基本クロツクは、最大記録速度と
最小記録速度の間で設定した基準速度を示す信号Ａであ
り、アツプダウン・カウンタ４０２へダウン値入力とし
て供給される。アツプダウン・カウンタ４０２のアツプ
側入力は、タイミング発生制御回路３０４により発生さ
れている現在の記録速度を示す信号（クロツク）Ｂであ
る。尚、アツプダウン・カウンタ４０２は、桁上げ、桁
下げを示すキヤリ一出力、ボロ一出力でそれぞれ内容が
再セツトされるように構成されており、内容が最大値（
通常全桁゛１゛）もしくは最小値（通常全桁“０゛）へ
到達した以後は、同方向への内容変化は生じない。即ち
、アツプダウン・カウンタ４０２はフルビツトカウント
後現在の記録速度を示すクロツク信号が入力されてもフ
ルカウント状態を維持するものである。検出回路４０３
は、例えば基準値を出力するメモリと、上記アツプダウ
ン・カウンタ４０２の出力値を上記メモリの基準値と比
較する比較器とから構成され、この比較器の出力をヘツ
ド駆動時間を指定する制御信号Ｃとしてタイミング発生
制御回路３０４へ送出する。またタイミング発生制御回
路３０４は、例えば第５図に示す如く、長さの異なる２
種類の通電時間を設定する２個の単安定マルチバイブレ
ータ（モノマルチ）４１，４２を有し、これらのモノマ
ルチ４１，４２の出力を、ゲート回路４３を前記検出回
路４０３からの制御信号Ｃで開閉制御することにより択
一的にヘツド駆動回路３０３へ送出するものとなつてい
る。しかして、このタイミング発生制御回路３０４によ
り、前記検出回路４０３からの制御信号Ｃに従つて、記
録速度が速い時は通電時間を短かく、逆に記録速度が遅
い時は通電時間を長くするようにヘツド駆動時間を制御
することは可能である。上記動作を具体例で示せば以下
のようになる。
最大記録速度を５行／秒、最小記録速度をＯ行／秒、基
準速度を２．５行／秒とし、これらを示す信号（クロツ
ク）の周波数をそれぞれ５Ｈｚ，０Ｈｚ，２．５Ｈｚと
する。また、アツプダウン・カウンタ４０２を所定数の
ビツト構成とし、ヘツド駆動時間の制御は長短２段階の
切替とし、検出回路４０３の出力Ｃはカウンタ４０２が
フルビツトカウント例えば５ビツト構成では「３２」の
時に″Ｈ゛となり、「３２」未満の時に゛Ｌ゛となるも
のとする。初期状態にあるとき、カウンタ４０２の内容
は「０」である。
準速度を２．５行／秒とし、これらを示す信号（クロツ
ク）の周波数をそれぞれ５Ｈｚ，０Ｈｚ，２．５Ｈｚと
する。また、アツプダウン・カウンタ４０２を所定数の
ビツト構成とし、ヘツド駆動時間の制御は長短２段階の
切替とし、検出回路４０３の出力Ｃはカウンタ４０２が
フルビツトカウント例えば５ビツト構成では「３２」の
時に″Ｈ゛となり、「３２」未満の時に゛Ｌ゛となるも
のとする。初期状態にあるとき、カウンタ４０２の内容
は「０」である。
この状態で５行／秒の一定速度で記録を開始すると、検
出回路４０３からの制御信号Ｃの信号レベルが６Ｌ″で
ある間は、モノマルチ４１が選択されて長い通電時間を
設定するためのパルス信号Ｅが出力され、この結果ヘツ
ド１０１は長い通電時間で駆動される。しかるに、カウ
ンタ４０２は（５−２．５）Ｈｚのクロツクで増加方向
に駆動されるので、約１２．８秒でカウンタ４０２の内
容が「３２」になつた時検出回路４０３の出力信号レベ
ルは“Ｈ”となり、この結果モノマルチ４１に代わつて
モノマルチ４２が選択されて短かい通電時間を設定する
ためのパルス信号Ｅが出力され、ヘツド１０１は短かい
通電時間で駆動される。同様のことは２．５行／秒以上
の記録速度全てについて当てはまり、例えば初期状態か
ら４行／秒の一定速度で記録する場合には、始めの約２
１．３秒間は長いヘツドの駆動時間が指定されるが、以
後は短かいヘツドの駆動時間に切換わる。逆に、初期状
態から２．５行／秒未満の記録速度で記録する場合には
、カウンタ４０２の内容（最小値）は変化しないので常
に長いヘツドの駆動時間が指定される。尚、高速度でｌ
枚の記録を終了したのち続けて次の記録を開始する場合
のようにカウンタ４０２の内容が最大値にある状態から
、低速（例えば２．５行／秒）の記録を行なう場合は、
カウンタ４０２の内容が基準値未満に低下するまで短い
駆動時間が設定され、基準値以下になると長い駆動時間
が設定される。つまり、この場合の感熱ヘツド駆動時間
の切換タイミングは、前述したカウンタ４０２の内容が
゛０゜゛のときから駆動を開始する場合の逆となる。以
上のように、本発明の感熱記録装置によれば、記録速度
に応じてヘツドの駆動時間が制御されるので、記録速度
の変化に起因したヘツド基板の温度変化が記録濃度に対
して与える影響は均一化され、記録速度によらず一定の
記録濃度を実現できる。
出回路４０３からの制御信号Ｃの信号レベルが６Ｌ″で
ある間は、モノマルチ４１が選択されて長い通電時間を
設定するためのパルス信号Ｅが出力され、この結果ヘツ
ド１０１は長い通電時間で駆動される。しかるに、カウ
ンタ４０２は（５−２．５）Ｈｚのクロツクで増加方向
に駆動されるので、約１２．８秒でカウンタ４０２の内
容が「３２」になつた時検出回路４０３の出力信号レベ
ルは“Ｈ”となり、この結果モノマルチ４１に代わつて
モノマルチ４２が選択されて短かい通電時間を設定する
ためのパルス信号Ｅが出力され、ヘツド１０１は短かい
通電時間で駆動される。同様のことは２．５行／秒以上
の記録速度全てについて当てはまり、例えば初期状態か
ら４行／秒の一定速度で記録する場合には、始めの約２
１．３秒間は長いヘツドの駆動時間が指定されるが、以
後は短かいヘツドの駆動時間に切換わる。逆に、初期状
態から２．５行／秒未満の記録速度で記録する場合には
、カウンタ４０２の内容（最小値）は変化しないので常
に長いヘツドの駆動時間が指定される。尚、高速度でｌ
枚の記録を終了したのち続けて次の記録を開始する場合
のようにカウンタ４０２の内容が最大値にある状態から
、低速（例えば２．５行／秒）の記録を行なう場合は、
カウンタ４０２の内容が基準値未満に低下するまで短い
駆動時間が設定され、基準値以下になると長い駆動時間
が設定される。つまり、この場合の感熱ヘツド駆動時間
の切換タイミングは、前述したカウンタ４０２の内容が
゛０゜゛のときから駆動を開始する場合の逆となる。以
上のように、本発明の感熱記録装置によれば、記録速度
に応じてヘツドの駆動時間が制御されるので、記録速度
の変化に起因したヘツド基板の温度変化が記録濃度に対
して与える影響は均一化され、記録速度によらず一定の
記録濃度を実現できる。
しかも、ヘツド基板の温度情報を直接フイードバツクす
るものではないので、ヘッドの構造が複雑化することが
ない利点も有する。また本発明では、現在の記録速度に
対応する信号の計数値と基準速度を示す信号の計数値と
の差を求め、この差が基準値に満たない期間は記録時間
を長く設定し、かつ差が基準値以上となつた期間では記
録時間を短く設定するようにしたので、記録開始直後に
おける感熱ヘツドの蓄積熱がほとんどなく低温となつて
いる初期期間は、たとえ記録速度が速い場合でも長い駆
動時間で感熱ヘツドを駆動することができる。
るものではないので、ヘッドの構造が複雑化することが
ない利点も有する。また本発明では、現在の記録速度に
対応する信号の計数値と基準速度を示す信号の計数値と
の差を求め、この差が基準値に満たない期間は記録時間
を長く設定し、かつ差が基準値以上となつた期間では記
録時間を短く設定するようにしたので、記録開始直後に
おける感熱ヘツドの蓄積熱がほとんどなく低温となつて
いる初期期間は、たとえ記録速度が速い場合でも長い駆
動時間で感熱ヘツドを駆動することができる。
また、逆に感熱ヘツドの蓄積熱が大きく高温となつてい
るときの初期期間ではたとえ記録速度が遅い場合でも感
熱ヘツドの駆動時間を短かく設定でき、これによりヘツ
ドの過熱を防いで記録濃度を抑制することができる。さ
らに、感熱ヘツドの蓄熱が中程度で中温の状態から記録
を開始する場合は、カウンタ回路の差出力値が上記蓄熱
に対応する値となつているため、そのときの蓄熱量に応
じて最適なタイミングで駆動時間の切換えを行なうこと
ができ、この結果記録濃度の均一化をはかることができ
る。このように、本発明であれば、感熱ヘツドの蓄積熱
量に応じて、常に最適な駆動時間をヘツドに与えること
ができ、この結果如何なる状態から如何なる速度で記録
を開始した場合でも、常に濃度の均一な記録結果を得る
ことができる。
るときの初期期間ではたとえ記録速度が遅い場合でも感
熱ヘツドの駆動時間を短かく設定でき、これによりヘツ
ドの過熱を防いで記録濃度を抑制することができる。さ
らに、感熱ヘツドの蓄熱が中程度で中温の状態から記録
を開始する場合は、カウンタ回路の差出力値が上記蓄熱
に対応する値となつているため、そのときの蓄熱量に応
じて最適なタイミングで駆動時間の切換えを行なうこと
ができ、この結果記録濃度の均一化をはかることができ
る。このように、本発明であれば、感熱ヘツドの蓄積熱
量に応じて、常に最適な駆動時間をヘツドに与えること
ができ、この結果如何なる状態から如何なる速度で記録
を開始した場合でも、常に濃度の均一な記録結果を得る
ことができる。
尚、実施例ではヘツド駆動時間を長短２通りで切換える
場合を例示したが、複数の基準速度を設定してヘツド駆
動時間を多段に切換えることにより、記録濃度の均一化
が一層顕著になることは明らかである。
場合を例示したが、複数の基準速度を設定してヘツド駆
動時間を多段に切換えることにより、記録濃度の均一化
が一層顕著になることは明らかである。
第１図は感熱記録ヘツドおよびその駆動回路の一例を示
す構成図、第２図はプロツクドライバおよびビツトドラ
イバを示す回路図、第３図は従来の感熱記録装置の概要
を示すプロツク図、第４図は本発明の一実施例を示すプ
ロツク図、第５図は第４図に示した装置の要部を示す回
路図である。 １０１・・・・・・感熱記録ヘツド、１０３ａ〜１０３
ｎ・・・・・・プロツクドライバ、１０４・・・・・・
選択回路、１０５ａ〜１０５ｅ・・・・・・ビツトドラ
イバ、１０６・・・・・・画素信号レジスタ、３０１・
・・・・・入カバツフア、３０２・・・・・・文字信号
発生器、３０３・・・・・・ヘツド駆動回路、３０４・
・・・・タイミング発生制御回路、３０５・・・・・・
発振器、３０６・・・・・・パルスモータ駆動回路、３
０７・・・・・・パルスモータ、４０１・・・・・・基
本クロツク発生回路、４０２・・・・・・アツプダウン
・カウンタ、４０３・・・・・・検出回路。
す構成図、第２図はプロツクドライバおよびビツトドラ
イバを示す回路図、第３図は従来の感熱記録装置の概要
を示すプロツク図、第４図は本発明の一実施例を示すプ
ロツク図、第５図は第４図に示した装置の要部を示す回
路図である。 １０１・・・・・・感熱記録ヘツド、１０３ａ〜１０３
ｎ・・・・・・プロツクドライバ、１０４・・・・・・
選択回路、１０５ａ〜１０５ｅ・・・・・・ビツトドラ
イバ、１０６・・・・・・画素信号レジスタ、３０１・
・・・・・入カバツフア、３０２・・・・・・文字信号
発生器、３０３・・・・・・ヘツド駆動回路、３０４・
・・・・タイミング発生制御回路、３０５・・・・・・
発振器、３０６・・・・・・パルスモータ駆動回路、３
０７・・・・・・パルスモータ、４０１・・・・・・基
本クロツク発生回路、４０２・・・・・・アツプダウン
・カウンタ、４０３・・・・・・検出回路。
Claims (1)
- １ 最大記録速度と最小記録速度との間で設定した基準
速度を示す信号を発生する回路と、上記基準速度を示す
信号を常時入力して計数するとともに記録動作時にその
記録速度を示す信号を入力して上記基準速度を示す信号
とは別個に計数し、これらの各計数値の差出力を所定の
最小値および最大値間の範囲内で発生するカウンタ回路
と、このカウンタ回路からの差出力が基準値に満たない
期間では記録時間を長く設定しかつ差出力が基準値以上
の期間では記録時間を短く設定する制御信号を発生する
検出回路と、この検出回路の制御信号に応じて感熱ヘッ
ドの駆動時間を制御する制御回路とを具備したことを特
徴とする感熱記録装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52080603A JPS5913993B2 (ja) | 1977-07-06 | 1977-07-06 | 感熱記録装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP52080603A JPS5913993B2 (ja) | 1977-07-06 | 1977-07-06 | 感熱記録装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5414752A JPS5414752A (en) | 1979-02-03 |
| JPS5913993B2 true JPS5913993B2 (ja) | 1984-04-02 |
Family
ID=13722896
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP52080603A Expired JPS5913993B2 (ja) | 1977-07-06 | 1977-07-06 | 感熱記録装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5913993B2 (ja) |
Families Citing this family (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5737852Y2 (ja) * | 1978-01-17 | 1982-08-20 | ||
| JPS5824467A (ja) * | 1981-08-06 | 1983-02-14 | Seiko Instr & Electronics Ltd | サ−マルプリンタ |
| JPH0421234Y2 (ja) * | 1984-12-04 | 1992-05-14 |
-
1977
- 1977-07-06 JP JP52080603A patent/JPS5913993B2/ja not_active Expired
Also Published As
| Publication number | Publication date |
|---|---|
| JPS5414752A (en) | 1979-02-03 |
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