JPS59172103A - 非線形エンフアシス回路 - Google Patents
非線形エンフアシス回路Info
- Publication number
- JPS59172103A JPS59172103A JP58045940A JP4594083A JPS59172103A JP S59172103 A JPS59172103 A JP S59172103A JP 58045940 A JP58045940 A JP 58045940A JP 4594083 A JP4594083 A JP 4594083A JP S59172103 A JPS59172103 A JP S59172103A
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- JP
- Japan
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- emphasis
- circuit
- signal
- nonlinear
- emphasis circuit
- Prior art date
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- Pending
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Classifications
-
- G—PHYSICS
- G11—INFORMATION STORAGE
- G11B—INFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
- G11B20/00—Signal processing not specific to the method of recording or reproducing; Circuits therefor
- G11B20/10—Digital recording or reproducing
- G11B20/10009—Improvement or modification of read or write signals
Landscapes
- Engineering & Computer Science (AREA)
- Signal Processing (AREA)
- Television Signal Processing For Recording (AREA)
- Signal Processing Not Specific To The Method Of Recording And Reproducing (AREA)
- Reduction Or Emphasis Of Bandwidth Of Signals (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明は非線形エンファシス回路を備えたＶＴＲの録
画時のプリエンファシス回路、再生時のディエンファシ
ス回路の改良に関するものである。
画時のプリエンファシス回路、再生時のディエンファシ
ス回路の改良に関するものである。
ＦＭ変復調方式により録画再生を行なうＶ ’ｌ’ Ｒ
においでは１通常、復調時の８／Ｎｆ向上させるためエ
ンファシス回路が使用されている。すなわち、録画時変
割前に高域をエンファシスするためプリエンファシス回
路が、また、再生時復調後に前記高域エンファシス分を
復元するためディエンファシス回路が設けられている。
においでは１通常、復調時の８／Ｎｆ向上させるためエ
ンファシス回路が使用されている。すなわち、録画時変
割前に高域をエンファシスするためプリエンファシス回
路が、また、再生時復調後に前記高域エンファシス分を
復元するためディエンファシス回路が設けられている。
第１図はＶＴ）ｔで一般的に用いられる非線形プリエン
ファシス回路の一例である。１は画像信号の入力端、２
は出力端、３はグランドである。ダイオード７．８が導
通しないようなレベル変化の少ない信号においてはエン
ファシス量は抵抗４．コンデンサ５．負荷抵抗１０で決
まりエンファシス量は犬となる。しかし、ダイオード７
．８が導通するようなレベル変化の太きい１周波数成分
の高い信号が入ると、エンファシス回路にコンデンサ６
が入り、エンファシス量を低下させる。この回路の目的
は高周波で大きなレベル変化を持った信号に対してはエ
ンファシス量を落して変調器へ送り。
ファシス回路の一例である。１は画像信号の入力端、２
は出力端、３はグランドである。ダイオード７．８が導
通しないようなレベル変化の少ない信号においてはエン
ファシス量は抵抗４．コンデンサ５．負荷抵抗１０で決
まりエンファシス量は犬となる。しかし、ダイオード７
．８が導通するようなレベル変化の太きい１周波数成分
の高い信号が入ると、エンファシス回路にコンデンサ６
が入り、エンファシス量を低下させる。この回路の目的
は高周波で大きなレベル変化を持った信号に対してはエ
ンファシス量を落して変調器へ送り。
キャリア信号の帯域を制限することにあり、再生画の反
転を防いでいる。
転を防いでいる。
また、レベル変化の少ない信号に対してはエンファシス
量を上げ再生画のＳ／Ｎを向上させている。画像信号中
の同期信号においても前縁、後縁において、ダイオード
７．８が導通しエンファシス量が低下するため、再生画
においてこの部分のＳ／Ｎが低下する。
量を上げ再生画のＳ／Ｎを向上させている。画像信号中
の同期信号においても前縁、後縁において、ダイオード
７．８が導通しエンファシス量が低下するため、再生画
においてこの部分のＳ／Ｎが低下する。
ダイレクトカラープロセスによる再生の場合。
時間軸変動を含んだ再生画を時間軸補正器を通して安定
したカラー再生画を得ているが、この補正を行なう基準
信号として、主に再生画の同期信号エツジが使われる。
したカラー再生画を得ているが、この補正を行なう基準
信号として、主に再生画の同期信号エツジが使われる。
このとき、同期信号エツジのＳ／Ｎが悪いと時間軸変動
を十分取り除くことができず、安定したカラー再生画を
得ることはできない。非線形エンファシス回路において
は、再生画の反転防止、およびレベル変化の少ない信号
に対してはＳ／Ｎを向上させる利点はあったが１時間軸
補正器を通した時は前記の欠点があった。
を十分取り除くことができず、安定したカラー再生画を
得ることはできない。非線形エンファシス回路において
は、再生画の反転防止、およびレベル変化の少ない信号
に対してはＳ／Ｎを向上させる利点はあったが１時間軸
補正器を通した時は前記の欠点があった。
第２図は非線形ディエンファシス回路の一例で。
１１は回路入力端、１２は帰還回路１３を持った増幅器
。
。
１４はその出力端である。増幅器、出力信号は帰還回路
Ｊ３の入力端１から回路に入り、出力＠２がら増幅器１
２へ帰還される。帰還回路１３は第１図に示したプリエ
ンファシス回路と同じ回路であるため。
Ｊ３の入力端１から回路に入り、出力＠２がら増幅器１
２へ帰還される。帰還回路１３は第１図に示したプリエ
ンファシス回路と同じ回路であるため。
第２図に示した帰還回路を持った増幅器は帰還回路の入
力端１の信号レベルを第１図の入力端１のレベルと同じ
にすればプリエンファシスとは逆のディエンファシス特
性を持つことになる。
力端１の信号レベルを第１図の入力端１のレベルと同じ
にすればプリエンファシスとは逆のディエンファシス特
性を持つことになる。
この発明は例えば同期信号後縁部分はエンファシス量を
低下きせずに記録再生を行なわせるように非線形エンフ
ァシス回路を改良したことを特徴とし、その目的は再生
信号における同期信号後縁のＳ／Ｎを向上させ、後縁を
時間軸補正器の基準信号とすることにより１時間軸補正
器度ヲ上げることにある。
低下きせずに記録再生を行なわせるように非線形エンフ
ァシス回路を改良したことを特徴とし、その目的は再生
信号における同期信号後縁のＳ／Ｎを向上させ、後縁を
時間軸補正器の基準信号とすることにより１時間軸補正
器度ヲ上げることにある。
画像信号をプリエンファシス回路に通してＦＭ変調する
と同期信号前縁はキャリア周波数がキャリア中心周波数
から離れる方向に偏移し、ＲＦ帯域が狭いと反転を起す
。同期信号後縁はキャリア周波数がキャリア中心周波数
方向に偏移し反転は起きにくい。よってこの発明におい
ては前縁は非線形エンファシスにより反転を起さなくシ
、この前縁タイミングから後縁部分のタイミングパルス
を作ジ、パルス期間は線形エンファシスとし、エンファ
シス量を大きくして同期信号後縁部のＳ／Ｎを向上させ
るようにしている。
と同期信号前縁はキャリア周波数がキャリア中心周波数
から離れる方向に偏移し、ＲＦ帯域が狭いと反転を起す
。同期信号後縁はキャリア周波数がキャリア中心周波数
方向に偏移し反転は起きにくい。よってこの発明におい
ては前縁は非線形エンファシスにより反転を起さなくシ
、この前縁タイミングから後縁部分のタイミングパルス
を作ジ、パルス期間は線形エンファシスとし、エンファ
シス量を大きくして同期信号後縁部のＳ／Ｎを向上させ
るようにしている。
以下この発明の実施例を第３図により説明する。
これはプリエンファシス回路であって信号の入力端１は
線形エンファシス回路すなわち抵抗４．コンデンサ５の
並列回路を介して出力端２に接続される。出力端２には
負荷抵抗１ｏが接続される。さらに出力端２にはアナロ
グスイッチ回路１５を介して非線形エンファシス回路、
すなわちコンデンサ６とダイオード７．８．抵抗９の並
列回路との直列回路が接続される。通常はスイッチ回路
１５は閉じており、第１図に示した回路と同様の動作を
する。
線形エンファシス回路すなわち抵抗４．コンデンサ５の
並列回路を介して出力端２に接続される。出力端２には
負荷抵抗１ｏが接続される。さらに出力端２にはアナロ
グスイッチ回路１５を介して非線形エンファシス回路、
すなわちコンデンサ６とダイオード７．８．抵抗９の並
列回路との直列回路が接続される。通常はスイッチ回路
１５は閉じており、第１図に示した回路と同様の動作を
する。
ダイレクトカラープロセスによる再生を行なう時１時間
軸補正器の基準信号を再生画信号の同期信号後縁とする
。時間軸補正の精度を上げるには。
軸補正器の基準信号を再生画信号の同期信号後縁とする
。時間軸補正の精度を上げるには。
この同期信号後縁の８／Ｎを向上させ、エツジをシャー
プにする必要がある。この目的のため同期５
ｑｒｓ信号後縁部分ではスイッチ回
路１５が開き非線形回路を切り離しエンファシス量を上
げる。この操作をディエンファシス回路についても同様
に行なうことによって、波形を復元できＳ／Ｎも向上す
る。
プにする必要がある。この目的のため同期５
ｑｒｓ信号後縁部分ではスイッチ回
路１５が開き非線形回路を切り離しエンファシス量を上
げる。この操作をディエンファシス回路についても同様
に行なうことによって、波形を復元できＳ／Ｎも向上す
る。
１６はスイッチ回路を駆動する信号の入力端である。
スイッチ駆動信号のタイミングの一例を第４図に示す。
１７は入力信号、１８はスイッチ駆動信号である。スイ
ッチ駆動信号１８は入力信号１７の同期信号前縁１７ａ
から作られたタイミングパルスでこのパルスは入力信号
の後縁１７ｂを含みバースト信号１７Ｃの前でパルスを
切るようにした期間１９を有する。この期間１９はスイ
ッチ開放タイミングを示す。
ッチ駆動信号１８は入力信号１７の同期信号前縁１７ａ
から作られたタイミングパルスでこのパルスは入力信号
の後縁１７ｂを含みバースト信号１７Ｃの前でパルスを
切るようにした期間１９を有する。この期間１９はスイ
ッチ開放タイミングを示す。
前述のようにスイッチ駆動信号１８でスイッチ回路１５
を切ることにより同期信号後縁部のエンファシス量が上
がりＳ／Ｎが向上する。しかも同期信号後縁部はエンフ
ァシス量が上がっても、キャリア信号はキャリア周波数
がキャリア中心周波数方向に偏移するので反転を起こし
にくい利点がある。
を切ることにより同期信号後縁部のエンファシス量が上
がりＳ／Ｎが向上する。しかも同期信号後縁部はエンフ
ァシス量が上がっても、キャリア信号はキャリア周波数
がキャリア中心周波数方向に偏移するので反転を起こし
にくい利点がある。
この発明による非線形エンファシス回路を使って録画・
再生を行なうと同期信号後縁のＳ／Ｎ。
再生を行なうと同期信号後縁のＳ／Ｎ。
６−
波形特性が向上し、これを基準信号とした時間軸補正器
を通すことにより補正精度が向上する。また同期信号後
縁部分以外は非線形エンファシスの利点が現われ１反転
を起こしにくいし、レベル変化の少ない画像信号におい
てはＳ／Ｎが向上する。
を通すことにより補正精度が向上する。また同期信号後
縁部分以外は非線形エンファシスの利点が現われ１反転
を起こしにくいし、レベル変化の少ない画像信号におい
てはＳ／Ｎが向上する。
第１図は従来の非線形プリエンファシス回路。
第２図は非線形ディエンファシス回路、第３図は本発明
の一実施例のプリエンファシス回路、第４図は本発明の
動作タイミング図である。 ■・・・回路入力端、２・・・回路出力端、３・・グラ
ンド端、４，９・・・抵抗、５．６・・コンデンサ、７
，８・・ダイオード、１０・・・負荷抵抗、１１・・デ
ィエンファシス入力端、１２・・差動増幅器、１３
・非線形プリエンファシス回Ｌ １４・・ディエンフ
ァシス出力端。 １５・・・アナログスイッチ、１６・・・スイッチ駆動
信号端、１７・・・エンファシス回路入力画像信号、１
８・・・スイッチ駆動信号、１９・・・スイッチ開放タ
イミング。 ７− 第１図 。 （
の一実施例のプリエンファシス回路、第４図は本発明の
動作タイミング図である。 ■・・・回路入力端、２・・・回路出力端、３・・グラ
ンド端、４，９・・・抵抗、５．６・・コンデンサ、７
，８・・ダイオード、１０・・・負荷抵抗、１１・・デ
ィエンファシス入力端、１２・・差動増幅器、１３
・非線形プリエンファシス回Ｌ １４・・ディエンフ
ァシス出力端。 １５・・・アナログスイッチ、１６・・・スイッチ駆動
信号端、１７・・・エンファシス回路入力画像信号、１
８・・・スイッチ駆動信号、１９・・・スイッチ開放タ
イミング。 ７− 第１図 。 （
Claims (1)
- （１）高周波で且つ大きいレベル変化を有する信号に対
してはエンファシス量を減少させるようにした。録硫再
生装置の非線形エンファシス回路において、録画再生信
号中の所定のパルスエツジ部を含む期間ではエンファシ
ス量を減少させないようにしたことを特徴とする非線形
エンファシス回路。 （２１特許請求の範囲第１項において、前記所定パルス
エツジ部は同期信号における後縁であることを特徴とす
る非線形エンファシス回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58045940A JPS59172103A (ja) | 1983-03-22 | 1983-03-22 | 非線形エンフアシス回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58045940A JPS59172103A (ja) | 1983-03-22 | 1983-03-22 | 非線形エンフアシス回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS59172103A true JPS59172103A (ja) | 1984-09-28 |
Family
ID=12733269
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58045940A Pending JPS59172103A (ja) | 1983-03-22 | 1983-03-22 | 非線形エンフアシス回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS59172103A (ja) |
-
1983
- 1983-03-22 JP JP58045940A patent/JPS59172103A/ja active Pending
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