JPS59220383A - 感熱記録装置 - Google Patents
感熱記録装置Info
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- JPS59220383A JPS59220383A JP58096285A JP9628583A JPS59220383A JP S59220383 A JPS59220383 A JP S59220383A JP 58096285 A JP58096285 A JP 58096285A JP 9628583 A JP9628583 A JP 9628583A JP S59220383 A JPS59220383 A JP S59220383A
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- Japan
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- bit
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- B—PERFORMING OPERATIONS; TRANSPORTING
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- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
- B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
- B41J2/35—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads providing current or voltage to the thermal head
- B41J2/355—Control circuits for heating-element selection
- B41J2/3555—Historical control
-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
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- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
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- B41J2/355—Control circuits for heating-element selection
- B41J2/36—Print density control
- B41J2/365—Print density control by compensation for variation in temperature
Landscapes
- Electronic Switches (AREA)
- Facsimile Image Signal Circuits (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
抜４防」
本発明は、感熱記録装置に関し、特に、一定しない時間
間隔で且つ高速で記録する感熱記録装置において、予定
の濃度で記録するために記録電力パルス幅の制御を行な
う感熱記録ヘッド駆動方式感熱記録における記録濃度は
、種々の要因に基づいて変動するが、これらの要因の中
で、特に高速記録においては′、記録間隔の時間による
影響が大きい。即ち記録ヘッドの発熱要素は、駆動され
た場合、所定時間後には基底温度レベルに復帰するが、
それ迄は蓄熱状態にあり、高蓄熱状態で駆動すると濃い
記録となってしまう。その為、発熱要素が基底温度レベ
ルへ落ちるのを待って次の記録を行なうか、或いは急速
に基底温度レベルへ落とす工夫を行なってきたが、高速
記録が要求される場合には、対処できなくなり、蓄熱状
態で次の記録を行なわざるを得なくなってきていた。そ
こで従来、記録ヘッドの各発熱要素毎に記録間隔時間を
測定し、その記録間隔時間に応じて選択したパルス幅の
記録電力パルスで各発熱要素を熱駆動する方式が提案さ
れている。
間隔で且つ高速で記録する感熱記録装置において、予定
の濃度で記録するために記録電力パルス幅の制御を行な
う感熱記録ヘッド駆動方式感熱記録における記録濃度は
、種々の要因に基づいて変動するが、これらの要因の中
で、特に高速記録においては′、記録間隔の時間による
影響が大きい。即ち記録ヘッドの発熱要素は、駆動され
た場合、所定時間後には基底温度レベルに復帰するが、
それ迄は蓄熱状態にあり、高蓄熱状態で駆動すると濃い
記録となってしまう。その為、発熱要素が基底温度レベ
ルへ落ちるのを待って次の記録を行なうか、或いは急速
に基底温度レベルへ落とす工夫を行なってきたが、高速
記録が要求される場合には、対処できなくなり、蓄熱状
態で次の記録を行なわざるを得なくなってきていた。そ
こで従来、記録ヘッドの各発熱要素毎に記録間隔時間を
測定し、その記録間隔時間に応じて選択したパルス幅の
記録電力パルスで各発熱要素を熱駆動する方式が提案さ
れている。
第１図は、従来の記録ヘッド駆動方式を示す図で、各ビ
ット毎に、測定した記録間隔時間に応じて選択したパル
ス幅ψｌ、ψ２．ψＢ・で、データ１゜２．３をゲート
して発熱要素Ｈ１ｒＨ２＋ＨＢを駆動するものであるが
、回路、装置が大がかりになると共に、パルス幅規定信
号が複数ビット共通となっている記録ヘッドにおいては
、各ビット毎の駆動制御ができないという欠点があった
。
ット毎に、測定した記録間隔時間に応じて選択したパル
ス幅ψｌ、ψ２．ψＢ・で、データ１゜２．３をゲート
して発熱要素Ｈ１ｒＨ２＋ＨＢを駆動するものであるが
、回路、装置が大がかりになると共に、パルス幅規定信
号が複数ビット共通となっている記録ヘッドにおいては
、各ビット毎の駆動制御ができないという欠点があった
。
また、記録ヘッド内に、各ビット毎にパルス幅を制御で
きるシフトレジスタ、デコーダ、ラッチ回路を備え、転
送は、画情報と平行してパルス幅を規定するコードを転
送し、画情報と同様にシフト、デコード、ラッチを行な
い、そのビットの長さを駆動パルス幅とする方式のもの
が提案されているが、記録ヘッド内部のパルス幅情報用
のシフトレジスタ等が必要であること、各ビットパルス
幅制御の不要な低速用にはこの機能がむだとなり、コス
ト的に共用化に問題があること、そのため。
きるシフトレジスタ、デコーダ、ラッチ回路を備え、転
送は、画情報と平行してパルス幅を規定するコードを転
送し、画情報と同様にシフト、デコード、ラッチを行な
い、そのビットの長さを駆動パルス幅とする方式のもの
が提案されているが、記録ヘッド内部のパルス幅情報用
のシフトレジスタ等が必要であること、各ビットパルス
幅制御の不要な低速用にはこの機能がむだとなり、コス
ト的に共用化に問題があること、そのため。
パルス幅情報用のシフトレジスタ等をヘッド外部に設け
るのは装置が大がかりになること、またデコーダのみを
外部に設けた場合、シフトレジスタの列が増し、ヘッド
内部の回路の軽減はあまり望めないこと等の欠点があっ
た。
るのは装置が大がかりになること、またデコーダのみを
外部に設けた場合、シフトレジスタの列が増し、ヘッド
内部の回路の軽減はあまり望めないこと等の欠点があっ
た。
目 的
本発明は、斯かる事情に鑑みてなされたもので、サーマ
ルヘッド内部に各ビット単位で印加エネルギを制御する
手段を持たずに、各ビットの駆動制御を行なうことを目
的とする。
ルヘッド内部に各ビット単位で印加エネルギを制御する
手段を持たずに、各ビットの駆動制御を行なうことを目
的とする。
眉ニーー戒。
本発明の構成について、以下、実施例に基づいて説明す
る。
る。
第２図は、本発明の実施例を示す回路構成図、基本的に
は、１ラインのデータを２にビット（２０４８ビツト）
とし、ｌラインを８回転送し、各発熱要素の駆動パルス
幅を ■、各ビットの８ライン分相当の時間までの駆動前歴（
３ビツト） ■、各ビットの左右の情報（２ビツト）■、サーマルヘ
ッドの蓄熱状態（３ビツト）の３つの情報８ビツトから
演算して決定するものである。
は、１ラインのデータを２にビット（２０４８ビツト）
とし、ｌラインを８回転送し、各発熱要素の駆動パルス
幅を ■、各ビットの８ライン分相当の時間までの駆動前歴（
３ビツト） ■、各ビットの左右の情報（２ビツト）■、サーマルヘ
ッドの蓄熱状態（３ビツト）の３つの情報８ビツトから
演算して決定するものである。
第２図において、入力データＩＤＡＴＡは、ＲΔＭｌ又
はＲＡＭ２にトグル的に入力され、この制御は、トグル
バッファコントロール３によって行なわれる。一方のＲ
ＡＭが”Ｆｕｌｌ”になると。
はＲＡＭ２にトグル的に入力され、この制御は、トグル
バッファコントロール３によって行なわれる。一方のＲ
ＡＭが”Ｆｕｌｌ”になると。
そのデータは１ラインの８倍の速度で出力され、シフト
レジスタ４に入力される。この出力は、１ラインの時間
に８回行なわれる。なお、ＩＡＤＤは入力時のアドレス
、０ＡＤＤは出力時のアドレスである。そしてシフトレ
ジスタ４の３ビット遅れの出力（Ｑｅ）は、ゲート５の
一方に入力される。ゲート５の他方の入力は、各ビット
に同期したパルス幅を決定するデータで、この値が’Ｔ
ｒｕ ｅ ｕのときのサーマルヘッドへの転送データは
有効で、”Ｆａｌｓｅ”の場合は無効になる。
レジスタ４に入力される。この出力は、１ラインの時間
に８回行なわれる。なお、ＩＡＤＤは入力時のアドレス
、０ＡＤＤは出力時のアドレスである。そしてシフトレ
ジスタ４の３ビット遅れの出力（Ｑｅ）は、ゲート５の
一方に入力される。ゲート５の他方の入力は、各ビット
に同期したパルス幅を決定するデータで、この値が’Ｔ
ｒｕ ｅ ｕのときのサーマルヘッドへの転送データは
有効で、”Ｆａｌｓｅ”の場合は無効になる。
次に駆動パルス幅決定のためのデータ処理の説明をする
。ＲＡＭ６は２ＫＸ４ビツトの容量を持ち、トグルバッ
ファからの出力速度と同期してアドレッシングされる。
。ＲＡＭ６は２ＫＸ４ビツトの容量を持ち、トグルバッ
ファからの出力速度と同期してアドレッシングされる。
このＲＡＭ６の入力は、８回データ転送の最初の１回の
時間に行なわれる。
時間に行なわれる。
そして入力の４ビツト目（４ｐ ｉｎ）にシフトレジス
タ４の１ビット遅れのデータが入力される！これは、サ
ーマルヘッドへのデータは、３ビット遅れのデータであ
るが、マルチプレクサ９の出力までには２ビツトの遅れ
が生ずるので、これと同期をとるため２ビツト前のデー
タをＲＡＭ６に入力している。
タ４の１ビット遅れのデータが入力される！これは、サ
ーマルヘッドへのデータは、３ビット遅れのデータであ
るが、マルチプレクサ９の出力までには２ビツトの遅れ
が生ずるので、これと同期をとるため２ビツト前のデー
タをＲＡＭ６に入力している。
今、ＲＡＭ ６ （４ｐ ｉ ｎ） ヘの入力データが
、“Ｔ ｒ ｕ ｅ ”で１ライン前のデータがＴ ｒ
ｕ ｅの場合、ゲート１１の出力によってカウンタ７
がリセットされる。データが”Ｆ ａ ｌ ｓ ｅ”で
あるとカウンタ７がインクレメントされる。カウンタ７
が８カウントするとＱＡ、ＱＢ、ＱＣの値は全て”Ｔｒ
ｕｅ”となり、ゲート１０の出力によりカウンタ動作は
停止する。また、カウンタ７の出力はＲＡＭ６に入力さ
れ、これが各ビットの駆動前歴のデータとなる。すなわ
ち、データ”Ｔｒｕｅ”が生じた時、その８ライン前ま
でのどの位置でそのビットが駆動されたかが記憶されて
おり、ＲＯＭ８の入力０，１．２に入力される。なお、
この実施例では連続記録の場合で記述しているが、ファ
クシミリにおける間欠動作がある場合は、カウンタ７の
インクレメント動作をライン単位ではなく単位時間で行
なうことにより、駆動前歴を時間で記憶することができ
る。
、“Ｔ ｒ ｕ ｅ ”で１ライン前のデータがＴ ｒ
ｕ ｅの場合、ゲート１１の出力によってカウンタ７
がリセットされる。データが”Ｆ ａ ｌ ｓ ｅ”で
あるとカウンタ７がインクレメントされる。カウンタ７
が８カウントするとＱＡ、ＱＢ、ＱＣの値は全て”Ｔｒ
ｕｅ”となり、ゲート１０の出力によりカウンタ動作は
停止する。また、カウンタ７の出力はＲＡＭ６に入力さ
れ、これが各ビットの駆動前歴のデータとなる。すなわ
ち、データ”Ｔｒｕｅ”が生じた時、その８ライン前ま
でのどの位置でそのビットが駆動されたかが記憶されて
おり、ＲＯＭ８の入力０，１．２に入力される。なお、
この実施例では連続記録の場合で記述しているが、ファ
クシミリにおける間欠動作がある場合は、カウンタ７の
インクレメント動作をライン単位ではなく単位時間で行
なうことにより、駆動前歴を時間で記憶することができ
る。
ＲＯＭ８のｐｉｎ３．４にはシフトレジスタ４のＱＡ、
ＱＣの出力が入力されるが、これは各ビットの左右の情
報である。実際はＱＢ、ＱＤのデータであるが、マルチ
プレクサ９へのラッチ動作で１ビツト遅れるためＱＡ、
ＱＣとなっている。
ＱＣの出力が入力されるが、これは各ビットの左右の情
報である。実際はＱＢ、ＱＤのデータであるが、マルチ
プレクサ９へのラッチ動作で１ビツト遅れるためＱＡ、
ＱＣとなっている。
ＲＯＭ８のｐｉｎ５，６，７にはヘッド基板温度の情報
が入力される。
が入力される。
以上ＲＯＭ８への８つの入力によって各ビットの印加パ
ルス幅が、ＲＯＭ８のテーブルによっ決定される。この
動作は８回転送の第１回目に行なわれる（ＷＥＮＡが”
Ｔ ｒ’ ｕ ｅ ”の間）。したがって第１回回転送
の間はデータをすべてＴｒｕｅにする（ＲＯＭ８の出力
ＱＯは常に’Ｔ ｒ ｕ ｅ”） 、。
ルス幅が、ＲＯＭ８のテーブルによっ決定される。この
動作は８回転送の第１回目に行なわれる（ＷＥＮＡが”
Ｔ ｒ’ ｕ ｅ ”の間）。したがって第１回回転送
の間はデータをすべてＴｒｕｅにする（ＲＯＭ８の出力
ＱＯは常に’Ｔ ｒ ｕ ｅ”） 、。
マルチプレクサ９の出力はＭＰＸＣＬＫにより、転送回
数（第何回目）によってＲＯＭ８の出力の８ビツトのう
ち１ビツトが選ばれ、ゲート５に入力され、その出力は
シフトレジスタ１２（２０４８ビツト）に入力される。
数（第何回目）によってＲＯＭ８の出力の８ビツトのう
ち１ビツトが選ばれ、ゲート５に入力され、その出力は
シフトレジスタ１２（２０４８ビツト）に入力される。
第ｎ回目の転送データは、転送終了後ＬＯＡＤ信号によ
ってヘッドにラッチされ、次のＬＯＡＤ信号が入力され
るまでその信号を記録する。第８回目のラッチが終了す
ると、１回転送分の時間経過時点でＲＥＳＥＴ信号によ
ってラッチデータがリセットされｌラインの記録が終了
する。この様子を第３図にタイムチャートとして示す。
ってヘッドにラッチされ、次のＬＯＡＤ信号が入力され
るまでその信号を記録する。第８回目のラッチが終了す
ると、１回転送分の時間経過時点でＲＥＳＥＴ信号によ
ってラッチデータがリセットされｌラインの記録が終了
する。この様子を第３図にタイムチャートとして示す。
なお、データ転送速度が素子等の制限で追従しない場合
はデータを並列に入力し、各データラインにおいて同様
の制御をすることにより、速度に ゛追従させること
が可能である。
はデータを並列に入力し、各データラインにおいて同様
の制御をすることにより、速度に ゛追従させること
が可能である。
来−一一里
以上のように本発明によれば、■ライン中画情報をｎ回
転送し、各ビットごとにデータ゛’Ｔｒｕｅ”の回数を
駆動パルス幅とし、また、各ビット毎にその駆動前歴お
よび左右又はそれ以上の周辺のデータ、ヘッド基板温度
から駆動パルス幅を制御しているので、サーマルヘッド
内部に各ビット単位で印加エネルギを制御する手段を設
けずに各ビットのエネルギ制御を行なうことができ、低
速記録用とし共通化も可能になる。
転送し、各ビットごとにデータ゛’Ｔｒｕｅ”の回数を
駆動パルス幅とし、また、各ビット毎にその駆動前歴お
よび左右又はそれ以上の周辺のデータ、ヘッド基板温度
から駆動パルス幅を制御しているので、サーマルヘッド
内部に各ビット単位で印加エネルギを制御する手段を設
けずに各ビットのエネルギ制御を行なうことができ、低
速記録用とし共通化も可能になる。
第１図は従来の記録ヘッド駆動方式を示す図、第２図は
本発明の実施例を示す回路構成図、第３図はタイムチャ
ートである。 １．２・・・ＲＡＭ、３・・トグルバッファコントロー
ル、４・・・シフトレジスタ、５・・・ゲート、６・・
・ＲＡＭ、７・・・カウンタ、８・・・ＲＡＭ、９・・
・マルチプレクサ、１０．１１・・・ゲート、１２・・
・シフトレジスタ、１３・・・ラッチ回路。 ４４９
本発明の実施例を示す回路構成図、第３図はタイムチャ
ートである。 １．２・・・ＲＡＭ、３・・トグルバッファコントロー
ル、４・・・シフトレジスタ、５・・・ゲート、６・・
・ＲＡＭ、７・・・カウンタ、８・・・ＲＡＭ、９・・
・マルチプレクサ、１０．１１・・・ゲート、１２・・
・シフトレジスタ、１３・・・ラッチ回路。 ４４９
Claims (2)
- （１）、直列にアレイ状に記録素子が並ぶ記録装置にお
いて、サーマルヘッドに１ラインのシフトレジスタとそ
のデータをラッチするラッチ手段を設け、ｌラインのデ
ータを複数回転送し、ヘッドの各発熱体に対応するデー
タの長さく個数）を駆動パルス幅とすることによって各
発熱体ごとの駆動エネルギを制御することを特徴とする
感熱記録装置。 - （２）、直列にアレイ状に記録素子が並ぶ記録装置にお
いて、サーマルヘッドに１ラインのシフトレジスタとそ
のデータをラッチするラッチ手段を設け、更に各ビット
ごとにその駆動前歴および左右又はそれ以上の周辺デー
タ、及びヘッド基板温度から当該ビットの発熱温度が一
定となるように駆動パルス幅を制御する演算回路を設け
、各発熱体に対応するデータの長さく個数）を駆動パル
ス幅とすることによって各発熱体ごとの駆動エネルギを
制御することを特徴とする感熱記録装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58096285A JPH0655520B2 (ja) | 1983-05-31 | 1983-05-31 | 感熱記録ヘッドの駆動方法 |
| US06/570,303 US4590484A (en) | 1983-01-13 | 1984-01-13 | Thermal recording head driving control system |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58096285A JPH0655520B2 (ja) | 1983-05-31 | 1983-05-31 | 感熱記録ヘッドの駆動方法 |
Related Child Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29162993A Division JPH0811450B2 (ja) | 1993-11-22 | 1993-11-22 | 記録ヘッドの駆動装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS59220383A true JPS59220383A (ja) | 1984-12-11 |
| JPH0655520B2 JPH0655520B2 (ja) | 1994-07-27 |
Family
ID=14160827
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58096285A Expired - Lifetime JPH0655520B2 (ja) | 1983-01-13 | 1983-05-31 | 感熱記録ヘッドの駆動方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPH0655520B2 (ja) |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57117978A (en) * | 1981-01-16 | 1982-07-22 | Canon Inc | Thermal printer |
-
1983
- 1983-05-31 JP JP58096285A patent/JPH0655520B2/ja not_active Expired - Lifetime
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS57117978A (en) * | 1981-01-16 | 1982-07-22 | Canon Inc | Thermal printer |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0655520B2 (ja) | 1994-07-27 |
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