JPS5925581A - Ｄｃ／ｄｃコンバ−タ装置 - Google Patents
Ｄｃ／ｄｃコンバ−タ装置Info
- Publication number
- JPS5925581A JPS5925581A JP13489882A JP13489882A JPS5925581A JP S5925581 A JPS5925581 A JP S5925581A JP 13489882 A JP13489882 A JP 13489882A JP 13489882 A JP13489882 A JP 13489882A JP S5925581 A JPS5925581 A JP S5925581A
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- JP
- Japan
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- transistors
- transistor
- circuit
- transformer
- terminal
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- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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-
- H—ELECTRICITY
- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M3/00—Conversion of DC power input into DC power output
- H02M3/22—Conversion of DC power input into DC power output with intermediate conversion into AC
- H02M3/24—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters
- H02M3/28—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC
- H02M3/325—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC using devices of a triode or a transistor type requiring continuous application of a control signal
- H02M3/335—Conversion of DC power input into DC power output with intermediate conversion into AC by static converters using discharge tubes with control electrode or semiconductor devices with control electrode to produce the intermediate AC using devices of a triode or a transistor type requiring continuous application of a control signal using semiconductor devices only
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- Engineering & Computer Science (AREA)
- Power Engineering (AREA)
- Dc-Dc Converters (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
この発明はある＠流電圧を別の直流電圧へ変換するＤｃ
／ＤＣコンバータ装置の改良に関するものである。
／ＤＣコンバータ装置の改良に関するものである。
従来のＤ Ｃ／Ｄ Ｃコンバータは第１図に示すような
回路で構成されていた。第１図において＋１１は直流電
源、 ＋２１． ＋３＋、 ＋４１及び（５）はトラン
ジスタ。
回路で構成されていた。第１図において＋１１は直流電
源、 ＋２１． ＋３＋、 ＋４１及び（５）はトラン
ジスタ。
＋６＋、 （７１，ｆ８Ｌ 及び）９）はダイオード、
０ｕ）はトランスでＡ、 Ｂはトランスｎｏｔの一次
仰ｊ端子Ｃ，Ｄ は２次１則端子、 ｕｉ＋は整流平滑
回路、 Ｕａは負荷、 （１ｊ１はトランジスタ（２）
及びトランジスタ（５）を駆動するドライバー回路、
［１４１はトランジスタ（３）及びトランジスタ１５１
ｋ 非動するドライバー回路である。
０ｕ）はトランスでＡ、 Ｂはトランスｎｏｔの一次
仰ｊ端子Ｃ，Ｄ は２次１則端子、 ｕｉ＋は整流平滑
回路、 Ｕａは負荷、 （１ｊ１はトランジスタ（２）
及びトランジスタ（５）を駆動するドライバー回路、
［１４１はトランジスタ（３）及びトランジスタ１５１
ｋ 非動するドライバー回路である。
この回路は直流電源（１）の出力電圧ｆｒ：Ｐｆｒ望の
直流電圧にするためトランジスタ＋２１． ＋５）’ｔ
ドライバー回路で０Ｎ１０ＦＦ （、、韮たトランジス
タ（３１，＋４１をドライバー回路圓で０Ｎ１０ＦＦ
ＬこのＯＮ／（ＪＦＦされた信号をトランスｔ１０１で
所望の電圧へ笈酸し。
直流電圧にするためトランジスタ＋２１． ＋５）’ｔ
ドライバー回路で０Ｎ１０ＦＦ （、、韮たトランジス
タ（３１，＋４１をドライバー回路圓で０Ｎ１０ＦＦ
ＬこのＯＮ／（ＪＦＦされた信号をトランスｔ１０１で
所望の電圧へ笈酸し。
整流平滑回路で直流にＫ（！ｉｌ！ｔ、ている。
次にこの装置の励Ｉ／ｆ：全詳細に説明する。直流′岨
源ｉ１Ｊの出力はトランジスタｔ２Ｌ ＋３＋のコレク
タに正電極をトランジスタ＋４１． ＋５１のエミッタ
ＶＣ頁電極を印カロしている。
源ｉ１Ｊの出力はトランジスタｔ２Ｌ ＋３＋のコレク
タに正電極をトランジスタ＋４１． ＋５１のエミッタ
ＶＣ頁電極を印カロしている。
この状態でドライバー回路（１３１よシトランジスタｆ
２１． ＋５１のベースにＯＮ信号が伝送されると、ト
ランジスタ＋２）、 ＋５１はＯＮ となシ直流亀源（
１）からトランジスタｆ２１． ）ランスＬＩＯＩの
Ａ＠子に入り。
２１． ＋５１のベースにＯＮ信号が伝送されると、ト
ランジスタ＋２）、 ＋５１はＯＮ となシ直流亀源（
１）からトランジスタｆ２１． ）ランスＬＩＯＩの
Ａ＠子に入り。
トランスａ■のＢ端子、トランジスタ（５）全経由して
電源電流が流れトランス（１０）の２次側端子に電圧が
誘起され整流平滑回路Ｕυで直流となシ貝何じに電圧が
印加される。この時トランジスタ（３）（４）はドライ
バー回路（１４１によってＯＦＦとなっている。
電源電流が流れトランス（１０）の２次側端子に電圧が
誘起され整流平滑回路Ｕυで直流となシ貝何じに電圧が
印加される。この時トランジスタ（３）（４）はドライ
バー回路（１４１によってＯＦＦとなっている。
次にドライバー回路口Ｊによってトランジスタ＋２１
＋５１はＯＦ’Ｆとなシトライバー回路（１４Ｉより、
トランジスタｆ３＋ ＋４１のベースにＯＮ信号が伝送
されトランジスタ＋３１ ＋４１がＯＮとなシ直流′亀
源（１）からトランジスタ（３）トランスｔｌＵｌのＢ
＠ｉ十に入シ、トランス叫のＡ端子、トランジスタ＋４
１に一経由して電流か流れトランスｕＱの２次側端子に
電圧が誘起され整流平滑回路（１１１で直流となシ貝向
０カに電圧が印加される。この様に動作し負荷（１２＋
にはトランス叫の１次巻線と２次巻線の巻線比による所
望の電圧を供給することができる。以上の様に従来のこ
の棟の装置は動作するがドライバー回路口−及びσりに
よってトランジスタ＋２１． ＋５Ｊ及び（３）（４）
がＯＦＦになる時にトランジスタのベース信号のＯＦＦ
時間と実際にトランジスタがＯＦＦ Ｉｃなる時間（ト
ランジスタのコレクタ電流が零になる時間）に時間差が
ある。この時間差はトランジスタ固有のものであり１通
常この時間差を想定してドライバ回路の０Ｎ１０ＦＦ時
間差を決めているが、この時間差は周囲温度条件等によ
って大きく変化するためスイッチング周仮数を高くする
場什のＬ）Ｃ／ＤＣコンバータ装置においては大きな障
害となっていた。またタリえげトランジスタ（２）およ
び（５）がこの時間差によってまだ導通状態にある時一
方のトランジスタ＋３１．１４１がドライバー回路（１
４１によって（ＪＮ状態になると直流電源（１）からの
電流はトランジスタ（２）からトランジスタ（３）から
トランジスタ（５）へ流れるため負荷１１４＋１へ電流
が流れず短絡状態となシトラ／ジスタ及び直流電源を破
損する原因となっていた。
＋５１はＯＦ’Ｆとなシトライバー回路（１４Ｉより、
トランジスタｆ３＋ ＋４１のベースにＯＮ信号が伝送
されトランジスタ＋３１ ＋４１がＯＮとなシ直流′亀
源（１）からトランジスタ（３）トランスｔｌＵｌのＢ
＠ｉ十に入シ、トランス叫のＡ端子、トランジスタ＋４
１に一経由して電流か流れトランスｕＱの２次側端子に
電圧が誘起され整流平滑回路（１１１で直流となシ貝向
０カに電圧が印加される。この様に動作し負荷（１２＋
にはトランス叫の１次巻線と２次巻線の巻線比による所
望の電圧を供給することができる。以上の様に従来のこ
の棟の装置は動作するがドライバー回路口−及びσりに
よってトランジスタ＋２１． ＋５Ｊ及び（３）（４）
がＯＦＦになる時にトランジスタのベース信号のＯＦＦ
時間と実際にトランジスタがＯＦＦ Ｉｃなる時間（ト
ランジスタのコレクタ電流が零になる時間）に時間差が
ある。この時間差はトランジスタ固有のものであり１通
常この時間差を想定してドライバ回路の０Ｎ１０ＦＦ時
間差を決めているが、この時間差は周囲温度条件等によ
って大きく変化するためスイッチング周仮数を高くする
場什のＬ）Ｃ／ＤＣコンバータ装置においては大きな障
害となっていた。またタリえげトランジスタ（２）およ
び（５）がこの時間差によってまだ導通状態にある時一
方のトランジスタ＋３１．１４１がドライバー回路（１
４１によって（ＪＮ状態になると直流電源（１）からの
電流はトランジスタ（２）からトランジスタ（３）から
トランジスタ（５）へ流れるため負荷１１４＋１へ電流
が流れず短絡状態となシトラ／ジスタ及び直流電源を破
損する原因となっていた。
従来の装置はこの棟に構成され、かつＩＭＪ作するため
スイッチング周波数の高周肢の障害となるばかりか、ト
ランジスタの破損さらには直流電源を破損するという欠
点があった。
スイッチング周波数の高周肢の障害となるばかりか、ト
ランジスタの破損さらには直流電源を破損するという欠
点があった。
この発明は従来のこの様なりＣ／ＤＣコンバータ装置の
欠点を除去するためにトランスの一次巻線を２つの巻線
にし短絡モードとなるトランジスタをそれぞれ別巻線に
接続してトランジスタの短絡現象を防止したもので第２
図にこの発明の実施例を示し以下詳細に説明する。
欠点を除去するためにトランスの一次巻線を２つの巻線
にし短絡モードとなるトランジスタをそれぞれ別巻線に
接続してトランジスタの短絡現象を防止したもので第２
図にこの発明の実施例を示し以下詳細に説明する。
この発明はトランス（１０）の−次巻一を２つの巻線に
分離し、それぞれの巻線の端金Ａ端子−Ｂ端子とＦ端子
−Ｆ端子に分離してＭ絖しＡ端子とＦ端子を同相となる
様にし、Ａ端子にトラン−：） スタ［３１のエミッタ
を接続しＦ端子にトランジスタ（２）のエミッタを接続
しＢ端子にトランジスタ＋４）（７） ：＋レクタを接
続しＦ端子にトランジスタ（５）のコレクタを接続した
もので２次にこの発明の詳細な説明する。
分離し、それぞれの巻線の端金Ａ端子−Ｂ端子とＦ端子
−Ｆ端子に分離してＭ絖しＡ端子とＦ端子を同相となる
様にし、Ａ端子にトラン−：） スタ［３１のエミッタ
を接続しＦ端子にトランジスタ（２）のエミッタを接続
しＢ端子にトランジスタ＋４）（７） ：＋レクタを接
続しＦ端子にトランジスタ（５）のコレクタを接続した
もので２次にこの発明の詳細な説明する。
直流電源山の出力はドライバー回路ｕ３＋よりトランジ
スタｔ２Ｌ ＋５１のベースに（ＪＮ信号が伝送される
と、この回路′電流は直流′４源＋１１からトランジス
タ１２）、 ）ランスの１次巻藤のＦ端子に入シトラ
ンスのＦ端子、トランジスタ（５）を経由して流れ、ト
ランス叫の２次巻線に電圧が誘起され。
スタｔ２Ｌ ＋５１のベースに（ＪＮ信号が伝送される
と、この回路′電流は直流′４源＋１１からトランジス
タ１２）、 ）ランスの１次巻藤のＦ端子に入シトラ
ンスのＦ端子、トランジスタ（５）を経由して流れ、ト
ランス叫の２次巻線に電圧が誘起され。
整流平滑回路ｕＩＩで直流となシ創旧’ａＫ或圧が印加
される。この時トランジスタ（３１，＋４１はドライバ
ー回路口４によってＯＦＦとなっている。次にドライバ
ー回路ｑＪによってトランジスタ＋２１． ＋５１ハＯ
ＦＦとなｐドライバー回路口ａによってトランジスタ！
３＋ ＋４）がＯＮとなシ直流篭源（１）からトランジ
スタ＋３）、 ＋−ランスｔｌＱ）のＡ端子に入シ、
Ｂ端子。
される。この時トランジスタ（３１，＋４１はドライバ
ー回路口４によってＯＦＦとなっている。次にドライバ
ー回路ｑＪによってトランジスタ＋２１． ＋５１ハＯ
ＦＦとなｐドライバー回路口ａによってトランジスタ！
３＋ ＋４）がＯＮとなシ直流篭源（１）からトランジ
スタ＋３）、 ＋−ランスｔｌＱ）のＡ端子に入シ、
Ｂ端子。
トランジスタ（４）全経由して電流が流れトランス００
）の２次１目１１端子に電圧が誘起され廠流平ｍ回路口
ｌＩで直流となシ貝荷口２に電圧が目」加される。この
様に動作するためドライバー回路（ＩＪ及びｕＯＫよっ
てトランジスタ＋２＋、 ＋５Ｊ及び＋３１ ＋４Ｊが
ＯＦＦになる時にトランジスタのベース信号のＯＩ＝”
Ｆ時間と実際にトランジスタがＯＦＦになる時間に時間
差が生じた場合でも互いに短絡モードとなるトランジス
タの間は接続がないため（たとえ（ばトラノシスタ（２
）トランジスタ（４）の１団及びトランジスタ（３）と
トランジスタ（５）の間フトランジスタ間で短絡状態と
ならずトランジスタの破損を防止し。
）の２次１目１１端子に電圧が誘起され廠流平ｍ回路口
ｌＩで直流となシ貝荷口２に電圧が目」加される。この
様に動作するためドライバー回路（ＩＪ及びｕＯＫよっ
てトランジスタ＋２＋、 ＋５Ｊ及び＋３１ ＋４Ｊが
ＯＦＦになる時にトランジスタのベース信号のＯＩ＝”
Ｆ時間と実際にトランジスタがＯＦＦになる時間に時間
差が生じた場合でも互いに短絡モードとなるトランジス
タの間は接続がないため（たとえ（ばトラノシスタ（２
）トランジスタ（４）の１団及びトランジスタ（３）と
トランジスタ（５）の間フトランジスタ間で短絡状態と
ならずトランジスタの破損を防止し。
かつ直流電源も破損しない。したがってスイッチング周
波数を高くする場合この時間差を短縮できる。
波数を高くする場合この時間差を短縮できる。
この発明は以上の様に構成され、かつ動作するためトラ
ンジスタの製造ロフト及び周囲＠匿が大きく変化しても
トランジスタ及び直流電源が破損することなく安定に動
作することができ。
ンジスタの製造ロフト及び周囲＠匿が大きく変化しても
トランジスタ及び直流電源が破損することなく安定に動
作することができ。
かつＤＣ／ＤＣコンバータ装置に要求されるスイッチン
グ周波数を篩くする場合にも殆んど障害とならず高周波
化が実現できる利点がある。
グ周波数を篩くする場合にも殆んど障害とならず高周波
化が実現できる利点がある。
なお、この発明はスイッチング素子にトランジスタ全１
吏って説明したがこれに限らず他のスイッチング素子ヲ
匣用してもよい。
吏って説明したがこれに限らず他のスイッチング素子ヲ
匣用してもよい。
以上の様にこの発明に係るＬＩＣ／ＤＱコンバータ装置
ではＤ Ｃ７０Ｃコンバータ装置のスイッチング周波数
を高くできかつスイッチング素子及びこれに供給する直
流電源全破唄させることなく安定に動作することができ
る。
ではＤ Ｃ７０Ｃコンバータ装置のスイッチング周波数
を高くできかつスイッチング素子及びこれに供給する直
流電源全破唄させることなく安定に動作することができ
る。
第１図は従来のＤ Ｃ７０Ｃコンバータの回路構成図、
第２図はこの発明のＤ Ｃ７０Ｃコンバータの回路構成
図である。 図中＋１１は直流゛電源、 ＋２１． ＋３１．１４１
及び（５）はトランジスタ、 （６１（７）（８）及び
（９）はタイ、ｔ −）”ｔ ｔｌＱｌはトランス、ｄ
υは畳流平滑回路ｕ２１は負荷、 ｕ３１及びＵΦはド
ライバー回路、Ａ、Ｂ及びＥ、 Ｆはトランスααの
１次１則端子、Ｃ，ｌ）はトランス（ｌαの２次側端子
である。 なお１図中、同圧あるいは相当部分は同一符号を付して
示しである。 代理人 葛 野 信 −
第２図はこの発明のＤ Ｃ７０Ｃコンバータの回路構成
図である。 図中＋１１は直流゛電源、 ＋２１． ＋３１．１４１
及び（５）はトランジスタ、 （６１（７）（８）及び
（９）はタイ、ｔ −）”ｔ ｔｌＱｌはトランス、ｄ
υは畳流平滑回路ｕ２１は負荷、 ｕ３１及びＵΦはド
ライバー回路、Ａ、Ｂ及びＥ、 Ｆはトランスααの
１次１則端子、Ｃ，ｌ）はトランス（ｌαの２次側端子
である。 なお１図中、同圧あるいは相当部分は同一符号を付して
示しである。 代理人 葛 野 信 −
Claims (1)
- 【特許請求の範囲】 直流電源と、この直流電源の正電極１１＋１１にコレク
タが接Ｍｊれている二つのトランジスタと。 −次巻線を２つの巻線に分けであるトランスと。 このトランスのそれぞれの一次巻線のうち互いに逆相と
なる端子に前記トランジスタのエミッタがそれぞれ接続
されるとともに、前記トランスの一次巻線の一方の端子
それぞれには別の二つのトランジスタのコレクタを接続
し、この別の２つのトランジスタのエミッタ全前記直流
屯諒の負′屯極側に接続し、前記トランスの２次側に整
流平滑回路を介して負何を接続したこと全特徴とし′ｆ
ｃＩＪｃ／ＤＣコンバータ装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13489882A JPS5925581A (ja) | 1982-08-02 | 1982-08-02 | Ｄｃ／ｄｃコンバ−タ装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP13489882A JPS5925581A (ja) | 1982-08-02 | 1982-08-02 | Ｄｃ／ｄｃコンバ−タ装置 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS5925581A true JPS5925581A (ja) | 1984-02-09 |
Family
ID=15139096
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP13489882A Pending JPS5925581A (ja) | 1982-08-02 | 1982-08-02 | Ｄｃ／ｄｃコンバ−タ装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5925581A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61288772A (ja) * | 1985-06-12 | 1986-12-18 | Densetsu Kiki Kogyo Kk | ブリツジ型コンバ−タ |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50121728A (ja) * | 1974-03-13 | 1975-09-23 |
-
1982
- 1982-08-02 JP JP13489882A patent/JPS5925581A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS50121728A (ja) * | 1974-03-13 | 1975-09-23 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS61288772A (ja) * | 1985-06-12 | 1986-12-18 | Densetsu Kiki Kogyo Kk | ブリツジ型コンバ−タ |
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