JPS5930371A - 同期信号処理回路 - Google Patents
同期信号処理回路Info
- Publication number
- JPS5930371A JPS5930371A JP57140620A JP14062082A JPS5930371A JP S5930371 A JPS5930371 A JP S5930371A JP 57140620 A JP57140620 A JP 57140620A JP 14062082 A JP14062082 A JP 14062082A JP S5930371 A JPS5930371 A JP S5930371A
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- JP
- Japan
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- pulse
- circuit
- signal
- synchronization
- composite
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-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04N—PICTORIAL COMMUNICATION, e.g. TELEVISION
- H04N5/00—Details of television systems
- H04N5/04—Synchronising
- H04N5/08—Separation of synchronising signals from picture signals
Landscapes
- Engineering & Computer Science (AREA)
- Multimedia (AREA)
- Signal Processing (AREA)
- Synchronizing For Television (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明はテレビジョンの複合同期信号から等化パルス期
間、垂直同期パルス期間を検出する手段に関する。
間、垂直同期パルス期間を検出する手段に関する。
従来例の構成とその問題点
等化パルス、垂直同期パルスの検出には従来から種々の
方法が考案され実用に供されている。これらは２つの方
法に大別できる。第１は積分回路を用いる方法であり、
第２は水平同期パルス、等化パルス、垂直同期パルスの
パルス幅の違いを判定する方法である。
方法が考案され実用に供されている。これらは２つの方
法に大別できる。第１は積分回路を用いる方法であり、
第２は水平同期パルス、等化パルス、垂直同期パルスの
パルス幅の違いを判定する方法である。
しかしながら第１の方法は原理的に時定数によって定す
る遅延を出力に生じ、かつ等化パルスの検出が困難であ
るといった欠点を有する。
る遅延を出力に生じ、かつ等化パルスの検出が困難であ
るといった欠点を有する。
また、第２の方法は、検出出力の遅延時間を小３べ一〕
デ さくする事が可能であり、デジタル回路で構成する事が
でき、ＩＣ化にも適している。しかしながら、等化パル
スのパルス幅は水平同期パルスより狭く、その差は約２
．４μｓｅｃと小さいので、等化パルスのパルス幅が約
１．２μ気だけ広く々ったり、または、水平同期パルス
のパルス幅が約１．２μ渡だけ狭くなったりすれば、等
化パルスと水平同期パルスとの区別は困難どなり、誤判
定してし１う。
デ さくする事が可能であり、デジタル回路で構成する事が
でき、ＩＣ化にも適している。しかしながら、等化パル
スのパルス幅は水平同期パルスより狭く、その差は約２
．４μｓｅｃと小さいので、等化パルスのパルス幅が約
１．２μ気だけ広く々ったり、または、水平同期パルス
のパルス幅が約１．２μ渡だけ狭くなったりすれば、等
化パルスと水平同期パルスとの区別は困難どなり、誤判
定してし１う。
ＶＴＲを再生、特にダビングしたテープを再生して得ら
れる複合同期信号のようにテレビジョンの規格のパルス
幅より１〜２μ豊はずれたパルス幅をもつこともある複
合同期信号を入力すれば、等化パルスと水平同期パルス
との判定を誤するといった問題点を有する。
れる複合同期信号のようにテレビジョンの規格のパルス
幅より１〜２μ豊はずれたパルス幅をもつこともある複
合同期信号を入力すれば、等化パルスと水平同期パルス
との判定を誤するといった問題点を有する。
発明の目的
複合同期信号の各同期パルスのパルス幅がテレビジョン
の規格からはずれていても、前記複合同期信号から等化
パルス、垂直同期パルスの期間を確実に検出することを
本発明の目的とする。
の規格からはずれていても、前記複合同期信号から等化
パルス、垂直同期パルスの期間を確実に検出することを
本発明の目的とする。
発明の構成
複合同期信号中、水平同期パルスは水平走査周期Ｈの間
隔で並んでおり、等化パルス及び垂ｎｋＰＩ期パルスは
０．６Ｈ間隔で並Ｘ、でいる。また、等化パルス、垂直
同期パルスのスタートタイミングは水平同期パルスのス
タートタイミングより０．５ Ｈの整数倍能れた位置に
ある。本発明はこの複合同期信号の性質にもとづき、複
合同期信号中の各同期パルスのスタートタイミングより
０．５Ｈ離れた位置に等化パルスまたは垂直同期パルス
があるがどうか判定することにより等化パルス、垂直同
期パルスの期間を検出している。垂直同期パルスのパル
ス幅は等化パルスより充分広いので、等化パルス及び垂
直同期パルスの有無の判定は、等化パルス幅をＥとした
とき、複合同期信号中の各同期パルスのスタートタイミ
ングより次式（１）をＷ足する時間Ｔｓ だけ遅れたタ
イミングで複合同期信号をサンプリングすればよい。
隔で並んでおり、等化パルス及び垂ｎｋＰＩ期パルスは
０．６Ｈ間隔で並Ｘ、でいる。また、等化パルス、垂直
同期パルスのスタートタイミングは水平同期パルスのス
タートタイミングより０．５ Ｈの整数倍能れた位置に
ある。本発明はこの複合同期信号の性質にもとづき、複
合同期信号中の各同期パルスのスタートタイミングより
０．５Ｈ離れた位置に等化パルスまたは垂直同期パルス
があるがどうか判定することにより等化パルス、垂直同
期パルスの期間を検出している。垂直同期パルスのパル
ス幅は等化パルスより充分広いので、等化パルス及び垂
直同期パルスの有無の判定は、等化パルス幅をＥとした
とき、複合同期信号中の各同期パルスのスタートタイミ
ングより次式（１）をＷ足する時間Ｔｓ だけ遅れたタ
イミングで複合同期信号をサンプリングすればよい。
実施例の説明
６ページ
第１図に本発明の基本構成を示す。パルス発生回路１は
端子２に印加される複合同期信号中の各同期パルスのス
タートタイミングを検出し、時間ＴＢ後にサンプリング
パルスを出力する。サンプル・アンド・ホールド回路３
はパルス発生回路１の出力をサンプリングパルスとして
複合同期信号入力を読み込む。このサンプル・アンド・
ホールド回路３の出力が等化パルス、垂直同期パルスの
期間の検出出力である。
端子２に印加される複合同期信号中の各同期パルスのス
タートタイミングを検出し、時間ＴＢ後にサンプリング
パルスを出力する。サンプル・アンド・ホールド回路３
はパルス発生回路１の出力をサンプリングパルスとして
複合同期信号入力を読み込む。このサンプル・アンド・
ホールド回路３の出力が等化パルス、垂直同期パルスの
期間の検出出力である。
第２図にその動作波形例を示す。Ａは奇数フィールドの
、Ｄは偶数フィールドの複合同期信号の波形であり、４
は水平同期信号を、６は等化パルスを、６は垂直同期パ
ルスをそれぞれ示しているＯＢ、Ｅはパルス発生回路１
の出力例であり、Ｃ２Ｆがサンプル・アンド・ホールド
回路３の出力である。第２図のり、Ｆを見れば、偶数フ
ィールドにおける等化パルス、垂直同期パルス検出の時
間遅れは小さいが、Ａ、Ｃを見れば、奇数フィールドに
おける等化パルス、垂直同期パルス検出は０．５Ｈの時
間遅れを生じることがわかる。しかし、６ページ ０．５Ｈの時間遅れは実用上問題とならない。Ａ。
、Ｄは偶数フィールドの複合同期信号の波形であり、４
は水平同期信号を、６は等化パルスを、６は垂直同期パ
ルスをそれぞれ示しているＯＢ、Ｅはパルス発生回路１
の出力例であり、Ｃ２Ｆがサンプル・アンド・ホールド
回路３の出力である。第２図のり、Ｆを見れば、偶数フ
ィールドにおける等化パルス、垂直同期パルス検出の時
間遅れは小さいが、Ａ、Ｃを見れば、奇数フィールドに
おける等化パルス、垂直同期パルス検出は０．５Ｈの時
間遅れを生じることがわかる。しかし、６ページ ０．５Ｈの時間遅れは実用上問題とならない。Ａ。
ＤはＮＴＳＣ方式の場合同期信号であるが、ＰＡＬ方式
、ＳＥＣＡＭ方式についても適用できる。
、ＳＥＣＡＭ方式についても適用できる。
第３図に本発明の具体的な一実施例を示す。パルス発生
回路１は、デジタル単安定マルチバイブレータと、前記
デジタル単安定マルチバイブレータのカウンタの状態を
デコードしてサンプリグパルス出力を発生するデコーダ
とからなる。また、サンプル・アンド・ホールド回路３
は、フリップフロップから成っている。デジタル単安定
マルチバイブレータは複合同期信号の各同期パルスのス
タートタイミングでトリガされ、次式（２）を満足する
時間１ｗ０幅のパルスを出力する。
回路１は、デジタル単安定マルチバイブレータと、前記
デジタル単安定マルチバイブレータのカウンタの状態を
デコードしてサンプリグパルス出力を発生するデコーダ
とからなる。また、サンプル・アンド・ホールド回路３
は、フリップフロップから成っている。デジタル単安定
マルチバイブレータは複合同期信号の各同期パルスのス
タートタイミングでトリガされ、次式（２）を満足する
時間１ｗ０幅のパルスを出力する。
Ｔ８≦ＴＷくＨ・・・・・・・・・・・・・・・・・・
・・・・・・・・・・・・（２）なぜなら、時間Ｔｓ
を検出するためにはＴ８≦Ｔｗでなければならないし
、時間ＴＩＩ以後、時間Ｈまで各同期パルスは来ないの
でＴｗ〈Ｈであればよい。もちろん時間”ｗが必要なけ
れば、Ｔｗ＝Ｔｓとして良く、回路構成が一簡単になる
。
・・・・・・・・・・・・（２）なぜなら、時間Ｔｓ
を検出するためにはＴ８≦Ｔｗでなければならないし
、時間ＴＩＩ以後、時間Ｈまで各同期パルスは来ないの
でＴｗ〈Ｈであればよい。もちろん時間”ｗが必要なけ
れば、Ｔｗ＝Ｔｓとして良く、回路構成が一簡単になる
。
第３図の動作を説明する。フリップフロップ７７ページ
は、同期パルスのスタートタイミング、すなわち立ち」
二かりてセットされる。フリラフ“フロップ了の出力Ｑ
によりＡＮＤゲート８が開いて発振器９（第３図ではｏ
ＳＣと略記）からのクロックがカウンタ１０へ入力され
はじめる。デコーダ１１はカウンタの状態をデコードし
てタイミングパルスを発生する。デコーダの出力αは時
間ＴＷの検出出力で、フリップフロップ７をリセットす
る。フリップフロップ７のＱ出力によりＡＮＤゲート８
は閉じ、フリップフロップ７の０出力によりカウンタ１
０はリセットされてデジタル単安定マルチバイブレータ
の動作を完了する。デコーダ出力βは時間ＴＳ ｓすな
わちサンプリングタイミングの検出出力である。サンプ
ル・アンド・ホールド回路３、すなわちフリップ７０ツ
ブ１２はデコーダ出力βをサンプリングパルスとして複
合同期信号を読み込む。
二かりてセットされる。フリラフ“フロップ了の出力Ｑ
によりＡＮＤゲート８が開いて発振器９（第３図ではｏ
ＳＣと略記）からのクロックがカウンタ１０へ入力され
はじめる。デコーダ１１はカウンタの状態をデコードし
てタイミングパルスを発生する。デコーダの出力αは時
間ＴＷの検出出力で、フリップフロップ７をリセットす
る。フリップフロップ７のＱ出力によりＡＮＤゲート８
は閉じ、フリップフロップ７の０出力によりカウンタ１
０はリセットされてデジタル単安定マルチバイブレータ
の動作を完了する。デコーダ出力βは時間ＴＳ ｓすな
わちサンプリングタイミングの検出出力である。サンプ
ル・アンド・ホールド回路３、すなわちフリップ７０ツ
ブ１２はデコーダ出力βをサンプリングパルスとして複
合同期信号を読み込む。
第３図に示した回路例の動作波形を、第４図に示す。第
４図Ａに示すように複合同期信号中の各同期パルスの幅
が、破線で示すように狭くなっても、また、一点破線で
示すように広くなっても確実に等化パルス、垂直同期パ
ルスの期間を検出できることが容易に理解できる。
４図Ａに示すように複合同期信号中の各同期パルスの幅
が、破線で示すように狭くなっても、また、一点破線で
示すように広くなっても確実に等化パルス、垂直同期パ
ルスの期間を検出できることが容易に理解できる。
なお、第４図のＢは、フリップフロップ７のＱ出力、Ｃ
はゲート８の出力、Ｄはデコーダ１１の出力ａ、Ｅはデ
コーダ１１の出力β、Ｆはノリ、ノブフロップ１２の出
力をそれぞれ示し、このフリップフロップ１２の出力に
より、等化パルス期間および垂直同期信号期間と水平同
期信号期間とを検出した出力となる。
はゲート８の出力、Ｄはデコーダ１１の出力ａ、Ｅはデ
コーダ１１の出力β、Ｆはノリ、ノブフロップ１２の出
力をそれぞれ示し、このフリップフロップ１２の出力に
より、等化パルス期間および垂直同期信号期間と水平同
期信号期間とを検出した出力となる。
本実施例におけるパルス発生回路１は、第４図の動作波
形かられかるように等化パルスや垂直同期信号を除去す
る水平同期信号分離回路の動作をしている。逆にみれば
、水平同期信号分離回路にデコーダ１つと７リツプンロ
ツプ１つとを追加する事により簡単な構成で等化パルス
、垂直同期パルス期間検出回路を実現できる。また、本
構成ではディジタル回路のみで実現できるためＩＣ化に
適しているといった利点をもつ。
形かられかるように等化パルスや垂直同期信号を除去す
る水平同期信号分離回路の動作をしている。逆にみれば
、水平同期信号分離回路にデコーダ１つと７リツプンロ
ツプ１つとを追加する事により簡単な構成で等化パルス
、垂直同期パルス期間検出回路を実現できる。また、本
構成ではディジタル回路のみで実現できるためＩＣ化に
適しているといった利点をもつ。
以上は、複合同期信号の位相変動がない場合で９ページ
あったが、位相変動のある複合同期信号であっても、第
３図中の発振器９の発振周波数を位相変動量で制御する
ことにより、確実に等化パルス、垂直パルスの期間を検
出できることがわかる。複合同期信号の位相変動により
発振器９の発振周波数を制御する構成例を第６図、第６
図に示す。第６図は、複合同期信号より分離した水平同
期信号と可変発振器９の発振周波数をカウンタ１３で分
周して得た信号とを位相比較器１４で位相比較し、この
位相比較器１４の出力を低域ろ波器１６を介して前記可
変発振器９を制御するＡＰＣ方式である。第６図は複合
同期信号の位相変動に比例した位相変動量をもち端子１
６に印加された再生カラーバーストとカラーバーストの
基準発振器１７とを位相比較器１４で位相比較し、その
位相比較器１４の出力を低域ろ波器１６を介して発振器
９を制御するＡＰＣ方式である。ＡＰＣ方式ではカラー
バーストを取り出すためのパルストゲートパルスが必要
であるが、バーストゲルト発生用フリップ７０ツブとこ
の７リツプ７０ツブのセット、す１０ページ セットタイミングを検出するデコーダを第３図の実施例
の回路に追加することにより容易に構成できる。
３図中の発振器９の発振周波数を位相変動量で制御する
ことにより、確実に等化パルス、垂直パルスの期間を検
出できることがわかる。複合同期信号の位相変動により
発振器９の発振周波数を制御する構成例を第６図、第６
図に示す。第６図は、複合同期信号より分離した水平同
期信号と可変発振器９の発振周波数をカウンタ１３で分
周して得た信号とを位相比較器１４で位相比較し、この
位相比較器１４の出力を低域ろ波器１６を介して前記可
変発振器９を制御するＡＰＣ方式である。第６図は複合
同期信号の位相変動に比例した位相変動量をもち端子１
６に印加された再生カラーバーストとカラーバーストの
基準発振器１７とを位相比較器１４で位相比較し、その
位相比較器１４の出力を低域ろ波器１６を介して発振器
９を制御するＡＰＣ方式である。ＡＰＣ方式ではカラー
バーストを取り出すためのパルストゲートパルスが必要
であるが、バーストゲルト発生用フリップ７０ツブとこ
の７リツプ７０ツブのセット、す１０ページ セットタイミングを検出するデコーダを第３図の実施例
の回路に追加することにより容易に構成できる。
発明の詳細
な説明したごとく本発明によれば、複合同期信号中の各
同期パルスのパルス幅がテレビジョンの規格外であって
も確実に等化パルス、垂直同期パルスの期間を検出でき
る。
同期パルスのパルス幅がテレビジョンの規格外であって
も確実に等化パルス、垂直同期パルスの期間を検出でき
る。
また、回路構成が簡単であり、デジタル回路だけで構成
できるのでＩＣ化に適している。
できるのでＩＣ化に適している。
さらに回路を追加することにより、位相変動をもつ複合
同期信号であっても等化パルス、垂直同期パルスの期間
の検出が可能にできる。
同期信号であっても等化パルス、垂直同期パルスの期間
の検出が可能にできる。
第１図は本発明の基本構成を示すブロック図、第２図は
同動作原理図、第３図は本発明による同期信号処理回路
の１実施例のブロック図、第４図は第３図の動作波形図
、第５図および第６図はそれぞれ位相変動をもつ複合同
期信号の等化パルス。 垂直同期パルスを検出する本発明の他の実施例を１１２
−ッ 示すブロック図である。 １・・・・・パルス発生回路、３・・・・・・サンプル
・アンド・ホールド回路、９・・・・・・発振器、８・
・・・・・ＡＮＤゲ−）、７．１２・・団・フリップフ
ロップ、１５・・・低域ろ波器、１ｏ・・・・・カウン
タ、１４・・・・・・位相比較器、１７・・・・・・基
準発振器。
同動作原理図、第３図は本発明による同期信号処理回路
の１実施例のブロック図、第４図は第３図の動作波形図
、第５図および第６図はそれぞれ位相変動をもつ複合同
期信号の等化パルス。 垂直同期パルスを検出する本発明の他の実施例を１１２
−ッ 示すブロック図である。 １・・・・・パルス発生回路、３・・・・・・サンプル
・アンド・ホールド回路、９・・・・・・発振器、８・
・・・・・ＡＮＤゲ−）、７．１２・・団・フリップフ
ロップ、１５・・・低域ろ波器、１ｏ・・・・・カウン
タ、１４・・・・・・位相比較器、１７・・・・・・基
準発振器。
Claims (2)
- （１）水平同期パルス、等化パルス、垂直同期パルスか
ら成る複合同期信号の水平走査同期をＨ１等化パルス幅
をＥとした時に、前記複合同期信号の各同期パルスのス
タートタイミングよシ、時間Ｔ。 ＨＨ （但し、 （Ｔ、＜（Ｈ＋Ｅ）だけ遅れたタイミングの
パルスを発生するパルス発生回路と、前記パルス発生回
路の出力信号をサンプリングパルスとし、前記複合同期
信号を入力とするサンプル・アンド・ホールド回路とを
有し、前記サンプル・アンド・ホールド回路より出力信
号を得ることを特徴とする同期信号処理回路。 - （２） パルス発生回路が、発生器からのクロックを
カウントすることにより、出力パルス幅ＴＷ （但し
、１８５７ｗ（Ｈ）を決定し、前記複合同期信号の各同
期パルスのスタートタイミングでトリガされるデジタル
単安定マルチバイブレータと、前記デジタル単安定マル
チバイブレータ内のカウンタの状態をデコードして時間
Ｔ８のサンプリングパルスを出力するデゴーダとから成
る特許請求の範囲第１項に記載の同期信号処理回路。
°′、゛
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57140620A JPS5930371A (ja) | 1982-08-12 | 1982-08-12 | 同期信号処理回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP57140620A JPS5930371A (ja) | 1982-08-12 | 1982-08-12 | 同期信号処理回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS5930371A true JPS5930371A (ja) | 1984-02-17 |
| JPH0218636B2 JPH0218636B2 (ja) | 1990-04-26 |
Family
ID=15272939
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP57140620A Granted JPS5930371A (ja) | 1982-08-12 | 1982-08-12 | 同期信号処理回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS5930371A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS60198973A (ja) * | 1984-03-22 | 1985-10-08 | Matsushita Electric Ind Co Ltd | 垂直同期信号検出回路 |
| JP2002335074A (ja) * | 2001-05-09 | 2002-11-22 | Denpuro:Kk | 自動はんだ付け装置 |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH04109062A (ja) * | 1990-08-28 | 1992-04-10 | Hitachi Ltd | 内燃機関の異常燃焼検出装置および内燃機関のトルク制御装置 |
Citations (6)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS521848A (en) * | 1975-06-20 | 1977-01-08 | Aaru Puraisu Uiriamu | Method of detecting and controlling movement of movable portion material and its device |
| JPS5213885A (en) * | 1975-07-09 | 1977-02-02 | Keisuke Iwashita | Electric buoys with movable shade |
| JPS5321517A (en) * | 1976-08-12 | 1978-02-28 | Nippon Television Ind Corp | Synchronizing signal selection circuit |
| JPS5353918A (en) * | 1976-10-27 | 1978-05-16 | Nec Corp | Detecting method for vertical synchronizing signal and its circuit |
| JPS5696576A (en) * | 1979-12-29 | 1981-08-04 | Sony Corp | Framing circuit |
| JPS5714259A (en) * | 1980-06-30 | 1982-01-25 | Mitsubishi Electric Corp | Vertical synchronizing signal separation circuit |
-
1982
- 1982-08-12 JP JP57140620A patent/JPS5930371A/ja active Granted
Patent Citations (6)
| Publication number | Priority date | Publication date | Assignee | Title |
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| JPS60198973A (ja) * | 1984-03-22 | 1985-10-08 | Matsushita Electric Ind Co Ltd | 垂直同期信号検出回路 |
| JP2002335074A (ja) * | 2001-05-09 | 2002-11-22 | Denpuro:Kk | 自動はんだ付け装置 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0218636B2 (ja) | 1990-04-26 |
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