JPS6010331A - Ｃｒｔインタフエ−ス回路 - Google Patents
Ｃｒｔインタフエ−ス回路Info
- Publication number
- JPS6010331A JPS6010331A JP11704583A JP11704583A JPS6010331A JP S6010331 A JPS6010331 A JP S6010331A JP 11704583 A JP11704583 A JP 11704583A JP 11704583 A JP11704583 A JP 11704583A JP S6010331 A JPS6010331 A JP S6010331A
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- JP
- Japan
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- circuit
- transistor
- interface
- signal
- interface circuit
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明はＣＲＴインタフェース回路に関し、特に異なる
インタフェース回路を持つＣＲＴ表示装置のインタフェ
ース切換え方式に関する。
インタフェース回路を持つＣＲＴ表示装置のインタフェ
ース切換え方式に関する。
従来、この種のＣＲＴ表示装置の構成を第１図に示す。
図において、１は第１のインタフェース回路、２はＣＲ
Ｔモニタ３に画像を表示する為の動作を制御する制御回
路である。４は外部装置よりインタフェース回路１のコ
ネクター０を介し供給される第１の入力信号である。５
は制御回路２で定められた信号に変換されたインタフェ
ース回路１の出力信号である。６は制御装置２からＣＲ
Ｔモニタ３４Ｃ供給されるビデオ信号を示す。そして、
２′８ｉ類以上の入力信号を表示する為には、第２の入
力信号８に対応する第２のインタフェース回路７が必要
となる。この） 場合、上記第２の入力信号８け上記コネクター０とは別
のコネクター１を介して上記第２のインタフェース回路
７に供給される。第２のインタフェース回路７の出力信
号９は上記と同様に制御回路２に供給される。
Ｔモニタ３に画像を表示する為の動作を制御する制御回
路である。４は外部装置よりインタフェース回路１のコ
ネクター０を介し供給される第１の入力信号である。５
は制御回路２で定められた信号に変換されたインタフェ
ース回路１の出力信号である。６は制御装置２からＣＲ
Ｔモニタ３４Ｃ供給されるビデオ信号を示す。そして、
２′８ｉ類以上の入力信号を表示する為には、第２の入
力信号８に対応する第２のインタフェース回路７が必要
となる。この） 場合、上記第２の入力信号８け上記コネクター０とは別
のコネクター１を介して上記第２のインタフェース回路
７に供給される。第２のインタフェース回路７の出力信
号９は上記と同様に制御回路２に供給される。
従って、従来のインタフェース回路では異なる入力信号
に対応して、それぞれのコネクタが設けられ、そのコネ
クタを介して得られる信号をそれぞれのイ／タフニース
回路に導く構成となっている。この為、２つ以上のコネ
クタが必要となるばかシか、２つ以上のコネクタ実装ス
ペースも必要となる欠点がめった。
に対応して、それぞれのコネクタが設けられ、そのコネ
クタを介して得られる信号をそれぞれのイ／タフニース
回路に導く構成となっている。この為、２つ以上のコネ
クタが必要となるばかシか、２つ以上のコネクタ実装ス
ペースも必要となる欠点がめった。
本発明は上記欠点を除去し、共通のコネクタから異なる
入力信号を受信し、更に異なるインタフェース回路を切
換えスイッチ手段にょシその動作を指定できるようにし
たＣＲＴインタフェース回路を提供することを目的とす
る。
入力信号を受信し、更に異なるインタフェース回路を切
換えスイッチ手段にょシその動作を指定できるようにし
たＣＲＴインタフェース回路を提供することを目的とす
る。
本発明は共通のコネクタから供給される入力信号が同時
に供給される第１および第２のインタフェース回路と、
この第１および第２のインタフェース回路のいずれか一
方の回路が動作するように指定する切換えスイッチ手段
とを具備して上記目的を達成せしめている。
に供給される第１および第２のインタフェース回路と、
この第１および第２のインタフェース回路のいずれか一
方の回路が動作するように指定する切換えスイッチ手段
とを具備して上記目的を達成せしめている。
以下、図面を参照して本発明の一実施例を説明する。
第２図は本発明の全体の構成を示すブロック図である。
参照符号１〜３．５〜７．９の装置名称は第１図の対応
する装置と同じであるので同一番号を引用して説明を省
略する。２ｏけ共通のコネクタ２１より入力された表示
入力データ信号であり、インタフェース回路１とインタ
フェース回路７の両方に人力されている。入力データ信
号２ｏは信号レベルの異なる２通り以上の信号が異なる
タイミングで含むコトニなる。２２はインタフェース回
路１．７のいずれか一方の回路を動作するように指定す
る切換えスイッチ回路で、この切換えスイッチ回路から
の動作を指定する信号２３と２４は、対応するそれぞれ
インタフェース回路１．７て供給される。また、切換え
スイッチ回路２２からの信号２５．２６が制御回路２に
供給されている。
する装置と同じであるので同一番号を引用して説明を省
略する。２ｏけ共通のコネクタ２１より入力された表示
入力データ信号であり、インタフェース回路１とインタ
フェース回路７の両方に人力されている。入力データ信
号２ｏは信号レベルの異なる２通り以上の信号が異なる
タイミングで含むコトニなる。２２はインタフェース回
路１．７のいずれか一方の回路を動作するように指定す
る切換えスイッチ回路で、この切換えスイッチ回路から
の動作を指定する信号２３と２４は、対応するそれぞれ
インタフェース回路１．７て供給される。また、切換え
スイッチ回路２２からの信号２５．２６が制御回路２に
供給されている。
第３図はインタフェース回路１．７切換えスイッチ回路
２２および制御回路２の本発明に係わる所を抽出して示
した回路構成図である。
２２および制御回路２の本発明に係わる所を抽出して示
した回路構成図である。
図において、３０〜３５．６０〜６４はトランジスタで
ありスイッチング動作をする。４０〜４８．７０〜７６
は抵抗、４９は切換えスイッチを示す。
ありスイッチング動作をする。４０〜４８．７０〜７６
は抵抗、４９は切換えスイッチを示す。
５０．５１はそれぞれの出力信号を増幅するアンプ回路
である。８１．８２はダイオードである。そして、共通
のコネクタ２１よシ受信した入力データ信号２０は切換
えスイッチ４９によって得られる選択信号２３．２４の
いずれかによってインタフェース回路１．７の対応する
回路に供給される。
である。８１．８２はダイオードである。そして、共通
のコネクタ２１よシ受信した入力データ信号２０は切換
えスイッチ４９によって得られる選択信号２３．２４の
いずれかによってインタフェース回路１．７の対応する
回路に供給される。
次に、本発明の詳細な説明する。
まず、第２図において、インタフェース回路１．７には
それぞれ信号の入力レベルが定められており、入力デー
タ信号２０に対しどちらのインタフェース回路を有効に
するかを切換えスイッチ回路２２により選択指定する。
それぞれ信号の入力レベルが定められており、入力デー
タ信号２０に対しどちらのインタフェース回路を有効に
するかを切換えスイッチ回路２２により選択指定する。
例えば、入力データ信号２０の入力レベルがインクフェ
ース回路１に適した入力信号の時、切換えスイッチ回路
２２の信号２４がＧＮＤ （接地）に接続される。これ
によりインタフェース回路７は入力データ信号２０が入
力不可となる状態に設定される。
ース回路１に適した入力信号の時、切換えスイッチ回路
２２の信号２４がＧＮＤ （接地）に接続される。これ
によりインタフェース回路７は入力データ信号２０が入
力不可となる状態に設定される。
一方、インタフェース回路１は切換えスイッチ回路２２
からの指示信号２３により入力データ信号２０を受信し
、その出力信号５を制御回路２に入力してＣＲＴモニタ
３に画像を表示させる。制御装置２の受檜部はインタフ
ェース回路１．７の出力信号５．９の両方が入力されて
いるが、出力信号９は禁止されているので、信号５のみ
を有効な信号として受信するＯＲ回路の動作を行なう。
からの指示信号２３により入力データ信号２０を受信し
、その出力信号５を制御回路２に入力してＣＲＴモニタ
３に画像を表示させる。制御装置２の受檜部はインタフ
ェース回路１．７の出力信号５．９の両方が入力されて
いるが、出力信号９は禁止されているので、信号５のみ
を有効な信号として受信するＯＲ回路の動作を行なう。
また、インタフェース回路７の規格にあった入力データ
信号２０が共通のコネクタ２１から入力されると、切換
えスイッチ回路２２によりインタフェース回路１をＧＮ
Ｄに接続するように指定され、その動作が禁止される。
信号２０が共通のコネクタ２１から入力されると、切換
えスイッチ回路２２によりインタフェース回路１をＧＮ
Ｄに接続するように指定され、その動作が禁止される。
そして、インタフェース回路７の方が有効となり上記と
同様な動作を行なう。
同様な動作を行なう。
次に、第３図を用いて上記した本発明の更に詳細な動作
を説明する。
を説明する。
まず、トランジスタ３４０ベースラインがスイッチ４９
によｆｉ ＧＮＨに接続されている時には、トランジス
タ３４が動作せず（ＯＦＦ ）、トランジスタ３００ベ
ース信号ライン２３はほぼＧＮＤレベル、となυ、この
トランジスタ３０も動作しない（ＯＦＦである）。従っ
て、入力データ信号２０は抵抗４０を介してトランジス
タ３２のペースに供給される。一方トランジスタ３４が
ＯＦＦであるからトランジスタ３５もＯＦＦのままであ
り、抵抗４８．７６との間の電圧が供給される信号ライ
ン２４が「ＨｉｇｈＪとなり、トランジスタ３１がＯＮ
となる。このトランジスタ３１がＯＮとなることにより
、トランジスタ３３のペース電圧がほぼＧＮＤレベルと
なり、このトランジスタ３３は（ＪＦＦとなる。即ち、
入力データ信号２０がトランジスタ３３のペースに入力
されない。一方、トランジスタ３２のペースに供給され
ている入力データ信号２０に応じてトランジスタ３２が
ＯＮ、ＯＦＦされる。従って、トランジスタ３２を通過
したエミッタ出力信号はアンプ回路５０を通って出力信
号５となり、制御回路２へ供給される。
によｆｉ ＧＮＨに接続されている時には、トランジス
タ３４が動作せず（ＯＦＦ ）、トランジスタ３００ベ
ース信号ライン２３はほぼＧＮＤレベル、となυ、この
トランジスタ３０も動作しない（ＯＦＦである）。従っ
て、入力データ信号２０は抵抗４０を介してトランジス
タ３２のペースに供給される。一方トランジスタ３４が
ＯＦＦであるからトランジスタ３５もＯＦＦのままであ
り、抵抗４８．７６との間の電圧が供給される信号ライ
ン２４が「ＨｉｇｈＪとなり、トランジスタ３１がＯＮ
となる。このトランジスタ３１がＯＮとなることにより
、トランジスタ３３のペース電圧がほぼＧＮＤレベルと
なり、このトランジスタ３３は（ＪＦＦとなる。即ち、
入力データ信号２０がトランジスタ３３のペースに入力
されない。一方、トランジスタ３２のペースに供給され
ている入力データ信号２０に応じてトランジスタ３２が
ＯＮ、ＯＦＦされる。従って、トランジスタ３２を通過
したエミッタ出力信号はアンプ回路５０を通って出力信
号５となり、制御回路２へ供給される。
また、トランジスタ３４のペースがスイッチ４９により
解放状態となっている場合は、トランジスタ３４がＯＮ
となυ、信号ライ／２３がｌ−ＨｉｇｈＪとなｐ、トラ
ンジスタ３ｏｔｏＮにする。従って、トランジスタ３２
のベースラインはほぼＧＮＤレベルとなる為、トランジ
スタ３２のペースには入力データ信号２０が入力さｉｚ
ない。一方、トランジスタ３４のエミッタ出力電圧によ
りトランジスタ３５がＯＮとなるので、信号ライン２４
はほぼ（）Ｎｌ）レベルになる。これにより、トランジ
スタ３１はＯＦＦ となり、人力データ信号２０は抵抗
４１を介してトランジスタ３３０ベースに供給される。
解放状態となっている場合は、トランジスタ３４がＯＮ
となυ、信号ライ／２３がｌ−ＨｉｇｈＪとなｐ、トラ
ンジスタ３ｏｔｏＮにする。従って、トランジスタ３２
のベースラインはほぼＧＮＤレベルとなる為、トランジ
スタ３２のペースには入力データ信号２０が入力さｉｚ
ない。一方、トランジスタ３４のエミッタ出力電圧によ
りトランジスタ３５がＯＮとなるので、信号ライン２４
はほぼ（）Ｎｌ）レベルになる。これにより、トランジ
スタ３１はＯＦＦ となり、人力データ信号２０は抵抗
４１を介してトランジスタ３３０ベースに供給される。
従つて、トランジスタ３３は入力データ信号２０に応じ
てＯＮ、 ＯＦＦし、そのエミッタ出力信号はアンプ回
路５１を通過して出力信号９として制御回路２へ供給さ
れる。
てＯＮ、 ＯＦＦし、そのエミッタ出力信号はアンプ回
路５１を通過して出力信号９として制御回路２へ供給さ
れる。
尚、抵抗４０．４１は入力データ信号２ｏのマツチング
抵抗の働きをする。
抵抗の働きをする。
次に、スイッチ４９の選択指定に応じた制御回路２の動
作について説明する。
作について説明する。
スイッチ４９によってトランジスタ３４０ベースがＧＮ
Ｄと接続されている時、上記の通りトランジスタ３４と
３５はＯＦＦ Ｌ、信号ライン２５（２４と同じ）はｌ
−１ｌ−１−１ｉレベルの状態にある。一方、トランジ
スタ６０はＯＮ Ｌ、そのコレクタ出力ライン２６はほ
ぼＧＮｒ）レベル［Ｌｏｗ Ｊとなる。この結果、信号
ライン５が有効ラインであることが識別され、トランジ
スタ６１をＯＮにし、更にトランジスタ６３．６４もＯ
Ｎとなるので、信号ライン８３．８４．８５を通シ入カ
データ信号が出力される。また、スイッチ４９がオープ
ンの場合には、上記した通りトランジスタ３４．３５が
共にＯＮとなる。従って、信号ライン２５（２４）が「
ＬｏｗＪレベルとなり信号ライン２６が「ＨｉｇｈＪレ
ベルとなる。従って、今度は出力信号９が有効となり、
トランジスタ６２を動作させ上記と同じ経路で出力され
る。
Ｄと接続されている時、上記の通りトランジスタ３４と
３５はＯＦＦ Ｌ、信号ライン２５（２４と同じ）はｌ
−１ｌ−１−１ｉレベルの状態にある。一方、トランジ
スタ６０はＯＮ Ｌ、そのコレクタ出力ライン２６はほ
ぼＧＮｒ）レベル［Ｌｏｗ Ｊとなる。この結果、信号
ライン５が有効ラインであることが識別され、トランジ
スタ６１をＯＮにし、更にトランジスタ６３．６４もＯ
Ｎとなるので、信号ライン８３．８４．８５を通シ入カ
データ信号が出力される。また、スイッチ４９がオープ
ンの場合には、上記した通りトランジスタ３４．３５が
共にＯＮとなる。従って、信号ライン２５（２４）が「
ＬｏｗＪレベルとなり信号ライン２６が「ＨｉｇｈＪレ
ベルとなる。従って、今度は出力信号９が有効となり、
トランジスタ６２を動作させ上記と同じ経路で出力され
る。
尚、本発明はプリンタ装置等の他の端末装置にも応用で
きる。
きる。
以上、本発明によれば信号の種類は同じであシ、レベル
等の異なる２以上の入力信号がある場合、コネクタを共
通に使用できる。この結果、装置自体のコネクタパネル
を小さくする事が可能となり、装置の＃ｊ、ｆｌＪｉ短
小化に効果全小化する。更にコネクタ部品の削減に効果
を発揮する。
等の異なる２以上の入力信号がある場合、コネクタを共
通に使用できる。この結果、装置自体のコネクタパネル
を小さくする事が可能となり、装置の＃ｊ、ｆｌＪｉ短
小化に効果全小化する。更にコネクタ部品の削減に効果
を発揮する。
第１図は従来のＣＲＴインタフェース回路の構成を示す
ブロック図、第２図は本発明のＣＲＴインタフェース回
路の構成を示すブロック図、第３図は本発明の更に詳細
な回路構成を示す図である。 １．７・・・・・・第１、第２のインクフェース回路２
・・・・・・制御回路 ２１・・・・・・共通コネクタ ２２・・・・・・切換えスイッチ回路 代理人 弁理士 則 近 恵 佑（嫌か１名）手 続
補 正 書（−５ね 昭１８ジｏ、’２７Ｂ 特許庁、、＆官若杉和夫 殿 １、事件の表示 達専願昭夕８− ／１７０１１５号 ２金Ｂ月の名称 ＣＲＴインタ入−２回路 ３補正をする者 事件との関係 特許 出願人 （３０７） 東京芝浦電気株式会社 ４、代 理 人 〒１００ １９１１，１１．・昌 −１ ７、補正の内容
ブロック図、第２図は本発明のＣＲＴインタフェース回
路の構成を示すブロック図、第３図は本発明の更に詳細
な回路構成を示す図である。 １．７・・・・・・第１、第２のインクフェース回路２
・・・・・・制御回路 ２１・・・・・・共通コネクタ ２２・・・・・・切換えスイッチ回路 代理人 弁理士 則 近 恵 佑（嫌か１名）手 続
補 正 書（−５ね 昭１８ジｏ、’２７Ｂ 特許庁、、＆官若杉和夫 殿 １、事件の表示 達専願昭夕８− ／１７０１１５号 ２金Ｂ月の名称 ＣＲＴインタ入−２回路 ３補正をする者 事件との関係 特許 出願人 （３０７） 東京芝浦電気株式会社 ４、代 理 人 〒１００ １９１１，１１．・昌 −１ ７、補正の内容
Claims (1)
- 共通のコネクタから供給される入力信号が同時に供給さ
れる第１および第２のインタフェース回路と、この第１
又は第２′のインタフェース回路のいずれか一方の回路
が動作するように指定する切換えスイッチ手段と、上記
第１および第２のインタフェース回路の出力信号のうち
上記切換えスイッチ手段の指示と対応するインタフェー
ス回路からの上記出方信号を受信する表示制御回路と、
この表示制御回路からのビデオ信号を表示するＣＲＴモ
ニタとを具備することを特徴とするＣＲＴインタフェー
ス回路
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11704583A JPS6010331A (ja) | 1983-06-30 | 1983-06-30 | Ｃｒｔインタフエ−ス回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP11704583A JPS6010331A (ja) | 1983-06-30 | 1983-06-30 | Ｃｒｔインタフエ−ス回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6010331A true JPS6010331A (ja) | 1985-01-19 |
Family
ID=14702060
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP11704583A Pending JPS6010331A (ja) | 1983-06-30 | 1983-06-30 | Ｃｒｔインタフエ−ス回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6010331A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03118630A (ja) * | 1989-09-29 | 1991-05-21 | Fujitsu Ltd | 表示装置 |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5864544A (ja) * | 1981-10-12 | 1983-04-16 | Ricoh Co Ltd | プリンタ−装置の外部システム対応装置 |
-
1983
- 1983-06-30 JP JP11704583A patent/JPS6010331A/ja active Pending
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5864544A (ja) * | 1981-10-12 | 1983-04-16 | Ricoh Co Ltd | プリンタ−装置の外部システム対応装置 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH03118630A (ja) * | 1989-09-29 | 1991-05-21 | Fujitsu Ltd | 表示装置 |
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