JPS60109342A - 秘話通信装置 - Google Patents

秘話通信装置

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JPS60109342A
JPS60109342A JP21734983A JP21734983A JPS60109342A JP S60109342 A JPS60109342 A JP S60109342A JP 21734983 A JP21734983 A JP 21734983A JP 21734983 A JP21734983 A JP 21734983A JP S60109342 A JPS60109342 A JP S60109342A
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signal
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clock
output
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Shintaro Hirose
広瀬 新太郎
Akihiko Yamashita
昭彦 山下
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Sanyo Electric Co Ltd
Sanyo Denki Co Ltd
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    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04KSECRET COMMUNICATION; JAMMING OF COMMUNICATION
    • H04K1/00Secret communication
    • H04K1/06Secret communication by transmitting the information or elements thereof at unnatural speeds or in jumbled order or backwards

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  • Computer Networks & Wireless Communication (AREA)
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (イ1 産業上の利用分野 本発明は、無糊通信において、通話の秘話性を保証する
ための秘話通信回路方式に関する。
(口1 従来技術 通、官の無呻通信においては、甲及び乙が通話している
時、第ろ者丙が甲、乙の交信に使用している搬送川波数
域の信号を受信した場合、印、乙間の通話の内容を傍受
できるため通話の秘話性が損なわれるという問題がある
この秘話性を保証する方法としては、音声信号をスクラ
ンブル化し−C送出し、これを受信側で復元する方法が
有効である。この方法によれば、受信部に復元回路を備
えていない第6者、若しくはキーコードが異なる第6者
に対しては、受信音声はスクランブルされたま−まであ
るので、通話の内容が了解されず、秘話性を保持するこ
とができる0従来、このような秘話回路の一方式として
平衡変調器を内職した回路素子(バランス・モジュレー
ション方式ンが一般に市販されている。この方式は音声
信号を、例えば5KH2の搬送波で変調後、その下側イ
ロリ帯波のみケフィルタ処理によシ抽出して送出する方
式である。この場合、音声信号の周波数は、元の信号に
対して反転する。すなわち、音声周波数をfとすると、
f’=5−f(KH2)となる。復元は逆の操作を行な
えばよく、音声周波数は再度反転するので元に戻る。こ
の場合、平衡変調器の搬送波周波数を若干変えても、再
生される音声は元の音声に対して音程が少しずれる程度
であり、了解性には支障はない。このことはこの方式の
場合秘話のためのキーコードが実質1つしかとれないこ
とを意味している。従って、同種のスクランブル回路を
備えている者に対しては秘話性保持の効果が発揮されな
いという欠点を有している。
l/i 目 的 本発明は、かかる秘話性の保証の要求に対してキーコー
ドが多数設けられる装置を提供することを目的とする。
に)構成 本発明は基本的には音声信号をスクランブルする送信部
と該スクランブルされた音声信号を復元する受信部から
構成される。
更に詳説゛すると、本発明は信号をクロックパルスに従
って順次サンプリングして記憶すると同時に出力する信
号の可変遅延回路と、前記クロックパルスの周波数を制
御するクロック周波数制御回路と、送信41111と受
信側とを同期させるための同期信号回路と、前記クロッ
ク周波数制御回路中に含まれ且つ可変遅延回路に印加さ
れる前記クロックパルスを計数するカウンタ回路と、送
信側の前記可変遅延回路の出力音声信号と同期信号を合
成する合成回路とから構成されている○ (ホ)実施例 次に図面と共に本発明の装置について詳説する0第1図
は本発明装置の原理を説明するブロック図であって、(
A]は送信側、(B)は受信(Illを示す。まず第1
図(A)に於いて、Illは音声入力端子、(21はL
PFである。(31はN個の遅延段数を有する遅延回路
(記憶回路]であシ、クロック周波数制御回路(CP1
月41のクロックに従って音声をサンプリングして記憶
すると同時に、N標本時点以前にサンプリング記憶され
たサンプリング値を順次出力するN個のサンプリング値
を常時記憶する可変遅延回路でちる。該遅延回路の出力
は、L P F151e経た後、同期信号回路(6)の
出力と合成回路(7)により加算され続いて伝送の為の
変調増幅を行う送信回路(81を経て有線或は無線の伝
送系(91に送出される。
第1図(B)の受信側に於いては、前記伝送系+91を
経た受信信号は、増幅、彷調回路を含む受信回路11(
lで復調後、L P Flll+を介して、クロック周
波数制御回路(CP2目41のクロックに従って該受信
音声をサンプリングして記憶すると同時に、N標本時点
以前にサンプリング記憶されたサンプリング値を順次L
PF[121を介して出力するNサンプル記憶回路+3
1に記憶される。送信(1(!lと受信(lIllの同
期は、送信側の同期信号発生回路(6)より送られる同
期信号を受信41111の同期信号回路(61の同期分
離回路により受信信号より分離し、この分離された同期
信号により受信(llIのクロックを送信(IIIのそ
れと完全に同期させることにより行なわれる。
次に本発明の送信側および受信(illの基本回路をそ
れぞれ第2図および第3図に示す。この基本構成は送信
側及び受信イ111共略同様の構成である。即ち、音声
信号を入出力するBBD等の遅延回路(31(31とそ
のクロ・ンクパルス(131a31の周波数を制御する
クロック周波数制御回路14バ41と同期信号回路f6
+f6+’とから構成されている。更に詳説すると、ク
ロック周波数制御回路14バ41は、マスタークロック
問波数発振回路usasと、その出力を分周する可変分
局回路tt61a、eと、BBD等の遅延回路+311
31へのクロックパルスを計数するカウンタ回路(17
1(171と、該カウンタの出力信号により分局回路f
161 +lθの分間数を制御するための論理回路(J
訓+a+から構成される。また、第2図の発信4Bl+
の同期信号回路+61はゲート信号発生回路09)と同
期用搬送波発生回路(范とゲート制御回路(21)とか
ら成っており、第6図の受信1111の同期信号回路+
41は同期分離回路(2υと同期用トリガ発生回路(2
21とプリセ、ソト値fl;I+御回路(陰とから成っ
ている0 本発明の基本的原理は、例えば入力信号として正弦波イ
g号を例にして説明すると、入力正弦波信号に対して第
4図に示す如くその周波数を同期的に上下にシフトさせ
る処理を行なって、音声信号のスペクトル構造を変え、
了解性を低下させるものであるっ更に詳説すると、第2
図において、クロ・ツク周波数制御回路(41中の可変
分周回路[1,61の分周数を変化させることによりa
 a D13+へのクロック周波数を変化させ、音声信
号がBBDへ入力するときのクロックパルスの周波数と
、遅延後の出力時のクロック周波数とを異ならせること
によって、出力音声信号の周波数を元のものに対して変
化させて、音声のスクランブル化を図るものである〇 一方、受信側第6図では、送信イIIJ第2図と略同構
成の回路において、送信4uh KおけるB B D1
3+へのクロック周波数の変化と同期して受信側のBB
D(141へのクロック同波数を変化させることによっ
て、受信したスクランブル音声の周波数を丁度元に戻る
ように再度変換を行なって復元動作を行なうように構成
している。
次に上述の動作を第2図および第5図と共に更に詳説す
る。
音声信号は遅延回路13+(3+’にクロック(131
(I iに従って取込まれ、ljKバヶッリレー的に遅
延回路内のメモリセルの次段に転送され、遅延段数分の
クロックが入力後、出力する。ここで音声信号が入力す
るときのクロ・ツク周波数をfa、遅延後信号が出力す
るときのクロック周波数をfbとすると、出力時の音声
信号けf b / f a倍@波数が変換されて送出さ
れる。従って、クロック周波数を変化させておくことに
よってスクランブル処理が行える0 ここで送信(ill遅延回路(31に音声信号が入力の
ときのクロック8e、数をfl、信号の遅延後出力のと
きのクロック同波数をf2とすると、受信側遅延回路に
入力するときのクロ、ツク周波数はf2であり、更に遅
延後受信側から出力するときのクロック周波数をf3と
すると、受信(M11遅延回路から元の音声信号が復元
されて出力する為にはf2/f1 x f5/f’2 
= 1即ち、f5=f1となるようにクロック周波数を
送信側と受信(Illとの遅延時間の和の分の周期を持
たせて変化させておけばよい。そして、第2図および第
6図におけるクロック周波数制御回路(4)14IはJ
:記のように汗声局波数の変換をM制御する回路である
さて、送信(111と受信4111の回路は共に、同じ
周波数で且つ同じ位相のクロックで動作しないと、元信
号か正しく復元されない。本発明はこの周波数と位相の
関係を利用して、送信(it!Iと受信(lullとで
クロックの位相をパラメータとして多くのキーをつくる
ことを提供するものである。即ち、本発明はクロ・ツク
周波数がカウンタqyot6の値によって決定されるこ
とを利用する。送信側カウンタ(17Iがある特定の値
のとき、ゲート信号発生回路(19からゲート信号を発
生させ、この信号を用いて、同期用搬送波発生回路α刀
の搬送波(例えば周波数5〜10KHzの正弦波ンをゲ
ート制御回路t21)でゲートIll、+制御し、この
ゲート制御された信号を同期信号として使用する。そし
て、この同期信号を合成回路(7)に印加してスクラン
ブル処理された音声信号に重畳し、罐送糸(91に伝送
する。
一方、受信01!l (第5図)では、同期分離回路(
211で受信信号中の同期信号を分離し、同期用トリガ
発生回路122でトリガ信号を発生させ、紋とリガ信号
をグリセ・ソト値制御回路(2うJに印加し、プリセッ
ト値制御回路(23)によりカウンタ回路ofを送信側
のカウンタanと同じ値になるようプリセットする。
本発明ではキーをつくる為、ゲート信号発生回路(Il
lの出力ゲート信号を送出するときの送信側カウンタ鰭
の値と、受信側カウンタaiをプリセットする値上をペ
アでパラメータ設定し、キーが異なると、元信号が正し
く復元されず、内容が了解されないように構成している
次に本発明の具体的実確例を第5図および第6図と共に
説明する。
先ず、第5図において、送信側のクロック周波数はカウ
ンタ(Inの値に応じて決定される。該カウンタ(17
)の最上位の出力(Ql)の周期は送信側と受信側の遅
延回路tsrtsrの遅延時間の和の分、即ち送・受信
(#!lの遅延段数の和の分だけクロックを計数する時
間であり、クロック川波数はこの周期で変化する。ゲー
ト信号発生回路a9の出力ゲート信号は図中NOR回路
@の出力から得られる。図の例では、キー設定用の端子
(’l’1〕(’r2)(’[’5)(T4)が例えば
、それぞれ(1,0,1,0)の場合、カウンタQ7J
の値がQ1=R1、Q2==0、Q3=1、Q4−00
とき、NOR回mtuの出力(G)は]“となり、その
他の場合は1ゞo″である。このゲート信号を用いて同
期用搬送波(5〜10KHzの正弦波や矩形波〕をゲー
ト面御回路121)でグー)f[御した信号を同期信号
として用いる〇 一方、受信側ではこの同期信号をフィルタよりなる同期
分離回路Qυで抽出し、この信号の立ち上がりのタイミ
ングを検出してトリガパルスを発生させ、受信側のカウ
ンタan*プリセットする。このときのプリセット値は
、第6丙のような回路で構成しておけば、送信側と同じ
値になる。第6図において(T1〕(T2)(T5)(
T4Jはキーセット用端子、(LlJ(L2J(Lg)
・・・はカウンタプリセット用の負荷入力端子、(Ql
)(Q2)(Q5)・・・カウンタ出力である。
次忙受信41111におけるカウンタ回路aiのプリセ
ット用のトリガの発生回路例を説明する。第7図におい
7.(87図はグー)ftil、’l+llされた同期
信号であり、この信号をコンパレータ回路に通すと、(
b)図のようなパルス列が得られる。尚、(a)図で(
?JはI8&a!5−10 K Hz tD(ifJ期
信号用搬送波信号、(vl)はコンパレータの基準電圧
である。さらに例えば単安定回路などに(b ) 丙の
パルス列を通すと、(C)図のようなパルス列が連らな
った一つの単パルスが得られるが、コノ波形に対して立
上りエツジで(d)図のようなトリガパルスを発生させ
、これをカウンタ回路anのプリセット用トリガとして
用いる。
尚、このとき(dJ図のトリガの発生タイミングは、コ
ンパレータ出力波形である(b)図のパルスタIJの最
初の二<ル・の立ち上がり時刻であるが、41 送El
 カ5〜l0KHz位の場合、このタイミングは送信4
ti11のゲート信号発生回路(19の出方である九の
ゲート;1声陣信号の立ち上がりょシは若干(Δt)遅
れる。この遅れは々信4MQカウンタa%の下位の値(
Qs、Q6、Ql等)を更にプリセット値ておくことに
より光分抽償できる。
上述の実捲例の説明では、便宜上z4−i6通りのキー
をつくる場合の例を示した。実験では送信イ則と受信側
とでクロック動作の位相が約10〜15度以上異なると
、再生音声信号はその内容がほとんど聞きとれなくなる
。従ってこの場合、キーコードの数としては20〜40
通りもつくることができる。このように、送信側と受信
側のクロック周波数の位相をパラメータとしてキーを作
ることによりキー数を多数とることができる。まだ、他
の条件をパラメータ、例えばマスタークロック周波数を
送・受信側で変えておくことによっても、キーがつくれ
るので、これらを糾合せると、数百通りのキーも可能で
ある。
尚また、上述に於ては可変遅延回路として88Dを例に
とって説明したが、CODやシフトレジスタを使用して
も同様に構成できることは言うまでもない。史にRAM
等のディジタル・メモリー回路を使用する際にはD/A
回路やA/D回路と組み合わせて回路を適当に組み変え
ればよい。
(へ)効 果 このように本発明は送信側と受信側のクロック周波数を
制御するカウンタ回路のプリセット値をパラメータとし
てキーをつくることKより、キー数が多くとれるスクラ
ンブル装置を提供するものであシ、この方式に基づくと
回路を搭載した有線・無線機器を用いれば、第三者に受
信されても通話内容を傍受されることはなく、秘話通信
を行う上で実用上大きな効果が得られる。
【図面の簡単な説明】
第1図は本発明の原理を示すプロツク回路図、第2図は
本発明の秘話通信装置の送信側回路ブロック図、第3図
は同装電の受信411回路ブロック図、第4図は本発明
の装置で処理したスクランブル信号波形の特性図、第5
図は本発明の装置に使用するゲート信号発生回路の具体
的実施例、第6図は本発明の装置に使用するプリセット
値制御回路の具体的実施例、第7図は同期に用いる信号
波形である。 1 ′UQ @(D N’il” 4;tl+・・・入
力端子、+a++ai・・・可変遅延回路、+41A・
・・クロ(b’> ツク周波数制御回路、(6)に・・同期信号回路、→→
−1、+71・・・合成回 路、+9ト・・云送系、(131・・・クロックパルス
、(14+・・・出力端子、++s+am・・・マスタ
ークロツク1聞沢数発撮回路、u6Iae・・・可変分
間回路、++71+tn・・・カウンタ回路、aaai
・・・論理回路、(19・・・ゲート信号発生回路、(
20+・・・同期用搬送波発生回路、(211・・・同
期分離1回路、(22・・・同期用トリガ発生回路、!
?、’(+・・・プリセット値制御回路。 第4図 第7図 :; −ζ1

Claims (1)

  1. 【特許請求の範囲】 (川a1 信号をクロックパルスに従って順次サンプリ
    ングして記憶し且つ出力する信号の可変遅延回路と、 イb) 前記クロックパルスの周汲数を制御するクロッ
    ク周波数制御回路と、 (01送信(11と受信(tliとを同期させるだめの
    同期信号回路と を通信系の送信側と受信側とに備え、 前記クロック周波数制御回路は前記可変遅延回路に印加
    される前記クロックパルスを計数するカウンタ回路を含
    み、該カウンタ回路の出力に関連して前記クロックパル
    スの1波数を制御し、前記送信41t11の前記カウン
    タ回路が所定のクロックパルスを計数した時の該カウン
    タ回路の出力に応答して前記同期信号回路にて同期信号
    を発生させ、送信4111の前記可変遅延回路の出力音
    ¥R信号と前記同期信号を合成回路で合成した後、伝送
    系に伝送し、而して、受信4111で該同期信号を分離
    し、分離された同期信号により受信41111の前記カ
    ウンタ回路をプリセ・フトし、送信411+1の同期信
    号送出時におけるカウンタ回路の値と受信側のカウンタ
    回路をプリセットする値とをパラメータとしてキーコー
    ドを作成することを特徴とす秘話通信装置○ (2)カウンタ回路の上位をキーコード設定に使用し、
    下位を受信4111の同期遅れの補償に使用することを
    特徴とする特許請求の範囲il+に記載の秘話通信装置
JP21734983A 1983-11-17 1983-11-17 秘話通信装置 Granted JPS60109342A (ja)

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