JPS60142394A - ロウ・カラム変換方式 - Google Patents
ロウ・カラム変換方式Info
- Publication number
- JPS60142394A JPS60142394A JP58246120A JP24612083A JPS60142394A JP S60142394 A JPS60142394 A JP S60142394A JP 58246120 A JP58246120 A JP 58246120A JP 24612083 A JP24612083 A JP 24612083A JP S60142394 A JPS60142394 A JP S60142394A
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- Controls And Circuits For Display Device (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は９文字発生器から発生されるノ々ターンデータ
のような２次元配列データの行９列すなわちロウおよび
カラムを変換する方式に関し、特に従来よシも少ないハ
ードウェア量で実現する方式に関する。
のような２次元配列データの行９列すなわちロウおよび
カラムを変換する方式に関し、特に従来よシも少ないハ
ードウェア量で実現する方式に関する。
図形処理では、所定のデータ領域について９０度、１８
０度、２７０度等の回転処理を要求される場合がある。
０度、２７０度等の回転処理を要求される場合がある。
またＣＲＴディスプレイ装置とドツトプリンタとが１つ
の文字発生器を共有しているシステムでは、ＣＲＴディ
スプレイ装置がラスク走査方式をとっているため９文字
パターンをロウ単位で供給する必要があるのに対して、
ドツトプリンタでは印字ヘッドのピン配列が縦方向に設
けられているため９文字パターンをカラム単位で供給す
る必要がある。このため９通常は文字発生器から文字パ
ターンデータをロウ単位で読み出し。
の文字発生器を共有しているシステムでは、ＣＲＴディ
スプレイ装置がラスク走査方式をとっているため９文字
パターンをロウ単位で供給する必要があるのに対して、
ドツトプリンタでは印字ヘッドのピン配列が縦方向に設
けられているため９文字パターンをカラム単位で供給す
る必要がある。このため９通常は文字発生器から文字パ
ターンデータをロウ単位で読み出し。
ＣＲＴディスプレイ装置に対してはそのままの形で供給
するとともに、ドツトプリンタに対しては。
するとともに、ドツトプリンタに対しては。
第１図に示すようなロウ・カラム変換すなわち９０度の
回転操作を行なってから供給する方法がとられている。
回転操作を行なってから供給する方法がとられている。
第２図は、従来のロウ・カラム変換回路の１例を示す。
なお説明の便宜上、４×４ビツトのデータ領域について
のロウ・カラム変換回路に簡単化して示す。ここで４×
４ビツトのデータは９次のように表わす。
のロウ・カラム変換回路に簡単化して示す。ここで４×
４ビツトのデータは９次のように表わす。
カ ラ ム
ｌ ２３４
第２図において、ｌは４ビツトのデータ幅のバッファメ
モリ、２乃至５は入力レジスタ。６乃至９はデータセレ
クタ、１０は出力レジスタであるバッファメモリ１から
読み出されたロウｌのデータは、入力レジスタ２へ格納
され、ロウ２のデータは入力レジスタ３へ格納され、以
下同様にロウ３，４のデータは入力レジスタ３，４へそ
れぞれ格納される。このようにして、バッファメモリｌ
の内容は、入力レジスタ２乃至５へ展開される。
モリ、２乃至５は入力レジスタ。６乃至９はデータセレ
クタ、１０は出力レジスタであるバッファメモリ１から
読み出されたロウｌのデータは、入力レジスタ２へ格納
され、ロウ２のデータは入力レジスタ３へ格納され、以
下同様にロウ３，４のデータは入力レジスタ３，４へそ
れぞれ格納される。このようにして、バッファメモリｌ
の内容は、入力レジスタ２乃至５へ展開される。
各入力レジスタへのデータ格納が終了した段階で。
データセレクタ６乃至９が同期的に制御される。
データセレクタ６乃至９は、順次のカラムデータを選択
する。たとえば図示された各データセレクタの第１位置
では、入力レジスタ？乃至５の各カラム１のビットＢｌ
ｌ 、 Ｂ２１ 、１３１１ 、 、ｆ３４１ が選択
され、出力レジスタに格納される。
する。たとえば図示された各データセレクタの第１位置
では、入力レジスタ？乃至５の各カラム１のビットＢｌ
ｌ 、 Ｂ２１ 、１３１１ 、 、ｆ３４１ が選択
され、出力レジスタに格納される。
このように、従来のロウ・カラム変換回路は。
ロウ数と同数の入力レジスタおよびデータセレクタが必
要とされ、変換対象のデータサイズが大きくなるとハー
ドウェア量が大幅に増加し、コストが上るという問題が
あった。
要とされ、変換対象のデータサイズが大きくなるとハー
ドウェア量が大幅に増加し、コストが上るという問題が
あった。
本発明の目的は、ロウ・カラム変換回路のハードウェア
量を削減することにあフ、そのための新規なロウ・カラ
ム変換方式を提供するものである。
量を削減することにあフ、そのための新規なロウ・カラ
ム変換方式を提供するものである。
本発明の構成は、それによυロウおよびカラムからなる
２次元配列のデータを記憶し、ロウ単位で読み出し可能
な記憶手段と、該記憶手段から読み出された各ロウ・デ
ータから特定のカラムビットを選択する手段と、該選択
された各ロウ・データのカラム・ビットを順次的に格納
するシフトレジスタ手段とをそなえ、上記選択手段に選
択すべ旨順次のカラム位置を指示し、該指示したカラム
立置ごとに上記記憶手段から全ロウ・データを順次的に
読み出させ、上記シフトレジスタ手段から並列にカラム
・データを取シ出すことを特徴とするものでちる。
２次元配列のデータを記憶し、ロウ単位で読み出し可能
な記憶手段と、該記憶手段から読み出された各ロウ・デ
ータから特定のカラムビットを選択する手段と、該選択
された各ロウ・データのカラム・ビットを順次的に格納
するシフトレジスタ手段とをそなえ、上記選択手段に選
択すべ旨順次のカラム位置を指示し、該指示したカラム
立置ごとに上記記憶手段から全ロウ・データを順次的に
読み出させ、上記シフトレジスタ手段から並列にカラム
・データを取シ出すことを特徴とするものでちる。
以下に９本発明の詳細を実施例にしたがって説明する。
第３図は９本発明の１実施例の構成図であシ。
文字発生器ＣＧのパターンデータをロウ・カラム変換す
る回路を示す。図中、１１は８×８ビツトのバッファメ
モリ、１８はロウ・カウンタ、１２はカラム拳セレクタ
、１４はカラム・カウンタ。
る回路を示す。図中、１１は８×８ビツトのバッファメ
モリ、１８はロウ・カウンタ、１２はカラム拳セレクタ
、１４はカラム・カウンタ。
１５はシフトレジスタ、１６はデータバッファを示す。
文字発生器ＣＧ（図示せず）は、２４Ｘ２４ドツトの文
字パターンを発生する。この文字パターンは、第４図に
示すように８×８ピツトすなわち８バイト単位の９ブロ
ツクに分割して、ロウスキャン方式で読み出される。読
み出されたｌブロック分のデータは、第３図のバッファ
メモリ１１に格納される。
字パターンを発生する。この文字パターンは、第４図に
示すように８×８ピツトすなわち８バイト単位の９ブロ
ツクに分割して、ロウスキャン方式で読み出される。読
み出されたｌブロック分のデータは、第３図のバッファ
メモリ１１に格納される。
ロウ・カウンタ１３は、クロックをカウントして、バッ
ファメモリ１１を読み出すためのロウアドレスを順次的
に発生する。
ファメモリ１１を読み出すためのロウアドレスを順次的
に発生する。
カラム拳セレクタ１２は、バッファメモリ１１から並列
に読み出された８ビツトのロウ・データから特足のビッ
ト位置、すなわちカラムを選択する。このカラム・セレ
クタ１２のカラム選択位置は、バッファメモリ１１のロ
ウ・データ読み出しが一巡するまで同じ位置に留められ
る。その結果。
に読み出された８ビツトのロウ・データから特足のビッ
ト位置、すなわちカラムを選択する。このカラム・セレ
クタ１２のカラム選択位置は、バッファメモリ１１のロ
ウ・データ読み出しが一巡するまで同じ位置に留められ
る。その結果。
バッファメモリ１１からロウ・データが読み出されるた
びにその同じカラム位置のビットのみが抽出される。各
抽出されたカラムビットは、シフトレジスタ１５に順次
書き込まれる。
びにその同じカラム位置のビットのみが抽出される。各
抽出されたカラムビットは、シフトレジスタ１５に順次
書き込まれる。
カラム・カウンタ１４は、カラム−セレクタ１３のカラ
ム選択位置を順次移動させるためのセレクタ制御信号を
発生する。カラム−カウンタ１４は、バッファ・メモリ
１１からのロウ・データ読み出しが一巡するたびに、Ｃ
ＰＵから与えられるリード信号によって歩進される。
ム選択位置を順次移動させるためのセレクタ制御信号を
発生する。カラム−カウンタ１４は、バッファ・メモリ
１１からのロウ・データ読み出しが一巡するたびに、Ｃ
ＰＵから与えられるリード信号によって歩進される。
シフトレジスタ１５はリードクロックによシシフト制御
される。シフトレジスタ１５には、バッファメモリ１１
から全ロウ・データが読み出されるたびに１つのカラム
データが収集され、それはさらにデータバッファ１６に
直列に転送される。
される。シフトレジスタ１５には、バッファメモリ１１
から全ロウ・データが読み出されるたびに１つのカラム
データが収集され、それはさらにデータバッファ１６に
直列に転送される。
データバッファ１６は、直列に入力されたカラムデータ
を並列形式に変換し、リード信号によって読み出される
。
を並列形式に変換し、リード信号によって読み出される
。
このようにして、バッファメモリ１１中のロウデータ読
み出しが８巡したとき、８個のカラムデータがデータバ
ッファ１６から読み出され、ロウ・カラム変換は完了す
る。
み出しが８巡したとき、８個のカラムデータがデータバ
ッファ１６から読み出され、ロウ・カラム変換は完了す
る。
第５図は、第３図に示した実施例構成の詳細図であシ、
第６図は、その信号タイミング図である。
第６図は、その信号タイミング図である。
図中、ＣＧ ＤＡＴＡ は文字発生器から出力されたロ
ウ睡データ、ＡＤＤＲはアドレス、妓ＷＲＩＴＥは書き
込み制御信号、ＨＣＬＯＣＫはクロック、誉ＣＲ８Ｔは
カウンタリセット信号、ＨＲ］１ｉ２ＡＤはＣＰＵから
与えられるリード信号、ＲＣＬＫはシフトレジスタ１５
に対するシフト制御信号となるリードクロックである。
ウ睡データ、ＡＤＤＲはアドレス、妓ＷＲＩＴＥは書き
込み制御信号、ＨＣＬＯＣＫはクロック、誉ＣＲ８Ｔは
カウンタリセット信号、ＨＲ］１ｉ２ＡＤはＣＰＵから
与えられるリード信号、ＲＣＬＫはシフトレジスタ１５
に対するシフト制御信号となるリードクロックである。
またロウ・カウンタ１５から出力されるＲ１゜Ｒ２，Ｒ
３は、バッファメモリ１１をアクセスする３ピツトのロ
ウ・アドレスでアシ、カラム・カウンタ１４から出力さ
れるＲＡ、ＲＢ、ＲＣは。
３は、バッファメモリ１１をアクセスする３ピツトのロ
ウ・アドレスでアシ、カラム・カウンタ１４から出力さ
れるＲＡ、ＲＢ、ＲＣは。
カラムセレクタ１２へ印加される３ビツトのセレクタ制
御信号である。
御信号である。
第７図は、バッファメモリ１１に格納されている８×８
ビツトの、ａターンデータに対するロウ・アドレスＲ１
，Ｒ２，Ｒ３とセレクタ制御信号ＲＡ、ＲＢ、ＲＣのカ
ラム選択位置とを示したものである。ＲＤＯ乃至ＲＤ７
は、ロウ・データを表わしている。
ビツトの、ａターンデータに対するロウ・アドレスＲ１
，Ｒ２，Ｒ３とセレクタ制御信号ＲＡ、ＲＢ、ＲＣのカ
ラム選択位置とを示したものである。ＲＤＯ乃至ＲＤ７
は、ロウ・データを表わしている。
カラム・セレクタ１２から出力されるＳＬＤはシリアル
データであることを表わし、シフトレジスタ１５に直列
に入力される。
データであることを表わし、シフトレジスタ１５に直列
に入力される。
第８図は、セレクタ制御信号ＲＡ、ＲＢ、ＲＣが”００
０”のときのＳＬＤの内容す碌わち、各ロウ・データＲ
ＤＯ乃至ＲＤ７のカラム″ｈｉｔ ’？ ”の配列を示
したものである。
０”のときのＳＬＤの内容す碌わち、各ロウ・データＲ
ＤＯ乃至ＲＤ７のカラム″ｈｉｔ ’？ ”の配列を示
したものである。
゛ シフトレジスタ１５は、データＳ ＬＤｆ、リード
クロックＲＣＬＫにしたがって順次読み込む。
クロックＲＣＬＫにしたがって順次読み込む。
第９図は、ＲＣＬＫの進行にともなうシフトレジスタ１
５の各段（ＱＡ乃至ＱＨ）の内容を示したものである。
５の各段（ＱＡ乃至ＱＨ）の内容を示したものである。
時間Ｔｌでロウ・カウンタ１３が停止するため、ＲＣＬ
Ｋは８個目のパルスで安定する。
Ｋは８個目のパルスで安定する。
このとき、シフトレジスタの段ＱＡ乃至ＱＨには。
ＳＬＤすなわちＲＤＯ乃至ＲＤ７の同一カラムのビット
が配列されている。
が配列されている。
シフトレジスタ１５の各段の状態は、並列データＱｌ乃
至ＱＢの形でデータバッファ１６に転送され、ＨＩＡＤ
によって書き込まれる。データバッファ１６の内容は、
さらにデータＤＯ乃至Ｄ７としてデータバスへ出力され
る。
至ＱＢの形でデータバッファ１６に転送され、ＨＩＡＤ
によって書き込まれる。データバッファ１６の内容は、
さらにデータＤＯ乃至Ｄ７としてデータバスへ出力され
る。
これらの動作は、順次のカラム位置が選択されるごとに
繰シ返される。なお、カラムカウンタ１４の代シに、ア
ドレス信号を用いてセレクタ制御信号を生成することも
可能である。
繰シ返される。なお、カラムカウンタ１４の代シに、ア
ドレス信号を用いてセレクタ制御信号を生成することも
可能である。
以上のように９本発明は、カラムセレクタや。
カラムカウンタ、シフトレジスタなど少数の部品で構成
することができ、ロウ数やカラム数が増加してもそれぞ
れのピッ）Ｗ量が変るだけで個数は増やす必要はなく、
従来の方式にくらべてハードウェア量金著しく削減する
ことができ、それに応じてコストも低減することができ
る。
することができ、ロウ数やカラム数が増加してもそれぞ
れのピッ）Ｗ量が変るだけで個数は増やす必要はなく、
従来の方式にくらべてハードウェア量金著しく削減する
ことができ、それに応じてコストも低減することができ
る。
第１図はロウ・カラム変換の説明図、第２図は従来のロ
ウ・カラム変換回路の回路図、第３図は本発明方式の１
実施例回路の構成図、第４図は文字パターンデータの説
明図、第５図は本実施例回路の詳細図、第６図は第５図
に示す実施例回路の信号タイミング図、第７図はロウ・
アドレスおよびセレクタ制御信号の説明図、第８図はＳ
ＬＤの内容説明図、第９図はシフトレジスタ動作の説明
図である。 図中、１１はバッファメモリ、１２はカラム・セレクタ
、１３はロウ・カウンタ、１４はカラム・カウンタ、１
５はシフトレジスタ、１６はデータバッファである。 特許出願人 富士通株式会社 才８図 Ｑｑ 〒 ＱＨ■ Ｔ＋ ″ｉ′９国
ウ・カラム変換回路の回路図、第３図は本発明方式の１
実施例回路の構成図、第４図は文字パターンデータの説
明図、第５図は本実施例回路の詳細図、第６図は第５図
に示す実施例回路の信号タイミング図、第７図はロウ・
アドレスおよびセレクタ制御信号の説明図、第８図はＳ
ＬＤの内容説明図、第９図はシフトレジスタ動作の説明
図である。 図中、１１はバッファメモリ、１２はカラム・セレクタ
、１３はロウ・カウンタ、１４はカラム・カウンタ、１
５はシフトレジスタ、１６はデータバッファである。 特許出願人 富士通株式会社 才８図 Ｑｑ 〒 ＱＨ■ Ｔ＋ ″ｉ′９国
Claims (1)
- 【特許請求の範囲】 ロウおよびカラムからなる２次元配列のデータを記憶し
、ロウ単位で読み出し可能な記憶手段と。 該記憶手段から読み出された各ロウ・データから特定の
カラムピッ）１−選択する手段と、該選択された各ロウ
・データのカラム・ピッ）ｔ−順次的に格納するシフト
レジスタ手段とをそなえ、上記選択手段に選択すべき順
次の力２ム位置を指示し。 該指示したカラム位置ごとに上記記憶手段から全ロウ・
データを順次的に読み出させ、上記シフトレジスタ手段
から並列にカラム・データを取９出すことを特徴とする
ロウ・カラム変換方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58246120A JPS60142394A (ja) | 1983-12-29 | 1983-12-29 | ロウ・カラム変換方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58246120A JPS60142394A (ja) | 1983-12-29 | 1983-12-29 | ロウ・カラム変換方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60142394A true JPS60142394A (ja) | 1985-07-27 |
Family
ID=17143778
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58246120A Pending JPS60142394A (ja) | 1983-12-29 | 1983-12-29 | ロウ・カラム変換方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60142394A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62266682A (ja) * | 1986-05-14 | 1987-11-19 | Matsushita Graphic Commun Syst Inc | 画像処理装置 |
Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51134034A (en) * | 1975-05-16 | 1976-11-20 | Hitachi Ltd | Dot character generation method |
| JPS5897083A (ja) * | 1981-12-07 | 1983-06-09 | 株式会社東芝 | 縦横変換回路 |
-
1983
- 1983-12-29 JP JP58246120A patent/JPS60142394A/ja active Pending
Patent Citations (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51134034A (en) * | 1975-05-16 | 1976-11-20 | Hitachi Ltd | Dot character generation method |
| JPS5897083A (ja) * | 1981-12-07 | 1983-06-09 | 株式会社東芝 | 縦横変換回路 |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62266682A (ja) * | 1986-05-14 | 1987-11-19 | Matsushita Graphic Commun Syst Inc | 画像処理装置 |
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