JPS60167096A - 表示回路 - Google Patents
表示回路Info
- Publication number
- JPS60167096A JPS60167096A JP2117784A JP2117784A JPS60167096A JP S60167096 A JPS60167096 A JP S60167096A JP 2117784 A JP2117784 A JP 2117784A JP 2117784 A JP2117784 A JP 2117784A JP S60167096 A JPS60167096 A JP S60167096A
- Authority
- JP
- Japan
- Prior art keywords
- light emitting
- emitting diodes
- display circuit
- voltage
- zener
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Audible And Visible Signals (AREA)
- Control Of El Displays (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
（ａ）６発明の技術分野
本発明は発光ダイオードを使用する表示回路に係り、特
に複数個の発光ダイオードを直列に接続して各種情報を
表示する表示回路に関するものである。
に複数個の発光ダイオードを直列に接続して各種情報を
表示する表示回路に関するものである。
（ｂ）、従来技術と問題点
第１図は従来の複数個の発光ダイオードを直列に接続し
て各種情報を表示する表示回路の一実施例を示す回路図
である。
て各種情報を表示する表示回路の一実施例を示す回路図
である。
図中、ＰＤＩ 〜ＰＤｎは夫々発光ダイオード、Ｒ１”
−Ｒｎは夫々抵抗、Ｒｃは電流制限素子、■は直流電源
である。
−Ｒｎは夫々抵抗、Ｒｃは電流制限素子、■は直流電源
である。
以下図に従って従来６複数個の発光ダイオードを直列に
接続して各種情報を表示する表示回路を説明する。
接続して各種情報を表示する表示回路を説明する。
発光ダイオードＰＤ、が規定の動作状態で発光する為に
必要な電流を流す時生ずる端子電圧をめ、此の端子電圧
の総和より大きい電源電圧Ｖを使用し、電源電圧Ｖには
電流制限用として電流制限素子Ｒｃを直列接続して負荷
に電圧を供給し、負荷である各発光ダイオードＰＤｎに
は夫々並列に保護抵抗Ｒｎを接続している。
必要な電流を流す時生ずる端子電圧をめ、此の端子電圧
の総和より大きい電源電圧Ｖを使用し、電源電圧Ｖには
電流制限用として電流制限素子Ｒｃを直列接続して負荷
に電圧を供給し、負荷である各発光ダイオードＰＤｎに
は夫々並列に保護抵抗Ｒｎを接続している。
然し此の様な従来の表示回路では何れかの発光ダイオー
ドＰＤｎが故障により切断状態になると保護抵抗Ｒｎだ
けを通って電流が流れる。普通保護抵抗ＲｎＯ値は発光
ダイオードＰＤｎの動作状態に於ける実効抵抗より大き
く取るので他の発光ダイオードに印加する電圧が低下し
て暗くなり、保護抵抗Ｒｎを実効抵抗より小さく設定す
ると切断の為他の発光ダイオードに対する影響は減少す
るが電流損が増大すると云う欠点があった。
ドＰＤｎが故障により切断状態になると保護抵抗Ｒｎだ
けを通って電流が流れる。普通保護抵抗ＲｎＯ値は発光
ダイオードＰＤｎの動作状態に於ける実効抵抗より大き
く取るので他の発光ダイオードに印加する電圧が低下し
て暗くなり、保護抵抗Ｒｎを実効抵抗より小さく設定す
ると切断の為他の発光ダイオードに対する影響は減少す
るが電流損が増大すると云う欠点があった。
（Ｃ）３発明の目的
本発明の目的は従来技術の有する上記の欠点を除去し、
直列接続された多数の発光ダイオードの中の何れか一つ
が断線状態になっても他の発光ダイオードの動作に異常
を与えることがない表示回路を提供することである。
直列接続された多数の発光ダイオードの中の何れか一つ
が断線状態になっても他の発光ダイオードの動作に異常
を与えることがない表示回路を提供することである。
（ｄ）３発明の構成
上記の目的は本発明によれば、発光ダイオード等の表示
素子を複数個直列接続して各種情報を表示する回路に於
いて、前記各発光ダイオードと並列にツェナーダイオー
ドを接続し、前記ツェナーダイオードのツェナー電圧値
が前記発光ダイオードの点火状態の電圧降下値に略等し
く且つ僅かに大きい値に設定することを特徴とする表示
回路を提供することにより達成される。
素子を複数個直列接続して各種情報を表示する回路に於
いて、前記各発光ダイオードと並列にツェナーダイオー
ドを接続し、前記ツェナーダイオードのツェナー電圧値
が前記発光ダイオードの点火状態の電圧降下値に略等し
く且つ僅かに大きい値に設定することを特徴とする表示
回路を提供することにより達成される。
（ｅ）０発明の実施例
図は本発明に依る表示回路の一実施例を示す回路図であ
る。
る。
図中、ＺＤ、〜ＺＤｎは夫々ツェナーダイオードであり
、其の他の記号、数字は第１図と同一である。
、其の他の記号、数字は第１図と同一である。
以下図に従って本発明の詳細な説明する。
本発明に依ると発光ダイオードＰＤ、と並列に接続され
るツェナーダイオードＺＤ、のツェナー電圧Ｖｚは発光
ダイオードＰＤ、が規定の発光状態にある時の電圧降下
Ｖｐと略等しく且つ僅かに大きい値のものを使用する。
るツェナーダイオードＺＤ、のツェナー電圧Ｖｚは発光
ダイオードＰＤ、が規定の発光状態にある時の電圧降下
Ｖｐと略等しく且つ僅かに大きい値のものを使用する。
即ちＶｚ ＃Ｖｐで且つＶｚ ＞Ｖｐとする。
以下総ての発光ダイオードＰＤｎと並列に接続されるツ
ェナーダイオードＺＤｎについても同様なものを使用す
る。
ェナーダイオードＺＤｎについても同様なものを使用す
る。
此の様なツェナーダイオードＺＤ、と発光ダイオードＰ
Ｄ、を並列に接続して直流電圧Ｖｐを印加すると発光ダ
イオードＰＤ、は規定の電流が流れて規定の発光状態に
なるが、ツェナーダイオードＺＤ、のツェナー電圧Ｖｚ
はＶｐより大きいので電流が流れない。
Ｄ、を並列に接続して直流電圧Ｖｐを印加すると発光ダ
イオードＰＤ、は規定の電流が流れて規定の発光状態に
なるが、ツェナーダイオードＺＤ、のツェナー電圧Ｖｚ
はＶｐより大きいので電流が流れない。
此の様な並列回路が第１図に示す様に多数直列に接続さ
れて使用されている時任意の発光ダイオード例えばＰＤ
、が切断状態になると一瞬其の端子電圧が上昇するが、
ツェナーダイオードＺＤ。
れて使用されている時任意の発光ダイオード例えばＰＤ
、が切断状態になると一瞬其の端子電圧が上昇するが、
ツェナーダイオードＺＤ。
のツェナー電圧Ｖｚになる。
此の電圧Ｖｚは前述した様にＶＰより大きいが略等しい
為他の並列回路の動作状態に殆ど変化を与えることはな
い。
為他の並列回路の動作状態に殆ど変化を与えることはな
い。
（ｆ）０発明の効果
以上詳細に説明した様に本発明によれば、複数個の発光
ダイオードを直列に接続して各種情報を表示する表示回
路に於いて其の一つの発光ダイオードの断線により他の
発光ダイオードの動作に影響を与えることがなく而も電
流損の少ない回路を実現出来ると云う大きい効果がある
。
ダイオードを直列に接続して各種情報を表示する表示回
路に於いて其の一つの発光ダイオードの断線により他の
発光ダイオードの動作に影響を与えることがなく而も電
流損の少ない回路を実現出来ると云う大きい効果がある
。
第１図は従来の複数個の発光ダイオードを直列に接続し
て各種情報を表示する表示回路の一実施例を示す回路図
である。 第２図は本発明に依る表示回路の一実施例を示す回路図
である。 図中、ＰＤ、〜ＰＤｎは夫々発光ダイオード、ＺＤ、〜
ＺＤｎは夫々ツェナーダイオード、Ｒ１−Ｒｎは夫々抵
抗、Ｒｃは電流制限素子、■は直流電源である。 寥１ 口 年２ 日
て各種情報を表示する表示回路の一実施例を示す回路図
である。 第２図は本発明に依る表示回路の一実施例を示す回路図
である。 図中、ＰＤ、〜ＰＤｎは夫々発光ダイオード、ＺＤ、〜
ＺＤｎは夫々ツェナーダイオード、Ｒ１−Ｒｎは夫々抵
抗、Ｒｃは電流制限素子、■は直流電源である。 寥１ 口 年２ 日
Claims (1)
- 発光ダイオード等の表示素子を複数個直列接続して各種
情報を表示する回路に於いて、前記各発光ダイオードと
並列にツェナーダイオードを接続し、前記ツェナーダイ
オードのツェナー電圧値が前記発光ダイオードの点火状
態の電圧降下値に略等しく且つ僅かに大きい値に設定す
ることを特徴とする表示回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2117784A JPS60167096A (ja) | 1984-02-08 | 1984-02-08 | 表示回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2117784A JPS60167096A (ja) | 1984-02-08 | 1984-02-08 | 表示回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS60167096A true JPS60167096A (ja) | 1985-08-30 |
Family
ID=12047648
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2117784A Pending JPS60167096A (ja) | 1984-02-08 | 1984-02-08 | 表示回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60167096A (ja) |
-
1984
- 1984-02-08 JP JP2117784A patent/JPS60167096A/ja active Pending
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