JPS60183818A - 発振周波数制御回路 - Google Patents
発振周波数制御回路Info
- Publication number
- JPS60183818A JPS60183818A JP59038826A JP3882684A JPS60183818A JP S60183818 A JPS60183818 A JP S60183818A JP 59038826 A JP59038826 A JP 59038826A JP 3882684 A JP3882684 A JP 3882684A JP S60183818 A JPS60183818 A JP S60183818A
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- vco
- phase
- current
- control
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03L—AUTOMATIC CONTROL, STARTING, SYNCHRONISATION OR STABILISATION OF GENERATORS OF ELECTRONIC OSCILLATIONS OR PULSES
- H03L7/00—Automatic control of frequency or phase; Synchronisation
- H03L7/06—Automatic control of frequency or phase; Synchronisation using a reference signal applied to a frequency- or phase-locked loop
- H03L7/08—Details of the phase-locked loop
- H03L7/085—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal
- H03L7/093—Details of the phase-locked loop concerning mainly the frequency- or phase-detection arrangement including the filtering or amplification of its output signal using special filtering or amplification characteristics in the loop
Landscapes
- Stabilization Of Oscillater, Synchronisation, Frequency Synthesizers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
(技術分野)
本発明は、位相同期ループ回路における電圧制御発掘器
の発振制御回路に関するものである。
の発振制御回路に関するものである。
(背景技術)
従来、位相同期ループ回路(以下P L Lと呼ぶ)は
第1図に示す回路糸であった。1ばPLLの人力信号源
(’l’ T Lレベルの矩形波)、2はP L Lの
入力端子、3は位相比較器(以下P、Cと呼ぶ)、4は
P、Cの第1の入力端子、5はP、Cの第2の入力端子
、6はP、Cの出力端子、7は低域通過フィルタ(以下
i、 P Fと呼ぶ)、8はT、 P li”の入力端
子、9ばL I) I!”の出力端子、10は直流増幅
器(以下D Cアンプと呼ぶ)、月は■)Cアンプの入
力端子、]2ばl)Cアンプの出力端子、13は発振周
波数制御回路(7と10を含んだ部分とする)、1・1
は電圧制御発振器(以下VCOと呼ぶ)、15ばV C
Oの制御入力端子、16は■COの発振出力端子、J7
ばP、Cの動作電源電圧■い18は発振周波数制御回路
と■COの動作電源電圧■2、また、1も、、1.(、
、、、I佑。
第1図に示す回路糸であった。1ばPLLの人力信号源
(’l’ T Lレベルの矩形波)、2はP L Lの
入力端子、3は位相比較器(以下P、Cと呼ぶ)、4は
P、Cの第1の入力端子、5はP、Cの第2の入力端子
、6はP、Cの出力端子、7は低域通過フィルタ(以下
i、 P Fと呼ぶ)、8はT、 P li”の入力端
子、9ばL I) I!”の出力端子、10は直流増幅
器(以下D Cアンプと呼ぶ)、月は■)Cアンプの入
力端子、]2ばl)Cアンプの出力端子、13は発振周
波数制御回路(7と10を含んだ部分とする)、1・1
は電圧制御発振器(以下VCOと呼ぶ)、15ばV C
Oの制御入力端子、16は■COの発振出力端子、J7
ばP、Cの動作電源電圧■い18は発振周波数制御回路
と■COの動作電源電圧■2、また、1も、、1.(、
、、、I佑。
■で・4はDCアンプの利得(以下Aとする)設定用抵
抗器、さらに、RV 1 、 LL、ばV CO発振中
心電圧設定用の半固定抵抗器および抵抗器であり、Q、
、 Q2はNi’N型1−ランジスタである。
抗器、さらに、RV 1 、 LL、ばV CO発振中
心電圧設定用の半固定抵抗器および抵抗器であり、Q、
、 Q2はNi’N型1−ランジスタである。
動作としては以下の通りである。ずなわち、1の人力イ
ー号どVCOの出力信号の位相差はP、Cで検出され1
,1川−で電流にした後、1)Cアンプでへ倍させてV
COの制御入力端子に印加され、1の人力信号とV C
Oの出力信号の周波数が等しい状態で位相同期する。こ
の場合、])Cアンプとしては差動1段アンプを例に挙
げた。
ー号どVCOの出力信号の位相差はP、Cで検出され1
,1川−で電流にした後、1)Cアンプでへ倍させてV
COの制御入力端子に印加され、1の人力信号とV C
Oの出力信号の周波数が等しい状態で位相同期する。こ
の場合、])Cアンプとしては差動1段アンプを例に挙
げた。
この様な発振周波数制御回路の場合、J)CアンプはL
I) I=”の出力電圧変化をへ倍した電圧変化をV
COの制御入力端子に印加する働きをイ1する。
I) I=”の出力電圧変化をへ倍した電圧変化をV
COの制御入力端子に印加する働きをイ1する。
この場合、差動アンプの性質により以下に示す欠点があ
る。
る。
1)DCアンプの出力電圧■とすると角変範囲は次式と
なる。
なる。
但し、[もはJtV、の抵抗値であて)。従って、電源
■2が変動すると直接(1)式の下限が、電源■2の変
動の](、、/(Jも+II、、)倍となって変化し、
VCOの制御可能範囲が変動することとなり、P L
Lとしての周波数引込範囲に影響が出る。すなわち、電
源変動に対して非常に弱い回路形式であった。
■2が変動すると直接(1)式の下限が、電源■2の変
動の](、、/(Jも+II、、)倍となって変化し、
VCOの制御可能範囲が変動することとなり、P L
Lとしての周波数引込範囲に影響が出る。すなわち、電
源変動に対して非常に弱い回路形式であった。
2)VCOの種類(”2が変化する場合なども含む)を
変えたい場合、VCOの発振中心電圧が式(1)の下限
以下となると、])Cアンプの出力を抵抗器などで分圧
する必要が生じ、I) L Lのループ特性を再設計す
ることとなり、VCOの選択自由度が小さい。
変えたい場合、VCOの発振中心電圧が式(1)の下限
以下となると、])Cアンプの出力を抵抗器などで分圧
する必要が生じ、I) L Lのループ特性を再設計す
ることとなり、VCOの選択自由度が小さい。
3)LPE’の出力電圧可変範囲は式(1)の■の可変
範囲のIAとなり、P、Cの位相比較領域が制限されて
しまう。
範囲のIAとなり、P、Cの位相比較領域が制限されて
しまう。
以−1−03点が主な欠点であった。
(発明の課題)
本発明の目的は従来の技術の上記欠点を改善するもので
、その要点は、直流増幅器の動作を電圧演算(入力電圧
に線形操作を加え出力電圧とする)から電流波’JA、
(入力電圧を電流に変換したのち線形操作を加え、再び
電圧に変換し出力電圧とする)に変更することにある。
、その要点は、直流増幅器の動作を電圧演算(入力電圧
に線形操作を加え出力電圧とする)から電流波’JA、
(入力電圧を電流に変換したのち線形操作を加え、再び
電圧に変換し出力電圧とする)に変更することにある。
(発明の構成および作用)
第2図はこの発明の実施例であり、1〜9J1〜J8は
第1図で述べたものと同一のもので・ある。1〕1は基
準電圧用ツェナーダイオード、IOは本発明による直流
増幅器、Jl、、ばD1用バイアス抵抗器、LLAI
2は基準電圧を電流に変換するための固定抵抗器、Jt
。はf、 J) J=’の出力電圧を電流に変換するだ
めの抵抗器、Q3 、Q<ば1もV l 、 I(、、
により変換された′電流同志の加規[用PNP型トラン
ジスタであり、1もψま加算された電流を電圧に変換す
るだめの抵抗器である。
第1図で述べたものと同一のもので・ある。1〕1は基
準電圧用ツェナーダイオード、IOは本発明による直流
増幅器、Jl、、ばD1用バイアス抵抗器、LLAI
2は基準電圧を電流に変換するための固定抵抗器、Jt
。はf、 J) J=’の出力電圧を電流に変換するだ
めの抵抗器、Q3 、Q<ば1もV l 、 I(、、
により変換された′電流同志の加規[用PNP型トラン
ジスタであり、1もψま加算された電流を電圧に変換す
るだめの抵抗器である。
動作は以下の通りである。Ql、Q、のベース−エミッ
タ間電圧を無祝し、Q31QIに流れる電流を]Q3゜
IO4とすると次式となる。
タ間電圧を無祝し、Q31QIに流れる電流を]Q3゜
IO4とすると次式となる。
(但し、v12.FはL l) ]−7tの出力電圧)
]tば■も■1の抵抗値) IO3,IO4はQ、 、 Q、により加算され、■も
、で電圧に変換されVCOの制御入力端子に印加される
。第1図のI) Cアンプ利得Aと第2図の直流増幅器
の利得を等しくするにはI(,7/IL。−Aとずれば
よい。
]tば■も■1の抵抗値) IO3,IO4はQ、 、 Q、により加算され、■も
、で電圧に変換されVCOの制御入力端子に印加される
。第1図のI) Cアンプ利得Aと第2図の直流増幅器
の利得を等しくするにはI(,7/IL。−Aとずれば
よい。
今、vCOの発振中心電圧をMlとすると次式となる。
vo −(11q3+I(24) xH,7,、、(4
)IO4はJt、を固定ずれば一定電流(VCO制御電
圧中心バイアス電流)であり1.R7/R,6:Aと式
(5)を満足するように設定すれば、第1図のPLLと
同一な特性となる。voO値により設定出来るので前記
の欠点2)は改善される。また、前記の欠点1)に対し
ては、vZが定電圧であるので、電%−j V2が変動
してもIO4は一定となり、1) L 、T、への周波
数引込範囲に影響を寿えることはない。さらに、前記の
欠点3)については、P、Cの位相比較領域に和尚する
IO3の変化量はJt7に全て供給されるため、位相比
較領域に制限を与えることはない。
)IO4はJt、を固定ずれば一定電流(VCO制御電
圧中心バイアス電流)であり1.R7/R,6:Aと式
(5)を満足するように設定すれば、第1図のPLLと
同一な特性となる。voO値により設定出来るので前記
の欠点2)は改善される。また、前記の欠点1)に対し
ては、vZが定電圧であるので、電%−j V2が変動
してもIO4は一定となり、1) L 、T、への周波
数引込範囲に影響を寿えることはない。さらに、前記の
欠点3)については、P、Cの位相比較領域に和尚する
IO3の変化量はJt7に全て供給されるため、位相比
較領域に制限を与えることはない。
(発明の効果)
この発明は以上説明した様に、発振周波数制御回路を?
L流演算型としたことにより、電源電圧変動に強く、y
C(、)の選択の自由度が高く、P、Cの位相比較領
域を有効に活用出来るなどの利点がある。また、この回
路は特殊なV CO(V+へ−V2 )を用いる場合に
有効である。
L流演算型としたことにより、電源電圧変動に強く、y
C(、)の選択の自由度が高く、P、Cの位相比較領
域を有効に活用出来るなどの利点がある。また、この回
路は特殊なV CO(V+へ−V2 )を用いる場合に
有効である。
第1図は従来のPIヨ1J回路であり、第2図は本発明
を適用した一実施例の回路例である。 11、− IL、:抵抗’A’tr、ILVI 、 I
tV2; 5T[F=抗器、1月 ;ツェナーダイオー
ド、Ql、Q2; N P N型トランジスタ、Q3.
Q、 ; 1.J N P型トランジスタ。 喝許出願人 沖電気工業株式会社 日本電信電話公社 特許出鮪代理人 弁理士 山 本 恵 − 手続補正書(自発) 昭和57年5月2日 特許庁長官 若 杉 和 夫 殿 1、事件の表示 11t(和59年 特許前 第38826号2、発明の
名称 発振周波数制御回路 3、補正をする者 7Jr件との関係 特許出願人 7、補正の内容 (1)明細書第5頁第6行及び第18行のrRV、Jを
それぞれ「Rv2」と補正する。 手続補正書(自発) 昭和59年8月140 特許庁長官 志賀 学殿 1 事件の表示 昭和59年 特許前 第38826号 2 発明の名称 発振周波微制御回路 3、補正をする者 事件との関係 特許出願人 名 称 (029)沖電気工業株式会社(他1名)4代
理人 住所 〒105 東京都ン荏区西新橋1丁目5番12号
タンハビル5 補正の対象 明細書の発明の詳細な説明の欄 6 補正の内容
を適用した一実施例の回路例である。 11、− IL、:抵抗’A’tr、ILVI 、 I
tV2; 5T[F=抗器、1月 ;ツェナーダイオー
ド、Ql、Q2; N P N型トランジスタ、Q3.
Q、 ; 1.J N P型トランジスタ。 喝許出願人 沖電気工業株式会社 日本電信電話公社 特許出鮪代理人 弁理士 山 本 恵 − 手続補正書(自発) 昭和57年5月2日 特許庁長官 若 杉 和 夫 殿 1、事件の表示 11t(和59年 特許前 第38826号2、発明の
名称 発振周波数制御回路 3、補正をする者 7Jr件との関係 特許出願人 7、補正の内容 (1)明細書第5頁第6行及び第18行のrRV、Jを
それぞれ「Rv2」と補正する。 手続補正書(自発) 昭和59年8月140 特許庁長官 志賀 学殿 1 事件の表示 昭和59年 特許前 第38826号 2 発明の名称 発振周波微制御回路 3、補正をする者 事件との関係 特許出願人 名 称 (029)沖電気工業株式会社(他1名)4代
理人 住所 〒105 東京都ン荏区西新橋1丁目5番12号
タンハビル5 補正の対象 明細書の発明の詳細な説明の欄 6 補正の内容
Claims (1)
- 電圧制御発振器と、入力信号と電圧制御発振器の出力信
号との位相差を検出する位相比較器と、該位相比較器の
出力電圧を電圧制御発振器の制御電圧に変換する発振周
波数制御回路とにより位相同期ループ回路を構成し、該
位相比較器の出力電圧を電流に変換したのち、電圧制御
発振器の制御電圧中心バイアス設定電流と電流加算を行
うことにより、位相同期ループ回路のループ特性を変え
ることなく該制御電圧中心バイアスおよび位相同期ルー
プ回路の周波数引込範囲を設定することを特徴とする発
振周波数制御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59038826A JPS60183818A (ja) | 1984-03-02 | 1984-03-02 | 発振周波数制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59038826A JPS60183818A (ja) | 1984-03-02 | 1984-03-02 | 発振周波数制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60183818A true JPS60183818A (ja) | 1985-09-19 |
| JPH0329209B2 JPH0329209B2 (ja) | 1991-04-23 |
Family
ID=12536037
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59038826A Granted JPS60183818A (ja) | 1984-03-02 | 1984-03-02 | 発振周波数制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS60183818A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1992007425A1 (fr) * | 1990-10-23 | 1992-04-30 | Seiko Epson Corporation | Circuit oscillant commande en tension et boucle a verrouillage de phase |
Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5631232A (en) * | 1979-08-24 | 1981-03-30 | Sony Corp | Pll circuit |
-
1984
- 1984-03-02 JP JP59038826A patent/JPS60183818A/ja active Granted
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5631232A (en) * | 1979-08-24 | 1981-03-30 | Sony Corp | Pll circuit |
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| WO1992007425A1 (fr) * | 1990-10-23 | 1992-04-30 | Seiko Epson Corporation | Circuit oscillant commande en tension et boucle a verrouillage de phase |
| US5302919A (en) * | 1990-10-23 | 1994-04-12 | Seiko Epson Corporation | VCO having voltage-to-current converter and PLL using same |
| US5359298A (en) * | 1990-10-23 | 1994-10-25 | Seiko Epson Corporation | VCO having voltage-to-current converter and PLL using same |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0329209B2 (ja) | 1991-04-23 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |