JPS60187047A - 厚膜回路基板の製造方法 - Google Patents

厚膜回路基板の製造方法

Info

Publication number
JPS60187047A
JPS60187047A JP59043422A JP4342284A JPS60187047A JP S60187047 A JPS60187047 A JP S60187047A JP 59043422 A JP59043422 A JP 59043422A JP 4342284 A JP4342284 A JP 4342284A JP S60187047 A JPS60187047 A JP S60187047A
Authority
JP
Japan
Prior art keywords
hole
thick film
layer
board
film circuit
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59043422A
Other languages
English (en)
Inventor
Hisashi Nakamura
中村 恒
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP59043422A priority Critical patent/JPS60187047A/ja
Publication of JPS60187047A publication Critical patent/JPS60187047A/ja
Pending legal-status Critical Current

Links

Classifications

    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W70/00Package substrates; Interposers; Redistribution layers [RDL]
    • H10W70/60Insulating or insulated package substrates; Interposers; Redistribution layers
    • H10W70/611Insulating or insulated package substrates; Interposers; Redistribution layers for connecting multiple chips together
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W70/00Package substrates; Interposers; Redistribution layers [RDL]
    • H10W70/01Manufacture or treatment
    • H10W70/05Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers
    • H10W70/095Manufacture or treatment of insulating or insulated package substrates, or of interposers, or of redistribution layers of vias therein
    • HELECTRICITY
    • H10SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10WGENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W70/00Package substrates; Interposers; Redistribution layers [RDL]
    • H10W70/60Insulating or insulated package substrates; Interposers; Redistribution layers
    • H10W70/62Insulating or insulated package substrates; Interposers; Redistribution layers characterised by their interconnections
    • H10W70/63Vias, e.g. via plugs
    • H10W70/635Through-vias

Landscapes

  • Printing Elements For Providing Electric Connections Between Printed Circuits (AREA)
  • Manufacturing Of Printed Wiring (AREA)
  • Parts Printed On Printed Circuit Boards (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 本発明はテレビジョン受像機やビデオテープレコーダな
どの一般電子機器に用いられる厚膜回路基板の製造方法
に関するものである。
従来例の構成とその問題点 近年、電子機器の1軽薄短小」化や高性能化をはかるこ
とを目的として、それらの電子回路の構成に厚膜回路基
板を用いた混成集積回路モジュールが多く使用されるよ
うになってきた。このモジュールにつかわれる回路基板
としてはフェノール樹脂やエポキシ樹脂などから成る合
成樹脂基板が使われているがこれらの回路基板では十分
な特性が得られず従って厚膜回路基板の多くは、アルミ
ナなどのセラミック基板の表面に主として銀−ノζラジ
ウム系の金属により導体回路を構成し、その同一面上に
酸化ルテニウム系の材料により抵抗体を構成したもので
あるが、昨今はモジュールの小型高密度化をはかること
を狙いとしてセラミック絶縁基板の表裏両面を利用して
回路導体層と抵抗体層を形成し、表裏の配線回路をアル
ミナ基板にあけた貫通孔に導体層を形成することにより
接続したものである。
このような両面厚膜回路基板は一般に第1図A〜Dに示
す製造工程を経て作られている。
すなわち、第1図Aに示すようにセラミック絶縁基板1
に貫通孔2をあけ、次いで第1図Bに示すようにセラミ
ック絶縁基板10表裏両面に銀−パラジウムなどの貴金
属粉末をガラスフリットと樹脂バインダーで混合した導
体ペーストをそれぞれ配線回路状に塗布するとともに、
貫通孔2の中にもこの導体ペーストを充填して高温焼成
することによシ回路導体層3,3′を形成し、さらに第
1図Cに示すように回路導体層の一方の面に酸化ルテニ
ウムから成るグレーズ系の抵抗ペーストを塗布し、高温
焼成することによシ抵抗層4を形成し、しかる後に第1
図りに示すように抵抗層4と回路導体層3,3′の一部
にガラス絶縁ペーストを塗布して絶縁体層6,6′それ
ぞれ形成する工程を経て作られたものである。
ところがこのような製造方法による厚膜回路基板では、
セラミック絶縁基板に設け/+1.貫通孔内に導体ペー
ストをスクリーン印刷法により充填するが、この方法で
は貫通孔へ確実に導体ペーストを充すことが極めて困難
であるためその修正作業に大きな労力を要し、かつ接続
が不安定になりやすいことからスルーホール接続の信頼
性が乏しいという欠点があった。
また一方、このような方法により得られる厚膜回路基板
では、その導体材料に主として銀−パラジウムを使わな
ければならないが、これらの貴金属材料は極めて高価に
つくとともに、銀糸導体材料特有の問題点として、この
厚膜回路基板を使ってモジュールを構成してゆくだめの
はんだづけ工程でいわゆ2銀が溶融したはんだに喰われ
るいわゆる銀喰われ不良や、湿中負荷による銀導体のマ
イグレーションが起り、回路導体間の短絡不良が発生し
やすいなどの欠点があった。
発明の目的 本発明の目的は、前記欠点に鑑み、スルーホール接続が
確実にできてその接続の信頼性が極めてすぐれ、かつ回
路導体層の特性にもすぐれた厚膜回路基板の製造方法を
提供することである。
発明の構成 前記目的を達成するだめに本発明は、セラミック絶縁基
板の所定の位置に貫通孔をあけて活性化処理を行い、こ
のセラミック絶縁基板の表裏両面に所望の回路図形状に
グレーズ系の導電ペーストと、必要により少くともその
一方の主面上にグレーズ系の抵抗体ペーストを塗布し、
高温焼成することにより、導体層と、抵抗体層をそれぞ
れ形成する工程、貫通孔と導体層の一部分が露出するよ
うに他の面に耐めっき性を有する絶縁性レジスト層を形
成する工程、露出した貫通孔内壁部と回路導体層の一部
に無電解めっき法により導電金属層を形成する工程を経
て作るものである。
実施例の説明 以下本発明の一実施例について図面を参照しながら説明
する。
第2図A−Fは本発明の一実施例における厚膜回路基板
の製造方法を説明するための主要製造工程図である。
第2図において、6はセラミック絶縁基板、7は貫通孔
、8は活性化層、9,9′は厚n々回路導体層10は厚
膜抵抗体層、11.11’は絶縁レジスト層、12は導
電金属層である。
以上のように構成された厚膜回路基板について以下その
実施例を詳細に述べることにする。
本実施例による厚膜回路基板は先づ第2図Aに示すよう
に、アルミナなどのセラミック絶縁基板6の必要個所に
レーザーや、アルミナを生シートの状態で金型を用いて
貫通孔7をあけ高温焼成したセラミック絶縁基板を用い
て、これを塩化第1スズと、塩化パラジウムの塩酸酸性
溶液に順次浸漬することにより、第2図Bに示すように
貫通孔γを含むセラミック絶縁基板の全面に金属パラジ
ウムの微粒子核から成る活性化層8を付着した。
そして、第2図Cに示すように、活性処理を施こしたセ
ラミック絶縁基板6の表裏両面に銅、銀。
銀−白金、銀−パラジウムの微粉末をガラスフリソトと
樹脂バインダーに混合してペースト状とした導電ペース
トを用いてスクリーン印刷法によシ所望の配線回路図形
状にそれぞれ塗布し、SOO〜860℃の高温で焼成す
ることにより厚膜回路導体層9,9′を形成した。
この場合、導電ペーストを高温焼成する際、活性化処理
により付着した金属パラジウムの微粒子核から成る活性
化層8は何ら影響なく、むしろ熱処理によりセラミック
絶縁基板6との密着性が向することが明らかとなった。
次に、第2図りに示すように、厚膜回路導体層9.9′
を形成したセラミック絶縁基板6の少くとも一方の面に
、酸化ルテニウムをガラス7リツトと樹脂バインダーで
混合した抵抗ペーストをスクリーン印刷法により塗布し
、これをSOO〜850℃の高温焼成することにより厚
膜抵抗体層10を形成した。
この場合、厚膜抵抗体層の下面には金属パラジウムの微
粒子核から成る活性化層8が残存しているがこれによる
抵抗体への影響は特にない。また厚膜抵抗体10は、そ
の抵抗値の調整をレーザートリミング技術を利用して行
った。このようにして、セラミック絶縁基板6の表裏両
面に厚膜回路導体層9,9′と、一方の面に厚膜抵抗体
層1゜を形成したものを、第2図Eに示すように、貫通
孔7とその周辺部の厚膜回路導体層9,9′の一部が露
出するように、絶縁性レジスト11,11′をセラミッ
ク絶縁基板の表裏両面にスクリーン印刷法によってそれ
ぞれ塗布乾燥した後で、この基板を無電解めっき液に浸
漬し、第2図下に示すように、貫通孔7の内壁面とその
周辺部に露出した厚膜回路導体層面9,9′に導電金属
層12を析出させることにより、セラミック絶縁基板6
0表裏面に形成した厚膜回路導体層9,9′を貫通孔7
を通して電気的に接続したいわゆる両面厚膜回路基板を
作った。
なお、第2図Eの工程で使用する絶縁レジスト11.1
1’ としては耐薬品性を有し、無電解めっきに対して
十分に耐えることが必要であるが、その他に厚膜抵抗体
層10に悪影響をおよI!さないことが必要不可欠であ
るが、このような目的に合致する絶縁レジタ)11.1
1’ として本実施例では、エポキシ樹脂やアクリル樹
脂、シリコン樹脂、環化ゴム系ポリブタジェン樹脂など
の有機系材料の他にガラスなどの無機質系の材料も使用
した。また−1方、この工程で使用する絶縁レジスト1
1として他の実施例では、無電解めっき後に容易にはく
離除去ができる性質のレジスト材料を用いた。そして無
電解めっき後にレジスト11を除去してから厚膜抵抗体
層10の抵抗値をレーザートリミング法で行ない、最終
的に樹脂系の永久絶縁レジタ、ト層を形成した。無電解
めっきについては、本実施例ではニッケルと銅の無電解
めっきさらにはニッケルと銅の2層のめっきを行なった
が、いずれの導電金属層12も厚膜回路導体層9゜9′
と一貫通孔内壁面の活性化層8との密着性は極めて良好
であった。
なお、本実施例においては、パラジウムの微粒子核から
成る活性化層8は全てセラミック絶縁基板上に最後まで
残存するが、たとえ活性化層8が残存しても、その絶縁
特性には何ら影響ないことが確認できた。
発明の効果 以上の説明から明らかなように、本発明による厚膜回路
基板は、セラミック絶縁基板に貫通孔をあけ、活性化処
理を行ってから、セラミック絶縁基板の表裏両面に厚膜
回路導体層と一方の面に厚膜抵抗体層を形成し、必要な
部分に耐無電解めっき性のレジスト層を形成した後で無
電解めっきを行うことにより、貫通孔内壁面と厚膜回路
導体層の一部に導電金属層を析出させる方法により作ら
れたものである。
従って、本発明による厚膜回路基板は無電解めつき法に
よりスルーホールめっきを行うために、セラミック絶縁
基板表裏の厚膜回路導体間の接続を確実に行うことがで
きその接続の信頼性は極めて高く、さらには表面に露出
する厚膜回路導体層は無電解めっきで析出した導電金属
層により構成されるため、はんだづけによる銀〈われや
耐湿角\ 穂による銀のマクブレーションなど、従来例で使用した
銀至導体材料の欠点は全て解消できるなどの効果が得ら
れた。
【図面の簡単な説明】
第1図A−Dは従来例による厚膜回路基板の製造工程図
、第2図A−Fは本発明の一実施例における厚膜回路基
板の製造方法を示す製造工程図である。 6・・・・・・セラミック絶縁基板、7・・・・・・貫
通孔、8・・・・・・活性化層、 9 、9’・・・・
・・厚膜回路導体層、10・・・・・・厚膜抵抗体層、
11.11’・・・・・・絶縁レジスト層、12・・・
・・・導電金属層。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1
図 5′3′

Claims (2)

    【特許請求の範囲】
  1. (1) セラミック絶縁基板の所定の位置に貫通孔をあ
    け、前記セラミック絶縁基板に活性化処理を行う工程、
    前記セラミック絶縁基板の表裏両面に所望の回路図形状
    にグレーズ系の導電ペーストと、必要により少くともそ
    の一方の主面上にグレーズ系の抵抗体ペーストをそれぞ
    れ塗布し、高温焼成することにより導体層と抵抗体をそ
    れぞれ形成する工程、前記貫通孔と導体層の一部が露出
    するように他の面に耐めっき性を有する絶縁レジスト層
    を形成する工程、前記露出した貫通孔内壁部と回路導体
    層の一部に無電解めっき法により導電金属層を形成する
    工程から成る厚膜回路基板の製造方法。
  2. (2)耐めっき性のレジストとして容易に剥離可能なレ
    ジストを使用する特許請求の範囲第1項記載の厚膜回路
    基板の製造方法。
JP59043422A 1984-03-07 1984-03-07 厚膜回路基板の製造方法 Pending JPS60187047A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59043422A JPS60187047A (ja) 1984-03-07 1984-03-07 厚膜回路基板の製造方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59043422A JPS60187047A (ja) 1984-03-07 1984-03-07 厚膜回路基板の製造方法

Publications (1)

Publication Number Publication Date
JPS60187047A true JPS60187047A (ja) 1985-09-24

Family

ID=12663260

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59043422A Pending JPS60187047A (ja) 1984-03-07 1984-03-07 厚膜回路基板の製造方法

Country Status (1)

Country Link
JP (1) JPS60187047A (ja)

Similar Documents

Publication Publication Date Title
JPS6194394A (ja) 厚膜回路基板の製造方法
US4898805A (en) Method for fabricating hybrid integrated circuit
JPH1098244A (ja) 厚膜回路基板及びその製造方法
JP2537893B2 (ja) 電子回路基板の製造方法
JPS6355796B2 (ja)
JPS60171793A (ja) 多層配線基板の製造方法
JPS61101093A (ja) 厚膜回路基板の製造方法
JPS60170296A (ja) 厚膜多層配線板の製造方法
JP3695769B2 (ja) 厚膜回路基板の製造方法
JPS62242325A (ja) チツプコンデンサ−の製造方法
JPS60167495A (ja) 多層配線基板の製造方法
JPH0151075B2 (ja)
JP2562797Y2 (ja) 配線基板
JPS6045095A (ja) 厚膜多層基板の製造方法
JPS63186492A (ja) 回路基板の製造方法
JPH04307797A (ja) 多層セラミック回路基板の製造方法
JPH03109793A (ja) 抵抗体付配線回路基板の製造方法
JPS63275196A (ja) 回路基板の製造方法
JPS58186996A (ja) 多層回路基板の製造方法
JPS6263488A (ja) 厚膜基板の製造方法
JPS59161093A (ja) 厚膜配線基板
JPS5856498A (ja) 厚膜回路基板の製造方法
JPS5875882A (ja) 印刷配線板の製造方法
JPS61121389A (ja) セラミツク配線板
JPS60165793A (ja) 多層配線基板の製造方法