JPS60208275A - 記録装置 - Google Patents

記録装置

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JPS60208275A
JPS60208275A JP59065076A JP6507684A JPS60208275A JP S60208275 A JPS60208275 A JP S60208275A JP 59065076 A JP59065076 A JP 59065076A JP 6507684 A JP6507684 A JP 6507684A JP S60208275 A JPS60208275 A JP S60208275A
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thermal head
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    • B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
    • B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
    • B41J2/375—Protection arrangements against overheating
    • G—PHYSICS
    • G06—COMPUTING OR CALCULATING; COUNTING
    • G06K—GRAPHICAL DATA READING; PRESENTATION OF DATA; RECORD CARRIERS; HANDLING RECORD CARRIERS
    • G06K15/00—Arrangements for producing a permanent visual presentation of the output data, e.g. computer output printers
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔技術分野〕 本発明は記録装置に関し、特にソフトウェアによって出
力される駆動信号の幅をバー ドウエア回路で制限して
複数の記録素子を駆動させる記録装置に関する。
〔従来技術〕
この種の記録装置として、多数の発熱体素子をライン状
に配列して構成されたサーマルヘッドを記録ヘッドに用
いる感熱プリンタが知られている。
第1図はドライバを付設された上記のサーマルヘッドの
構成の一例を示すものである。同図において符号R1〜
R172Bで示すものは上記の発熱体素子でここでは1
728個ライン状に配列され、これによりサーマルヘッ
ドが構成されている。各発熱体素子R1〜R1728の
一端はコモン端子Cに接続され、他端はアンドゲートA
1〜A 172Bの出力に接続されている。各アンドゲ
ートA1〜A1728はここでは配列順に4ブロツクに
分割され、それぞれの一方の入力がブロック毎に信号線
B1〜B4に並列に接続されておυ、それぞれの他方の
入力がシフトレジスタ・ラッチ回路100に並列に接続
されている。
シフトレジスタ・ランチ回路100は信号線S1を介し
て直列転送される記録データを順次/フ]・して格納す
る1728ビツトのシフトレジスタと、このソフトレジ
スタの格納データをラッチするランチ回路から構成され
ておシ、その入力には信号線81〜S3が接続されてい
る。
以上の構成により記録は次のように行なわれる。
まず記録データ信号DINが直列に信号線S1を介して
ソフトレジスタ・ラッチ回路100に入力されるととも
に、このデータをシフトするだめのシフトクロック信号
5CLKが信号線S2を介して入力され、入力データは
シフトクロック信号5CLKによってシフトレジスタ内
を左から右へ順次シフトされる。
このようにして1728ビツトのデータ転送が終了する
と、信号線S6を介して入力されるランチ信号LAによ
ってシフトレジスタ内のデータはラッチ回路にラッチさ
れ、ラッチされた1728ビツトの各記録データはアン
トゲ−)A1−A1728の入力に導かれる。
次に前述のブロック1駆動信号であるストローブ信号5
TR1〜5TR4が信号線81〜B4を介してブロック
毎に順次アントゲ−)A1−A1728[導かれ、アン
r゛ゲー)A1−A1728がブロック毎に順次開閉さ
れる。これにより記録データ信号がブロック毎に順次発
熱体素子R1〜R1728に導かれ、データ信号に従っ
て各素子が発熱して1ラインの記録が行なわれる。
以上のサーマルヘッドの駆動を行なう駆動回路は、従来
第2図に示すように構成されている。
同図において符号200で示すものは出力iCであり、
記録装置全体の制御を行なう不図示の中央処理装置(C
PU )に接続されており、CPUから信号線201を
介して入力されるコントロール信号C0NTにより制御
され、またデータバス202を介して入力される所定ビ
ット数の並列の記録データ信号DATAを入力される。
出力ICは第1+−L第3の出力ボート206〜205
を有している。第1出力ボート203には、上記の並列
の記録データ信号DATAを前述の直列の記録データ信
号DINに変換してサーマルベッドに出力するP/S変
換回路206が接続されている。第2出力ボート204
には、前述のシフトクロック信号5CLKをサーマルヘ
ッドに出力するとともに、上記のP/S変換回路206
に同じクロッ〉信号CLKを出力するシフトクロックコ
ントローラ207が接続されている。まだこの第2出力
ボート204から先述のラッチ信号LAがサーマルヘッ
ドに出力される。さらに第3出力ポート205にはこの
ポートから出力される前述のストローブは号5T81〜
4を増幅してサーマルヘッドに出力するストローブアン
プ208が接続されている。
以上の構成の駆動回路の動作は次のように行なわれる。
まず出力IC200はコントロール信号に従って、デー
タバス202から入力される記録データ信号1)ATA
を第1出力ボート206に並列のまま取り込む。
次にP/S変換を指示する制御信号を第2出カポ−ト2
04からP/S変換回路206に出力し、これにより1
’/S変換回路206に第1ボート206から並列の記
録データ信号DATAを取り込ませる。
次に第2出力ボート204からシフトクロックコントロ
ーラ207に制御信号を送ってこれを作動させる。これ
によりクロック信号CLKがP/S変換回路206に出
力され、このクロック信号CLKに従って1)/S変換
が行なわれ、P/S変換回路206から前述した直列の
記録データ信号DINがサーマルヘッドに出力される。
またこれとともにシフトクロノク信号5CLKがサーマ
ルヘッドに出力され、これにより前述のシフトレジスタ
において記録データの取シ込みおよびシフトが行なわれ
る。
以上の動作の繰り返しによりシフトレジスタへ1728
ビツトの記録データの転送が終了すると、出力I C2
00は第2出力ボート204からラッチ信−号LAをサ
ーマルヘッドに出力して前述のランチ回路にラッチを行
なわせる。
次に出力I C200は第3出力ポート205からスト
ローブ信号STB 1〜4をストローブアンプ208に
出力し、ストローブアンプ208は前記信号を増幅して
サーマルヘッドに出力し、これにより前述のように記録
が行なわれる。なおここでストローブ信号STB 1〜
4はパルス信号として形成され、ソノパルス幅はサーマ
ルヘッドの各発熱体素子1<1〜R1728の通電時間
に対応し、適当な記録濃度が得られしかも各発熱体素子
が過熱しない幅に設定されている。
ところで以上に述べた駆動動作は全て前述のCPTJの
ソフトウェアによって制御されるように構成されている
。
ところがこのよう々構成によると、例えば入力電圧の瞬
断、入力電圧に重畳してくる外来ノイズ、あるいは雷サ
ージ等の原因によりCPUが暴走し、制御能力がなくな
り、前述のストローブ信号5TB1〜4が直流出力状態
になった場合には、発熱体素子の通電時間が長くなるた
め、記録画像品位が劣化するのは勿論、甚だしい場合に
は発熱体素子が損傷してしまう場合があった。
以上の欠点は上述の感熱プリンタに限らず、複数の記録
素子を記録データ信号と駆動信号の論理積によって駆動
するものならば、例えばインクジェットプリンタ等の他
の記録装置にも共通する。
〔目 的〕
本発明は以上の事情に鑑みてなされたもので、上述の種
類の記録装置において上記の欠点を除去し、中央処理装
置の暴走による画像品位の劣化や記録素子の損傷を防止
できる記録装置の提供を目的とする。
〔実施例〕
以下本発明の構成を前述の感熱プリンタに適用した実施
例を第3図以下を参黒して説明する。
なお本実施例においてはサーマルヘッドとして、第2図
に示された従来例と同じ構成のドライバを付設されたサ
ーマルヘッドを用いているものとする。
第3図は本実施例によるサーマルヘッドの駆動回路の構
成を示すものである。なお同図において第2図と同一部
分には同一符号が付してあり、同一部分の説明は省略す
る。
同図に示されるように本実施例の駆動回路においては符
号209で示す保護回路と、従来例のストローブアンプ
のかわりにストa−ブ信号ドライバ216とが設けられ
ている点が従来と異なる。
保護回路209は、カウンタタイマー210とカウンタ
211およびデコーダ212から構成されており、この
うちカウンタタイマー(以下タイマーと略称する)21
0は出力I C200の第2出力ポート204に接続さ
れ、デコーダ212はストローブ信号ドライバ216に
接続されている。
タイマー210は、前述のストローブ信号STB 1〜
4のパルス幅を制限する所定時間を計時するものであシ
、出力1c200の第2出力ボート204からタイマー
起動信号TKを受けてこの所定時間の計時を開始する。
そして前記の所定時間が経過するまでハイレベルのタイ
マ動作中信号TDをデコーダ212に出力し、経過する
と同時にごく狭い所定幅のパルス信号であるタイムアツ
プ信号TAをカウンタ211に出力し、このタイムアツ
プ信号TAの立ち下がり直後に再び前述の計時を開始し
、上記動作を操シ返すように構成されている。
ここで上記の所定時間すなわちタイマ動作中信号’1’
 I)のパルス幅は、ストローブ信号5TI31〜4の
パルス幅すなわちサーマルヘッドの各発熱体素子1<1
〜R1728の1回の通電時間に対応し、適自な記録濃
度が得られしかも発熱体素子が過熱することのない所定
の時間に設定されている。またタイマ動作中信号T I
)のタイミングもストローブ信号ST81〜4と同じに
なるように構成されている。
一方カウンタ211は、入力される上述のタイムアツプ
信号TAの個数を計数し、その序数を第1〜第4に循環
的に示す2値レベルの2ビツトで並列のカウント信号C
1,C2をデコーダ212に出力するように構成されて
いる。
またデコータ212は、上記のカウント信号CI。
C2に従って、先述のタイマー210から入力されるタ
イマー動作中信号TDを順次連続する4ビツトの並列な
デコーダ出力信号DC1〜4として振り分けてストロー
ブ信号ドライツク216に出力するように構成されてい
る。
ここでデコーダ出力信号1)C1〜4のそれぞれは、出
力ICの第3出カポ−1−205からス]・ローブ1言
号ドライバ216に出力される正常な場合のストローブ
信号STB 1〜4にパルス幅およびタイミングが対応
してお9、ストローブ信号ドライバ216はこのストロ
ーブ信号S’l”B1〜4のそれぞれと上記のデコーダ
出力信号DC1〜4のそれぞれの論理積信号をストロー
ブ信号STB 1’〜4′ としてサーマルヘッドに出
力するように構成されている。
次に以上の構成による本実施例の動作を第4図を参照し
て説明する。ここで同図は本実施例の駆動回路中の保護
回路209の動作時における各信号のタイミングチャー
ト図である。
本実施例の駆動回路により1728ビツトの記録データ
を前述のシフトレジスタ・ラッチ回路100へ転送し、
ラッチさせるまでの動作は先述の従来例と同じである。
上記のランチが完了すると直ちに、出力ICの第2出力
ポート204かも第4図最上段に示すようにタイマー起
動信号TKがタイマー210に出力される。
これを受けてタイマー210は同図の第3段、第2段に
示すようにタイマー動作中信号TDとタイムアツプ信号
TAを交互にデコーダ212とカウンタ211に出力す
る。
次に上記のタイムアツプ信号TAの入力される個数によ
り、カウンタ211からデコーダ212に出力されるカ
ウント信号CI、C2は同図の第4区第5段に示すよう
に変化し、各タイマー動作中信号TDの第1〜第4の循
環的な序数を2値レベル、2ビツトで示す。
次にデコーダ213は、上記のカウント信号CI。
C2により指示される上記の序数に従って、同図第6〜
第9段に示すように、タイマー動作中信号T Dに対応
した4ビツトの並列のデコーダ出力信号DC1〜4を順
次ストロープ信号ドライバ216に出力する。
ここで先述のCPUに異常のない場合には、ストローブ
信号ドライバ216に対して上記のデコーダ出力信号D
C1〜4のそれぞれと同じタイミング、同じパルス幅の
ストローブ信号S’l’81〜4が第3出力承−トから
順次入力されており、ストローブ信号ドライバ216は
デコーダ出力信号1) C1〜4のそれぞれとストロー
ブ信号S’l’lJ 1〜4のそれぞれの論理積信号を
ストローブ信号STB 1’〜4′としてサーマルヘッ
ドに出力する。これによりサーマルヘッドにおいて前述
と同様にして記録が行なわれる。ストローブ信号STB
 1’〜4′の印加により前述のサーマルヘッド1ライ
ンの各発熱体素子R1〜R1728の4ブロツクが順次
駆動されて1ラインの記録が行なわれる。
ここで前述のCPUが暴走し、タイマー起動信号T K
が第4図に示すように直流状態なシ、また出力iCの第
3出力ボート205からストローブ信号ドライバ216
に出力される各ストローブ信号5TB1〜4が直流状態
になった場合でも、タイマ210は1度起動されると前
述と同様に作動し、前述と全く同様にタイマ動作中信号
TDとタイムアツプ信−Jrhを交互に出力する。
従ってカウンタ211も前述と全く同様にカウント信号
C1,C2を出力し、これによシデコーダ212も前述
と全く同様にデコーダ出力信号DC1〜DC4をストロ
ーブ信−号ドライバ213に出力する。
ストローブ信号ドライバ216はデコーダ出力信号D(
j〜DC4とストローブ信号8T81〜4の論理積信号
をストローブ信号STB 1’〜4′としてサーマルヘ
ッドに出力するので、入力されるストローブ信号8TB
 1〜4が直流状態であっても、出力されるストローブ
は号STB 1’〜4′はデコーダ出力信号])C1〜
DC4と同じ波形、すなわち正常状態でのストローブ信
号STB 1〜4と同じになる。
従ってサーマルヘッドにおいて、各発熱体素子R1〜R
1728の駆動は正常状態と変わらずに行なわれ、発熱
体素子R1〜R1728の損傷や記録画像品位の劣化が
生じることなく、正常に記録が行なわれる。
なお以上の構成において各発熱体素子R1〜R1728
の数およびブロック数が上記と異なる場合でも本発明が
適用できるのは勿論であり、その場合ブロック数に合わ
せてカウンタとデコーダを適当に構成すれば良い。また
ブロックを構成する発熱体数が単一で各発熱体毎に駆動
信号が導かれる構成にも本発明を適用できる。
さらに本発明の構成は萼或転実施「11の感熱プリンタ
に限らず、前述した複数の記録素子を記録f−タ信号と
駆動信号の論理積によって駆動する記録装置の全てに適
用できる。
〔効 果〕
以上の説明から明らかなように本発明によれば上述の種
類の記録装置において、上記の駆動信号の幅を所定内に
制限するハードウェアの回路を設けたので、ソフトウェ
アにより作動される制御部が暴走した場合の記録素子の
損傷や記録品位の劣化を防止できるという優れた効果が
得られる。
【図面の簡単な説明】
第1図はドライバを付設したサーマルヘッドの。 回路構成を示すブロック図、第2図は第1図のサーマル
ヘッドを駆動する従来の駆動回路の構成を示すブロック
図、第3図は本発明の実施例によるサーマルヘッドの駆
動回路の構成を示すブロック図、第4図は第3図の駆動
回路中の保護回路の動作における各部の信号を示すタイ
ミングチャート図である。 100・・・シフトレジスタ・ランチ回路200・・・
出力IC206・・・P/S変換回路207・・・シフ
トクロックコントローラ209・・・保護回路 210
・・・カウンタタイマー211・・・カウンタ 212
・・・デコーダ216・・・ストローブ信号ドライバ A1〜A1728・・・アンドゲート R1〜R1728・・・発熱体素子 特許出願人 キ ヤ ノ ン 株式会社代理人 弁理士
加 藤 卓 り、、゛

Claims (1)

    【特許請求の範囲】
  1. ソフトウェアによって作動される制御装置の出力により
    複数の記録素子を駆動する記録装置において、該制御装
    置から出力される駆動信号の幅をハードウェア回路を介
    して所定内に制限して記録素子を駆動することを特徴と
    する記録装置。
JP6507684A 1984-04-03 1984-04-03 プリンタ用の記録制御装置 Expired - Lifetime JPH0775893B2 (ja)

Priority Applications (4)

Application Number Priority Date Filing Date Title
JP6507684A JPH0775893B2 (ja) 1984-04-03 1984-04-03 プリンタ用の記録制御装置
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Applications Claiming Priority (1)

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JP6507684A JPH0775893B2 (ja) 1984-04-03 1984-04-03 プリンタ用の記録制御装置

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JP (1) JPH0775893B2 (ja)
DE (1) DE3512059C3 (ja)
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