JPS60231981A - デジタルデ−タの誤り修整方式 - Google Patents
デジタルデ−タの誤り修整方式Info
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- JPS60231981A JPS60231981A JP59086755A JP8675584A JPS60231981A JP S60231981 A JPS60231981 A JP S60231981A JP 59086755 A JP59086755 A JP 59086755A JP 8675584 A JP8675584 A JP 8675584A JP S60231981 A JPS60231981 A JP S60231981A
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- H04N5/00—Details of television systems
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- Transmission Systems Not Characterized By The Medium Used For Transmission (AREA)
- Detection And Prevention Of Errors In Transmission (AREA)
- Error Detection And Correction (AREA)
- Radar Systems Or Details Thereof (AREA)
- Detection And Correction Of Errors (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
産業上の利用分野
本発明は例えばデジタルＶＴＲに適用して好適なデジタ
ルデータの誤シ修整方式に関する。
ルデータの誤シ修整方式に関する。
背景技術とその問題点
以下に、第１図〜第３図を参照して、従来のデジタルＶ
ＴＲの一例について説明する。先ず、第１図を参照して
回転磁気ヘッドの配置関係を説明するに、ＤＲはテープ
案内ドラムである。ＨＡ−ＨＤは記録用回転磁気ヘッド
、馬′〜ＨＤ′は再生用回転磁気ヘラＰである。テープ
案内ドラムＤＲは上ドラムとしての回転ドラム及び下ド
ラムとしての固定ドラムからなる。尚、このテープ案内
ドラムＤＲは、上下ドラムとしての固定ドラム及び中ド
ラムとしての回転ドラムにて構成してもよい。そして、
上述の各回転磁気ヘッドはこのテープ案内ドラムＤＲの
回転ドラムに取シ付けられている。記録用回転磁気ヘッ
ドＨＡ、 ＨＢ及びＨｃ、ＨＤは１８０°の角度割をも
って配された２組の記録用回転磁気ヘッドである。又、
再生用回転磁気ヘッドＨ，’ ｌ ＨＢ’及びＨｃ／Ｈ
Ｄ′は１８０°の角度割をもって配された２組の再生用
回転磁気ヘッドである。そして、２組の再生用回転磁気
ヘッド及び２組の記録用回転磁気ヘッドを結ぶ線は互い
に直交している。そして記録用回転磁気ヘッドＨＡｌ
）Ｉ、が磁気テープＴＰ上に互いに異なるアジマスの磁
気トラックを形成する如くデジタル化映像信号を記録し
、再生時においては再生用回転磁気ヘッドＨＡ′ｌ Ｈ
Ｂ′がその各トラックの記録信号を再生する。同様に、
記録用回転磁気へラドＨｃ、 ＨＤが磁気テープＴＰ上
に互いに異なるアジマスの磁気トランクを形成する如く
デジタル化映像信号を記録し、再生時においてこれらト
ラックの記録信号を再生用回転磁気ヘッドＨｃ’ ！
１（、’が再生するようになされている。
ＴＲの一例について説明する。先ず、第１図を参照して
回転磁気ヘッドの配置関係を説明するに、ＤＲはテープ
案内ドラムである。ＨＡ−ＨＤは記録用回転磁気ヘッド
、馬′〜ＨＤ′は再生用回転磁気ヘラＰである。テープ
案内ドラムＤＲは上ドラムとしての回転ドラム及び下ド
ラムとしての固定ドラムからなる。尚、このテープ案内
ドラムＤＲは、上下ドラムとしての固定ドラム及び中ド
ラムとしての回転ドラムにて構成してもよい。そして、
上述の各回転磁気ヘッドはこのテープ案内ドラムＤＲの
回転ドラムに取シ付けられている。記録用回転磁気ヘッ
ドＨＡ、 ＨＢ及びＨｃ、ＨＤは１８０°の角度割をも
って配された２組の記録用回転磁気ヘッドである。又、
再生用回転磁気ヘッドＨ，’ ｌ ＨＢ’及びＨｃ／Ｈ
Ｄ′は１８０°の角度割をもって配された２組の再生用
回転磁気ヘッドである。そして、２組の再生用回転磁気
ヘッド及び２組の記録用回転磁気ヘッドを結ぶ線は互い
に直交している。そして記録用回転磁気ヘッドＨＡｌ
）Ｉ、が磁気テープＴＰ上に互いに異なるアジマスの磁
気トラックを形成する如くデジタル化映像信号を記録し
、再生時においては再生用回転磁気ヘッドＨＡ′ｌ Ｈ
Ｂ′がその各トラックの記録信号を再生する。同様に、
記録用回転磁気へラドＨｃ、 ＨＤが磁気テープＴＰ上
に互いに異なるアジマスの磁気トランクを形成する如く
デジタル化映像信号を記録し、再生時においてこれらト
ラックの記録信号を再生用回転磁気ヘッドＨｃ’ ！
１（、’が再生するようになされている。
ＴＧｌ ＋ Ｔｏ２ Ｆｌ磁気テープＴＰのテープ案内
ドラムに対する巻付角θを決定するためのテープ案内ポ
ールで、その巻付角θは例えば２４０°である。
ドラムに対する巻付角θを決定するためのテープ案内ポ
ールで、その巻付角θは例えば２４０°である。
次に第２図を参照して、との従来のデジタルＶＴＲの記
録系を説明する。（１）はい変換器で、これにコンポー
ネントカラービデオ信号、即ち輝度信号Ｙ、青色差信号
Ｂ−Ｙ及び赤色差信号Ｒ−Ｙが供給されて夫々い変換さ
れてデジタルコンポーネント信号に変換される。デジタ
ル化されたこれらコンポーネント信号は、マルチプレク
サ（２）に供給されて、多重化されると共に２４ヤ／ネ
ル符号化されて、２チヤンネルの多重化デジタルビデオ
信号が得られ、これがシャツフル回路（３）に供給され
てシャツフルされる。このシャツフル回路（３）では、
２チヤンネルのデジタルビデオ信号が各書込りｐツク／
ｆルスによってそのメモリに書き込まれ、それが所定の
処理スピードの読出クロック信号によって読み出される
ことによって２チヤンネルのデジタルビデオ信号のシャ
ツフルが行なわれて、テープのドロップアウト等によっ
て、再生データにバースト誤υが生じないようにされる
０シャツフル回路（３）の出力たる２チヤンネルのデジ
タルビデオ信号は、娯シ訂正符号化回路（４）に供給さ
れて符号化された後、時間軸伸長回路（ＦＩＦＯメモ１
（５）に供給されて時間軸伸長される。この時間軸伸長
回路（５）では、誤シ訂生符号化回路（４）よシの２チ
ヤンネルのデジタルビデオ信号が処理スピードに応じた
書込クロック信号によってメモリに書込まれ、それが記
録レートに応じた読出クロック信号によって読み出され
る。
録系を説明する。（１）はい変換器で、これにコンポー
ネントカラービデオ信号、即ち輝度信号Ｙ、青色差信号
Ｂ−Ｙ及び赤色差信号Ｒ−Ｙが供給されて夫々い変換さ
れてデジタルコンポーネント信号に変換される。デジタ
ル化されたこれらコンポーネント信号は、マルチプレク
サ（２）に供給されて、多重化されると共に２４ヤ／ネ
ル符号化されて、２チヤンネルの多重化デジタルビデオ
信号が得られ、これがシャツフル回路（３）に供給され
てシャツフルされる。このシャツフル回路（３）では、
２チヤンネルのデジタルビデオ信号が各書込りｐツク／
ｆルスによってそのメモリに書き込まれ、それが所定の
処理スピードの読出クロック信号によって読み出される
ことによって２チヤンネルのデジタルビデオ信号のシャ
ツフルが行なわれて、テープのドロップアウト等によっ
て、再生データにバースト誤υが生じないようにされる
０シャツフル回路（３）の出力たる２チヤンネルのデジ
タルビデオ信号は、娯シ訂正符号化回路（４）に供給さ
れて符号化された後、時間軸伸長回路（ＦＩＦＯメモ１
（５）に供給されて時間軸伸長される。この時間軸伸長
回路（５）では、誤シ訂生符号化回路（４）よシの２チ
ヤンネルのデジタルビデオ信号が処理スピードに応じた
書込クロック信号によってメモリに書込まれ、それが記
録レートに応じた読出クロック信号によって読み出され
る。
時間軸伸長回路（５）よシ得られた２チヤンネルのとに
交互に供給される。そして、記録増幅器（６Ａ）（６Ｂ
）及び（６Ｃ） 、 （６Ｄ）の各出力が夫々記録用回
転磁気ヘッドＨＡ ’ ＨＢ及びＨｃ、ＨＤに供給され
て、磁気テープＴＰ上に傾斜トラックを形成するごとく
記録される。
交互に供給される。そして、記録増幅器（６Ａ）（６Ｂ
）及び（６Ｃ） 、 （６Ｄ）の各出力が夫々記録用回
転磁気ヘッドＨＡ ’ ＨＢ及びＨｃ、ＨＤに供給され
て、磁気テープＴＰ上に傾斜トラックを形成するごとく
記録される。
次に第３図を参照して、従来のデジタルＶＴＲの再生系
について説明する。再生回転磁気ヘッドＨＡ／〜ＨＤ′
によって磁気テープＴＰよシ再生されたデジタルビデオ
信号は、夫々再生増幅器（７Ａ）、（７Ｂ）。
について説明する。再生回転磁気ヘッドＨＡ／〜ＨＤ′
によって磁気テープＴＰよシ再生されたデジタルビデオ
信号は、夫々再生増幅器（７Ａ）、（７Ｂ）。
（７Ｃ）、（７Ｄ）を通じて再生プロセッサ（８Ａ）
、（８Ｂ）・（８Ｃ） 、 （８Ｄ）に供給される。こ
れら回路（８Ａ）〜（８Ｄ）においては、各増幅器（７
Ａ）〜（７Ｄ）よシ得られた再生デジタルビデオ信号が
ＰＬＬに供給されることによってクロック信号が検出さ
れ、このクロック信号によって、ビット同期回路に供給
された各デジタルビデオ信号が同期化される。更に、こ
の回路（８Ａ）〜（８Ｄ）は、ビット同期回路及びＰＬ
Ｌの出力に基づいて、同期化された各デジタルビデオ信
号からブロック同期信号を抽出する抽出回路を有してい
る。
、（８Ｂ）・（８Ｃ） 、 （８Ｄ）に供給される。こ
れら回路（８Ａ）〜（８Ｄ）においては、各増幅器（７
Ａ）〜（７Ｄ）よシ得られた再生デジタルビデオ信号が
ＰＬＬに供給されることによってクロック信号が検出さ
れ、このクロック信号によって、ビット同期回路に供給
された各デジタルビデオ信号が同期化される。更に、こ
の回路（８Ａ）〜（８Ｄ）は、ビット同期回路及びＰＬ
Ｌの出力に基づいて、同期化された各デジタルビデオ信
号からブロック同期信号を抽出する抽出回路を有してい
る。
再生プロセッサ（８Ａ）〜（８Ｄ）の出力は、タイムペ
ースコレクタ（９）に供給されて時間圧縮される。
ースコレクタ（９）に供給されて時間圧縮される。
このタイムペースコレクタ（９）においては、再生プロ
セッサ（８Ａ）〜（８Ｄ）の出力を供給して記録レート
に対応した書込クロック信号によってメモリに書き込み
、それを処理スピードに対応した読出しクロック信号に
よって読み出して時間圧縮する。
セッサ（８Ａ）〜（８Ｄ）の出力を供給して記録レート
に対応した書込クロック信号によってメモリに書き込み
、それを処理スピードに対応した読出しクロック信号に
よって読み出して時間圧縮する。
タイムペースコレクタ（９）よシ得られた時間圧縮され
た２チヤンネルのデジタルビデオ信号は同期検出回路ａ
Ｑを通じてアドレス再生回路Ｑ９に供給される。アドレ
ス再生回路α力より得られた２チヤンネルのデジタルビ
デオ信号は誤ル訂正デコーダ（６）に供給されて、誤シ
訂正が行なわれた後、フレームメモリ（２）に供給され
てｔ？！込まれる〇メモリ（２）より読み出された２チ
ヤンネルのデジタルビデオ信号はデシャツフル回路０４
に供給される。デシャツフル回路←→では、メモリ（２
）よシの２チヤンネルのデジタルビデオ信号を処理スピ
ードに基づいた書込クロック信号によシ書き込み、読み
出し処理スピードに応じた読出クロック信号によってデ
シャツフルして読み出すので、再生信号にドロップアウ
ト等によるバースト糾シが発生しても、画面上でまとま
って誤セが発生する可能性は小さい。
た２チヤンネルのデジタルビデオ信号は同期検出回路ａ
Ｑを通じてアドレス再生回路Ｑ９に供給される。アドレ
ス再生回路α力より得られた２チヤンネルのデジタルビ
デオ信号は誤ル訂正デコーダ（６）に供給されて、誤シ
訂正が行なわれた後、フレームメモリ（２）に供給され
てｔ？！込まれる〇メモリ（２）より読み出された２チ
ヤンネルのデジタルビデオ信号はデシャツフル回路０４
に供給される。デシャツフル回路←→では、メモリ（２
）よシの２チヤンネルのデジタルビデオ信号を処理スピ
ードに基づいた書込クロック信号によシ書き込み、読み
出し処理スピードに応じた読出クロック信号によってデ
シャツフルして読み出すので、再生信号にドロップアウ
ト等によるバースト糾シが発生しても、画面上でまとま
って誤セが発生する可能性は小さい。
このデシャツフル回路ａ４よシの２チヤンネルのデジタ
ルビデオ信号は、デマルチプレクサ（至）に供給されて
、３チヤンネルのデジタルコンポーネントビデオ信号に
デコードされた後、誤シ修整回路Ｃ１→に供給されて県
シ修整が行なわれる。誤シ修整回路αＱよシ得られた３
チヤンネルのデジタルコンポーネントビデオ信号は、Ｄ
／Ａ変換器α乃に供給されて夫々Ｄ／Ａ変換されること
によシ、アナログコンポーネントビデオ信号、即ち輝度
信号Ｙ、青色差信号Ｂ−Ｙ及び赤色差信号Ｒ−Ｙが出力
される。
ルビデオ信号は、デマルチプレクサ（至）に供給されて
、３チヤンネルのデジタルコンポーネントビデオ信号に
デコードされた後、誤シ修整回路Ｃ１→に供給されて県
シ修整が行なわれる。誤シ修整回路αＱよシ得られた３
チヤンネルのデジタルコンポーネントビデオ信号は、Ｄ
／Ａ変換器α乃に供給されて夫々Ｄ／Ａ変換されること
によシ、アナログコンポーネントビデオ信号、即ち輝度
信号Ｙ、青色差信号Ｂ−Ｙ及び赤色差信号Ｒ−Ｙが出力
される。
ここで、第４図〜第９図を参照しながら、従来の誤シ修
整について説明する。
整について説明する。
第４図はテレビジョン画面の任意の走査線り。上の任意
の画素ｅと、これに隣接して同−走査線並びに上下の走
査線Ｌｎ−１’ ”ｎ＋１上にある８個の画素ｈ−ｄ
＋ ｆ−１を示す。この場合、画面上で上下に隣接する
２個の画素、例えばａ及び６間には１水平走査周期（Ｉ
Ｈ）の時間差がある。
の画素ｅと、これに隣接して同−走査線並びに上下の走
査線Ｌｎ−１’ ”ｎ＋１上にある８個の画素ｈ−ｄ
＋ ｆ−１を示す。この場合、画面上で上下に隣接する
２個の画素、例えばａ及び６間には１水平走査周期（Ｉ
Ｈ）の時間差がある。
画素ｅに対応するデータが誤シ修整を要する場合、画素
ｅの左右（ｄ、ｆ）、上下（ｂ、ｈ）、斜め（ａ ｒ
１ ： ｃ＋ ｇ ）、十字形（ｂ、ｄ、ｆ。
ｅの左右（ｄ、ｆ）、上下（ｂ、ｈ）、斜め（ａ ｒ
１ ： ｃ＋ ｇ ）、十字形（ｂ、ｄ、ｆ。
ｈ）、Ｘ字形（ＩＬ、 ｅ 、 ｇ 、 ｉ ） ｆ）
画ｆ、ノｆ” ｌ’による補間、または周囲の画素のい
ずれかのデータとの置換が行なわれる。
画ｆ、ノｆ” ｌ’による補間、または周囲の画素のい
ずれかのデータとの置換が行なわれる。
第５図に従来の誤り修整装置の構成ｆｌＪを示す。
第５図において、翰は遅延メモリを全体として示し、こ
の遅延メモＩＪ Ｈの全遅延時間は、第４図に示したよ
うな上下３本の走査線にわたる正方格子の９画素を処理
対象とするため、１画素（サンプル単位）に対する遅延
時間をＴ！ｌとして、２Ｈ＋２Ｔ。
の遅延メモＩＪ Ｈの全遅延時間は、第４図に示したよ
うな上下３本の走査線にわたる正方格子の９画素を処理
対象とするため、１画素（サンプル単位）に対する遅延
時間をＴ！ｌとして、２Ｈ＋２Ｔ。
に設定される。Ｑカル（ハ）は個々の遅延メモリ、翰は
誤り修整回路である。入力端子ＩＮから供給されたデジ
タルデータ信号は誤シ訂正を終了しており、誤シ訂正能
力を越えた場合はエラーフラグを伴って、第１の単位遅
延メモリｅメに供給されると共に、誤シ修整回路（ハ）
に分岐供給される。第１の単位遅延メモリｆ２９の出力
は第２の単位遅延メモリ（イ）に供 １給されると共に
、誤シ修整回路（ハ）に分岐供給される。翰は主遅延メ
モリであって、その遅延時間は第４図に示した正方格子
の１本の走査線の右側の画素、向えはｆと次の走査線の
左側の画素、例えばｇとの間の時間差（１）Ｉ−２７）
に等しく設定される。第２の単位遅延メモリ四の出力は
主遅延メモリに）に供給されると共に、誤シ修整回路（
ハ）に分岐供給される。遅延メモリ（財）〜（イ）はそ
れぞれ上述の遅延メモ＋Ｊ ０１）〜翰と同一の遅延時
間を有し、第１の主遅延メモリ（２）の出力は、上述と
同様に、第３、第４の単位遅延メモリ（ハ）、に）及び
第２の主遅延メモリ（ハ）に順次供給されると共に、各
遅延メモリ（ハ）〜に）の出力が誤り修整回路−に分岐
供給される。
誤り修整回路である。入力端子ＩＮから供給されたデジ
タルデータ信号は誤シ訂正を終了しており、誤シ訂正能
力を越えた場合はエラーフラグを伴って、第１の単位遅
延メモリｅメに供給されると共に、誤シ修整回路（ハ）
に分岐供給される。第１の単位遅延メモリｆ２９の出力
は第２の単位遅延メモリ（イ）に供 １給されると共に
、誤シ修整回路（ハ）に分岐供給される。翰は主遅延メ
モリであって、その遅延時間は第４図に示した正方格子
の１本の走査線の右側の画素、向えはｆと次の走査線の
左側の画素、例えばｇとの間の時間差（１）Ｉ−２７）
に等しく設定される。第２の単位遅延メモリ四の出力は
主遅延メモリに）に供給されると共に、誤シ修整回路（
ハ）に分岐供給される。遅延メモリ（財）〜（イ）はそ
れぞれ上述の遅延メモ＋Ｊ ０１）〜翰と同一の遅延時
間を有し、第１の主遅延メモリ（２）の出力は、上述と
同様に、第３、第４の単位遅延メモリ（ハ）、に）及び
第２の主遅延メモリ（ハ）に順次供給されると共に、各
遅延メモリ（ハ）〜に）の出力が誤り修整回路−に分岐
供給される。
（ロ）、（ハ）は第５、第６の単位遅延メモリであって
、第２の主遅延メモリに）の出力が両単位遅延メモリ勾
及び（ハ）に順次供給されると共に、両単位遅延メ七り
に）及び（財）の出力が誤シ修整回路（ハ）に供給され
る。
、第２の主遅延メモリに）の出力が両単位遅延メモリ勾
及び（ハ）に順次供給されると共に、両単位遅延メ七り
に）及び（財）の出力が誤シ修整回路（ハ）に供給され
る。
誤シ修整回路（ハ）は遅延メモＩＪ Ｈから供給された
各データを用いて最適補間方向の決定等の修整処理を行
ない、ここで誤シ修整されたデータが出力端子ＯＵＴに
導出される。入力データが正しい場合は入力データがそ
の！！、ま出力される。
各データを用いて最適補間方向の決定等の修整処理を行
ない、ここで誤シ修整されたデータが出力端子ＯＵＴに
導出される。入力データが正しい場合は入力データがそ
の！！、ま出力される。
なお、遅延メモリ翰の中央、即ち第３及び第４の単位遅
延メモＩＪ ％及び（ハ）の接続中点に第４図の正方格
子の中央の画素ｅに対応するデータ＠が存在する時Ａｔ
ｏにおいて、遅延メモＩＪ Ｈの入出力端並びに各分岐
点のデータは、入力端から出力端方向に、それぞれ画素
ｉ〜ａに対応するθ）〜６）となるＯ ところで、第６図は前述のデジタルＶＴＲによる磁気テ
ープＴＰの記録トラックのノやターンを示し、Ａ、Ｂ、
Ｃ，Ｄは夫々記録用回転磁気ヘッド瓜。
延メモＩＪ ％及び（ハ）の接続中点に第４図の正方格
子の中央の画素ｅに対応するデータ＠が存在する時Ａｔ
ｏにおいて、遅延メモＩＪ Ｈの入出力端並びに各分岐
点のデータは、入力端から出力端方向に、それぞれ画素
ｉ〜ａに対応するθ）〜６）となるＯ ところで、第６図は前述のデジタルＶＴＲによる磁気テ
ープＴＰの記録トラックのノやターンを示し、Ａ、Ｂ、
Ｃ，Ｄは夫々記録用回転磁気ヘッド瓜。
ＨＢ ＋ Ｈｃ ＋ ＨＤによる傾斜記録トランクを示
し、それに順次０．１．２．・・・の添字を付しである
。
し、それに順次０．１．２．・・・の添字を付しである
。
第６図の磁気テープＴＰを記録時と同じ速度で定速走行
させて、各記録トラックを対応する再生用回転磁気ヘッ
ドＨＡ′ｔ Ｈ，’ ｌ Ｈｃ’ ｌ ＨＤ′で走査し
てその各記録信号を再生した場合の走査トランクをＡ／
。
させて、各記録トラックを対応する再生用回転磁気ヘッ
ドＨＡ′ｔ Ｈ，’ ｌ Ｈｃ’ ｌ ＨＤ′で走査し
てその各記録信号を再生した場合の走査トランクをＡ／
。
ｎ／ 、 Ｃ／ 、 Ｄ／で示し、それに０．１．２．
・・・の添字を付しであるが、これら走査トラックはい
ずれも記録トラックと略完全に一致するので、その各再
生高周波信号の包絡線の振幅は各再生用回転磁気ヘッド
ＨＡ′〜ＨＤ′の各１走査トラツクの全体に於いて略一
定となる。
・・・の添字を付しであるが、これら走査トラックはい
ずれも記録トラックと略完全に一致するので、その各再
生高周波信号の包絡線の振幅は各再生用回転磁気ヘッド
ＨＡ′〜ＨＤ′の各１走査トラツクの全体に於いて略一
定となる。
前述のように、デジタルＶＴＲでは、記録時にシャフリ
ング処理を行なっているため、定速再生時、画面上でま
とまって誤シが発生することは稀である。従って第４図
の画素ｅのデータに誤シが発生しても、近傍の画素ａ−
ｄ＋ｆｘｉのデータを誤シ修整処理にそのまま使用する
ことができる。
ング処理を行なっているため、定速再生時、画面上でま
とまって誤シが発生することは稀である。従って第４図
の画素ｅのデータに誤シが発生しても、近傍の画素ａ−
ｄ＋ｆｘｉのデータを誤シ修整処理にそのまま使用する
ことができる。
ところが、第６図と同様の磁気テープＴＰを高速、例え
ば記録時の走行速度の３倍で走行させた場合、再生用回
転磁気ヘッドＨＡ′〜ＨＤ′の走査トラック・・・Ａ１
／ ＋ Ｂｌ’ ＋ ＣＩ’ ＋ Ｄ１’ ＊ ＩＬ２
’ ＋ Ｂ２’ ＋・・・のパターンは第７図に示すよ
うになる。この再生用回転磁気ヘッドＨ，／〜ＨＩの各
再生高周波信号の１走査トラツク毎の包絡線は、各磁気
ヘッドが交互に記録アジマスを異にする記録トラックを
多数横切るため、第８図に示す如く菱形の繰返し波形と
なる。かかる再生高周波信号は、その振幅が所定値以上
の部分（第８図の斜線部分）しか利用できず、所要の再
生データが得られ々い。従って、被修整データの近傍の
データに誤シが発生したシ、再生データが得られなかっ
たシして、近傍のデータによる誤シ修整ができなくなる
。この場合、再生画像の画質が劣化してしまう。
ば記録時の走行速度の３倍で走行させた場合、再生用回
転磁気ヘッドＨＡ′〜ＨＤ′の走査トラック・・・Ａ１
／ ＋ Ｂｌ’ ＋ ＣＩ’ ＋ Ｄ１’ ＊ ＩＬ２
’ ＋ Ｂ２’ ＋・・・のパターンは第７図に示すよ
うになる。この再生用回転磁気ヘッドＨ，／〜ＨＩの各
再生高周波信号の１走査トラツク毎の包絡線は、各磁気
ヘッドが交互に記録アジマスを異にする記録トラックを
多数横切るため、第８図に示す如く菱形の繰返し波形と
なる。かかる再生高周波信号は、その振幅が所定値以上
の部分（第８図の斜線部分）しか利用できず、所要の再
生データが得られ々い。従って、被修整データの近傍の
データに誤シが発生したシ、再生データが得られなかっ
たシして、近傍のデータによる誤シ修整ができなくなる
。この場合、再生画像の画質が劣化してしまう。
なお、第９図に示すように、修整用データの採取範囲を
拡大することも考えられるが、回路規模が著しく増大す
るので、経済的かつ現実的ではない。
拡大することも考えられるが、回路規模が著しく増大す
るので、経済的かつ現実的ではない。
発明の目的
かかる点に鑑み、本発明の目的は、エラーレートが比較
的高い再生系において、小規模の誤り修整用データを用
いて修整処理を行なうことのできるデジタルデータの誤
シ修整方式を提供することにある。
的高い再生系において、小規模の誤り修整用データを用
いて修整処理を行なうことのできるデジタルデータの誤
シ修整方式を提供することにある。
発明の概要
本発明は再生されたデータ信号を誤シ修整回路に供給し
て再生データ信号の誤シデータをこの誤シデータの近傍
のデータによる補間または置換によって修整するように
したデジタルデータの誤ル修整方式において、近傍のデ
ータ（二誤シがあるとき、この近傍のデータを修整した
後修整回路に帰還して誤シ修整を行なうようにしたデジ
タルデータの誤シ修整方式である。
て再生データ信号の誤シデータをこの誤シデータの近傍
のデータによる補間または置換によって修整するように
したデジタルデータの誤ル修整方式において、近傍のデ
ータ（二誤シがあるとき、この近傍のデータを修整した
後修整回路に帰還して誤シ修整を行なうようにしたデジ
タルデータの誤シ修整方式である。
かかる本発明によれば、小規模の正しいデータによって
誤シデータを順次修整することができる。
誤シデータを順次修整することができる。
実施例
以下、第１０図及び第１１図を参照しながら、本発明に
よるデジタルデータの誤シ修整方式の一実施例について
説明する。
よるデジタルデータの誤シ修整方式の一実施例について
説明する。
第１０図に本発明の一実施例の構成を示す。この第１０
図において、第５図に対応する部分には同一の符号を付
して重複説明を省略する。
図において、第５図に対応する部分には同一の符号を付
して重複説明を省略する。
第１０図において、（イ）は遅延メモリを全体として示
し、この遅延メモリ（至）の全遅延時間は、第５図の遅
延メモリ翰と同じく、２Ｈ＋２ＴｓＫ設定される。
し、この遅延メモリ（至）の全遅延時間は、第５図の遅
延メモリ翰と同じく、２Ｈ＋２ＴｓＫ設定される。
０力及び０オはそれぞれ補償遅延メモリ及び主遅延メモ
リであって、補償遅延メモリ０ηには第４の単位遅延メ
モリの出力が供給され、主遅延メモリ０ネの出力は第５
の単位遅延メモリに）に供給される。補償遅延メモリ０
力と主遅延メモリＣ３２との間にマルチプレクサ０埠が
介挿される。０ゆは眼シ修整回路であって、誤シ修整回
路（ロ）から出力及び制御信号■がマルチプレクサ（至
）に供給される。
リであって、補償遅延メモリ０ηには第４の単位遅延メ
モリの出力が供給され、主遅延メモリ０ネの出力は第５
の単位遅延メモリに）に供給される。補償遅延メモリ０
力と主遅延メモリＣ３２との間にマルチプレクサ０埠が
介挿される。０ゆは眼シ修整回路であって、誤シ修整回
路（ロ）から出力及び制御信号■がマルチプレクサ（至
）に供給される。
また、誤シ修整回路（ロ）はその入出力間に遅延時間Ｔ
、を有するので、補償遅延メモリ０力の遅延時間はＴｐ
−Ｔｓに設定され、これに応じて、主遅延メモリ０力の
遅延時間はＩＨ−Ｔ、 −Ｔｐに設定される。
、を有するので、補償遅延メモリ０力の遅延時間はＴｐ
−Ｔｓに設定され、これに応じて、主遅延メモリ０力の
遅延時間はＩＨ−Ｔ、 −Ｔｐに設定される。
第１０図の実施例の動作は次のとおシである。
いま、第１１図Ａに示す方形格子において、走査線Ｌｎ
、上の画素ａ−ｃに対応するデータが正しく、他の走査
線Ｌｎ ” Ｌｎ＋２上の画素ｄ−１に対応するデータ
はすべて誤ルであるとする。
、上の画素ａ−ｃに対応するデータが正しく、他の走査
線Ｌｎ ” Ｌｎ＋２上の画素ｄ−１に対応するデータ
はすべて誤ルであるとする。
この場合、第５図に示した従来の誤シ修整装置では、走
査線Ｌｎ上の画素ｄ−ｆのデータは走査線Ｌｆｌ−１上
の画素ａ−ｃの正しいデータを用いて誤シを修整するこ
とができるが、走査線Ｌｎ＋１上の画素りのデータは周
囲の全データが誤シであるため修整することができない
。
査線Ｌｎ上の画素ｄ−ｆのデータは走査線Ｌｆｌ−１上
の画素ａ−ｃの正しいデータを用いて誤シを修整するこ
とができるが、走査線Ｌｎ＋１上の画素りのデータは周
囲の全データが誤シであるため修整することができない
。
ところが、第１０図に示す実施例では、主遅延メモリ０
■の入力側にマルチプレクサ０３が設けてあシ、誤シの
データ（図示の状態では［株］）が誤シ修整回路０ゆに
よって修整され、この修整されたデータ及びこのデータ
修整に対応して「誤シ」から「正しい」に切換えられた
エラー７ラグがマルチプレクサ０１に供給される。この
とき、マルチプレクサ０浄は修整回路０→から供給され
た制御信号Ｇ）によって修整されたデータを送出するよ
うに切換えられている。このようにして、修整された走
査線Ｌｎのデータが主遅延メモリ０２並びに百単位遅延
メモリ（イ）及び（ハ）に帰還される。そして、遅延メ
モリ（ト）の各データは、図示の状態から１水平周期経
過して、第１１図Ｂに示すように、走査線り。の修整さ
れたデータ■、■、■と、走査線Ｌｎ＋、及び”ｎ＋２
の誤シデータ■〜のとなυ、誤りデータ■の修整が可能
な状態に移行する。
■の入力側にマルチプレクサ０３が設けてあシ、誤シの
データ（図示の状態では［株］）が誤シ修整回路０ゆに
よって修整され、この修整されたデータ及びこのデータ
修整に対応して「誤シ」から「正しい」に切換えられた
エラー７ラグがマルチプレクサ０１に供給される。この
とき、マルチプレクサ０浄は修整回路０→から供給され
た制御信号Ｇ）によって修整されたデータを送出するよ
うに切換えられている。このようにして、修整された走
査線Ｌｎのデータが主遅延メモリ０２並びに百単位遅延
メモリ（イ）及び（ハ）に帰還される。そして、遅延メ
モリ（ト）の各データは、図示の状態から１水平周期経
過して、第１１図Ｂに示すように、走査線り。の修整さ
れたデータ■、■、■と、走査線Ｌｎ＋、及び”ｎ＋２
の誤シデータ■〜のとなυ、誤りデータ■の修整が可能
な状態に移行する。
上述のように、本実施例においては、修整されたデータ
を遅延メモリに帰還するようにしたので、小規模の正し
いデータを用いて、誤シデータを順次修整することがで
きるので、デジタルＶＴＲの高速再生時のように、比較
的エラーレートの高い場合でも、容易に誤シ修整を行な
うことができる。
を遅延メモリに帰還するようにしたので、小規模の正し
いデータを用いて、誤シデータを順次修整することがで
きるので、デジタルＶＴＲの高速再生時のように、比較
的エラーレートの高い場合でも、容易に誤シ修整を行な
うことができる。
以上高速再生の場合について説明したが、低速再生の場
合も同様である。
合も同様である。
次に、第１２図及び第１３図を参照しながら、本発明の
他の実施例について説明する。
他の実施例について説明する。
第１２図に本発明の他の実施例の構成を示す。この第１
２図において、第５図及び第１０図に対しＬ、する部分
には同一もしくは類似の符号を付し７て重複説明を省略
する。
２図において、第５図及び第１０図に対しＬ、する部分
には同一もしくは類似の符号を付し７て重複説明を省略
する。
第１２図において、（２０Ａ）および（２０Ｂ）はそれ
ぞれ後フィールド用及び前フイールド用ライン遅延メモ
リであって、両ライン遅延メモリ（２０Ａ）及び（２０
Ｂ）は第５図に示した遅延メモリに）と全く同一の構成
である。０埠及び（至）はそれぞれ後フィールド用及び
主フイールド用のフィールド遅延メモリであって、両フ
ィールド遅延メモリθつ及びに）にはそれぞれ後フィー
ルｒ用及び主フイールド９用のライン遅延メモリ（２０
Ａ）及び（イ）の出力が供給される。 １両フィールド
遅延メモリ（ロ）及び（６）の遅延時間は共に［ＩＶ
−２Ｈ−２Ｔｓ）であ）、その出力はそれぞれ主フイー
ルド用及び前フイールド用のライン遅延メモリ（２）及
び（２０Ｂ）に供給される。θ場は誤シ修整回路であっ
て、誤シ修整回路Ｏ］には前フイールド用、後フィール
ド用及び主フイールド用のライン遅延メモリ（２０Ａ）
、（２０Ｂ）及び（至）の各分岐出力、即ち後フィール
ドのデータａ 〜量 、主フィールドの＋１＋１ データａ。−１０及び前フィールドのデータ＆−１〜量
−４が供給される。また、誤シ修整回路（至）からその
出力と制御信号■とが主フイールド用ライン遅延メモリ
（イ）中のマルチプレクサ０３に供給されていることは
第１０図の実施列の場合と同様である。
ぞれ後フィールド用及び前フイールド用ライン遅延メモ
リであって、両ライン遅延メモリ（２０Ａ）及び（２０
Ｂ）は第５図に示した遅延メモリに）と全く同一の構成
である。０埠及び（至）はそれぞれ後フィールド用及び
主フイールド用のフィールド遅延メモリであって、両フ
ィールド遅延メモリθつ及びに）にはそれぞれ後フィー
ルｒ用及び主フイールド９用のライン遅延メモリ（２０
Ａ）及び（イ）の出力が供給される。 １両フィールド
遅延メモリ（ロ）及び（６）の遅延時間は共に［ＩＶ
−２Ｈ−２Ｔｓ）であ）、その出力はそれぞれ主フイー
ルド用及び前フイールド用のライン遅延メモリ（２）及
び（２０Ｂ）に供給される。θ場は誤シ修整回路であっ
て、誤シ修整回路Ｏ］には前フイールド用、後フィール
ド用及び主フイールド用のライン遅延メモリ（２０Ａ）
、（２０Ｂ）及び（至）の各分岐出力、即ち後フィール
ドのデータａ 〜量 、主フィールドの＋１＋１ データａ。−１０及び前フィールドのデータ＆−１〜量
−４が供給される。また、誤シ修整回路（至）からその
出力と制御信号■とが主フイールド用ライン遅延メモリ
（イ）中のマルチプレクサ０３に供給されていることは
第１０図の実施列の場合と同様である。
第１３図に各フィールドのデータの関係を示す。
これから明らかなように、第１２図の実施列は本発明を
時間軸を含めた３次元に適用したものであって、前のフ
ィールドの正しいデータを用いて修整されたデータを遅
延メモリに帰還して、後のフィールドの誤シデータを順
次修整し得ることは、前述の第１０図の実施例の説明か
ら容易に理解することができるであろう。
時間軸を含めた３次元に適用したものであって、前のフ
ィールドの正しいデータを用いて修整されたデータを遅
延メモリに帰還して、後のフィールドの誤シデータを順
次修整し得ることは、前述の第１０図の実施例の説明か
ら容易に理解することができるであろう。
なお、第１２図の実施例では・前後３フイールドのデー
タを修整に用いる場合について説明したが、３フイール
ドのデータに替えて３フレームのデータを用いることも
できる。
タを修整に用いる場合について説明したが、３フイール
ドのデータに替えて３フレームのデータを用いることも
できる。
発明の効果
以上詳述のように、本発明によれば、修整されたデータ
を遅延メモリに帰還し、誤シ修整用の正しいデータとし
て使用するようにしたので、小規模の正しいデータによ
って誤シデータを順次修整することができて、デジタル
ＶＴＲの変速再生に適用した場合、小規模の回路構成に
よって画質の向上に頗る有効である。
を遅延メモリに帰還し、誤シ修整用の正しいデータとし
て使用するようにしたので、小規模の正しいデータによ
って誤シデータを順次修整することができて、デジタル
ＶＴＲの変速再生に適用した場合、小規模の回路構成に
よって画質の向上に頗る有効である。
第１図、第２図及び第３図は夫々本発明を適用して好適
なデジタルＶＴＲの一例の夫々テープ案内ドラム及び回
転磁気ヘッドを示す配置図、記録系を示すブロック図、
再生系を示すブロック図、第４図、第９図、第１１図及
び第１３図は本発明の説明に供・する線図、第５図は←
従来の誤り修整装置のブロック図、第６図及び第７図は
夫々磁気テ−プのトラツクノ母ターンを示すノリーン図
、第８図は再生高周波信号の包絡線を示す波形図、第１
０図は本発明の一実施例を示すブロック図、第１２図は
本発明の他の実７１！１ＰＩＪを示すブロック図である
・θす、（ハ）、０→及び輪は誤シ修整回路、（イ）、
（２０Ａ）。 （２０Ｂ）及び（イ）は遅延メモリ、０９はマルチプレ
クサ、α心及びに）はフィールド遅延メモリである。
なデジタルＶＴＲの一例の夫々テープ案内ドラム及び回
転磁気ヘッドを示す配置図、記録系を示すブロック図、
再生系を示すブロック図、第４図、第９図、第１１図及
び第１３図は本発明の説明に供・する線図、第５図は←
従来の誤り修整装置のブロック図、第６図及び第７図は
夫々磁気テ−プのトラツクノ母ターンを示すノリーン図
、第８図は再生高周波信号の包絡線を示す波形図、第１
０図は本発明の一実施例を示すブロック図、第１２図は
本発明の他の実７１！１ＰＩＪを示すブロック図である
・θす、（ハ）、０→及び輪は誤シ修整回路、（イ）、
（２０Ａ）。 （２０Ｂ）及び（イ）は遅延メモリ、０９はマルチプレ
クサ、α心及びに）はフィールド遅延メモリである。
Claims (1)
- 再生されたデータ信号を誤シ修整回路に供給して上記再
生データ信号の！Ａシデータを該誤シデータの近傍のデ
ータによる補間または置換によって修整するようにした
デジタルデータの誤シ修整方式において、上記近傍のデ
ータに誤シがあるとき、該近傍のデータを修整した後上
記修整回路に帰還して誤シ修整を行なうようにしたこと
を特徴とするデジタルデータの誤シ修整方式。
Priority Applications (6)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59086755A JP2514181B2 (ja) | 1984-04-27 | 1984-04-27 | デジタルビデオデ−タの誤り修整方式 |
| AT85902148T ATE73253T1 (de) | 1984-04-27 | 1985-04-26 | Korrektursystem fuer fehler bei digitalen daten. |
| PCT/JP1985/000238 WO1985005211A1 (fr) | 1984-04-27 | 1985-04-26 | Systeme de correction d'erreurs dans des donnees numeriques |
| DE8585902148T DE3585492D1 (de) | 1984-04-27 | 1985-04-26 | Korrektursystem fuer fehler bei digitalen daten. |
| EP85902148A EP0179923B1 (en) | 1984-04-27 | 1985-04-26 | System for correcting error in digital data |
| US06/826,497 US4716565A (en) | 1984-04-27 | 1985-04-26 | Error concealing system for digital data |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP59086755A JP2514181B2 (ja) | 1984-04-27 | 1984-04-27 | デジタルビデオデ−タの誤り修整方式 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS60231981A true JPS60231981A (ja) | 1985-11-18 |
| JP2514181B2 JP2514181B2 (ja) | 1996-07-10 |
Family
ID=13895572
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP59086755A Expired - Lifetime JP2514181B2 (ja) | 1984-04-27 | 1984-04-27 | デジタルビデオデ−タの誤り修整方式 |
Country Status (6)
| Country | Link |
|---|---|
| US (1) | US4716565A (ja) |
| EP (1) | EP0179923B1 (ja) |
| JP (1) | JP2514181B2 (ja) |
| AT (1) | ATE73253T1 (ja) |
| DE (1) | DE3585492D1 (ja) |
| WO (1) | WO1985005211A1 (ja) |
Families Citing this family (15)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP2597987B2 (ja) * | 1986-02-08 | 1997-04-09 | ソニー株式会社 | ブロツク化伝送信号のデコード装置 |
| US4802152A (en) * | 1986-04-07 | 1989-01-31 | U.S. Philips Corporation | Compact disc drive apparatus having an interface for transferring data and commands to and from a host controller |
| US5257105A (en) * | 1989-09-29 | 1993-10-26 | Sharp Kabushiki Kaishi | Display driving method and apparatus with noise signal processing |
| DE3942273A1 (de) * | 1989-12-21 | 1991-06-27 | Broadcast Television Syst | Verfahren zum verdecken von fehlern in einem videosignal |
| JPH0498987A (ja) * | 1990-08-16 | 1992-03-31 | Matsushita Electric Ind Co Ltd | 誤り修整方法 |
| JPH04175084A (ja) * | 1990-08-22 | 1992-06-23 | Pioneer Electron Corp | 記録媒体演奏装置 |
| JP3109168B2 (ja) * | 1991-08-30 | 2000-11-13 | ソニー株式会社 | ディジタルビデオ信号記録、再生装置 |
| US5150379A (en) * | 1991-09-27 | 1992-09-22 | Hewlett-Packard Company | Signal processing system for adaptive equalization |
| JP2997355B2 (ja) * | 1991-12-04 | 2000-01-11 | シャープ株式会社 | 復号装置 |
| DE4427351C1 (de) * | 1994-08-02 | 1996-03-28 | Siemens Ag | Signalverarbeitungsverfahren und -anordnung für blockweise codierte Sprachsignale eines Nachrichtensystems |
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| EP0734022B1 (en) * | 1995-03-24 | 2001-05-16 | Sony Corporation | Method and apparatus for interpolating digital data |
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Citations (1)
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|---|---|---|---|---|
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Family Cites Families (8)
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| DE3028066A1 (de) * | 1980-07-24 | 1982-02-18 | Licentia Patent-Verwaltungs-Gmbh, 6000 Frankfurt | Schaltungsanordnung zur korrektur gestoerter abtastwerte bei einer pcm-uebertragungseinrichtung, insbesondere einer digital-tonplatte |
| US4380069A (en) * | 1980-12-18 | 1983-04-12 | Reitmeier Glenn A | Digital error detection using bracketing |
| DE3121599C2 (de) * | 1981-05-30 | 1986-11-27 | Robert Bosch Gmbh, 7000 Stuttgart | Verfahren und Schaltungsanordnung zum Verdecken von Fehlern in einem digitalen Videosignal |
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| JPS5898814A (ja) * | 1981-12-08 | 1983-06-11 | Sony Corp | エラ−デ−タ補間装置 |
| GB2120494B (en) * | 1982-05-14 | 1985-10-16 | Sony Corp | Error concealment in digital television signals |
| US4517600A (en) * | 1982-05-17 | 1985-05-14 | Rca Corporation | Error concealment system using dropout severity information for selection of concealment method |
-
1984
- 1984-04-27 JP JP59086755A patent/JP2514181B2/ja not_active Expired - Lifetime
-
1985
- 1985-04-26 US US06/826,497 patent/US4716565A/en not_active Expired - Lifetime
- 1985-04-26 WO PCT/JP1985/000238 patent/WO1985005211A1/ja not_active Ceased
- 1985-04-26 DE DE8585902148T patent/DE3585492D1/de not_active Expired - Lifetime
- 1985-04-26 EP EP85902148A patent/EP0179923B1/en not_active Expired
- 1985-04-26 AT AT85902148T patent/ATE73253T1/de not_active IP Right Cessation
Patent Citations (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5783943A (en) * | 1980-11-12 | 1982-05-26 | Sony Corp | Error correction device |
Also Published As
| Publication number | Publication date |
|---|---|
| DE3585492D1 (de) | 1992-04-09 |
| EP0179923A1 (en) | 1986-05-07 |
| ATE73253T1 (de) | 1992-03-15 |
| EP0179923B1 (en) | 1992-03-04 |
| US4716565A (en) | 1987-12-29 |
| JP2514181B2 (ja) | 1996-07-10 |
| WO1985005211A1 (fr) | 1985-11-21 |
| EP0179923A4 (en) | 1989-01-24 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |