JPS6023530B2 - プッシュプル増幅回路 - Google Patents

プッシュプル増幅回路

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JPS6023530B2
JPS6023530B2 JP4924178A JP4924178A JPS6023530B2 JP S6023530 B2 JPS6023530 B2 JP S6023530B2 JP 4924178 A JP4924178 A JP 4924178A JP 4924178 A JP4924178 A JP 4924178A JP S6023530 B2 JPS6023530 B2 JP S6023530B2
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JP
Japan
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transistor
bias
base
output
transistors
Prior art date
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JP4924178A
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JPS54142049A (en
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善博 河那辺
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Pioneer Corp
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Pioneer Electronic Corp
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Publication date
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Description

【発明の詳細な説明】 本発明はオーディオ機器のパワーアンプ等に用いられる
プッシュプル増幅回路の改良に関するものである。
かかる増幅回路の基本となるものはA級とB級のコンブ
リメンタリープッシュプル増幅回路であ。
ここでA級のものは一対の出力トランジスタは常に能動
領域にて動作し、遮断領域へ移行することがないのでス
イッチング歪が正じない利点が有るが、その反面バイア
ス電流を多く流す必要があり、熱損失が大きくなる欠点
がある。またB級のものはバイアス電流が少なくなって
熱損失は小さくなる利点が有るが、一対の出力トランジ
スタを交互に能動および遮断状態に切換えて動作させる
ため、スイッチング歪が発生する欠点がある。そこでコ
ンブリメンタリープツシュプル増幅回路の一対の出力ト
ランジスタのベース間に、該出力トランジスタに流れる
電流に応じて変化する可変バイアスを与えれば出力トラ
ンジスタを最小限の少ない動作電流で動作させ、かつ常
に能動領域にて動作させることが可能であり、B級動作
のブッシュプル増幅器にみられるようなスイッチング歪
の発生を防止する効果が有る。一方B級動作プッシュプ
ル増幅器におけるスイッチング歪は信号周波数が高い程
顕著に発生するものである。従って本発明の目的は上記
した可変バイアス発生手段を備えたプッシュプル増幅回
路におけるスイッチング歪発生防止効果を高城で増強す
ることにより、高城特性のより優れたプッシュプル増幅
回路を提供することにある。以下図面に基づいて本発明
の一実施例を具体的に説明する。
第1図においてNPNの出力トランジスタQ,とPNP
の出力トランジスタQ2の両ェミッタがそれぞれ抵抗戊
,,R2を介して出力点OUTにて共通接続され、出力
点OUTにはスピーカ等の負荷RLが接続されて出力ト
ランジスタQ,,Q2で増幅した出力により駆動するよ
うになっている。トランジスタQ,およびQ2の両ベー
スにはそれぞれドライバートランジスタQおよびQ4の
ェミッタが接続され、そのェミツタと出力点OUTとの
間にはそれぞれェミッタ抵抗R3,R4が接続されてい
る。そして上記ドライバートランジスタQおよびQ4の
両ベース間にはバイアス発生回路からのベースバイアス
電圧が供給されている。すなわちベースバイアス発生回
路はNPNのトランジスタはと、基準バイアスを発生す
るダイオード○,,D2および電圧調整用抵抗R5とP
NPのトランジスタQ6との直列回路より構成しており
、ここに定電流源1,からの電流が供給されると共にベ
ースを入力端INに接続した入力トランジスタQ7によ
り入力信号が印加されるよう構成されている。上記トラ
ンジスタQ5,Q6は固定バイアス発生トランジスタと
して動作するものであり、該トランジスタQ,Q6には
出力トランジスタQ,,Q2の電流を検出する可変バイ
アストランジスタQ,Qが接続されている。すなわちP
NPトランジスタ偽はエミツタがトランジスタはのベー
スに接続されると共にさらに抵抗R6を介してトランジ
スタQ5のコレクタに接続され、又コレクタがトランジ
スタQ5のェミッ夕に接続されさらにベースが抵抗R8
、ダイオードD3を介して出力点OUTに接続されてお
り、NPNのトランジスタQ9はェミッタがトランジス
タQ6のベースに接続されると共にからに抵抗R7を介
してトランジスタQのコレクタに接続され、又コレクタ
がトランジスタQェミッタに接続され、さらにベースが
抵抗虫9、ダイオードD4を介して出力点OUTに接続
されている。抵抗R8とダイオードD3および抵抗R9
とダイオード04には定電流源ら,13からの電流が供
給されて、トランジスタQ,公のベースに出力点OUT
に対し一定蝿圧を供給するようになつている。ここで可
変バイアストランジスタQ8,Q9は糠信号時の動作点
が第2図に示すA点にあるよう、すなわちコレクタ電流
が流れ始めようとする最低限のベースバイアスが印加さ
れらるよう設定されており、このため無信号時はトラン
ジスタQ8,Qのコレクタ電流は非常に少ない。
従って抵抗R6,R7の電圧降下も非常に小さくなり、
出力トランジスタQ,,Q2の両ベース間電圧はトラン
ジスタQ5,Q6のそれぞれのベース・ェミッタ間電圧
と、ダイオードD,,D2の順方向降下電圧と、抵抗R
5で生じる電圧の和に基づいて設定される。こうして入
力トランジスタQ7から信号が印加され、出力点OUT
がその入力信号条件により正側に遷移すると、出力トラ
ンジスタQ,に電流が流れてそのトランジスタQ,のベ
ースと出力点OUTとの間の電圧が増加するため、トラ
ンジスタQ8によって電流を検出し、そのベース・ェミ
ツタ間電圧が増加し、トランジスタQ6にコレクタ電流
が流れる。
ここで各トランジスタの電流増幅率が大きければ、抵抗
R6に流れる電流の殆んどがトランジスタQ8のコレク
タ電流となり、抵抗R5に流れる電流は無信号時と同じ
になってトランジスタQ8,Qの両コレクタ間の電圧は
無信号時と同一に保たれる。一方トランジスタ処の動作
点は第2図においてA点からB点に移行するが、この時
のベース・ェミッタ間の電圧の変化は微小であり、トラ
ンジスタQ8のベース・コレクタ間の電圧も無信号時と
略同じである。又抵抗R8とダイオードD3には定電流
源12により電流が供給され、その電圧降下は常に一定
である。従って出力点OUTに対するトランジスタQ2
のベース電圧は無信号時とほぼ同じ電圧に保たれること
になり、出力トランジスタQ2が遮断領域に移行するこ
とはない。次いで入力信号条件により出力点OUTが負
側に遷移して出力トランジスタQ2が増幅動作する場合
も、前述と同様の作用により出力トランジスタQ,は遮
断領域に移行することはない。
なお上記トランジスタQ,Qを含むバイアス発生回路の
両端P,Q間にはコンデンサCが並列に接続されている
このコンデンサCはバイアス発生回路の働きにより、点
P,Q間の電圧が増大する時充電され、逆に減少する時
に放電する。第1図の回路構成ではコンデンサCの充電
時間に対して放電時間の方が長く、従って高城信号が連
続する場合、コンデンサCが存在しない場合に比較して
P,Q間の電圧は増加し、その結果出力トランジスタQ
,,Q2の動作電流は増加する。このためB級増幅回路
においてスイッチング歪の発生が顕著になる高城周波数
で、バイアス回路の効果を増強することが出来、高城特
性のより優れた増幅回路を得ることができる。超高城周
波数において出力トランジスタQ,,Q2の動作電流が
増加し過ぎる場合には第3図に示すようにコンデンサC
と直列に抵抗Rを挿入すれば良い。本発明は以上のよう
に構成されているので、出力トランジスタは常に能動領
域で動作し、遮断鏡城へ移行することがないのでB級プ
ッシュプル増幅回路にみられるスイッチング歪を発生さ
せることはなく、又バイアス発生回路の両端にはコンデ
ンサCを並列に接続するよう構成したので、高城周波数
においてバイアス回路の効果を増強するよう作用し、高
城周波数の再生に際してもスイッチング歪の発生がない
安定な増幅回路を提供することができる。
【図面の簡単な説明】
第1図は本発明の一実施例を示す回路図、第2図は第1
図の実施例に用いられる一部のトランジスタの動作特性
図、第3図は可変バイアス発生回路に並例接続されるコ
ンデンサ回路の変形例を示した結線図である。 Q,,Q2…出力トランジスタ、Q5,Q…バイアス発
生トランジスタ、Q6,Q9…電流検出トランジスタ、
C…コンデンサ。 繁l図 第2図 第3図

Claims (1)

    【特許請求の範囲】
  1. 1 エミツタが夫々抵抗を介して出力点にて共通接続さ
    れる第1および第2の出力トランジスタのベース間に接
    続されたベースバイアス手段を有してプツシユプル動作
    する増幅回路において、前記ベースバイアス手段は前記
    出力点に対し一定電圧を発生する第1および第2の定電
    圧発生手段と、前記第1の出力トランジスタのベースに
    抵抗を介してエミツタが接続され、かつ前記第1の定電
    圧発生手段にベースが接続された第1のバイアストラン
    ジスタと、前記第2の出力トランジスタのベースに抵抗
    を介してエミツタが接続され、かつ前記第2の定電圧発
    生手段にベースが接続された第2のバイアストランジス
    タと、前記第1の出力トランジスタのベースにコレクタ
    が接続され、前記第1のバイアストランジスタのエミツ
    タにベースが接続され、前記第1のバイアストランジス
    タのコレクタにエミツタが接続された第3のバイアスト
    ランジスタと、前記第2の出力トランジスタのベースに
    コレクタが接続され、前第2のバイアストランジスタの
    エミツタにベースが接続され、前記第2のバイアストラ
    ンジスタのコレクタにエミツタが接続された第4のバイ
    アストランジスタと、前記第3および第4のバイアスト
    ランジスタのエミツタ間に接続された基準バイアス発生
    手段とを備え、さらに前記第3および第4のバイアスト
    ランジスタのコレクタ間にコンデンサを接続したことを
    特徴とするプツシユプル増幅回路。
JP4924178A 1978-04-27 1978-04-27 プッシュプル増幅回路 Expired JPS6023530B2 (ja)

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JP4924178A JPS6023530B2 (ja) 1978-04-27 1978-04-27 プッシュプル増幅回路

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Publication Number Publication Date
JPS54142049A JPS54142049A (en) 1979-11-05
JPS6023530B2 true JPS6023530B2 (ja) 1985-06-07

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