JPS60254621A - 薄膜形成方法 - Google Patents

薄膜形成方法

Info

Publication number
JPS60254621A
JPS60254621A JP59111116A JP11111684A JPS60254621A JP S60254621 A JPS60254621 A JP S60254621A JP 59111116 A JP59111116 A JP 59111116A JP 11111684 A JP11111684 A JP 11111684A JP S60254621 A JPS60254621 A JP S60254621A
Authority
JP
Japan
Prior art keywords
substrate
thin film
plasma
semiconductor substrate
film
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59111116A
Other languages
English (en)
Inventor
Akiyoshi Tamura
彰良 田村
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP59111116A priority Critical patent/JPS60254621A/ja
Publication of JPS60254621A publication Critical patent/JPS60254621A/ja
Pending legal-status Critical Current

Links

Classifications

    • CCHEMISTRY; METALLURGY
    • C23COATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; CHEMICAL SURFACE TREATMENT; DIFFUSION TREATMENT OF METALLIC MATERIAL; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL; INHIBITING CORROSION OF METALLIC MATERIAL OR INCRUSTATION IN GENERAL
    • C23CCOATING METALLIC MATERIAL; COATING MATERIAL WITH METALLIC MATERIAL; SURFACE TREATMENT OF METALLIC MATERIAL BY DIFFUSION INTO THE SURFACE, BY CHEMICAL CONVERSION OR SUBSTITUTION; COATING BY VACUUM EVAPORATION, BY SPUTTERING, BY ION IMPLANTATION OR BY CHEMICAL VAPOUR DEPOSITION, IN GENERAL
    • C23C16/00Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes
    • C23C16/44Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating
    • C23C16/50Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating using electric discharges
    • C23C16/505Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating using electric discharges using radio frequency discharges
    • C23C16/509Chemical coating by decomposition of gaseous compounds, without leaving reaction products of surface material in the coating, i.e. chemical vapour deposition [CVD] processes characterised by the method of coating using electric discharges using radio frequency discharges using internal electrodes
    • C23C16/5096Flat-bed apparatus

Landscapes

  • Chemical & Material Sciences (AREA)
  • Engineering & Computer Science (AREA)
  • Physics & Mathematics (AREA)
  • Plasma & Fusion (AREA)
  • General Chemical & Material Sciences (AREA)
  • Chemical Kinetics & Catalysis (AREA)
  • Materials Engineering (AREA)
  • Mechanical Engineering (AREA)
  • Metallurgy (AREA)
  • Organic Chemistry (AREA)
  • Formation Of Insulating Films (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 産業上の利用分野 −本発明は化合物半導体基板上への薄膜形成方法に関す
るものである。
従来例の構成とその問題点 化合物半導体と絶縁膜の界面特性は、SiとS i02
の界面に比して界面準位密度が多く、特にG a A 
sでは、反転層の形成が困難であった。このように界面
準位密度が多いのは、構成元素の損失によるダングリン
グボンドに起因している。
発明の目的 本発明は、このような従来の問題に鑑み、化合物半導体
基板上への界面準位密度の少ない薄膜形成方法を提供す
るものである。
発明の構成 本発明は、水素プラズマ中で化合物半導体基板を200
℃〜460℃の温度で、処理した後、薄膜を形成するこ
とによシ界面準位密度の少ない薄膜形成方法を可能とす
るものである。
実施例の説明 以下、n型G a A a基板上へのSi3N4膜形成
方法を例にとって説明する。
第1図に示すように、プラズマCVD装置1中に、試料
となるn型G a A s基板2を設置し、真空排気後
、H2ガスを導入しく約0.05 Torr )、基板
2を約350℃でヒーター3にて加熱しながら高周波(
13,56矧h)電源4(パワー60W)を印加してH
2プラズマを発生させ、約2時間放置後、ひき続いてS
iHとNH3ガスを導入し、基板2上にSi3N4膜を
堆積させるものである。5,6はガスの導入部、排気部
である。
第2図はこうして得られたSi3N4膜とn型G a 
A sとの界面準位密度を、H2プラズマ処理をした試
料としなかった試料について比較したもの9である。
界面準位密度は、2ケタも減少していることがわかる。
これはH原子の拡散によりダングリングボンドの数が減
少したためである。
なおH2プラズマ処理中の基板加熱温度としては、20
0℃〜460℃が良い。第3図は、n型G a A g
とSi3N4膜の最小界面準位密度と基板加熱温度との
関係を示しだものである。なおH2プラズマは0.05
 Torrパワー50W、2時間である。
最小界面準位密度は200℃より低い温度域と460℃
より高い温度域で大きくなっている。この原因として、
低温域ではH2プラズマのダメージが残っているためで
、高温域では、GaAs中のAsの解離のためである。
同様な傾向は1nPとSi3N4膜の界面についても見
られた基板加熱温度としては、200℃〜450℃が良
い0第4図は、n型InPとプラズマCV D ’S 
L 3N4膜との界面特性について、本発明のプラズマ
H2処理(基板加熱温度300℃、 0.05Torr
、パワー50W、2時間)をしたものとしていないもの
を比較したものである。この場合も界面準位密度は2ク
タはど減少していることがわかる。なお、馬プラズマ中
ではなくH2ガス雰囲気中放置の試料については、以上
のような効果は見られなかった。
以上のように本発明の方法を用いれば、従来に比して、
界面準位密度を顕著に減少させることが可能である。な
お以上の説明では、絶縁膜形成について述べたが、金属
膜形成に関しても利用できることはいうまでもない。
発明の効果 以上のように本発明は、化合物半導体基板を、H2プラ
ズマ中で、2oO℃〜450℃の温度で処理した後、薄
膜を形成することにより、従来より界面準位密度の少な
い良好な界面特性を持った薄膜形成方法を実現するもの
である。
【図面の簡単な説明】
第1図はプラズマCVD装置の概略図、第2図。 第4図はそれぞれn −GaAa 、 n −I nP
とSi3N4膜の界面準位密度分布を示す図、第3図は
、n −G a A sとSi3N4膜の最小界面準位
密度と基板加熱温度の関係を示す図である。 1・・・・・・CVD装置、2・・・・・・n型G a
 A s基板。 代理人の氏名 弁理士 中 尾 敏 男 ほか1名第1
図 第2図

Claims (1)

    【特許請求の範囲】
  1. 化合物半導体基板を水素プラズマ中で200℃〜450
    ℃の温度で加熱して処理した後、前記半導体基板表面に
    薄膜を形成することを特徴とする薄膜形成方法。
JP59111116A 1984-05-31 1984-05-31 薄膜形成方法 Pending JPS60254621A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59111116A JPS60254621A (ja) 1984-05-31 1984-05-31 薄膜形成方法

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59111116A JPS60254621A (ja) 1984-05-31 1984-05-31 薄膜形成方法

Publications (1)

Publication Number Publication Date
JPS60254621A true JPS60254621A (ja) 1985-12-16

Family

ID=14552819

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59111116A Pending JPS60254621A (ja) 1984-05-31 1984-05-31 薄膜形成方法

Country Status (1)

Country Link
JP (1) JPS60254621A (ja)

Cited By (4)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0321023A (ja) * 1989-05-31 1991-01-29 Mitel Corp スピン・オン・ガラス膜の形成を含む製造法
WO2002043115A3 (en) * 2000-11-24 2002-08-22 Asm Inc Surface preparation prior to deposition
US6960537B2 (en) 2001-10-02 2005-11-01 Asm America, Inc. Incorporation of nitrogen into high k dielectric film
US8557702B2 (en) 2009-02-02 2013-10-15 Asm America, Inc. Plasma-enhanced atomic layers deposition of conductive material over dielectric layers

Cited By (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0321023A (ja) * 1989-05-31 1991-01-29 Mitel Corp スピン・オン・ガラス膜の形成を含む製造法
WO2002043115A3 (en) * 2000-11-24 2002-08-22 Asm Inc Surface preparation prior to deposition
US6613695B2 (en) 2000-11-24 2003-09-02 Asm America, Inc. Surface preparation prior to deposition
US6958277B2 (en) 2000-11-24 2005-10-25 Asm America, Inc. Surface preparation prior to deposition
US7056835B2 (en) 2000-11-24 2006-06-06 Asm America, Inc. Surface preparation prior to deposition
US7476627B2 (en) 2000-11-24 2009-01-13 Asm America, Inc. Surface preparation prior to deposition
US6960537B2 (en) 2001-10-02 2005-11-01 Asm America, Inc. Incorporation of nitrogen into high k dielectric film
US7405453B2 (en) 2001-10-02 2008-07-29 Asm America, Inc. Incorporation of nitrogen into high k dielectric film
US7569284B2 (en) 2001-10-02 2009-08-04 Asm America, Inc. Incorporation of nitrogen into high k dielectric film
US8557702B2 (en) 2009-02-02 2013-10-15 Asm America, Inc. Plasma-enhanced atomic layers deposition of conductive material over dielectric layers
US9466574B2 (en) 2009-02-02 2016-10-11 Asm America, Inc. Plasma-enhanced atomic layer deposition of conductive material over dielectric layers

Similar Documents

Publication Publication Date Title
KR900007686B1 (ko) 선택적으로 산화된 실리콘 기판상에 에피택셜 실리콘층과 다결정 실리콘층을 동시에 성장시키는 기상 증착방법
US6255149B1 (en) Process for restricting interdiffusion in a semiconductor device with composite Si/SiGe gate
US5336361A (en) Method of manufacturing an MIS-type semiconductor device
WO2003058701A2 (en) Uv-enhanced oxy-nitridation of semiconductor substrates
JPH04233734A (ja) 弗素化窒化珪素を付着する方法
JPH04146619A (ja) 薄膜成長法
JPH04111362A (ja) 薄膜トランジスタとその製造方法
JPS617622A (ja) 半導体装置の製造方法
JPS59215728A (ja) 半導体表面の光洗浄方法
JPH0629222A (ja) 半導体装置の製造方法
JP2987926B2 (ja) 気相成長方法
JPS6380525A (ja) 被膜形成方法
JPH05251439A (ja) 半導体装置の絶縁膜形成方法
JPH05213695A (ja) ダイヤモンド薄膜の堆積方法
JP2917900B2 (ja) Iii −v族化合物半導体基板の表面処理方法
JP2004152863A (ja) 半導体装置及びその製造方法
KR20250143694A (ko) 기판 처리 방법
JPS6341014A (ja) エピタキシヤル成長方法
JP2853226B2 (ja) 半導体装置およびその製造方法
JPS6294942A (ja) 薄膜の製造方法
JPS6234139B2 (ja)
JPH08325100A (ja) 化合物半導体基板の前処理方法
JPH06349801A (ja) 表面処理方法
JPH0556025B2 (ja)
JP3077876B2 (ja) Iii−v族化合物半導体の表面処理方法