JPS602868U - プリント基板 - Google Patents

プリント基板

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Publication number
JPS602868U
JPS602868U JP1983094559U JP9455983U JPS602868U JP S602868 U JPS602868 U JP S602868U JP 1983094559 U JP1983094559 U JP 1983094559U JP 9455983 U JP9455983 U JP 9455983U JP S602868 U JPS602868 U JP S602868U
Authority
JP
Japan
Prior art keywords
printed circuit
circuit board
view
prevention part
chip resistor
Prior art date
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Granted
Application number
JP1983094559U
Other languages
English (en)
Other versions
JPH027482Y2 (ja
Inventor
哲朗 後藤
浩輔 増田
亮一 菅沼
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Nikon Corp
Original Assignee
Nikon Corp
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Filing date
Publication date
Application filed by Nikon Corp filed Critical Nikon Corp
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Publication of JPS602868U publication Critical patent/JPS602868U/ja
Application granted granted Critical
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Granted legal-status Critical Current

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  • Electric Connection Of Electric Components To Printed Circuits (AREA)
  • Structures For Mounting Electric Components On Printed Circuit Boards (AREA)
  • Apparatuses And Processes For Manufacturing Resistors (AREA)
  • Non-Adjustable Resistors (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図はチップ型抵抗器の一例を示す平面図、第２図は
同じく縦断面図、第３図および第４図は従来例を示し、
第３図はチップ型抵抗器を備えた基板の平面図、第４図
は第３図ＩＶ−ＩＶ断面図、第５図および第６図は本考
案の第１実施例を示し、第５図はチップ型抵抗器を備え
た基板の平面図、第６図は第５図Ｖｌ−ＶＩ断面図、第
７図および第８図は第２実施例を示し、第７図はチップ
型抵抗器を備えた基板の平面図、第８図は第７図■−■
断面図、第９図および第１０図は第３実施例を示し、第
９図はチップ型抵抗器を備えた基板の平面図、第１０図
は第９図Ｘ−Ｘ断面図、第１１図は第４実施例を示すチ
ップ型抵抗器を備えた基板の平面図、第１２図および第
１３図は第５実施例を示し、第１２図はチップ型抵抗器
を備えた基板の平面図、第１３図は第１２図ｘｍ−ｘｍ
断面図、第１４図は第６実施例を示すチップ型抵抗器を
備えた基板の縦断面図、第１５図および第１６図は第７
実施例を示し、第１５図はチップ型抵抗器の平面図、第
１６図はチップ型抵抗器を備えた基板の平面図、第１７
図および第１８図は第８実施例を示し、第１７図はチッ
プ型抵抗器を備えた基板の平面図、第１８図は部分回路
図、第１９図は第９実施例を示すチップ型抵抗器を備え
た基板の平面図である。 １・・・・・・チップ型抵抗器、１１・・・・・・セラ
ミック板、１２・・・・・・内部電極、１３・・・・・
・抵抗体、１４・・・・・・ガラスコー′ト保護膜、１
５・・・・・・外部電極、２・・・・・・基板、３・・
・・・・配線パターン、３１・・・・・・端子、３２・
・・・・・ハンダ、４・・・・・・ベッド、４１・・・
・・・逆げ溝、ａ・・・・・・起動位置、ａｌ・・・・
・・助走区間、２２．２３゜２４・・・・・・透孔（焼
損防止部）、３３・・・・・・保護体（焼損防止部）、
５・・・・・・接着剤（焼損防止部）。

Claims (3)

    【実用新案登録請求の範囲】
  1. （１）チップ型抵抗器がプリント基板の配線パターンに
    形成した端子間に架設されたプリント基板において、 前記抵抗器をレーザートリミングする際のレーザービー
    ムの走査線の軌跡上に焼損防止部を設けたことを特徴と
    するプリント基板。
  2. （２）焼損防止部は基板に穿設した透孔である請求の範
    囲第１項記載のプリント基板。
  3. （３）焼損防止部は基板に延設した保護体である請求の
    範囲第１項記載のプリント基板。
JP1983094559U 1983-06-20 1983-06-20 プリント基板 Granted JPS602868U (ja)

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JP1983094559U JPS602868U (ja) 1983-06-20 1983-06-20 プリント基板

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JP1983094559U JPS602868U (ja) 1983-06-20 1983-06-20 プリント基板

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JPS602868U true JPS602868U (ja) 1985-01-10
JPH027482Y2 JPH027482Y2 (ja) 1990-02-22

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ID=30226292

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Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5849472U (ja) * 1981-09-29 1983-04-04 株式会社東芝 印刷配線基板
JPS5863704U (ja) * 1981-10-23 1983-04-28 三菱電機株式会社 チツプ抵抗器
JPS58111952U (ja) * 1982-01-25 1983-07-30 オムロン株式会社 混成集積回路

Patent Citations (3)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS5849472U (ja) * 1981-09-29 1983-04-04 株式会社東芝 印刷配線基板
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JPS58111952U (ja) * 1982-01-25 1983-07-30 オムロン株式会社 混成集積回路

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JPH027482Y2 (ja) 1990-02-22

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