JPS6033743A - 入力整合回路 - Google Patents
入力整合回路Info
- Publication number
- JPS6033743A JPS6033743A JP14283183A JP14283183A JPS6033743A JP S6033743 A JPS6033743 A JP S6033743A JP 14283183 A JP14283183 A JP 14283183A JP 14283183 A JP14283183 A JP 14283183A JP S6033743 A JPS6033743 A JP S6033743A
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- JP
- Japan
- Prior art keywords
- circuit
- input terminal
- input
- matching
- capacitor
- Prior art date
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- Granted
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Classifications
-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03H—IMPEDANCE NETWORKS, e.g. RESONANT CIRCUITS; RESONATORS
- H03H11/00—Networks using active elements
- H03H11/02—Multiple-port networks
- H03H11/28—Impedance matching networks
-
- H—ELECTRICITY
- H04—ELECTRIC COMMUNICATION TECHNIQUE
- H04B—TRANSMISSION
- H04B1/00—Details of transmission systems, not covered by a single one of groups H04B3/00 - H04B13/00; Details of transmission systems not characterised by the medium used for transmission
- H04B1/06—Receivers
- H04B1/16—Circuits
- H04B1/18—Input circuits, e.g. for coupling to an antenna or a transmission line
Landscapes
- Engineering & Computer Science (AREA)
- Computer Networks & Wireless Communication (AREA)
- Signal Processing (AREA)
- Input Circuits Of Receivers And Coupling Of Receivers And Audio Equipment (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
この発明は、例えば衛星放送用ＳＨＦ受信システムに利
用されるものであって屋外ユニットと屋内ユニットとの
間に設けられる入力整合回路に関する。
用されるものであって屋外ユニットと屋内ユニットとの
間に設けられる入力整合回路に関する。
一般にＳＨＦ帯受信システム、例えば衛星放送用ＳＨＦ
受信システムにおいては、衛星からのＳＨＦ帯の放送信
号（１１，７〜１２．２ Ｇ１１ｚ ）は、ノクラボラ
アンテナで受信され、アンテナに付ＰＡの屋外ユニット
（第１のコンバータ）テＵＨＦ帯の信号（１〜１．５
Ｇ ｆｉｚ ）に変換される。
受信システムにおいては、衛星からのＳＨＦ帯の放送信
号（１１，７〜１２．２ Ｇ１１ｚ ）は、ノクラボラ
アンテナで受信され、アンテナに付ＰＡの屋外ユニット
（第１のコンバータ）テＵＨＦ帯の信号（１〜１．５
Ｇ ｆｉｚ ）に変換される。
このＵＨＦ帯の信号は、一般家庭の屋内ユニット（第２
のコンバータを含む）でＶＨＦ帯の定められた周波数（
例えば１３０ＭＩＩｚ）に変換される。続いて、このＶ
ＨＦの信号は、ＦＭ復調回路に入力されベースバンド信
号寸たＲＦ（ｉ号に変換され、一般のテレビ・ジョン受
像機にて受信可能な信号となる。
のコンバータを含む）でＶＨＦ帯の定められた周波数（
例えば１３０ＭＩＩｚ）に変換される。続いて、このＶ
ＨＦの信号は、ＦＭ復調回路に入力されベースバンド信
号寸たＲＦ（ｉ号に変換され、一般のテレビ・ジョン受
像機にて受信可能な信号となる。
第１図は上記のシステムを概略的に示すもので、１）は
ノヤラデラアンテナ、１２は屋外ユニット、１３は屋内
ユニットである。ここで、屋内ユニット１３は、入力端
子１４、増幅回路１５、可変前段パントノｅスフィルタ
１６、混合回路１７、局部発振器１８、増幅回路１９、
後段バンド・ぐスフイルタ２０、増幅回路２ノ、出力端
子２２を第２コンバータ部として有する。入力端子１４
に入力したＵ ＨＦ帯の信号（１〜１．５ Ｇ Ｈｚ
）は、混合回路１２においてＶＨＦ帯の信号に変換され
ることになる。
ノヤラデラアンテナ、１２は屋外ユニット、１３は屋内
ユニットである。ここで、屋内ユニット１３は、入力端
子１４、増幅回路１５、可変前段パントノｅスフィルタ
１６、混合回路１７、局部発振器１８、増幅回路１９、
後段バンド・ぐスフイルタ２０、増幅回路２ノ、出力端
子２２を第２コンバータ部として有する。入力端子１４
に入力したＵ ＨＦ帯の信号（１〜１．５ Ｇ Ｈｚ
）は、混合回路１２においてＶＨＦ帯の信号に変換され
ることになる。
ここで、端子２３はコイル２４を介して入力端子１４に
接続されている。これは、屋内ユニット１３側から屋外
ユニット１２側に直流電源子Ｂを供給する必要があるか
らである。
接続されている。これは、屋内ユニット１３側から屋外
ユニット１２側に直流電源子Ｂを供給する必要があるか
らである。
このようなシステムにおいて、屋内ユニット１３の入力
部では、ＦＭ信号伝送を歪なく行うだめの良好なＶＳＷ
Ｒが要求される。
部では、ＦＭ信号伝送を歪なく行うだめの良好なＶＳＷ
Ｒが要求される。
一般に良好なりｓｗＲを得るだめの手法としては、フィ
ルタ構成による整合回路を用いる方法、アイソレータを
用いる方法などがある。しかし、前述した第２のコンバ
ータ部のように、１〜１．５Ｇ Ｈｚの広帯域を扱い、
しかも入力端子に直流電源を重畳させるような回路の入
力整合には次のような問題がある。
ルタ構成による整合回路を用いる方法、アイソレータを
用いる方法などがある。しかし、前述した第２のコンバ
ータ部のように、１〜１．５Ｇ Ｈｚの広帯域を扱い、
しかも入力端子に直流電源を重畳させるような回路の入
力整合には次のような問題がある。
たとえば、フィルタ構成による整合回路の場合、周波数
特性を考慮すると広帯域なために多段構成になるととも
に、人力部に短絡スタブを構成できない。また減衰器を
挿入する際も直流電圧が重畳するため直流阻止コンデン
サが余分に必要となる。次にアイソレータを用いるにし
ても、広帯域用のものが必要となり民生用としては高価
になりすぎるという問題がある。
特性を考慮すると広帯域なために多段構成になるととも
に、人力部に短絡スタブを構成できない。また減衰器を
挿入する際も直流電圧が重畳するため直流阻止コンデン
サが余分に必要となる。次にアイソレータを用いるにし
ても、広帯域用のものが必要となり民生用としては高価
になりすぎるという問題がある。
この発明は上記の事情に対処すべくなされたもので、簡
単な回路構成で広帯域にわたる入力整合回路を提供する
ことを目的とするものである。
単な回路構成で広帯域にわたる入力整合回路を提供する
ことを目的とするものである。
この発明においては、入力インピーダンスに整合した抵
抗と直流阻止コンデンサを直列にし、この直列回路と並
列にコンデンサとコイルの直列回路を接続するものであ
る。
抗と直流阻止コンデンサを直列にし、この直列回路と並
列にコンデンサとコイルの直列回路を接続するものであ
る。
以下この発明の実施例を図面を参照して説明する。
第２図はこの発明による入力整合回路であり、第１図で
説明した第２コンバータの前段に適用したものである。
説明した第２コンバータの前段に適用したものである。
第２図において入力端子１４には、ＵＨＦ帯の信号（１
〜１．５ＧＩ］ｚ）が入力される。入力端子１４は、コ
イル３２を介して屋外ユニット電源用入力端子３ノに接
続されるとともに、整合抵抗３３、整合用コンデンサ３
５の一方の端子に接続される本実施例の場合、入力イン
ピーダンスが７５０であるので、抵抗３３の値は７５Ω
に選定される。整合抵抗３３の他端は、直流阻止コンデ
ンサ３４を介して、また整合コンデンサ３５の他端はコ
イル３６を介してトランジスタ３７のペースに接続され
る。つまり、この整合部の後段には、トランジスタ増幅
回路が接続されている。
〜１．５ＧＩ］ｚ）が入力される。入力端子１４は、コ
イル３２を介して屋外ユニット電源用入力端子３ノに接
続されるとともに、整合抵抗３３、整合用コンデンサ３
５の一方の端子に接続される本実施例の場合、入力イン
ピーダンスが７５０であるので、抵抗３３の値は７５Ω
に選定される。整合抵抗３３の他端は、直流阻止コンデ
ンサ３４を介して、また整合コンデンサ３５の他端はコ
イル３６を介してトランジスタ３７のペースに接続され
る。つまり、この整合部の後段には、トランジスタ増幅
回路が接続されている。
ここで、入力周波数は、１〜１．５ Ｇ Ｉｌｚである
ので、周波数特性設定回路を構成するコンデンサ３５と
コイル３６の値は、上限周波数１．５ Ｇ ｌｌｚをｆ
として Ｒ；入力インピーダンス に：ｏ、５〜０．７ なるコンデンサ３５の値Ｃ３５、コイル３６の値Ｌ８６
を用いれば良い。本実施例では、Ｃ３，−１，５ｐｐｌ
。
ので、周波数特性設定回路を構成するコンデンサ３５と
コイル３６の値は、上限周波数１．５ Ｇ ｌｌｚをｆ
として Ｒ；入力インピーダンス に：ｏ、５〜０．７ なるコンデンサ３５の値Ｃ３５、コイル３６の値Ｌ８６
を用いれば良い。本実施例では、Ｃ３，−１，５ｐｐｌ
。
Ｉ、３．＝４ｙＩＨを採用している。
次に、後段には、トランジスタ増幅器が構成されている
。
。
３８は電源供給端子であり、ここの電源は抵抗３９．４
０により分圧され、その分圧電圧は、コイル４１を介し
てトランジスタ３７のペースバイアスとなる。また、電
源は、抵抗４３、コイル４４を介してトランジスタ３７
のコレクタにも供給され駆動電源として作用する。トラ
ンジスタ３７のエミッタは、エミッタ抵抗４６を介して
接地される。そして、出力は、トランジスタ３７のコレ
クタから結合コンデンサ４８、出力整合用コンデンサ５
０を介して出力端子４９に導出される。なおコンデンサ
４２，４５．４７は、交流ハイノ？スコンデンサである
。
０により分圧され、その分圧電圧は、コイル４１を介し
てトランジスタ３７のペースバイアスとなる。また、電
源は、抵抗４３、コイル４４を介してトランジスタ３７
のコレクタにも供給され駆動電源として作用する。トラ
ンジスタ３７のエミッタは、エミッタ抵抗４６を介して
接地される。そして、出力は、トランジスタ３７のコレ
クタから結合コンデンサ４８、出力整合用コンデンサ５
０を介して出力端子４９に導出される。なおコンデンサ
４２，４５．４７は、交流ハイノ？スコンデンサである
。
トランジスタ３７のペースに接続されたコイル４１は、
利得補１Ｆ用であり、その条件としては、（１） （２
）式と同じように で計算される値のインダクタンスを用いれば良い。
利得補１Ｆ用であり、その条件としては、（１） （２
）式と同じように で計算される値のインダクタンスを用いれば良い。
上記のように構成された入力整合回路によると、ｖｓｗ
Ｒが非常に良好で、周波数に対して平坦な特性の増幅回
路を実現できた。第３図は、第２図の回路の通過特性と
反射特性を示している。
Ｒが非常に良好で、周波数に対して平坦な特性の増幅回
路を実現できた。第３図は、第２図の回路の通過特性と
反射特性を示している。
ＶＳＷＲは反射損失７’ （ｄＢ） とすると、であら
れされ、第３図からＶＳＷＲは１．０７〜１．２２と読
みとれる。第３図のように反射損失の曲線Ａは広帯域に
わたって変化が少ない。
れされ、第３図からＶＳＷＲは１．０７〜１．２２と読
みとれる。第３図のように反射損失の曲線Ａは広帯域に
わたって変化が少ない。
上記実施例において、コイル３６は、コンデンサ３５の
リードインダクタンスで代替される。
リードインダクタンスで代替される。
またノ母ターンインダクタンスで代替することも可能で
ある。
ある。
以上説明したようにこの発明によると広帯域に整合し、
しかも少ない部品数で良好なＶＳＷＲが得られ、かつ広
帯域にわたって利得が平坦な増幅回路も容易に実現でき
る入力整合回路を提供できる。
しかも少ない部品数で良好なＶＳＷＲが得られ、かつ広
帯域にわたって利得が平坦な増幅回路も容易に実現でき
る入力整合回路を提供できる。
第１図は衛星放送用Ｓ ｆ（Ｆ受信システムを示す図、
第２図はこの発明の一実施例を示す回路図、第３図は本
実施例における実測値を示すグラフである。 １４・・・入力端子、３１・・・電源用入力端子、３２
・・・コイル、３３・・・整合抵抗、３４・・・直流阻
止コンデンサ、３５・・・整合用コンデンサ、３６・・
・コイル、３７・・・トランジスタ。
第２図はこの発明の一実施例を示す回路図、第３図は本
実施例における実測値を示すグラフである。 １４・・・入力端子、３１・・・電源用入力端子、３２
・・・コイル、３３・・・整合抵抗、３４・・・直流阻
止コンデンサ、３５・・・整合用コンデンサ、３６・・
・コイル、３７・・・トランジスタ。
Claims (1)
- 【特許請求の範囲】 入力端子に出力信号を導入する外部回路に対して前記入
力端子を介して直流電源を供給するために、前記入力端
子にコイルを介して接続された電源入力端子と、 前記入力端子と増幅回路入力部間に直列に接続された整
合抵抗及び直流阻止コンデンサと、前記整合抵抗と直流
阻止コンデンサの直列接続に対して並列に接続されたコ
ンデンサとインダクタによる周波数特性設定回路とを具
備したことを特徴とする入力整合回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14283183A JPS6033743A (ja) | 1983-08-04 | 1983-08-04 | 入力整合回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14283183A JPS6033743A (ja) | 1983-08-04 | 1983-08-04 | 入力整合回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6033743A true JPS6033743A (ja) | 1985-02-21 |
| JPH0129448B2 JPH0129448B2 (ja) | 1989-06-12 |
Family
ID=15324627
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14283183A Granted JPS6033743A (ja) | 1983-08-04 | 1983-08-04 | 入力整合回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6033743A (ja) |
-
1983
- 1983-08-04 JP JP14283183A patent/JPS6033743A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0129448B2 (ja) | 1989-06-12 |
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