JPS6041847A - Efm復調方法 - Google Patents

Efm復調方法

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JPS6041847A
JPS6041847A JP58149597A JP14959783A JPS6041847A JP S6041847 A JPS6041847 A JP S6041847A JP 58149597 A JP58149597 A JP 58149597A JP 14959783 A JP14959783 A JP 14959783A JP S6041847 A JPS6041847 A JP S6041847A
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JP
Japan
Prior art keywords
bit
efm
code
signal
conversion circuit
Prior art date
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Pending
Application number
JP58149597A
Other languages
English (en)
Inventor
Masahiro Watanabe
雅弘 渡辺
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Panasonic Holdings Corp
Original Assignee
Matsushita Electric Industrial Co Ltd
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Filing date
Publication date
Application filed by Matsushita Electric Industrial Co Ltd filed Critical Matsushita Electric Industrial Co Ltd
Priority to JP58149597A priority Critical patent/JPS6041847A/ja
Publication of JPS6041847A publication Critical patent/JPS6041847A/ja
Pending legal-status Critical Current

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    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B20/00Signal processing not specific to the method of recording or reproducing; Circuits therefor
    • G11B20/10Digital recording or reproducing
    • G11B20/14Digital recording or reproducing using self-clocking codes
    • G11B20/1403Digital recording or reproducing using self-clocking codes characterised by the use of two levels
    • G11B20/1423Code representation depending on subsequent bits, e.g. delay modulation, double density code, Miller code
    • G11B20/1426Code representation depending on subsequent bits, e.g. delay modulation, double density code, Miller code conversion to or from block codes or representations thereof
    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B20/00Signal processing not specific to the method of recording or reproducing; Circuits therefor
    • G11B20/10Digital recording or reproducing
    • G11B20/14Digital recording or reproducing using self-clocking codes
    • G11B20/1403Digital recording or reproducing using self-clocking codes characterised by the use of two levels
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    • G11B20/1426Code representation depending on subsequent bits, e.g. delay modulation, double density code, Miller code conversion to or from block codes or representations thereof
    • G11B2020/14618 to 14 modulation, e.g. the EFM code used on CDs or mini-discs

Landscapes

  • Engineering & Computer Science (AREA)
  • Signal Processing (AREA)
  • Dc Digital Transmission (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 (産業上の利用分野) 本発明はコンパクトディスク(以下CDと記す)プレー
ヤにおけるEFM (EIGHT To FOURTE
EUMODULAT ION )信号の復調方法に関す
る。
(従来例の構成と問題点) CDに記録されるべき音声信号は、16ビツトでA−D
変換された後8ビツトずつ2ワードに分割され、分割さ
れた各ワードは再生時のビット同期用クロックの抽出を
容易にするためおよびDC成分を少くするため等の目的
で、8ビツトのデータ・ぐターン256組の各々に対応
し庭14ビット信号に変換され、この14ビツト1ワ一
ド信号は3ビットのカプリングビットで他の14ビツト
1ワ一ド信号に接続される。この操作をEFMと云う。
このEFM信号はNRZ −I (No RETURN
 To ZEROINVERTED)符号でディスクに
記録される。再生時は上記と逆の操作即ちEFM復調が
必要となる。従来、上記EFM復調はケ8−ト回路の組
合せで構成される復調回路で行なわれているが、この方
法は必要なケ゛−ト数が多く構成が犬がかりとなる。
また、上記方法の他に前記EFM信号1ワード14ビッ
トをアドレス信号とし、各アドレスに対応した8ビツト
の復調信号を書きこんだROMを用いる方法もあるが、
この方法はEFM信号1ワード14ビットの内、有効な
アドレス(正しい復調信号が書きこまれているアドレス
)は256組のみであり無、駄分が非常に多く実用的と
は云い難い。
(発明の目的) 本発明はこのような問題を解決し、小容量のROMを用
い、かつ、比較的簡易な構成でEFM復調を可能にする
方法を提供するものである。
(発明の構成) 本発明のEFM復調方法は、連続する8ビツトで構成さ
れる第1のグループと、各々連続する3ビツトで構成さ
れる第2及び第3のグループに分割しだEFMされた1
4ビツトコードを、前記連続する8ビツトで構成される
第1のグループを入力し8ビツトのコードパターン中E
FM信号の条件(ランレングス3ビツト以上)を満足す
る28種のコードパターンに対応した5ビツトコードを
出力する第1の変換回路、前記連続する3ビットで構成
される第2及び第3のグループを入力しグループ毎に3
ビツトコ一ド中上記EFM信号条件を満足する4 f!
fiのコードパターンに対応した2ビツトコードを出力
する第2、第3の変換回路、上記第1、第2、第3の変
換出力である9ビツトコードを入力しこれと対応したE
FM復調信号である8ビツトコードに変換する第4の変
換回路、を用いて復調を行なうことを特徴とするもので
あり、これにより上記目的が達成される。
また、本発明のEFM復調方法は、4個の2インプット
オアゲート(又は2インゾツトノアグート)、256X
5ビツトのROM及び51 zxsビットのROM又は
8個の2インプツトオアゲート(又は2インプットノア
ケゝ−ト)、64X4ビツトのROM及び512X8ビ
ツトのROMで構成される回路を用いて実施することが
できる。この構成に際しては14ビツト1ワードのEF
M信号の性質の1つであるアンレングス(NRZ符号、
NRZ−1符号のレベル反転ビット長)が3以上である
ことを利用する。
即ちEFMされた14ビツトコードのNRZ −I符号
中連続する3ビツトを考えると上記EFM信号の性質か
らこの3ビツトの考えられるコード/やターンは000
、 001. 010. 100.の4種類しかないこ
と又この4種類は2ビツトで書きなおすことができるこ
と例えば00. 01. ’11. 10あるいは11
゜10.00,01 (1の3ビツト→2ピツトの変換
はオアゲート又はノアケゝ−トを用いて可能であること
又EFMされた14ビツトコード中の連続する8ピント
を考える。とこの8ビツトコ一ド中上記EFM信号の性
質から考えられるコード・ぐターンは衣−1に示す28
種でありこれは5ビツトコードに変換できることを利用
している。
表−1連続する8ビットコード中のEFM信号の性質か
ら許容されるコード (実施例の説明) 本発明の実施例を第1図〜第4図を用いて説明する。
第1図はCDプレーヤにおけるRF波形整形信号からE
FM復調信号を得る一般的な構成例を示したものである
第1図において1はCDプレーヤにおいて、光ピツクア
ップでピックアップされた信号を波形整形して得られた
信号(第2図(4)参照)を入力し信号の立上り及び立
下り信号を検出して第2図(B)に示すような出力信号
を得るエツジ検出回路、2は前記工、ソ検出回路1出力
でトリガされ時間幅約230μsec (ランレングス
:1)のノeルス(第2図(C)参照)を出力するモノ
ステーブルマルチ、3ハ前記モノステープルマルチ2出
力を第2図(D)ニ示すクロック(f中4.3M)(z
)の立上シエッノ毎に入力するシフトレソスタ、4は前
記シフトレノスタの内容をEFM信号lワード(14ピ
ツト)毎にラッチするラッチ回路、5は本発明によるE
FM復調回路であり前記ランチ回路4出力の14ピント
EFM信号を8ピツトのEFM復調信号に変換して次段
の信号処理部へ送る。
本EFM復調回路5の具体的な構成例を第3図に示す。
第3図において、4は前述のラッチ回路、5はIDFM
復調回路であり、50は前記う、チ回路4出力信号す。
−b7をアドレス入力とし前記連続する8ビツトコード
中のEFM信号として許容されるコード・ぐターン28
種に対応した5ビツトコードdO〜d4を出力する25
6X5ビツトのROJ 51,52,53.54は各々
前記ラッチ回路4出力信号中のb8とbg、bg とb
lotbllと1)12 + l)+2とb13を入力
しd6 ’+ d6 r d7+d8を出力するオアケ
゛−ト、55は前記256X5ビツトのROM 50及
びオアケ”l・51〜54出力であるd。−d8の9ビ
ツトコードをアドレス入力とし前記アドレスに対応した
EFM復調信号である8ビツトコードを出力する512
ノぐイトのROMである。
また、前記2.56 X 5ビツトのROMに替えて第
4図の如き構成も可能である。すなわち、第4図におい
て、500,501,502,503は各各前記ラッチ
回路4出力信号中のb2とb3.b3とb4+b5とb
6 、b6とblを入力としb2′。
b3′、l〕4′、b5′を出力するオアケ8−ト、5
04は前記う、子回路4出力のす。、bl及び前記オア
ケゝ−ト500,501’、502,503の出力’)
2’ p b3’ r b4’ J bS’の計6ビツ
トをアドレス入力とし前記アドレスに対応した5ビ、ト
コードを出力する64×5ピツトのROMであり、本構
成は第3図の50と全く同二機能を有するものである。
寸だ、本発明の場合、第3図、第4図におけるオアケゝ
−トにかえてノアケゞ−トとしてもよい。
本発明のEFM復調方法は、このように、14ビツトの
EFM信号を4つの2インプットオアケ゛−ト(又は2
インプットノアケゞ−ト)と256X5ピツトのROM
あるいは8つの2インプットオアケ8−ト(又は2イン
プ、トノアク8−ト) 64. X 5ビツトのROM
を用いて9ビツトコードに変換するとともに9ビツトコ
ードに変換されだEFM信号に対応する8ビツトコード
(EFM復調信号)を前記9ビツトコードをアドレスと
して512パイ) ノROMに書きこみこれを用いて9
ビット→8ビット回路を構成することにより容易に実施
することができる0 (発明の効果) 以上の説明で明らかなように、本発明によれば、小容量
のROMを用い、かつ比較的簡易な構成でEFM復調を
行なうことが可能となる。
【図面の簡単な説明】
第1図はCDプレーヤにおけるRF波形整形信号からE
FM復調信号を得る一般な構成例を示す図、第2図は第
1図の動作説明用タイムチャート、第3図、第4図は本
発明に用いるEFM復調回路の具体例を示す図である。 4・・・ラッチ回路、5・・・EFM復調回路、50・
・・ROM、 51+52.53,54 ・・・オ ア
ケ8− ト 。 第3図 [tjl;−、)コートJ 第4図

Claims (1)

  1. 【特許請求の範囲】 (]) 連続する8ビツトで構成される第1のグループ
    と、各々連続する3ビツトで構成される第2及び第3の
    グループに分割したEFMされた14ビツトコードを、
    前記連続する8ビツトで構成される第1のグループを入
    力し8ビツトのコードパターン中EFM信号の卑件(ラ
    ンレングス3ビツトυ]二)を満足する28種のコード
    パターンに対応した5ビツトコードを出力する第1の変
    換回路、前記各々連続する3ビツトで構成される第2及
    び第3のグループを入力し、グループ毎に3ビツトコ一
    ド中上記EFM信号条件を満足する4種のコード・?ク
    ーンに対応した2ビツトコードを出力する第2、第3の
    変換回路、上記第1、第2、第3の変換出力である9ビ
    アトコードを入力しこれに対応したEFM復調信号であ
    る8ビツトコードに変換する第4の変換回路、を用いて
    復調を行うことを特徴とするEFM復調方法。 (2) 前記第1の変換回路入力信号(8ビットコード
    )中の各々連続する3ビツトを入力し、3ビツトコード
    中の前記EFM信号条件を満足する4種のコードパター
    ンに対応した2ビットコードを出力する第5、第6の変
    換回路、前記8ビットコード中前記第5及び第6の変換
    回路入力以外の2ピツト及び前記第5、第6の変換回路
    出力の言)6ビツトコードを入力し、これに対応した5
    ピットコ−1・゛を出力する第7の変換回路から前記第
    1の変換回路を構成することを特徴とする特許請求の範
    囲第(])項記載のEFM復調方法。 (3) 前記第1の変換回路を、256X5ビツトのR
    OMを用いて構成することを特徴とする特許請求の範囲
    第(1)項または第(2)項記載のEFM復調方法。 (4) 前記第4の変換回路を、512X8ビツトのR
    OMを用いて構成することを特徴とする特許請求の範囲
    第(1)項から第(3)項のいずれか1項記載のEFM
    復調方法。 (5) 前記第7の変換回路を、64×5ピツトのRO
    Mを用いて構成することを特徴とする特許請求の範囲第
    (2)項から第(4)項のいずれか1項記載のEFM復
    調方法。 (6) 前記第2、第3あるいは第5、第6の変換回路
    を2インプットオアケ8−トを用いて構成することを特
    徴とする特許請求の範囲第(1)項から第(5)項のい
    ずれか1項記載のEFM復調方法。
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Cited By (2)

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Publication number Priority date Publication date Assignee Title
JPH05252046A (ja) * 1991-12-25 1993-09-28 Nec Corp 8−14変調符号復調器
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JPS5899028A (ja) * 1981-12-09 1983-06-13 Hitachi Ltd 符号変換装置

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