JPS6082345U - デ−タ処理システム - Google Patents

デ−タ処理システム

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Publication number
JPS6082345U
JPS6082345U JP17356783U JP17356783U JPS6082345U JP S6082345 U JPS6082345 U JP S6082345U JP 17356783 U JP17356783 U JP 17356783U JP 17356783 U JP17356783 U JP 17356783U JP S6082345 U JPS6082345 U JP S6082345U
Authority
JP
Japan
Prior art keywords
memory section
devices
connection
switching
dma controller
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP17356783U
Other languages
English (en)
Inventor
吉岡 道雄
椛沢 秀男
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Yokogawa Electric Corp
Original Assignee
Yokogawa Electric Corp
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Publication date
Application filed by Yokogawa Electric Corp filed Critical Yokogawa Electric Corp
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Publication of JPS6082345U publication Critical patent/JPS6082345U/ja
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
図は本考案にかかるデータ処理システムの一実施例の構
成ブロック図である。 10.10.〜10n・・・ディバイス、20・・・メ
モリ部、30・・・DMAコントローラ、50・・・切
換回路、60・・・切換スイッチ、70・・・CPU、
1・・・アドレスデコーダ、90・・・切換部。

Claims (1)

    【実用新案登録請求の範囲】
  1. 複数個設けられている信号の入出力を行なうディバイス
    と、該ディバイスの動作に関連した情報を格納している
    メモリ部と、前記ディバイスの前記メモリ部に対するD
    MA動作の制御を行なうDMAコントローラと、前記各
    ディバイスと前記メモリ部の接続を選択的に切り換える
    切換凹座と、前記DMAコントローラのチャネルが接続
    されていて前記各ディバイスとDMAコントローラの接
    続を選択的に切り換える切換スイッチと、前記メモリ部
    に対してDMA動作を行なわせるディバイスのアドレス
    信号を発生するCPUと、アドレス信号を受けてDMA
    動作を行なわせるディバイスにアドレスデコード信号を
    発生するアドレスデコーダと、このアドレスデコード−
    信号が発生したときにどのディバイスを接続すべきかを
    判断して前記切換回路と切換スイッチの接続を切り換え
    る切換部とを具備したことを特徴とするデータ処理シス
    テム。
JP17356783U 1983-11-09 1983-11-09 デ−タ処理システム Pending JPS6082345U (ja)

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JP17356783U JPS6082345U (ja) 1983-11-09 1983-11-09 デ−タ処理システム

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JPS6082345U true JPS6082345U (ja) 1985-06-07

Family

ID=30378078

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