JPS6083350A - 集積回路の製造方法 - Google Patents

集積回路の製造方法

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Publication number
JPS6083350A
JPS6083350A JP58191473A JP19147383A JPS6083350A JP S6083350 A JPS6083350 A JP S6083350A JP 58191473 A JP58191473 A JP 58191473A JP 19147383 A JP19147383 A JP 19147383A JP S6083350 A JPS6083350 A JP S6083350A
Authority
JP
Japan
Prior art keywords
film
bump
integrated circuit
forming
metal
Prior art date
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Pending
Application number
JP58191473A
Other languages
English (en)
Inventor
Katsuhiko Yabe
矢部 勝彦
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
Nippon Electric Co Ltd
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Filing date
Publication date
Application filed by NEC Corp, Nippon Electric Co Ltd filed Critical NEC Corp
Priority to JP58191473A priority Critical patent/JPS6083350A/ja
Publication of JPS6083350A publication Critical patent/JPS6083350A/ja
Pending legal-status Critical Current

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    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00—Interconnections or connectors in packages
    • H10W72/01—Manufacture or treatment
    • H10W72/012—Manufacture or treatment of bump connectors, dummy bumps or thermal bumps
    • H—ELECTRICITY
    • H10—SEMICONDUCTOR DEVICES; ELECTRIC SOLID-STATE DEVICES NOT OTHERWISE PROVIDED FOR
    • H10W—GENERIC PACKAGES, INTERCONNECTIONS, CONNECTORS OR OTHER CONSTRUCTIONAL DETAILS OF DEVICES COVERED BY CLASS H10
    • H10W72/00—Interconnections or connectors in packages
    • H10W72/20—Bump connectors, e.g. solder bumps or copper pillars; Dummy bumps; Thermal bumps
    • H10W72/251—Materials

Landscapes

  • Wire Bonding (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔発明の属する技術分野〕 本発明は集積回路の製造方法に関し、特に外部端子であ
る電極用金バンプを有する集積回路の製造方法に関する
。
〔従来技術〕
従来、集積回路の電極用Auバンプ及び表面保護用のポ
リイミド被膜の形成は、第1図〜第3図に示す如〈実施
されている。
第1図はウェーハ上に第1バンプ並びに第2バンプの形
成された集積回路製造工程の断面図、第2図は表面保護
とバンプのはがれ防止のためにポリイミド被膜を形成し
た集積回路の平面図、第3図は第2図のA−A’断面図
である0 第1図に示すように、拡散、絶縁膜形成、配線工程の終
了したウェーハの絶縁膜5の上に接着層であるTi膜1
、バリヤ層であるpt模膜2全付た後その上に第1バン
プ3、第2バンプ4をAuメッキで形成する。
次いで、第2図、第3図に示すエラに表面保護並びにバ
ンプのはがれ防止の九めポリイミド被膜6を形成する。
ポリイミド被膜はウェーッ・上にポリイミド被膜を翅布
形成した後、露光、現像により第2バンプ4上のポリイ
ミド被膜を除去し、第1バンプ3の端部を覆うように選
択除去する0しかし、第2バンプ4の厚さは10〜25
μmと厚く異常にきつい段差のため、所望のパターン通
りの選択除去が困難で、第1バング3の端部を覆,1つ
ないばかりか、第2バンプ4以外のウェーッ・表面を露
出して形成されることが多い。
このように形成された集積回路では第1バンプ3の端部
が十分覆われていないのでポリイミド被膜6の第1の役
割であるバンプのはがれ防止の役に立たない。また第1
バンプ3及びバンプ以外のウェーハの一部が露出されて
いるので表面保護の面でも不十分であるという欠点がS
,た。
また、この種の集積回路は高温等の過酷な条件下での信
頼性が要求されることがあり、この場合Auバンプ内に
異種金属が狭まれていることは強度劣化、電気的特性の
劣化につながることになるという欠点を有していた。
〔発明の目的〕
本発明の目的は、上記欠点を除去し、ポリイミド被膜は
第1バンプ端部を十分覆い、バンプのはがれ防止を十分
果すと共に過酷な条件下でも信頼性の高い集積回路の製
造方法を提供することにある0 〔発明の構成〕 本発明の集積回路の製造方法は、拡散領域、絶縁膜、配
線を形成したウェーハの前記絶縁膜の上に密着層として
の第1の金属膜、バリヤ層としての第2金属膜及びAu
の第1バンプを順次形成する第1の工程と、前記第1バ
ツグの全部又は一部上に開:孔部を持つポリイミド被膜
を形成する第2の工程と、前記ポリイミド被膜の全表面
に化学薬品でエツチング可能な金属より成る第3の金属
膜を形成する第3の工程と、前記第3:の金属膜の形成
されまたウェーハ上にホトレジスト膜を全面被着し前記
ポリイミド被膜の開孔部より小さな開孔部を前記ポリイ
ミド被膜開孔部に重ねて形成する第4の工程と、前記第
3の金属膜のうち前記開孔部内の第3金属膜を工,チン
グ除去す・・る第15の工程と、前記ホトレジスト膜を
マスクとして前記第3の金属膜を電極として電解Auメ
ッキを・行な・うて第2バンプを形成する第6の工程と
、前記ホトレジスト膜をポリイミド膜を溶解しない有機
性剥離剤で剥離する第7の工程と、前記第3の金属膜を
工,チング除去する第8の工程とを含んで構成される。
〔実施例の説明〕
以下、本発明の実施例について、図面を参照して説明す
る。
第4図(a)〜(g)は本発明の一実施例を説明するた
めの工程順に示した断面図である。
第4図(a)に示すように、拡散、絶縁膜及び配線工程
を終了した集積回路表面の絶縁膜5の上にバンプと絶縁
層との密着層として0.1μm厚のIf i膜1、’p
iとAuバンプのバリヤ層としてのO51μm厚のpt
膜2、及びAuの第1バンプ3を形成する。
次に、第4図(b)に示すように1ウエーハの表面にポ
リイミド被膜を被着させ、第1バンブ3上に第2バンブ
形成用の開孔部9を形成する。このとき第1バンプ3の
端部はポリイミド被膜6により確実に覆われるように形
成する。
次に、第4図(C)に示すように、後の工程で化学薬品
により容易に工,チングされ、またAuメッキの電極と
して好都合な金属として1. Pd、 Ni 、 QH
からなる群から選ばれた金属として0.1μm厚のPd
膜7を全面にスバ、りにより形成する。
次に、第4図(d)に示すように全表面にホトレジスト
膜8を塗布した後ポリイミド被膜6の開孔部9より小さ
な開孔部となるようポリイミド被膜の開孔部に重ねてホ
トレジスト膜8をパターニングし、ホトレジスト膜の開
孔部1oを形成する。
次に、ホトレジスト膜8をマスクとし、ウェーハを塩化
第二鉄、塩酸等にょるPdエツチング液に浸漬し、開孔
部10に露出しているPd膜を選択工、チングにより除
去する。
次に、第4図(e)に示すように、さきに形成したPd
膜7を電極として、開孔部1oに電解Auメ、キにより
20μm厚の第2バンプ4を形成する。
次に、第4図(f)に示すように、ウェーハ上のホトレ
ジスト・1膜8を剥離液で剥離除去する。
次いで、第4図(g)に示すように、Pd膜7を塩化第
二鉄、塩酸等によるPdエツチング液で工、チング除去
する。
以上の工程によって、電極のAuバンプ及び保護ポリイ
ミド被膜が形成できる。
以上形成されたポリイミド被膜は従来のように第2バン
プ形成後でなく、薄い第1バンプ形成後に形成するので
ホトレジストのパターニングは正確に実施することがで
き、第1バンプの端部をポリイミド被膜で十分カバーす
ることができ、従って絶縁層との間でのはがれを確実に
防止することができる。また同様の理由にエリウェーハ
面も露出することがないのでポリイミド被膜の保護膜と
しての役割も十分果すことが可能である。
なお、本実施例では第2バンプ形成前に第1バンプ上に
形成した第3の金属膜であるPd膜を除去した。Pd膜
が第1バンプ、第2バンプ間に介在しても本発明の目的
は達成できるが、この集積回路が高温等の過酷な条件に
さらされると機械的強度の劣化、電気的特性劣化を促進
するが本実施例では第2バンプ形成前に除去されている
ので高信頼性の集積回路とすることができる。
なお、上記実施例では第1金属膜としてT1膜、第2金
属膜としてPt膜を使用し九が、これに限定されるもの
でなく第1金属膜としてはOr 、 Ni0r。
Ta、Mo、第2金属膜としては、Pd、Niの金属膜
が同様に適用することが出来る。 □ 〔発明の効果〕 以上説明したように、本発明によれば、バンプのはがれ
が少なく、表面保護効果が大きく、高信頼性の集積回路
を容易に製造することができる。
【図面の簡単な説明】
第1図は従来のウェーハ上に第1バンプ上第2バンクの
形成された工程の集積回路の断面図、第2図は従来の表
面にポリイミド被膜の形成された集積回路の平面図、第
3図は第2図のA、−A’断面図、第4図(a)〜(g
)は本発明の一実施例を説明するための工程順に示した
断面図である。 1・・・・・・Ti膜、2・・・・・・pt膜、3・・
・・・・第1バンプ、4・・・・・・第2バンプ、5・
・・・・・絶縁膜、6・・・・・・ポリイミド被膜、7
・・・・・・Pd膜、8・・・・・・ホトレジスト膜、
9.10・・・・・・開孔部。 第l 図 凛22 図 第 4 旧

Claims (3)

    【特許請求の範囲】
  1. (1)拡散領域、絶縁膜、配線を形成したウェーハの前
    記絶縁膜の上に密着層としての第1の金属膜、バリヤ層
    としての第2金属膜及びAuの第1バンブを、順次形成
    する第1の工程と、前記第1バンプの全部又は一部上に
    開孔部を持つポリイミド被膜を形成する第2の工程と、
    前記ポリイミド被膜の全表面に化学薬品で工、チング可
    能な金属よシ成る第3の金属膜を形成する第3の工程と
    、前記第3の金属膜の形成されたウェーハ上にホ、トレ
    ジスト腺ヲ全面被着し前記ポリイミド被膜の開孔部より
    小さな開孔部を前記ポリイミド被膜開孔部に重ねて形成
    する第4の工程と、前記第3の金属膜のうち前記開孔部
    内の第3金属膜を工、チング除去する第5の工程と、前
    記ホトレジスト膜をマスクとして前記第3の金属膜を電
    極として電解Auメ、キを行なって第2バンプを形成す
    る第6の工程と、前記ホトレジスト膜をポリイミド膜を
    溶解しない有機性剥離剤で剥離する第7の工程と、前記
    第3の金属膜を工、チング除去する第8の工程とを含む
    ことを特徴とする集積回路の製造方法。
  2. (2)第1の金属膜がTi膜、第2の金属膜がpt膜で
    ある特許請求の範囲第(1)項記載の集積回路の製造方
    法。
  3. (3)化学薬品でエツチング可能な金属がpa、Ni。 Ouからなる群から選ばれた金属でるる特許請求の範囲
    第(1)項又は第(2)項記載の集積回路の製造方法。
JP58191473A 1983-10-13 1983-10-13 集積回路の製造方法 Pending JPS6083350A (ja)

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Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5917231A (en) * 1997-02-17 1999-06-29 Mitsubishi Denki Kabushiki Kaisha Semiconductor device including an insulative layer having a gap

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US5917231A (en) * 1997-02-17 1999-06-29 Mitsubishi Denki Kabushiki Kaisha Semiconductor device including an insulative layer having a gap

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