JPS609374A - サイリスタ変換器の転流失敗保護方式 - Google Patents
サイリスタ変換器の転流失敗保護方式Info
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- JPS609374A JPS609374A JP58114245A JP11424583A JPS609374A JP S609374 A JPS609374 A JP S609374A JP 58114245 A JP58114245 A JP 58114245A JP 11424583 A JP11424583 A JP 11424583A JP S609374 A JPS609374 A JP S609374A
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- H02—GENERATION; CONVERSION OR DISTRIBUTION OF ELECTRIC POWER
- H02M—APPARATUS FOR CONVERSION BETWEEN AC AND AC, BETWEEN AC AND DC, OR BETWEEN DC AND DC, AND FOR USE WITH MAINS OR SIMILAR POWER SUPPLY SYSTEMS; CONVERSION OF DC OR AC INPUT POWER INTO SURGE OUTPUT POWER; CONTROL OR REGULATION THEREOF
- H02M7/00—Conversion of AC power input into DC power output; Conversion of DC power input into AC power output
- H02M7/42—Conversion of DC power input into AC power output without possibility of reversal
- H02M7/44—Conversion of DC power input into AC power output without possibility of reversal by static converters
- H02M7/48—Conversion of DC power input into AC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode
- H02M7/505—Conversion of DC power input into AC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means
- H02M7/515—Conversion of DC power input into AC power output without possibility of reversal by static converters using discharge tubes with control electrode or semiconductor devices with control electrode using devices of a thyratron or thyristor type requiring extinguishing means using semiconductor devices only
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Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の技術分野〕
本発明は高゛電圧ザイリスタダ換装置にお４Ｊる逆変換
監の転流失敗を保静する方式に閂するものＣある。
監の転流失敗を保静する方式に閂するものＣある。
近年、直流送電技術の進歩により人容ｌｉｚ文直久換装
置が設置、運転され・９つあるが系粕、内での牛故に対
して速やかに保ｗシ動作をｆｊないη１． ｐ；ｊ（の
系統へ及１シ：ず影響をｌｄ小限に抑える必要があるっ
１１１に、１″ｊ ’Ｉｔｊ圧リーイすスタ変換装置を
用いるＪｌ、５合ｇ、、１． 、ＨｔＨ；勉換器におけ
る運転中の典型的故障として転流失１１（がある。転流
失敗時の過電流は順変換器の）↑２屯流制御によ−って
数サイクル後には抑制されるが何票」１６器の点弧位相
を転流可能な位相まで急速？いｔ（３に’）る心安があ
る。
置が設置、運転され・９つあるが系粕、内での牛故に対
して速やかに保ｗシ動作をｆｊないη１． ｐ；ｊ（の
系統へ及１シ：ず影響をｌｄ小限に抑える必要があるっ
１１１に、１″ｊ ’Ｉｔｊ圧リーイすスタ変換装置を
用いるＪｌ、５合ｇ、、１． 、ＨｔＨ；勉換器におけ
る運転中の典型的故障として転流失１１（がある。転流
失敗時の過電流は順変換器の）↑２屯流制御によ−って
数サイクル後には抑制されるが何票」１６器の点弧位相
を転流可能な位相まで急速？いｔ（３に’）る心安があ
る。
ｒｆ口図はｉ！ｆ来のサイリスク変換器の転？ｔｆ：失
１（： Ｉ’＋！訛方式の−ｖミ施例、第２図は第１図
の（ｆｊ号のタイムチャートである。第１図におい−Ｃ
１目よ？ぺＥ、Ｑ Ｉ！／４のサイリスタがら拾成され
るザイリスタ変Ｊ’％ （ｉ内の１バルブであす、パル
ス制御回路２はインバータ回路ＩＮＶ−１に接続されそ
の出方はアン１′回ｙｈＡＮＤ−１の入力の一方に接続
されている。バルブの逆電圧を検出するために一般に光
信号を伝送するライトガイド等で接続されている逆゛屯
圧検出回路３はアンド回路ＡＮＤ−１の入力の他方に接
続されており、その出力はパルス発生回路４とインバー
タ回路１ＮＶ−２に接続され各々の出力はアンド回路Ａ
ＮＤ−２に接続されている。
１（： Ｉ’＋！訛方式の−ｖミ施例、第２図は第１図
の（ｆｊ号のタイムチャートである。第１図におい−Ｃ
１目よ？ぺＥ、Ｑ Ｉ！／４のサイリスタがら拾成され
るザイリスタ変Ｊ’％ （ｉ内の１バルブであす、パル
ス制御回路２はインバータ回路ＩＮＶ−１に接続されそ
の出方はアン１′回ｙｈＡＮＤ−１の入力の一方に接続
されている。バルブの逆電圧を検出するために一般に光
信号を伝送するライトガイド等で接続されている逆゛屯
圧検出回路３はアンド回路ＡＮＤ−１の入力の他方に接
続されており、その出力はパルス発生回路４とインバー
タ回路１ＮＶ−２に接続され各々の出力はアンド回路Ａ
ＮＤ−２に接続されている。
いま、逆変換器として運転中のバルブ１の各サイリスタ
のアノード・カソード間に第２図ａで力、される電圧波
形が印加しているとする。パルス制御回路２はバイパス
ペア期間や＞ＴｆＪ、常のめ通期間に相当するパルス制
御信号ｌ）を出力としインバータ回路Ｉ Ｎ Ｖ −１
を通して反転して１６号Ｃを出力とする。信号Ｃはアン
ド回ｊ７ＡＮＤ−１への人力１Ｍ号と、なる。逆゛屯圧
検出回路３はサイリスタの印加電圧波形ａの逆電圧検出
レベルｋＶＬより大きい３！／！ｔ：ｋｊ圧圧検検出逆
゛鴫圧信号ｄ２出力としアンド回路ＡＮＤ−１への入力
信号とする。アンド回船ＡＮＤ−１にてバイパスベア期
間および通常のみ通期間以外の逆゛也圧が検出され、信
号ｅが出力とされる。
のアノード・カソード間に第２図ａで力、される電圧波
形が印加しているとする。パルス制御回路２はバイパス
ペア期間や＞ＴｆＪ、常のめ通期間に相当するパルス制
御信号ｌ）を出力としインバータ回路Ｉ Ｎ Ｖ −１
を通して反転して１６号Ｃを出力とする。信号Ｃはアン
ド回ｊ７ＡＮＤ−１への人力１Ｍ号と、なる。逆゛屯圧
検出回路３はサイリスタの印加電圧波形ａの逆電圧検出
レベルｋＶＬより大きい３！／！ｔ：ｋｊ圧圧検検出逆
゛鴫圧信号ｄ２出力としアンド回路ＡＮＤ−１への入力
信号とする。アンド回船ＡＮＤ−１にてバイパスベア期
間および通常のみ通期間以外の逆゛也圧が検出され、信
号ｅが出力とされる。
パルス発生回路４はイＦｊ号ｅの入力となる時点１．ｊ
たはｔ２から一力三のパルス幅ＴｗのバルスイＦ７．１
．； （る：発生−支る。パルス幅Ｔｗは一般にサイリ
スタの余ｒ合角以上に設定されている。信号ｅはインバ
ータ回ＫＩｌ′１ＩＮＶ−２を通して反転されて信号ｇ
とｌリアンｌ゛回路ΔＮ１）−２への入力となる。アン
ド回１ｒｉ ＡＮＩＩ−２に゛Ｃパルス佃号ｆと信号ｇ
はつき合わされ転？）１１失敗イ５１護信号１１が出力
信号として出される。ｉｉｔ −） ’Ｃ十分な余裕角
の時はパルス信号ｆのパルス幅’Ｊ’ｗυ）時間後に信
号ｇは入力となるが、余１？、角イ・ノν−の時はパル
ス幅＋１゛、の時間内に信号ｇは入力とｌ″ｒ、ろのＣ
アンド回路ΔＮ Ｉ） −２にて転流失敗作ｔ？％ ’
ＩＦｔけ１１が出力とされる。従って転流失敗保詐信号
り全１１１７碗り器の点弧位相の位相進め信号として用
いる（−と１こより二ｊＩ、三重の転流失敗を防止して
いる。
たはｔ２から一力三のパルス幅ＴｗのバルスイＦ７．１
．； （る：発生−支る。パルス幅Ｔｗは一般にサイリ
スタの余ｒ合角以上に設定されている。信号ｅはインバ
ータ回ＫＩｌ′１ＩＮＶ−２を通して反転されて信号ｇ
とｌリアンｌ゛回路ΔＮ１）−２への入力となる。アン
ド回１ｒｉ ＡＮＩＩ−２に゛Ｃパルス佃号ｆと信号ｇ
はつき合わされ転？）１１失敗イ５１護信号１１が出力
信号として出される。ｉｉｔ −） ’Ｃ十分な余裕角
の時はパルス信号ｆのパルス幅’Ｊ’ｗυ）時間後に信
号ｇは入力となるが、余１？、角イ・ノν−の時はパル
ス幅＋１゛、の時間内に信号ｇは入力とｌ″ｒ、ろのＣ
アンド回路ΔＮ Ｉ） −２にて転流失敗作ｔ？％ ’
ＩＦｔけ１１が出力とされる。従って転流失敗保詐信号
り全１１１７碗り器の点弧位相の位相進め信号として用
いる（−と１こより二ｊＩ、三重の転流失敗を防止して
いる。
ところで転流失敗に至るｈλ因としてパルス１１・’ｌ
（ｌｌ’ｌｌ悄号のｔう失による場合が考えられる。
（ｌｌ’ｌｌ悄号のｔう失による場合が考えられる。
ｆ・すえｉｌ、 ＩＪ相のバルブが導；ｒ＋ＩＬ−ｃい
てＶ相のバルブに％＝ 踊、Ｖる時にＶ相のパルスｌ１
ｉｌ制御信号がｔう失しＶ相のバルブが点弧できなく入
相する場合がある。このためＵ相のバルブには逆電圧が
印加せず転流失敗に至る。この場合はＵ相のバルブは導
通状態とな−っているので順゛岨圧、逆電圧がともに印
加しない。
てＶ相のバルブに％＝ 踊、Ｖる時にＶ相のパルスｌ１
ｉｌ制御信号がｔう失しＶ相のバルブが点弧できなく入
相する場合がある。このためＵ相のバルブには逆電圧が
印加せず転流失敗に至る。この場合はＵ相のバルブは導
通状態とな−っているので順゛岨圧、逆電圧がともに印
加しない。
従ってパルス制御信号がそう失した場合には、転流失敗
を保護することができない。
を保護することができない。
特に、２群以上直列に接続される順逆変換器においては
急激な′１ピ流増加によってイホ全７；Ｔ、の逆変換器
も余裕角不足となり転流失敗が連続することがあるがこ
の結果３Ｌ’＋電流は大きくなり不規則な転流によ−っ
て系統電圧の歪みはひどくなり、ます寸ず転流失敗を誘
発する。
急激な′１ピ流増加によってイホ全７；Ｔ、の逆変換器
も余裕角不足となり転流失敗が連続することがあるがこ
の結果３Ｌ’＋電流は大きくなり不規則な転流によ−っ
て系統電圧の歪みはひどくなり、ます寸ず転流失敗を誘
発する。
［発明の目的〕
本発明の目的は上述の従来のゴ＆点を除去するだめにな
されたものであり、 ｆｉｎ単な回路の追加により、二
重、三重の転流失敗を防止するだめのサイリスタ変換器
の転流失敗保護方式を提供することにある。以下回向を
用いて本発明を説明する。
されたものであり、 ｆｉｎ単な回路の追加により、二
重、三重の転流失敗を防止するだめのサイリスタ変換器
の転流失敗保護方式を提供することにある。以下回向を
用いて本発明を説明する。
本発明は、この目的を達成するだめにサイリスクパルプ
の位相制御に用いられる位相検出信号等により、サイリ
スクバルブの転ｔＩＬ失１＋’ｊ ’ｉ） ？１７＋＋
、 実に検出できる（：Ｐにしたものである。
の位相制御に用いられる位相検出信号等により、サイリ
スクバルブの転ｔＩＬ失１＋’ｊ ’ｉ） ？１７＋＋
、 実に検出できる（：Ｐにしたものである。
し発明の実施例）
２５３図は本発明による転流失敗保ＩＬ４回路の一実１
１１、例である。第４図は、第３図の本発明の詳細な説
明するだめの各信号と示すタイツ・チャート’ＣＩ；る
。い−ま、ブリッジ接続された６相のりイリスタバルブ
が、逆変換器とし°〔運転しているＪ、！、５合日１、
各バルブの点弧位相と交流電源とのＷ４係１．１、；Ｉ
Ｔ ４図の波形Ｖに示すとおりである。ｔだ、バルブの
点弧角（鴫は電源波形Ｖに示す点弧角（χ＝θ°の時点
２ｊ： 、１１、準としている。このため一般にサイリ
スクバルブの位相制御を行なう隙には、バルブにかがイ
）グ流′屯源茫検出するだめの位相検出用トランス５を
詑り位相検出回路６により（ｘ−０°を示り０７相イ）
１号」を検出している。位相制御はこのα−（１’ ！
ｊ：Ｊ４゜′Ｉいとして、制御を行なっている。
１１、例である。第４図は、第３図の本発明の詳細な説
明するだめの各信号と示すタイツ・チャート’ＣＩ；る
。い−ま、ブリッジ接続された６相のりイリスタバルブ
が、逆変換器とし°〔運転しているＪ、！、５合日１、
各バルブの点弧位相と交流電源とのＷ４係１．１、；Ｉ
Ｔ ４図の波形Ｖに示すとおりである。ｔだ、バルブの
点弧角（鴫は電源波形Ｖに示す点弧角（χ＝θ°の時点
２ｊ： 、１１、準としている。このため一般にサイリ
スクバルブの位相制御を行なう隙には、バルブにかがイ
）グ流′屯源茫検出するだめの位相検出用トランス５を
詑り位相検出回路６により（ｘ−０°を示り０７相イ）
１号」を検出している。位相制御はこのα−（１’ ！
ｊ：Ｊ４゜′Ｉいとして、制御を行なっている。
い１、ブリッジが、逆変換器運転をしでいる１４，１合
、 ｕ、ｖ、ｗ、ｘ、ｙ、ｚの各バルブにはＬ’Ｔ Ａ
終了後に所定の期間通？ａ圧が加わる。
、 ｕ、ｖ、ｗ、ｘ、ｙ、ｚの各バルブにはＬ’Ｔ Ａ
終了後に所定の期間通？ａ圧が加わる。
この逆電圧は、逆電圧信号ｄによって示され、１″の期
間中、各パルプに′重圧が加わっている。
間中、各パルプに′重圧が加わっている。
この逆電圧信号ｄを６バルプ１どついてオア回路０几−
１へ入力する。また、位相信号ｊ゛はフリップフロップ
回路Ｆｐ−ｔへのセット入力信号となり、リセット人力
には、オア回路０１１・−１の出力遊心圧信号ｄ′が入
力し、位相信号Ｊと逆′醸圧信号ｄ′の期間は＋１１”
となる転流失敗検出信号ｋが出力される。
１へ入力する。また、位相信号ｊ゛はフリップフロップ
回路Ｆｐ−ｔへのセット入力信号となり、リセット人力
には、オア回路０１１・−１の出力遊心圧信号ｄ′が入
力し、位相信号Ｊと逆′醸圧信号ｄ′の期間は＋１１”
となる転流失敗検出信号ｋが出力される。
アンド回路ＡＮＤ−３へは転流失敗検出信号にと位相信
号ｊが入力となり転流失敗信号Ｅを出力する。
号ｊが入力となり転流失敗信号Ｅを出力する。
ブリッジ運転をしている際に、例えば波形Ｖに示す■の
時点でＶバルブのパルス制御信号がそう失した場合、Ｕ
バルブには逆電圧は加わらすＵパルプからＶパルプへの
転流が行なわれない。即ち転訛失敗の状態となりＵバル
ブはｄｊ通状態を継続する。この場合、Ｕバルブの逆電
圧信号は検出されないため、フリップフロップＦＦＩは
リセットされず、転流失敗検出信号には次の２パルプの
逆゛屯圧信号によってリセットされる。従って転流失敗
検出信号には定常運転状態よりも期間が長くなり、位相
信−弓Ｊの出る前にはリセットされていないためアンド
回ｋ”ｒ＋ ＡＮ Ｄ−３ノア ７ ト４ 件カＭ 立
１−７１ｇ ？’ｂ、失敗信号ｌが出力される〇 なお、Ｉ′１５３図に示す様にパルス制御信月の止′ン
さ２り場合の転ｖ；を失敗検出を従来方式Ｃｉｊないξ
、れと本発明の保護方式をオアにして全ての転＋＋Ｉｉ
−失敗に苅し保恐を行なうことも可能である。即イニ）
、従来方式による転流失敗検出信号に金６バルブ１こ−
）いてオア回路ＯＩｔ −３にてオアをとり、木／１コ
明の転１ｊｌｌ。
時点でＶバルブのパルス制御信号がそう失した場合、Ｕ
バルブには逆電圧は加わらすＵパルプからＶパルプへの
転流が行なわれない。即ち転訛失敗の状態となりＵバル
ブはｄｊ通状態を継続する。この場合、Ｕバルブの逆電
圧信号は検出されないため、フリップフロップＦＦＩは
リセットされず、転流失敗検出信号には次の２パルプの
逆゛屯圧信号によってリセットされる。従って転流失敗
検出信号には定常運転状態よりも期間が長くなり、位相
信−弓Ｊの出る前にはリセットされていないためアンド
回ｋ”ｒ＋ ＡＮ Ｄ−３ノア ７ ト４ 件カＭ 立
１−７１ｇ ？’ｂ、失敗信号ｌが出力される〇 なお、Ｉ′１５３図に示す様にパルス制御信月の止′ン
さ２り場合の転ｖ；を失敗検出を従来方式Ｃｉｊないξ
、れと本発明の保護方式をオアにして全ての転＋＋Ｉｉ
−失敗に苅し保恐を行なうことも可能である。即イニ）
、従来方式による転流失敗検出信号に金６バルブ１こ−
）いてオア回路ＯＩｔ −３にてオアをとり、木／１コ
明の転１ｊｌｌ。
失敗信号ｌとオア回路ｏｎ・−２への人力とし転戊先敗
保護信号ｍを出力する。この信号ＩＩＩにＪ、す５゛）
速位相進めを９−Ｊなうことが可能である。”ｒ、 ｋ
ｓオ発明では、６バルプに対し一括での転？７に失Ｉ
ｆ（： ４￥Ｉｒ’％方式に一ついて説明しだが、第３
図に示す木？「ｉ明の追加回路を各バルブ単位に設は位
相検出１４１号、ｊｊ７ｊ ｆｆｊ圧ｆｉｔ号も各パル
プ即位に入力することにより、転流失敗検出をパルプ別
に検出できるのは明Ｉ〕刀・Ｃある。
保護信号ｍを出力する。この信号ＩＩＩにＪ、す５゛）
速位相進めを９−Ｊなうことが可能である。”ｒ、 ｋ
ｓオ発明では、６バルプに対し一括での転？７に失Ｉ
ｆ（： ４￥Ｉｒ’％方式に一ついて説明しだが、第３
図に示す木？「ｉ明の追加回路を各バルブ単位に設は位
相検出１４１号、ｊｊ７ｊ ｆｆｊ圧ｆｉｔ号も各パル
プ即位に入力することにより、転流失敗検出をパルプ別
に検出できるのは明Ｉ〕刀・Ｃある。
［究明の効果〕
以上説明のように、従来パルス制御信号が（う失して転
流失敗に至・つた場合はｑｉ ｔ＆失敗を保賂でさ、り
か一つだが、本発明の転流失敗保ｉｌｈ方式によればバ
ルブにがかる市川の歪み等による転υ１を失敗以外にも
パルスｆ’ＪＩＪ御信号がそう失しＣも確実にし力λも
迅速に転流失敗を検出することが可１１ヒＣある。
流失敗に至・つた場合はｑｉ ｔ＆失敗を保賂でさ、り
か一つだが、本発明の転流失敗保ｉｌｈ方式によればバ
ルブにがかる市川の歪み等による転υ１を失敗以外にも
パルスｆ’ＪＩＪ御信号がそう失しＣも確実にし力λも
迅速に転流失敗を検出することが可１１ヒＣある。
この、先め逆変換器の位相を急速に、ｆムめること力ｉ
゛Ｃぎ、二知、三重の転流失敗を防止することができる
。
゛Ｃぎ、二知、三重の転流失敗を防止することができる
。
４、 図面のｆハｊ単なｔ兄明
第１図は従来のザイリスタ変ツク郵’ｒｉの転流失敗イ
５１コめ装置ｉｉ［のブロック図、柁２図は第１１！￥
１の動作をＨ！’ｔ。
５１コめ装置ｉｉ［のブロック図、柁２図は第１１！￥
１の動作をＨ！’ｔ。
明するだめのタイムチャート、ＥＴＩ図は、本発明によ
るサイリスク変損器の転流失敗検出装（１ツの〕゛ロッ
ク図、第４図は本発明の詳細な説明するだめのタイムチ
ャートである。
るサイリスク変損器の転流失敗検出装（１ツの〕゛ロッ
ク図、第４図は本発明の詳細な説明するだめのタイムチ
ャートである。
１・・・ザイリスタバルプ ２・・・ノくシス１ｌｔｌ
ｌ？ｄ１１回に６３・・・逆′弔圧杉ユ出回路 ４・・
・ノくルス発生回）！ｉ５・・・位相検出用トランス
６・・・位相検出回路（７３１７） 代理人弁理士 則
−近 宸 … （ほか１名）第１図 第２図 １１ 乙２
ｌ？ｄ１１回に６３・・・逆′弔圧杉ユ出回路 ４・・
・ノくルス発生回）！ｉ５・・・位相検出用トランス
６・・・位相検出回路（７３１７） 代理人弁理士 則
−近 宸 … （ほか１名）第１図 第２図 １１ 乙２
Claims (2)
- （１） ブリッジ接続されたサイリスタ変換器において
、サイリスタ変換器の交流ｒｉ源の位相検出信号と、各
バルブの逆電圧検出信号とから導出される転流失敗検出
信号と、前記位相検出信号とのアンド信号により転流失
敗を検出し検眼動作を行なうサイリスタ変換器の転流失
敗保護方式。 - （２） ブリッジ４に続されたサイリスク変換器におい
て、各バルブの余裕角が所定値以下であることを検出す
る余裕角不足検出信号と、或はサイリスク変換器の交流
電源の位相検出信号と各バルブの逆電圧検出信号とから
導出される転流失敗検出イム号と、前記位相検出信号と
のアンド信号により転ηし失敗を検出し保護動作を行な
うサイリスタ要換’４１ｆの転流失敗保護方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58114245A JPS609374A (ja) | 1983-06-27 | 1983-06-27 | サイリスタ変換器の転流失敗保護方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58114245A JPS609374A (ja) | 1983-06-27 | 1983-06-27 | サイリスタ変換器の転流失敗保護方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS609374A true JPS609374A (ja) | 1985-01-18 |
Family
ID=14632918
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58114245A Pending JPS609374A (ja) | 1983-06-27 | 1983-06-27 | サイリスタ変換器の転流失敗保護方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS609374A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0214618A (ja) * | 1988-06-30 | 1990-01-18 | Fujitsu Ltd | デジタルｐｌｌ回路 |
| JPH04179314A (ja) * | 1990-11-14 | 1992-06-26 | Hitachi Ltd | ディジタルｖｆｏ誤差制御方式 |
-
1983
- 1983-06-27 JP JP58114245A patent/JPS609374A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH0214618A (ja) * | 1988-06-30 | 1990-01-18 | Fujitsu Ltd | デジタルｐｌｌ回路 |
| JPH04179314A (ja) * | 1990-11-14 | 1992-06-26 | Hitachi Ltd | ディジタルｖｆｏ誤差制御方式 |
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