JPS6093858A - デイジタル変調方式 - Google Patents

デイジタル変調方式

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Publication number
JPS6093858A
JPS6093858A JP20208783A JP20208783A JPS6093858A JP S6093858 A JPS6093858 A JP S6093858A JP 20208783 A JP20208783 A JP 20208783A JP 20208783 A JP20208783 A JP 20208783A JP S6093858 A JPS6093858 A JP S6093858A
Authority
JP
Japan
Prior art keywords
code word
word
bits
code
consecutive
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP20208783A
Other languages
English (en)
Inventor
Takashi Ito
孝 伊藤
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Mitsubishi Electric Corp
Original Assignee
Mitsubishi Electric Corp
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Filing date
Publication date
Application filed by Mitsubishi Electric Corp filed Critical Mitsubishi Electric Corp
Priority to JP20208783A priority Critical patent/JPS6093858A/ja
Publication of JPS6093858A publication Critical patent/JPS6093858A/ja
Pending legal-status Critical Current

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Classifications

    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11BINFORMATION STORAGE BASED ON RELATIVE MOVEMENT BETWEEN RECORD CARRIER AND TRANSDUCER
    • G11B20/00Signal processing not specific to the method of recording or reproducing; Circuits therefor
    • G11B20/10Digital recording or reproducing
    • G11B20/14Digital recording or reproducing using self-clocking codes
    • G11B20/1403Digital recording or reproducing using self-clocking codes characterised by the use of two levels
    • G11B20/1423Code representation depending on subsequent bits, e.g. delay modulation, double density code, Miller code
    • G11B20/1426Code representation depending on subsequent bits, e.g. delay modulation, double density code, Miller code conversion to or from block codes or representations thereof

Landscapes

  • Engineering & Computer Science (AREA)
  • Signal Processing (AREA)
  • Signal Processing For Digital Recording And Reproducing (AREA)
  • Compression, Expansion, Code Conversion, And Decoders (AREA)
  • Dc Digital Transmission (AREA)

Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 [発明の技術分野] この発明はディジタル変調方式に関し、特に、ディジタ
ル信号を伝送路の特性に適した2値信号に変換するよう
なディジタル変調方式の改良に関する。
[従来技術] ディジタル変調方式は、これまで各種のものが発明され
、伝送路の特性に合わせて選択して使用されている。と
ころで、ディジタル信号が記録されたテープに、消去を
行なわずにさらにディジタル信号を記録して再生を行な
う場合、新たに記録した信号によりそれまでに記録され
ていた信号が十分消去されなければ、再生時に、前に記
録されていた信号に新たに記録した信号が重畳されて再
生されることになる。すなわち、所望の信号に不要な信
号が混入したこととなり、再生信号の品質が悪くなる。
このことは特に高記録密度で記録する場合に顕著である
。これを軽減させる1つの方法として、最長反転間隔(
TlaX)と最短反転間隔(T−In)の比Pを小さく
すれば効果的であることが知られている。
[発明の11 それゆえに、この発明の主たる目的は、入力されたディ
ジタル信号を4ピツトのデータ・ワードに分割し、2’
−16通りのデータ・ワードに対して同一ピットが2以
上5以下連続するとともに、端部においては1以上4以
下連続する7ビツトのコード・ワードを複数個対応させ
、各対応する複数コード・ワードの始端のビットは第1
の論理および第2の論理のものを少なくともそれぞれ1
つずつ含むようにし、このようなアルゴリズムによって
生成されたコード・ワードの各ビットに対して2値のレ
ベルを対応させて伝送路に伝送するようにし、磁気記録
媒体を介してディジタル情報を伝送する場合に最適なデ
ィジタル蛮講方式を提供することである。
この発明の上述の目的およびその他の目的と特徴は以下
に図面を参照して行なう詳細な説明から一層明らかとな
ろう。
[発明の実施例1 第1図はこの発明の一実施例におけるNRZ系変調方式
における4ビツトの入力ディジタル信号とこれに対応す
るコード・ワードの一例を示す図である。第1図におい
て、第1のコード・ワードは終端(右側)がビット「0
」であり、端部においては同一符号のピッ1へが1以上
41ス下連続し、その他の部分においては不同−符号の
ビットが2以上5以下連続して存在する16種類のパタ
ーンを示している。第2のコード・ワードは簡略化のた
め、第1のコード・ワードに対して2の補数の演算をと
った7ピツI・のパターンを示している。
なお、この第1図は一例を示したものであり、入力コー
ド・ワードに対応する第1および第2のコード・ワード
はこれに限定されるものではない。
また、第3のコード・ワードを設定することも可能であ
る。
以下に、第1および第2のコード・ワードの条件につい
て説明する。
第1のコード・ワードの条件 (1) ワード長−7ビットである。
(2) 端部にお番ノる同一符号のビットの連続する数
は1以上4以下である。
(3) 上述の(1)以外の部分における同一符号のビ
ットの連続する数は2以上5以下である。
第2のコード・ワードの条件 上述の第1のコード・ワードの条件に加えて、(1) 
始端のビットの符号が対応する第1のコード・ワードの
始端のビットと2の補数の関係にある。
(2) 第1のコード・ワードの始端における同一符号
のビットの連続する数が1(すなわち第1ビツトと第2
ビツトとで符号が興なる)場合は、対応する第2のコー
ド・ワードの始端においてもその数は1である。
(3) 上述の(2)以外の場合は、第2のコード・ワ
ードの始端における同一符号のビットの連続する数は2
以上4以下である。
第3のコード・ワードの条件 (1) ワード長−7ピットである。
(2) 端部における同一符号のビットの連続する数は
1以上5以下である。
(3) 上述の(2)以外の部分においては同5− 一符号のピッ1〜の連続する数は2以上5以下である。
第2図はこの発明の一実施例による変調過程の一例を示
す図である。第2図において、入力データ・ワードに応
じて、前述の第1図により対応するコード・ワードが複
数個選択される。これらのうち、各ワードの接続部にお
ける同一符号のビットの連続する数が2以−F5以下と
なるような当該接続部直後のコード・ワードが選択され
る。伝送路には選択されたコード・ワードのrOJをレ
ベルrLJに対応させかつ「1」をレベルrHJに対応
させた信号が直列的に送出される。
第2図において、ワードm1号1では第1のコード・ワ
ードが選択され、コード番号0のコード・ワードとの接
続部においては「0」が4個連続しており、上述の条件
を満たしている。この場合、コード番号1において第2
のコード・ワードが選択された場合においても上述の条
件は満たされる。
ワードl@2においては第2のコード・ワードが選択さ
れ、ワード番号1のコード・ワードとの接6一 続部においても上述の条件が満たされているが、第1の
コード・ワードが選択された場合にはrOJが6個連続
することとなり、上述の条件に反する。
上述のこと(、第1および第2のコード・ワードは、第
2図においてコード・ワードを連続的に見てすべての箇
所において同一符号のビットの連続する数が2以上5以
下となるものが選択される。
なお、第3のコード・ワードを選択する場合には、これ
に続いて入力されるデータ・ワードに対応する複数のコ
ード・ワードのうちいずれを選択しても上述の条件に反
する場合も出てくる。この場合においては、当該コード
・ワードの選択は、これに先立つコード・ワードとの接
続部以外に、これに続くコード・ワードとの接続部にお
いても上述の条件が満たされるべく選択を行なわねばな
らない。この発明の一実施例によるNRZ系変調方式に
おいては、検出窓幅(Tv ) −4/ 7 To 、
最長反転間vA(7max )−20/7To 、最短
反転ml (Twin )=8/ 7To 、Tgia
x /Tg+in −2,5どなる。
第3図はこの発明の一実施例を実現するための変調回路
の一例を示す図である。第3図において、入力データ・
ワードは変換手段1によって第1図に示したコード・ワ
ードに変換される。制御手段2は各コード・ワードの接
続部において同一符号のピッ]・の連続する数が2以上
5以下となるコード・ワードを複数のコード・ワードの
中から選択するための制御信号を出力する。選択手段3
は上述の複数のコード・ワードの中から制御信号により
適切なもののみを選択して出力する。ここで、データ・
ワードに対応してコード・ワードを出力する場合に、第
1図に示したごとく第2のコード・ワードは第1のコー
ド・ワードの2の補数である場合には、変換手段1は各
入力データ・ワードに対して第1または第2のいずれか
一方のコード・ワードのみを出力するとともに、選択手
段3は制御信号によって、入力されるコード・ワードに
対して2の補数の演算を行なうか否かの選択を行なうべ
く構成してもよい。NRZ変調手段4は「1」をr 1
1 Jレベルに対応させかつ「0」をrLJに対応させ
て変調信号を伝送路に送出する。
第4図は第3図に示した変調回路によ・)で変調された
信号を復調するための復調回路の一例を示す図である。
第4図において、反転間隔検出手段5は変調信号の同一
レベルが連続する時間を、Tw = 4 / ’7 T
 oを単位として計数する。逆変換手段6は上述の計数
結果をもとにして、NR2表現に変換し、これを第1図
に示すデータ・ワードと同一のディジタル信号を出力す
る。
[発明の効果] 以上のように、この発明によれば、入力されたディジタ
ル信号を順次4ビツトのデータ・ワードに分割し、2’
−16通りのデータ・ワードに対して、同一ビットが2
以上5以下連続しかつ端部において同一ビットが1以上
4以下連続する7ビツトのコード・ワードを複数個対応
ざ1t1各対応する複数のコード・ワードの始端のビッ
トを第1および第2の論理のそれぞれに少なくとも各1
つずつ含むようにして伝送路に伝送するようにしたので
、最長反転間隔(Tgiax)と最短反転W隔9− (Tmln)との比が2.5というように小さくでき、
高記録密度で記録する場合に再生信号の品質を向上でき
る。
【図面の簡単な説明】
第1図は4ピツ1〜の入力ディジタル信号とこれに対応
するコード・ワードの一例を示す図である。 第2図はこの発明の一実施例による変調過程の一例を示
す図である。第3図はこの発明の一実施例が適用される
変調回路の一例を示す概略ブロック図である。第4図は
第3図の変調回路で変調されたディジタル信号をW*す
る復調回路の一例を示す図である。 図において、1は変換手段、2は制御手段、3は選択手
段、4はNRZ変調手段、5は反転間隔検出手段、6は
逆変換手段を示す。 代 理 人 大 岩 増 雄 10− 第1図 0′ll″l 二 I」 ノ−m:と4−・−一

Claims (1)

    【特許請求の範囲】
  1. 入力されたディジタル信号を順次4ピツトで表わされる
    2’−16通りのデータ・ワードに分割し、前記データ
    ・ワードに対して同−論理のビットが2以上5以下連続
    するとともに、前記データ・ワードの端部においては同
    −論理のビットが1以上4以下連続する7ピツトのコー
    ド・ワードを対応させ、各対応する複数コード・ワード
    の始端のビットは第1の論理および第2の論理のものを
    少なくともそれぞれ1つずつ含み、前記アルゴリズムに
    よって生成されたコード・ワードの各ビットに対して2
    値のレベルを対応させ、そのような信号を順次直列的に
    伝送路に送出するようにした、ディジタル変調方式。
JP20208783A 1983-10-26 1983-10-26 デイジタル変調方式 Pending JPS6093858A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP20208783A JPS6093858A (ja) 1983-10-26 1983-10-26 デイジタル変調方式

Applications Claiming Priority (1)

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JP20208783A JPS6093858A (ja) 1983-10-26 1983-10-26 デイジタル変調方式

Publications (1)

Publication Number Publication Date
JPS6093858A true JPS6093858A (ja) 1985-05-25

Family

ID=16451748

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Application Number Title Priority Date Filing Date
JP20208783A Pending JPS6093858A (ja) 1983-10-26 1983-10-26 デイジタル変調方式

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JP (1) JPS6093858A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62500331A (ja) * 1984-09-13 1987-02-05 インデペンデント・ブロ−ドキヤステイング・オ−ソリテイ 記録の前にデイジタル信号を処理するための方法及び装置

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPS62500331A (ja) * 1984-09-13 1987-02-05 インデペンデント・ブロ−ドキヤステイング・オ−ソリテイ 記録の前にデイジタル信号を処理するための方法及び装置

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