JPS6097724A - 接点信号入力回路 - Google Patents
接点信号入力回路Info
- Publication number
- JPS6097724A JPS6097724A JP58206727A JP20672783A JPS6097724A JP S6097724 A JPS6097724 A JP S6097724A JP 58206727 A JP58206727 A JP 58206727A JP 20672783 A JP20672783 A JP 20672783A JP S6097724 A JPS6097724 A JP S6097724A
- Authority
- JP
- Japan
- Prior art keywords
- voltage
- current
- contact
- power supply
- primary winding
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
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-
- H—ELECTRICITY
- H03—ELECTRONIC CIRCUITRY
- H03K—PULSE TECHNIQUE
- H03K19/00—Logic circuits, i.e. having at least two inputs acting on one output; Inverting circuits
Landscapes
- Physics & Mathematics (AREA)
- Engineering & Computer Science (AREA)
- Computer Hardware Design (AREA)
- Computing Systems (AREA)
- General Engineering & Computer Science (AREA)
- Mathematical Physics (AREA)
- Electronic Switches (AREA)
- Logic Circuits (AREA)
- Programmable Controllers (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
く産業上の利用分野〉
本発明は、シークンス制御装置等へ接点信号を入力づる
場合の入力回路に関する。更に詳しく述べれば、５ＶＤ
Ｃ等の低電圧電源を用いて各人ツノ端へ接点信号をセン
スする為のセンス電流を供給し、前記接点信号のＡン・
オフ状態に関連し／ｊセンス電圧信号を０１５ＶＤＣ等
充分な大きさで後続のデジタル論理回路へ伝達すること
が出来る接点信号入力回路に関する。
場合の入力回路に関する。更に詳しく述べれば、５ＶＤ
Ｃ等の低電圧電源を用いて各人ツノ端へ接点信号をセン
スする為のセンス電流を供給し、前記接点信号のＡン・
オフ状態に関連し／ｊセンス電圧信号を０１５ＶＤＣ等
充分な大きさで後続のデジタル論理回路へ伝達すること
が出来る接点信号入力回路に関する。
〈従来技術〉
第１図は従来の接点信号入力回路の餞型例を示４回路図
である。本図において、１．２は入力端子で、これら端
子に接点３ｉｎが接続される一方、線路Ｗ ＋ 、 Ｗ
２が接続されている。線路ＷＩは、センス電流を供給
する為の電流制限抵抗Ｒ０を介し、本回路の後段に接続
される論理回路をＰＨ勢づる電源と同じ、例えば５ｖの
低電圧電源Ｅ１が接続されている。線路Ｗ２はコモンラ
インとなっている。Ｒ＋ 、Ｃ＋は接点Ｓｉ ｎにクリ
ーニング電流を供給する為の時定数回路を構成する抵抗
並びにコンデンサ−Ｃある。線路Ｗ１中に段εノられた
ダイオードＤ１は、接１１３ｉｎが外部の池の負荷を合
わけて操作しているどき電流が回路に流れ込まないよう
にＬＪる為の電流逆流防止用ダイＡ−ドである。Ｂ２は
、クイＡ−ドＤ＋の順方向電圧を相殺づる為に線路１−
１に挿入された補償用ダイオードである。Ｒ２は受信抵
抗、Ｃ２は接点入ツノ信号のヂャタリング成分を平滑づ
る為のコンデンサ、Ｂ１は受信抵抗Ｒ２の両端電圧を増
幅して後続の論理回路にノｊえるバッファ増幅器で、５
ｖの低電圧電源「２か電源とし゛〔加えられている。
である。本図において、１．２は入力端子で、これら端
子に接点３ｉｎが接続される一方、線路Ｗ ＋ 、 Ｗ
２が接続されている。線路ＷＩは、センス電流を供給
する為の電流制限抵抗Ｒ０を介し、本回路の後段に接続
される論理回路をＰＨ勢づる電源と同じ、例えば５ｖの
低電圧電源Ｅ１が接続されている。線路Ｗ２はコモンラ
インとなっている。Ｒ＋ 、Ｃ＋は接点Ｓｉ ｎにクリ
ーニング電流を供給する為の時定数回路を構成する抵抗
並びにコンデンサ−Ｃある。線路Ｗ１中に段εノられた
ダイオードＤ１は、接１１３ｉｎが外部の池の負荷を合
わけて操作しているどき電流が回路に流れ込まないよう
にＬＪる為の電流逆流防止用ダイＡ−ドである。Ｂ２は
、クイＡ−ドＤ＋の順方向電圧を相殺づる為に線路１−
１に挿入された補償用ダイオードである。Ｒ２は受信抵
抗、Ｃ２は接点入ツノ信号のヂャタリング成分を平滑づ
る為のコンデンサ、Ｂ１は受信抵抗Ｒ２の両端電圧を増
幅して後続の論理回路にノｊえるバッファ増幅器で、５
ｖの低電圧電源「２か電源とし゛〔加えられている。
回路定数を第１図中に記入したように定めＩこ場合、接
点３ｉｎのＡン・Δ）動作に対して第２図に示づような
動作をする。第２図に於いて図（ａ）は接Ｊ気３ｉｎの
動作状態を、 図（ｂ）はコンデンサＣ１の両端電圧ｅ
ｃｌを、 図（Ｃ）は接点ＳｉｎのＡン・Ａノ動作に応
じて流れる電流１１の状態を、図（ｄ）はバッファ増幅
器Ｂ１の人ノｊ電圧ｅ Ｃ２の状態を夫々示１波形図で
ある。
点３ｉｎのＡン・Δ）動作に対して第２図に示づような
動作をする。第２図に於いて図（ａ）は接Ｊ気３ｉｎの
動作状態を、 図（ｂ）はコンデンサＣ１の両端電圧ｅ
ｃｌを、 図（Ｃ）は接点ＳｉｎのＡン・Ａノ動作に応
じて流れる電流１１の状態を、図（ｄ）はバッファ増幅
器Ｂ１の人ノｊ電圧ｅ Ｃ２の状態を夫々示１波形図で
ある。
バッフ？増幅器１３盲を例えばＣ−ＭＯ８論理素子で構
成したとき、ルベル（「１は入力端子が５Ｖ、Ｏレベル
値は入力電圧がＯ■となるようにＪれば理想的であるが
、実際には接点信号入力回路はルベルが下降傾向を持ち
、０レベルが上脣Ｊる傾向を持つ。これは接点３ｉｎの
導線抵抗がＯレベルを上昇させ、接点３ｉｎの絶縁低下
がルベルを下降さぼるからである。
成したとき、ルベル（「１は入力端子が５Ｖ、Ｏレベル
値は入力電圧がＯ■となるようにＪれば理想的であるが
、実際には接点信号入力回路はルベルが下降傾向を持ち
、０レベルが上脣Ｊる傾向を持つ。これは接点３ｉｎの
導線抵抗がＯレベルを上昇させ、接点３ｉｎの絶縁低下
がルベルを下降さぼるからである。
〈従来技術の欠点〉
第１図に示Ｊ従来回路の場合、 第２図（ｄ）で示すよ
うにルベル値は４Ｖ１０レベル値は０．７５ Ｖとなり
、ルベル並びに０レベルのスレシホールド・マージンを
低下させる欠点があった。
うにルベル値は４Ｖ１０レベル値は０．７５ Ｖとなり
、ルベル並びに０レベルのスレシホールド・マージンを
低下させる欠点があった。
単純に、ルベルの電圧を上昇さゼる為に、電源Ｅ、を５
■から６ｖに上げただけでは、ルベルのスレシホールド
・マージンの向上は計れるが、Ｏレベルの電圧は０，７
５ Ｖから１．４ｖに上って、Ｏレベルのスレッシホー
ルド・マージンは低下してしまう。
■から６ｖに上げただけでは、ルベルのスレシホールド
・マージンの向上は計れるが、Ｏレベルの電圧は０，７
５ Ｖから１．４ｖに上って、Ｏレベルのスレッシホー
ルド・マージンは低下してしまう。
電源Ｅ１を電源［２より高く選び、ダイオードＤｏをイ
４加する方法も考えられるが、電源に別種の電源が必要
どなり、それだ【ノー１ストが嵩むことになる。
４加する方法も考えられるが、電源に別種の電源が必要
どなり、それだ【ノー１ストが嵩むことになる。
〈目的〉
本発明の［１的は、木図ＷＢの後段に接続される論理回
路をｊｌｌシリる電源と同じイ１（電圧電源を用いなが
ら、変化幅の人さなセンス電圧を出力出来る接点信号入
力回路を実現することにある。
路をｊｌｌシリる電源と同じイ１（電圧電源を用いなが
ら、変化幅の人さなセンス電圧を出力出来る接点信号入
力回路を実現することにある。
〈発明の構成〉
本発明の構成は、１次巻線、２次巻線を有りる相互イン
ダクタンス手段と、前記１次巻線を第１の極性で電源へ
接続して電流を注入づる第１のスイッチと、ｎａ記記法
次巻線第２の極１１で電源へ接続して電流を放出さける
第２のスイッチと、前記２次巻線の入力端子に接続され
た接点と、前記１次巻線に接続された受信抵抗とを段【
〕、前記電源にこの回路の後段に接続された論理回路を
附勢する電源と同じｌｉｔ電圧電源を用い、前記１次巻
線の電流放出期間に前記接点信号をセンスする為のセン
ス電流を前記２次巻線側に流し、前記接点の状態に応じ
た前記２次巻線の両端電圧を前記１次巻線に伝達し、前
記受信抵抗より前記接点信号のセンス電圧を発生させる
ようにしたものである。
ダクタンス手段と、前記１次巻線を第１の極性で電源へ
接続して電流を注入づる第１のスイッチと、ｎａ記記法
次巻線第２の極１１で電源へ接続して電流を放出さける
第２のスイッチと、前記２次巻線の入力端子に接続され
た接点と、前記１次巻線に接続された受信抵抗とを段【
〕、前記電源にこの回路の後段に接続された論理回路を
附勢する電源と同じｌｉｔ電圧電源を用い、前記１次巻
線の電流放出期間に前記接点信号をセンスする為のセン
ス電流を前記２次巻線側に流し、前記接点の状態に応じ
た前記２次巻線の両端電圧を前記１次巻線に伝達し、前
記受信抵抗より前記接点信号のセンス電圧を発生させる
ようにしたものである。
〈実施例〉
第３図は本発明の実施例を示Ｊ回路図である。
本図において、第２図におりる要素と実質的に同じ要素
には同一符号をイリし説明は省略づる。１１は１次膠線
し＋ 、２次巻線Ｌ２より構成された相ｎインダクタン
ス手段どし−Ｃの変成器で、１次、２次の巻線比１：１
の単純なセパレーション・タイプのものが用いられる。
には同一符号をイリし説明は省略づる。１１は１次膠線
し＋ 、２次巻線Ｌ２より構成された相ｎインダクタン
ス手段どし−Ｃの変成器で、１次、２次の巻線比１：１
の単純なセパレーション・タイプのものが用いられる。
電源Ｅ１と電流制限抵抗Ｒ９に接続されたスイッチ３
Ｗ １０１、 並びにコモンと１次巻線Ｌ＋の一端にダ
イオードＤ３を介し接続されたスイッチＳ Ｗ １０２
とは、１次巻線１１に第１の極性で電流を注入する為の
第１のスイッチを構成する。尚、ダイオードＤ３は１次
巻線り、への電流の方向を限定するために挿入されてい
る。
Ｗ １０１、 並びにコモンと１次巻線Ｌ＋の一端にダ
イオードＤ３を介し接続されたスイッチＳ Ｗ １０２
とは、１次巻線１１に第１の極性で電流を注入する為の
第１のスイッチを構成する。尚、ダイオードＤ３は１次
巻線り、への電流の方向を限定するために挿入されてい
る。
コモンと、 スイッチＳ Ｗ １０１と電流制限抵抗Ｒ
ｏとの接続点に接続されたスイッチ５Ｗ２０１、並びに
５ｖの低電圧電源Ｅ３と、 スイツｙ−８Ｗ１０２どク
イＡ ド１つ３どの接続点との間に接続されたスイッチ
５Ｗ２０２は１次逆線し！に第２の極性で電源を接続し
て電流を放出させる為の第２のスイッチを構成覆る。
ｏとの接続点に接続されたスイッチ５Ｗ２０１、並びに
５ｖの低電圧電源Ｅ３と、 スイツｙ−８Ｗ１０２どク
イＡ ド１つ３どの接続点との間に接続されたスイッチ
５Ｗ２０２は１次逆線し！に第２の極性で電源を接続し
て電流を放出させる為の第２のスイッチを構成覆る。
Ｏム記第１のスイッチど第２のスインＪ−とを相？ｉｌ
ｉ的に繰り返し操作Ｍるとぎ、前記第１のスイッチを介
して１次巻線（−１に電流が注入され、前記第２のスイ
ッチを介し、１次巻線Ｌ１から電源へ電流が還元される
。この還元電流は２次巻線Ｌ２にも分流し、コンデンサ
Ｃ＋を充電づるが、この」ンデン勺の両端電圧が１次巻
Ｐｉｔ Ｌ、 ＋の電源電圧に達づると、２次巻線Ｌ２
へのエネルギー注入は起らなくなり、１次巻線Ｌ１のみ
を通って還元電流が流れる。
ｉ的に繰り返し操作Ｍるとぎ、前記第１のスイッチを介
して１次巻線（−１に電流が注入され、前記第２のスイ
ッチを介し、１次巻線Ｌ１から電源へ電流が還元される
。この還元電流は２次巻線Ｌ２にも分流し、コンデンサ
Ｃ＋を充電づるが、この」ンデン勺の両端電圧が１次巻
Ｐｉｔ Ｌ、 ＋の電源電圧に達づると、２次巻線Ｌ２
へのエネルギー注入は起らなくなり、１次巻線Ｌ１のみ
を通って還元電流が流れる。
接点３ｉｎがΔ）状態で１つ、電流還元時には、５■の
電源Ｅ３がダイオードＤ、ｌｌ！Ｉを介して接続される
為、クイオードＤ３のアノード側には、５■の電源電圧
より高い電圧が発生する。このときのビークｒＵｉ圧の
充電によってコンデンサＣ２の電圧ｅＣ２は５■に保持
される。
電源Ｅ３がダイオードＤ、ｌｌ！Ｉを介して接続される
為、クイオードＤ３のアノード側には、５■の電源電圧
より高い電圧が発生する。このときのビークｒＵｉ圧の
充電によってコンデンサＣ２の電圧ｅＣ２は５■に保持
される。
−ｎ ％接点３ ｉ ｎがＡン状態で且つ、電流還元時
には、変成器［＋０２次側のインピーダンスが低く、電
流は２次巻線Ｌ２のみを流れる。 この電流によって２
次巻線に発生した電圧は１次巻線［１に複写され、この
電圧がダイオードＤ２１１！！を介した値となって与え
られ、コンデンサＣ２にはビＤ電圧が伝達される。
には、変成器［＋０２次側のインピーダンスが低く、電
流は２次巻線Ｌ２のみを流れる。 この電流によって２
次巻線に発生した電圧は１次巻線［１に複写され、この
電圧がダイオードＤ２１１！！を介した値となって与え
られ、コンデンサＣ２にはビＤ電圧が伝達される。
第４図は複数の接点信号入力回路を一式のスイッチで附
勢する場合の実施例を承り回路図である。
勢する場合の実施例を承り回路図である。
本図において、第１図及び第３図にＪハブる要素と実質
的に同じ要素には同一符号がイー１されている。
的に同じ要素には同一符号がイー１されている。
５Ｗ１０１ ’ 、 ５Ｗ１０２ ’ は第１のスイッ
チを構成づる１−ランジスタで、夫々のベースにバッフ
ァ増幅器Ｂ２ 、Ｂ３を介し例えば２５０Ｋ ｌ−Ｉ
Ｚのスイッチング信号が加えられている。５Ｗ２０１
’ 、 ５Ｗ２０２′ は第２のスイッチを構成づるダ
イオードである。
チを構成づる１−ランジスタで、夫々のベースにバッフ
ァ増幅器Ｂ２ 、Ｂ３を介し例えば２５０Ｋ ｌ−Ｉ
Ｚのスイッチング信号が加えられている。５Ｗ２０１
’ 、 ５Ｗ２０２′ は第２のスイッチを構成づるダ
イオードである。
図中に記入したように定数を定めた場合、第５図の波形
図で示すような動作をする。第５図に於い−Ｃ図（ａ）
は接点３ｉｎの動作状態を、図（ｂ）は１次巻Ｅｌｌ
１．、 ＋を流れる電流１［＋の状態を、図（Ｃ）は２
次谷線Ｌ２を流れる電流ＩＬ２の状態を、図（ｄ）は前
記第１スイツヂの状態を承り波形図である。
図で示すような動作をする。第５図に於い−Ｃ図（ａ）
は接点３ｉｎの動作状態を、図（ｂ）は１次巻Ｅｌｌ
１．、 ＋を流れる電流１［＋の状態を、図（Ｃ）は２
次谷線Ｌ２を流れる電流ＩＬ２の状態を、図（ｄ）は前
記第１スイツヂの状態を承り波形図である。
接点３ ｉ ｎがＡフのとさ、ｆｆＲ流の還元は、１す
］間Ｔａで起こり、 電流制限抵抗Ｒｏとクイオード５
Ｗ２０１’ どの接続点には、 」モンがらダイＡ−ｌ
’５Ｗ２０１ ’ ノＪ：ｏツ７分０．５ｖを差引イタ
、−Ｏ，！ｉＶの電ハ゛ｃ 「” 、が発生し、グイＡ
−ド］〕２のアノード側に１．Ｌ、１−５■の電源Ｅ３
に２個のダイオード３Ｗ２０２ ’ 、Ｄ３によるドロ
ップ分を加えた電圧ｅ「２が発生し、ダイオード５Ｗ２
０２’とダイオードＤ３との接続点には、ｒｒｉ源Ｅ３
にダイオード５Ｗ２０１’ のダイオード・ドロップ分
を加えた＋５．５Ｖの電圧ｅｆ、が光′Ｕ！Ｊる。コン
デン”ｊ’ Ｃ２は、このときのピーク電圧にＪｚっＣ
充電され、この二Ｊンｉ′ンυの両端電圧ｅｃ２は５Ｖ
に保持される。
］間Ｔａで起こり、 電流制限抵抗Ｒｏとクイオード５
Ｗ２０１’ どの接続点には、 」モンがらダイＡ−ｌ
’５Ｗ２０１ ’ ノＪ：ｏツ７分０．５ｖを差引イタ
、−Ｏ，！ｉＶの電ハ゛ｃ 「” 、が発生し、グイＡ
−ド］〕２のアノード側に１．Ｌ、１−５■の電源Ｅ３
に２個のダイオード３Ｗ２０２ ’ 、Ｄ３によるドロ
ップ分を加えた電圧ｅ「２が発生し、ダイオード５Ｗ２
０２’とダイオードＤ３との接続点には、ｒｒｉ源Ｅ３
にダイオード５Ｗ２０１’ のダイオード・ドロップ分
を加えた＋５．５Ｖの電圧ｅｆ、が光′Ｕ！Ｊる。コン
デン”ｊ’ Ｃ２は、このときのピーク電圧にＪｚっＣ
充電され、この二Ｊンｉ′ンυの両端電圧ｅｃ２は５Ｖ
に保持される。
一ノｊ接点Ｓｉ ｎがＡンのどさ、還元電流は２次１！
する。 このとき、 ２次巻ＩＩＬ−２の両端には、０
．７５ Ｖ （タイ；ｔ ｔ’Ｄ＋ （７）Ｆロｙフ分
０，５Ｖｋ：、１００Ｊ−ムの抵抗Ｒ＋を平均電流２．
５ｍＡが流れたことによって生じたドロップ分を加えた
電圧）が発生し、 これが１次巻線に複写される。 こ
ノ０，７５ Ｖハブ Ｔ：ンカラ’ｊ イＡ−ト５Ｗ２
０１ ’ 。
する。 このとき、 ２次巻ＩＩＬ−２の両端には、０
．７５ Ｖ （タイ；ｔ ｔ’Ｄ＋ （７）Ｆロｙフ分
０，５Ｖｋ：、１００Ｊ−ムの抵抗Ｒ＋を平均電流２．
５ｍＡが流れたことによって生じたドロップ分を加えた
電圧）が発生し、 これが１次巻線に複写される。 こ
ノ０，７５ Ｖハブ Ｔ：ンカラ’ｊ イＡ−ト５Ｗ２
０１ ’ 。
Ｄ２の２個のダイオード・ドロップ分を介した値となっ
てコンデンサＣ２に伝達される為、コンデン４Ｊ−０２
には１口電圧が伝達される。
てコンデンサＣ２に伝達される為、コンデン４Ｊ−０２
には１口電圧が伝達される。
〈効果〉
本発明によれば、相互インダクタンス手段を有効に利用
することによって、後続の論理回路を附勢Ｊる電源と同
じ低電圧電源を用い、電源電圧以−Ｌの電圧を発生する
ことが出来、ルベル、Ｏレベル何れの場合も充分なスレ
シホールド・マージンのあるセンス電ＩＥが得られる。
することによって、後続の論理回路を附勢Ｊる電源と同
じ低電圧電源を用い、電源電圧以−Ｌの電圧を発生する
ことが出来、ルベル、Ｏレベル何れの場合も充分なスレ
シホールド・マージンのあるセンス電ＩＥが得られる。
更に、回路中に前記相互インダクタンス手段による絶縁
要素が付加された為、装置内外のコモン電位差の影響を
受番ノることがなく、且つ高耐Ｌ」−が
要素が付加された為、装置内外のコモン電位差の影響を
受番ノることがなく、且つ高耐Ｌ」−が
第１図は従来の接自信号入力回路の曲型例を示１回路図
、第２図は第１図に承り従来回路の動作を説明する為の
波形図、第３図は本発明の実施例を示す回路図、第４図
は本発明の他の実施例を示Ｊ回路図、第５図は第４図に
示す本発明の実施例回路の動作を説明−４る為に波形図
でである。 １１・・・相互インダクタンス手段、１−１・・・１次
巻線、１−２・・・２次巻線、５Ｗ１０１ 、５Ｗ１０
２ 、５Ｗ１０１ ’ 、 ５Ｗ１０２ ’ ・・・第
１のスイッチを購成するスイッチ、 ５Ｗ２０１ 、５
Ｗ２０２ 、５Ｗ２０１ ’ 。 ５Ｗ２０２’ ・・・第２のスイッチを構成するスイッ
チ、３ ｉ ｎ ＝・・接点、 Ｒ２・・・受信抵抗、
Ｅ＋ 、Ｒ２。 Ｒ３・・・同種の低電Ｆ１電源。
、第２図は第１図に承り従来回路の動作を説明する為の
波形図、第３図は本発明の実施例を示す回路図、第４図
は本発明の他の実施例を示Ｊ回路図、第５図は第４図に
示す本発明の実施例回路の動作を説明−４る為に波形図
でである。 １１・・・相互インダクタンス手段、１−１・・・１次
巻線、１−２・・・２次巻線、５Ｗ１０１ 、５Ｗ１０
２ 、５Ｗ１０１ ’ 、 ５Ｗ１０２ ’ ・・・第
１のスイッチを購成するスイッチ、 ５Ｗ２０１ 、５
Ｗ２０２ 、５Ｗ２０１ ’ 。 ５Ｗ２０２’ ・・・第２のスイッチを構成するスイッ
チ、３ ｉ ｎ ＝・・接点、 Ｒ２・・・受信抵抗、
Ｅ＋ 、Ｒ２。 Ｒ３・・・同種の低電Ｆ１電源。
Claims (1)
- １次巻線、２次巻線をイｊする相ｎ、イングクタンス手
段と、前記１次巻線を第１の極性で電源へ接続して電流
を注入覆る第１のスイッチと、前記１次巻線を第２の極
性で電源へ接続して電流を放出さゼる第２のスイッチと
、前記２次巻線の入力端子に接続された接点と、ｎｔｓ
記１次巻線に接続された、前記接点の状態をレンス乃る
受信抵抗とを有し、前記電源としてこの回路の後段に接
続される論理回路を附勢りる電源と同じ低電圧電源を用
い、前記１次巻線の電ＩＪｆｊ放出期間に前記接点信号
をセンスづる為のセンス電流を前６［！２次巻線側に流
し、前記接点の状態に応じた前記２次巻線の両端電圧を
前記１次巻線に伝達し、前記受信抵抗より前記接点信号
のセンス電ｌ工を発生させるＪ：うにした接点信号入力
回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58206727A JPS6097724A (ja) | 1983-11-02 | 1983-11-02 | 接点信号入力回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP58206727A JPS6097724A (ja) | 1983-11-02 | 1983-11-02 | 接点信号入力回路 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS6097724A true JPS6097724A (ja) | 1985-05-31 |
Family
ID=16528102
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP58206727A Pending JPS6097724A (ja) | 1983-11-02 | 1983-11-02 | 接点信号入力回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6097724A (ja) |
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6335325U (ja) * | 1986-08-26 | 1988-03-07 |
-
1983
- 1983-11-02 JP JP58206727A patent/JPS6097724A/ja active Pending
Cited By (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6335325U (ja) * | 1986-08-26 | 1988-03-07 |
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