JPS61114294A - 2値画信号の太め回路 - Google Patents

2値画信号の太め回路

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Publication number
JPS61114294A
JPS61114294A JP59235284A JP23528484A JPS61114294A JP S61114294 A JPS61114294 A JP S61114294A JP 59235284 A JP59235284 A JP 59235284A JP 23528484 A JP23528484 A JP 23528484A JP S61114294 A JPS61114294 A JP S61114294A
Authority
JP
Japan
Prior art keywords
pixel
flip
shift register
signal
pixels
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Pending
Application number
JP59235284A
Other languages
English (en)
Inventor
富田 靖治
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
NEC Corp
Original Assignee
NEC Corp
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Filing date
Publication date
Application filed by NEC Corp filed Critical NEC Corp
Priority to JP59235284A priority Critical patent/JPS61114294A/ja
Publication of JPS61114294A publication Critical patent/JPS61114294A/ja
Pending legal-status Critical Current

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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【発明の詳細な説明】 〔産業上の利用分野〕 本発明はフォント出力装置の画質改善回路に関するもの
である。
〔従来の技術〕
従来z 600LPI(Line Per Inch)
程度の高解像度のスキャナーで活字版下を読みとシ記録
したものと、電子編集によって電子的にフォントを作成
し記録したものを比較すると、電子的にフォントを作成
し記録した記録面の方が文字の太さがやや細くなる傾向
があった。
〔発明が解決しようとする問題点〕
このため、数4−ジの印刷物の一部に活字版下を用い、
一部に電子編集による版下を用いる必要がある場合1文
字の太さがページによって異なり。
読者に不自然な感じを与えるという欠点があった。
本発明の目的は、電子編集によって作られたフォントを
記録時に太めることにより、活字版下に近い記録面が得
られる2値画信号の太め回路を提供することにある。
〔問題点を解決するための手段〕
本発明によれば、入力端子に受けた現在走査している2
値画信号を1画素づつ3画素分遅延する。
直列接続された第1.第2及び第3のフリップフロップ
と、前記2値画信号を1走査分遅延する第1のシフトレ
ジスタと、該第1のシフトレジスタによって1走査分遅
延した2値画確信号を1画素づつ3画素分遅延する。直
列接続された第4.第5及び第6のフリップフロップと
、前記第1のシフトレジスタの出力信号を1走査分遅延
する第2のシフトレジスタと、該第2のシフトレジスタ
の出力信号を1画素づつ3画素分遅延する。直列液め用
意された所定の・ぐターンと一致した時に、該局所領域
の中央画素を白画素から黒画素に変換することによ多画
像を太める手段とを有することを特徴とする2値画信号
の太め回路が得られる。
即ち2本発明は、入力2値画像信号に基づいて。
原画像中の3×3画素から太めるか否かを決定するため
に2画素を遅延させる9つのフリップフロップと、走査
線を遅延させる2つのシフトレジスタと、上記フリップ
フロップの出力に接続される例えば読み出し専用メモI
J (ROM)からなる画像を太める手段とを備えてい
る。
〔実施例〕
以下5図面を参照して本発明の詳細な説明する。
第1図は本発明の一実施例による2値画信号の太め回路
のブロック図である。第1図において。
1.2.3は入力端子INに入力された2値画信号を1
画素づつ遅延する直列接続された第1.第2及び第3の
フリップフロップ、4は入力端子INに入力された2値
画信号の1ライン分の遅延を行う第1のシフトレジスタ
、 5,6.7は第1のシフトレジスタ4の出力信号を
1画素づつ遅延する直列接続された第4.第5及び第6
のフリップフロップ、8は第1のシフトレジスタ4の出
力信号の1ライン分ノ遅延を行う第2のシフトレジスタ
、 9,10.11は第2のシフトレジスタ8の出力信
号を1画素づつ遅延する直列接続された第7.第8及び
第9のフリップフロップ、12は表1及び表2に示す内
容が書きこまれた読み出し専用メモリ(ROM)である
。表1及び表2において II I IIは黒画素;I
 Q IIは白画素を示す。入力画信号の第1ライン目
はフリップフロップ1,2.3によって1画素づつ遅延
され、 ROM12のアドレスAO、AI  r A2
に入力される。また、入力画信号は、第1のシフトレジ
スタ4によって1ライン遅延され、さらにフリップフロ
ップ5,6.7によって1画素づつ遅延されROM12
のアドレスA3 、A4  、A5に入力される。
また、入力画信号は、第1のシフトレジスタ4と第2の
シフトレジスタ8によって2ライン分遅延され、さらに
フリップフロップ9,10;11によって1画素づつ遅
延され、 ROM12のアドレスA6  * A7tA
8に入力される。ROM12には前述したように表1及
び表2に示した内容が書かれているので、第2図のよう
にROM12のアドレスを定義すれば、第3図(a)及
び(b)のように中央画素が白画素から黒画素に変換さ
れ、出力端子OUTに出力される。このように読み出し
専用メモリ(ROM)12は、原画像中の3×3画素の
局所領域が予め用意された所定のノやターンと一致した
時に、該局所領域の中央画素を白画素から黒画素に変換
することによ92画像を太める手段を構成している。す
なわち、第3図に示すように文字のつぶれを生じさせず
に、白画素から黒画素の変換が行なわれる。
以下余白 〔発明の効果〕 以上説明したように本発明によれば、原画像中の3×3
画素の局所領域があらかじめ用意した・ぐターンと一致
した時、白画素から黒画素に変換するので1文字のつぶ
れを生じさせずに1画像の太め処理が可能となるという
効果がある。
【図面の簡単な説明】
第1図は本発明による2画素信号の太め回路の構成を示
したブロック図、第2図はROMアドレスと画素の位置
の関係を示した図、第3図(a)及び(b)は本発明に
よる画素変換例を示す図である。 1・・・フリップフロツノ、2・・・フリッゾフロッf
。 3・・・フリップフロップ、4・・・シフトレジスタ、
5・・・フリップフロップ、6・・・フリップフロップ
、7・・・フIJ ノブフロップ、8・・・シフトレジ
スタ、9・・・フリップフロップ、10・・・フリップ
フロップ、11・・・フリップフロツノ、12・・・R
OM 。 斥

Claims (1)

    【特許請求の範囲】
  1. 1、入力端子に受けた現在走査している2値画信号を1
    画素づつ3画素分遅延する、直列接続された第1、第2
    及び第3のフリップフロップと、前記2値画信号を1走
    査分遅延する第1のシフトレジスタと、該第1のシフト
    レジスタによって1走査分遅延した2値画一信号を1画
    素づつ3画素分遅延する、直列接続された第4、第5及
    び第6のフリップフロップと、前記第1のシフトレジス
    タの出力信号を1走査分遅延する第2のシフトレジスタ
    と、該第2のシフトレジスタの出力信号を1画素づつ3
    画素分遅延する、直列接続された第7、第8及び第9の
    フリップフロップと、前記第1〜第9のフリップフロッ
    プの出力信号を受け、受けた信号による原画像中の3×
    3画素の局所領域があらかじめ用意された所定のパター
    ンとで致した時に、該局所領域の中央画素を白画素から
    黒画素に変換することにより画像を太める手段とを有す
    ることを特徴とする2値画信号の太め回路。
JP59235284A 1984-11-09 1984-11-09 2値画信号の太め回路 Pending JPS61114294A (ja)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP59235284A JPS61114294A (ja) 1984-11-09 1984-11-09 2値画信号の太め回路

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP59235284A JPS61114294A (ja) 1984-11-09 1984-11-09 2値画信号の太め回路

Publications (1)

Publication Number Publication Date
JPS61114294A true JPS61114294A (ja) 1986-05-31

Family

ID=16983821

Family Applications (1)

Application Number Title Priority Date Filing Date
JP59235284A Pending JPS61114294A (ja) 1984-11-09 1984-11-09 2値画信号の太め回路

Country Status (1)

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JP (1) JPS61114294A (ja)

Cited By (1)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JPH0226473A (ja) * 1988-07-15 1990-01-29 Nec Corp 画線付加装置

Cited By (1)

* Cited by examiner, † Cited by third party
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JPH0226473A (ja) * 1988-07-15 1990-01-29 Nec Corp 画線付加装置

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