JPS61196353A - 多重化バス制御方式 - Google Patents
多重化バス制御方式Info
- Publication number
- JPS61196353A JPS61196353A JP3635885A JP3635885A JPS61196353A JP S61196353 A JPS61196353 A JP S61196353A JP 3635885 A JP3635885 A JP 3635885A JP 3635885 A JP3635885 A JP 3635885A JP S61196353 A JPS61196353 A JP S61196353A
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- JP
- Japan
- Prior art keywords
- bus
- data
- transferring
- expansion
- receiving
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- Pending
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Classifications
-
- G—PHYSICS
- G06—COMPUTING OR CALCULATING; COUNTING
- G06F—ELECTRIC DIGITAL DATA PROCESSING
- G06F13/00—Interconnection of, or transfer of information or other signals between, memories, input/output devices or central processing units
- G06F13/38—Information transfer, e.g. on bus
- G06F13/40—Bus structure
- G06F13/4004—Coupling between buses
- G06F13/4022—Coupling between buses using switching circuits, e.g. switching matrix, connection or expansion network
Landscapes
- Engineering & Computer Science (AREA)
- Physics & Mathematics (AREA)
- General Engineering & Computer Science (AREA)
- Theoretical Computer Science (AREA)
- Mathematical Physics (AREA)
- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Bus Control (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔発明の利用分野〕
本発明は、多重化バス制御方式に関し、特に任意の装置
間のデータ転送制御において各装置固有のデータ処理能
力に対応してシステムデータ転送速度の最適化を図るの
に好適な多重化バス制御方式に関するものである。
間のデータ転送制御において各装置固有のデータ処理能
力に対応してシステムデータ転送速度の最適化を図るの
に好適な多重化バス制御方式に関するものである。
一般に、データ転送システムを構成する場合。
システム処理能力の最大値に応じてバスビット長が固定
長として決定される。したがって、処理能力の低い装置
を接続するときには、データ転送能力が低いにもかかわ
らずシステムのバスビット長が固定長であるため、最大
値のバスビット長を設けないとシステムに接続できない
という欠点があった。また、多重化バス制御を行うデー
タ転送システムでＦａ害が発生した時に、その障害とな
ったバス系を切離す等の縮退運用を考慮した多重化バス
制御方式の例としては、特開昭５６−６７４２４号公報
に記載されている。
長として決定される。したがって、処理能力の低い装置
を接続するときには、データ転送能力が低いにもかかわ
らずシステムのバスビット長が固定長であるため、最大
値のバスビット長を設けないとシステムに接続できない
という欠点があった。また、多重化バス制御を行うデー
タ転送システムでＦａ害が発生した時に、その障害とな
ったバス系を切離す等の縮退運用を考慮した多重化バス
制御方式の例としては、特開昭５６−６７４２４号公報
に記載されている。
しかし、この場合もバスビット長が固定長であるため、
装置固有の処理能力に＆適な多重化バスを設定するとい
うことができないという欠点があ一〕た。
装置固有の処理能力に＆適な多重化バスを設定するとい
うことができないという欠点があ一〕た。
本発明の目的は、このような従来の欠点を数置し、任意
の装置間のデータ転送システムにおいて。
の装置間のデータ転送システムにおいて。
任意の装置間のバス使用数の可変設定が可能な。
かつ、システムデータ転送速度の最適化が図れる多重化
バス制御方式を提供することにある。
バス制御方式を提供することにある。
上記目的を達成するために、本発明では、データバスを
介してデータ送受信を制御する送受信口＋Ｒ１を有する
任意の装置間のデータ転送システムにおいて、前記デー
タバスと並列に１つ以上の拡張用バスを設け、各装置間
の拡張用バスの設定数を前記データバスを介して相互に
認知する手順により２任意の前記装置間のバス使用数を
変更することに特徴がある。
介してデータ送受信を制御する送受信口＋Ｒ１を有する
任意の装置間のデータ転送システムにおいて、前記デー
タバスと並列に１つ以上の拡張用バスを設け、各装置間
の拡張用バスの設定数を前記データバスを介して相互に
認知する手順により２任意の前記装置間のバス使用数を
変更することに特徴がある。
以下１本発明の実施例を図面により説明する。
第１図は２本発明の一実施例を示す多重化バス制御方式
を説明するためのデータ転送システムの概略構成図であ
る。ここでは、装ＭＡとＢの２つの装に間について説明
する。
を説明するためのデータ転送システムの概略構成図であ
る。ここでは、装ＭＡとＢの２つの装に間について説明
する。
第１図において、１〜４は送受信バッファ、５はデータ
バス２６は拡張バス、７，８は送受信データＷ’積メモ
リである。
バス２６は拡張バス、７，８は送受信データＷ’積メモ
リである。
装＠Ａは、データバス５に接続された送受信バッファｌ
と拡張バス６に接続された送受信バッファ２、送受信バ
ッフγ１，２からのデータを蓄積する送受信データ蓄積
メモリ７を有している。同様に装［［３は、データバス
５に接続された送受信バッファ３と拡張バス６に接続さ
れた送受信バッファ４、送受信バッファ３．／Ｉからの
データを蓄積する送受信データ蓄積メモリ８を有してい
る。
と拡張バス６に接続された送受信バッファ２、送受信バ
ッフγ１，２からのデータを蓄積する送受信データ蓄積
メモリ７を有している。同様に装［［３は、データバス
５に接続された送受信バッファ３と拡張バス６に接続さ
れた送受信バッファ４、送受信バッファ３．／Ｉからの
データを蓄積する送受信データ蓄積メモリ８を有してい
る。
第２図は、装置Ａから装［Ｂへの送出コマンド列の概念
図であり、拡張バス６の使用有無を表示するバスビット
長１１．装［Ｂへの書込み読出し等を指示する動作指令
１２、装［Ｂの開始アドレス等を指示する開始情報１３
等の順にデータバス５を介して送信されるデータである
。
図であり、拡張バス６の使用有無を表示するバスビット
長１１．装［Ｂへの書込み読出し等を指示する動作指令
１２、装［Ｂの開始アドレス等を指示する開始情報１３
等の順にデータバス５を介して送信されるデータである
。
第３図は、装置ｉ１Ｂから装置Ａへのステータス列の概
念図であり、拡張バス６の有無を表示するバスビット長
１１．動作指令１２．開始情報１３、および終了結果を
表示する終了情報１４等の順にデータバス５を介して送
信されるデータである。
念図であり、拡張バス６の有無を表示するバスビット長
１１．動作指令１２．開始情報１３、および終了結果を
表示する終了情報１４等の順にデータバス５を介して送
信されるデータである。
次に、第１図の動作を第２図、第３図を用いて説明する
。また１本実施例では、データバス５を８ビツト長とし
２拡張バスとして８ビツト長の拡張バス６を設けた例と
する。
。また１本実施例では、データバス５を８ビツト長とし
２拡張バスとして８ビツト長の拡張バス６を設けた例と
する。
装置Ａから装置Ｂに対してデータ送受信を要求する場合
、装置Ａ側で送受信バッファ２を有するときには、送出
コマンド列のバスビット長Ｌ Ｉに拡張バス６の使用有
を表示１−、データバス５を介して装［Ｂへ転送される
。装置Ｂ側で送受信バッファ４を有するときには１次に
続くデータ送受信動作をデータバス５と拡張バス６との
両方を同時に用いて実行する。上記動作時、装置Ｂが送
受信バッファ４を有しないときには、次に続くデータ送
受信動作を実行せず送出ステータスのバスビット長１１
に拡張バス６無を表示し、かつ、終了情報１４にデータ
送受（ｎ不可を表示して終了する。
、装置Ａ側で送受信バッファ２を有するときには、送出
コマンド列のバスビット長Ｌ Ｉに拡張バス６の使用有
を表示１−、データバス５を介して装［Ｂへ転送される
。装置Ｂ側で送受信バッファ４を有するときには１次に
続くデータ送受信動作をデータバス５と拡張バス６との
両方を同時に用いて実行する。上記動作時、装置Ｂが送
受信バッファ４を有しないときには、次に続くデータ送
受信動作を実行せず送出ステータスのバスビット長１１
に拡張バス６無を表示し、かつ、終了情報１４にデータ
送受（ｎ不可を表示して終了する。
装置Ａ側は装置Ｂからの拡張バス６無を認知すると、送
出コマンドのバスビット長１１に拡張バス６の使用無を
表示し、データバス５のみを用いてデータ送受信を再開
する。一方、装置Ａ側で送受信バッファ２を有しないと
きには、送出コマンド列のバスビット長１１に拡張バス
６の使用無を表示するため、装［１側では送受信バッフ
ァ４の有無にかかわらず、データバス５のみを用いてデ
ータ送受信が実行されることになる。
出コマンドのバスビット長１１に拡張バス６の使用無を
表示し、データバス５のみを用いてデータ送受信を再開
する。一方、装置Ａ側で送受信バッファ２を有しないと
きには、送出コマンド列のバスビット長１１に拡張バス
６の使用無を表示するため、装［１側では送受信バッフ
ァ４の有無にかかわらず、データバス５のみを用いてデ
ータ送受信が実行されることになる。
このようにして、本実施例によれば、任意の装置間のデ
ータ転送システムにおいて、装置間の接続バスビット長
をシステム処理能力上の最大バスビット長を越えない範
囲内で、装置固有の処理能力に応じて任意に設定可能と
なるため、各装置のデータ転送処理動作時に実行中の装
置の処理能力に応じたデータ転送速度のｌｒｋ適化が図
れる。
ータ転送システムにおいて、装置間の接続バスビット長
をシステム処理能力上の最大バスビット長を越えない範
囲内で、装置固有の処理能力に応じて任意に設定可能と
なるため、各装置のデータ転送処理動作時に実行中の装
置の処理能力に応じたデータ転送速度のｌｒｋ適化が図
れる。
以上説明したように、本発明によれば、任意の装置間の
データ転送システムにおいて、任意の装置間のバス使用
数を可変設定ができるようになり、かつ、システムデー
タ転送速度の最適化が図れる多重化バス制御方式を実現
できる。
データ転送システムにおいて、任意の装置間のバス使用
数を可変設定ができるようになり、かつ、システムデー
タ転送速度の最適化が図れる多重化バス制御方式を実現
できる。
第１図は本発明の一実施例を示す多重化バス制御方式を
説明するための図、第２図は装［Ａから転送されるコマ
ンド列の概念図、第３図は装置Ｂから転送されるステー
タス列の概念図である。 １〜４：送受信バッファ、５：データバス、６：拡張バ
ス、７．８：送受信データ蓄積メモリ、１１バスビット
長、１２動作指令、１３：開始情報、１４：終了情報。 第１図
説明するための図、第２図は装［Ａから転送されるコマ
ンド列の概念図、第３図は装置Ｂから転送されるステー
タス列の概念図である。 １〜４：送受信バッファ、５：データバス、６：拡張バ
ス、７．８：送受信データ蓄積メモリ、１１バスビット
長、１２動作指令、１３：開始情報、１４：終了情報。 第１図
Claims (1)
- （１）データバスを介してデータ送受信を制御する送受
信回路を有する任意の装置間のデータ転送システムにお
いて、前記データバスと並列に１つ以上の拡張用バスを
設け、各装置間の拡張用バスの設定数を前記データバス
を介して相互に認知する手順により、任意の前記装置間
のバス使用数を変更することを特徴とする多重化バス制
御方式。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3635885A JPS61196353A (ja) | 1985-02-27 | 1985-02-27 | 多重化バス制御方式 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3635885A JPS61196353A (ja) | 1985-02-27 | 1985-02-27 | 多重化バス制御方式 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61196353A true JPS61196353A (ja) | 1986-08-30 |
Family
ID=12467603
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP3635885A Pending JPS61196353A (ja) | 1985-02-27 | 1985-02-27 | 多重化バス制御方式 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61196353A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7269672B2 (en) | 2003-08-19 | 2007-09-11 | Fujitsu Limited | Bus system design method, bus system, and device unit |
| US7343522B2 (en) | 2003-08-22 | 2008-03-11 | Fujitsu Limited | Apparatus having a transfer mode abnormality detecting function, storage controlling apparatus, and interface module for the storage controlling apparatus |
-
1985
- 1985-02-27 JP JP3635885A patent/JPS61196353A/ja active Pending
Cited By (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US7269672B2 (en) | 2003-08-19 | 2007-09-11 | Fujitsu Limited | Bus system design method, bus system, and device unit |
| US7277969B2 (en) | 2003-08-19 | 2007-10-02 | Fujitsu Limited | Bus system design method, bus system, and device unit |
| US7343522B2 (en) | 2003-08-22 | 2008-03-11 | Fujitsu Limited | Apparatus having a transfer mode abnormality detecting function, storage controlling apparatus, and interface module for the storage controlling apparatus |
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