JPS61201836U - - Google Patents
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- Publication number
- JPS61201836U JPS61201836U JP8523885U JP8523885U JPS61201836U JP S61201836 U JPS61201836 U JP S61201836U JP 8523885 U JP8523885 U JP 8523885U JP 8523885 U JP8523885 U JP 8523885U JP S61201836 U JPS61201836 U JP S61201836U
- Authority
- JP
- Japan
- Prior art keywords
- thermal head
- glaze layer
- substrate
- gap
- resistor
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Pending
Links
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Landscapes
- Electronic Switches (AREA)
Description
第１図は本考案によるサーマルヘツドの一実施
例の断面図、第２図は第１図の―矢視図、第
３図は従来のサーマルヘツドの断面図である。第
１図、第２図において、 １１はセラミツク基板、１２はグレーズ層、１
３は抵抗体、１４は導体、１５は保護膜、１６は
樹脂、１７はスペーサ、１８は空隙である。
例の断面図、第２図は第１図の―矢視図、第
３図は従来のサーマルヘツドの断面図である。第
１図、第２図において、 １１はセラミツク基板、１２はグレーズ層、１
３は抵抗体、１４は導体、１５は保護膜、１６は
樹脂、１７はスペーサ、１８は空隙である。
Claims (1)
- 【実用新案登録請求の範囲】 １ セラミツク基板上にグレーズ層を形成し、更
にその上に抵抗体及び導体を積層形成してなるサ
ーマルヘツドにおいて、前記基板とグレーズ層と
の間に空隙を有することを特徴とするサーマルヘ
ツド。 ２ 前記基板とグレーズ層との間にガラス粒状体
のスペーサをばらまいた状態にて介在させて前記
空隙を形成したことを特徴とする実用新案登録請
求の範囲第１項記載のサーマルヘツド。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8523885U JPS61201836U (ja) | 1985-06-07 | 1985-06-07 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP8523885U JPS61201836U (ja) | 1985-06-07 | 1985-06-07 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61201836U true JPS61201836U (ja) | 1986-12-18 |
Family
ID=30635452
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP8523885U Pending JPS61201836U (ja) | 1985-06-07 | 1985-06-07 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61201836U (ja) |
-
1985
- 1985-06-07 JP JP8523885U patent/JPS61201836U/ja active Pending
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