JPS6122196U - 機器の２状態制御回路 - Google Patents

機器の２状態制御回路

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JPS6122196U
JPS6122196U JP10558684U JP10558684U JPS6122196U JP S6122196 U JPS6122196 U JP S6122196U JP 10558684 U JP10558684 U JP 10558684U JP 10558684 U JP10558684 U JP 10558684U JP S6122196 U JPS6122196 U JP S6122196U
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JP
Japan
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signal
delay
control circuit
equipment
command signal
Prior art date
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Pending
Application number
JP10558684U
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Inventor
精一 豊岡
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Fuji Electric Co Ltd
Original Assignee
Fuji Electric Co Ltd
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Publication date
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Abstract

(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。

Description

【図面の簡単な説明】
第１図は本考案の実施例を示す回路図であり、第２図は
電動機の正逆転制御の従来例を示す回路図である。 １０・・・被制御機器としての３相誘導電動機、１１Ｆ
，１２Ｆ・・・正転用無接点スイッチ、１１Ｒ，１２Ｒ
・・・逆転用無接点スイッチ、１５・・・運転指令器、
１６Ｆ，１６Ｒ・・・タイマ素子、１７Ｆ，１７Ｒ・・
・反転入力端子付論理積素子、２１Ｆ，２１Ｒ・・・遅
延素子としての論理積素子、２２Ｆ，２２Ｒ・・・反転
入力端子付論理積素子、２３・・・タイマ素子、２４Ｆ
，２４Ｒ・・・論理積素子。

Claims (2)

    【実用新案登録請求の範囲】
  1. （１）被制御機器に対して第１の運転状態を指令する第
    １指令信号と第２の運転状態を指令する第２指令信号と
    を交互に出力して前記被制御機器をいずれかの運転状態
    にする装置において、前記第１指令信号を僅かな時間遅
    れで後段に伝える第１遅延素子と、該第１遅延素子出力
    信号と前記第２指令信号の反転信号との論理積信号を出
    力する第１論理積素子と、前記第２指令信号を僅かな時
    間遅れで後段に伝える第２遅延素子と、該第２遅延素子
    出力信号と前記第１指令信号の反転信号との論理積信号
    を出力する第２論理積素子と、前記第１論理積素子出力
    信号または第２論理積素子出力信号を所定時間遅延させ
    るタイマ素子と、該タイマ素子出力信号と前記第１指令
    信号との論理積信号を出力する第３論理積素子と、前記
    タイマ素子出力信号と前記第２指令信号との論理積信号
    を出力する第４論理積素子とを備えてなることを特徴と
    する機器の２状態制御回路。
  2. （２）実用新案登録請求の範囲第１項記載の機器の２状
    態制御回路において、前記第１遅延素子と第２遅延素子
    は前記タイマ素子をリセットさせるに十分な遅れ時間を
    有することを特徴とする機器の２状態制御回路。
JP10558684U 1984-07-12 1984-07-12 機器の２状態制御回路 Pending JPS6122196U (ja)

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