JPS6126158A - 情報伝送装置 - Google Patents
情報伝送装置Info
- Publication number
- JPS6126158A JPS6126158A JP14713784A JP14713784A JPS6126158A JP S6126158 A JPS6126158 A JP S6126158A JP 14713784 A JP14713784 A JP 14713784A JP 14713784 A JP14713784 A JP 14713784A JP S6126158 A JPS6126158 A JP S6126158A
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- JP
- Japan
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- input
- address
- output unit
- information
- output
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- Selective Calling Equipment (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
発明の属する技術分野
本発明は、マイクロプロセッサの制御によって、各種監
視情報、計測情報等を周辺回路から入力して、通信回線
に伝送情報フレームを送出する情報伝送装置に関し、特
に周辺回路の増設等に柔軟に対応するための改良に関す
る。
視情報、計測情報等を周辺回路から入力して、通信回線
に伝送情報フレームを送出する情報伝送装置に関し、特
に周辺回路の増設等に柔軟に対応するための改良に関す
る。
従来技術
従来、この種の情報伝送装置は、第6図(A)に示すよ
うに、マイクロプロセッサCPUを中心に、監視情報入
出力ユニットDI−8V 、アナログ計測情報入出力ユ
ニツ) AI 、変調送信ユニツ) MO[1−PS等
の各種入出力装置およびメモリMEMをパスラインBU
Sに接続した構成とされている。
うに、マイクロプロセッサCPUを中心に、監視情報入
出力ユニットDI−8V 、アナログ計測情報入出力ユ
ニツ) AI 、変調送信ユニツ) MO[1−PS等
の各種入出力装置およびメモリMEMをパスラインBU
Sに接続した構成とされている。
一般に、前記監視情報入出力ユニツ)Ill−3Vやア
ナログ計測情報入出力ユニツ)A1等の情報入出力ユニ
ットは、マイクロプロセッサCPUから見たときI10
アドレス可能な周辺機器として動作し、前記監視情報入
出力ユニツ) DI−SVやアナログ計測情報入出力ユ
ニツ)AI等に入力される 監視情報Sv、アナログ計
測情報Tに等の外部データは、■ワード(8または18
ビツト)単位でマイクロプロセッサCPUに入力される
。すなわち、マイクロプロセッサCPUからアドレスバ
ス上に送出されたアドレス信号によって指定された入出
力ユニットから外部データをデータバス上に送出させる
。
ナログ計測情報入出力ユニツ)A1等の情報入出力ユニ
ットは、マイクロプロセッサCPUから見たときI10
アドレス可能な周辺機器として動作し、前記監視情報入
出力ユニツ) DI−SVやアナログ計測情報入出力ユ
ニツ)AI等に入力される 監視情報Sv、アナログ計
測情報Tに等の外部データは、■ワード(8または18
ビツト)単位でマイクロプロセッサCPUに入力される
。すなわち、マイクロプロセッサCPUからアドレスバ
ス上に送出されたアドレス信号によって指定された入出
力ユニットから外部データをデータバス上に送出させる
。
各入出力ユニットは、同図(B)に示すように、自己に
割当てられた固有のアドレスを設定したI10アドレス
設定スイッチlと、該アドレス設定スイッチ1に設定さ
れたアドレスとアドレスバス上のアドレス信号とを比較
するアドレス−数構出回路2と、アドレス−数構出回路
2の出力する一致出力によって開かれたとき外部データ
をデータバスに送出するゲートGとを持ち、マイクロプ
ロセッサCPUからアドレス信号によって指定されたと
き、外部データをデータバス上に送出する。外部データ
がアナログ計測情報であるときは、勿論デジタルデータ
に変換されてデータバスに送出される。
割当てられた固有のアドレスを設定したI10アドレス
設定スイッチlと、該アドレス設定スイッチ1に設定さ
れたアドレスとアドレスバス上のアドレス信号とを比較
するアドレス−数構出回路2と、アドレス−数構出回路
2の出力する一致出力によって開かれたとき外部データ
をデータバスに送出するゲートGとを持ち、マイクロプ
ロセッサCPUからアドレス信号によって指定されたと
き、外部データをデータバス上に送出する。外部データ
がアナログ計測情報であるときは、勿論デジタルデータ
に変換されてデータバスに送出される。
一方、マイクロプロセッサCPUのプログラムは、同図
(C)に示すような送信情報テーブルを持っていて、そ
のテーブルには、現在実装されている入出力ユニットの
I10アドレスと、当該入出力ユニットから返送された
データが送信されるときに付加される送信ワードアドレ
スが併記されていて、マイクロプロセッサCPUがデー
タを入力するとき、およびデータ送信時に、上記テーブ
ルを参照することによって所定の情報伝送動作を実行す
るようにしている。
(C)に示すような送信情報テーブルを持っていて、そ
のテーブルには、現在実装されている入出力ユニットの
I10アドレスと、当該入出力ユニットから返送された
データが送信されるときに付加される送信ワードアドレ
スが併記されていて、マイクロプロセッサCPUがデー
タを入力するとき、およびデータ送信時に、上記テーブ
ルを参照することによって所定の情報伝送動作を実行す
るようにしている。
上記テーブルは、情報伝送装置の設計時に入出力ユニッ
トの組合わせに応じて、メーカの工場で作成され、リー
ドオンリメモリ(ROM)に記憶させて搭載している。
トの組合わせに応じて、メーカの工場で作成され、リー
ドオンリメモリ(ROM)に記憶させて搭載している。
従って、従来の情報伝送装置は、既設装置の拡張、変更
の際には、現場または工場で、新しい送信情報テーブル
が格納されたROMを作成して古いものと取替える必要
があり、同時期に数十局にも及ぶ変更等は、多大の時間
と労力を要し、また、ROMの書込みおよびマイクロプ
ロセッサのプログラムに精通した技術者を必要とすると
いう欠点がある。
の際には、現場または工場で、新しい送信情報テーブル
が格納されたROMを作成して古いものと取替える必要
があり、同時期に数十局にも及ぶ変更等は、多大の時間
と労力を要し、また、ROMの書込みおよびマイクロプ
ロセッサのプログラムに精通した技術者を必要とすると
いう欠点がある。
発明の目的
本発明の目的は、上述の従来の欠点を解決し、入出力ユ
ニットの増設や変更等に対して、マイクロプロセッサの
プログラムを変更することなく、容易かつ柔軟に対処す
ることができる情報伝送装置を提供することにある。
ニットの増設や変更等に対して、マイクロプロセッサの
プログラムを変更することなく、容易かつ柔軟に対処す
ることができる情報伝送装置を提供することにある。
発明の構成
本発明の情報伝送装置は、監視情報、計測情報等を入力
する各種入出力ユニットと、各入出力ユニットから入力
された情報を通信回線に送出する送出ユニット等をバス
を介してマイクロプロセッサに接続し、マイクロプロセ
ッサの制御によって各種入力情報を通信回線に送出する
情報伝送装置において、前記入出力ユニットに、それぞ
れに固有のアドレスとそれぞれの種類を示す実装コード
を割当て、各入出力ユニットは、アドレスバス上に送出
されたアドレス信号と自己に割当てられた固有のアドレ
スとの一致を検出するアドレス一致回路と、該アドレス
一致回路の一致出力によって活性化され前記マイクロプ
ロセッサから入力される制御コードを解読して対応する
後記ゲートを開くデコーダと、外部データまたは前記実
装コード発生器の出力とデータバス間に接続され前記デ
コーダ出力によって開かれるゲートとを備え、前記マイ
クロプロセッサは、各入出力ユニットのアドレスに対応
して当該入出力ユニットの実装コードを記憶させるため
の送信情報管理テーブルを備えて、初期動作時に順次ア
ドレス信号および制御コードによって各入出力ユニット
から前記実装コードを返送させて、各入出力ユニットか
ら返送された実装コードを上記送信情報管理テーブルの
対応する番地に格納しておき、本動作に移行した後は、
前記送信情報管理テーブルを参照して実装された各入出
力ユニットからデータを返送させ、該返送データに所定
の処理を施したデータに当該入出力ユニットのアドレス
と同じワード番号を付加した送信情報フレームを送出す
るように構成したことを特徴とする。
する各種入出力ユニットと、各入出力ユニットから入力
された情報を通信回線に送出する送出ユニット等をバス
を介してマイクロプロセッサに接続し、マイクロプロセ
ッサの制御によって各種入力情報を通信回線に送出する
情報伝送装置において、前記入出力ユニットに、それぞ
れに固有のアドレスとそれぞれの種類を示す実装コード
を割当て、各入出力ユニットは、アドレスバス上に送出
されたアドレス信号と自己に割当てられた固有のアドレ
スとの一致を検出するアドレス一致回路と、該アドレス
一致回路の一致出力によって活性化され前記マイクロプ
ロセッサから入力される制御コードを解読して対応する
後記ゲートを開くデコーダと、外部データまたは前記実
装コード発生器の出力とデータバス間に接続され前記デ
コーダ出力によって開かれるゲートとを備え、前記マイ
クロプロセッサは、各入出力ユニットのアドレスに対応
して当該入出力ユニットの実装コードを記憶させるため
の送信情報管理テーブルを備えて、初期動作時に順次ア
ドレス信号および制御コードによって各入出力ユニット
から前記実装コードを返送させて、各入出力ユニットか
ら返送された実装コードを上記送信情報管理テーブルの
対応する番地に格納しておき、本動作に移行した後は、
前記送信情報管理テーブルを参照して実装された各入出
力ユニットからデータを返送させ、該返送データに所定
の処理を施したデータに当該入出力ユニットのアドレス
と同じワード番号を付加した送信情報フレームを送出す
るように構成したことを特徴とする。
発明の実施例
次に、本発明について、図面を参照して詳細に説明する
。
。
第1図は、本発明の一実施例を示すブロック図である。
すなわち、各入出力装置は、アドレス設定スイッチ1と
、アドレス−数構出回路2と、デコーダ3と、ゲート4
,5と、ゲート4に接続された実装コード発生器7とを
備える。アドレス設定スイッチlには、例えば6ビツト
で構成される固有のアドレスを設定し、アドレス−数構
出回路2はアドレスバス上のアドレス信号をアドレス設
定スイッチlに設定された固有のアドレスと比較し、=
一致出力によってデコーダ3を活性化する。
、アドレス−数構出回路2と、デコーダ3と、ゲート4
,5と、ゲート4に接続された実装コード発生器7とを
備える。アドレス設定スイッチlには、例えば6ビツト
で構成される固有のアドレスを設定し、アドレス−数構
出回路2はアドレスバス上のアドレス信号をアドレス設
定スイッチlに設定された固有のアドレスと比較し、=
一致出力によってデコーダ3を活性化する。
デコーダ3は、マイクロプロセッサcP■から送られた
制御コードを解読し、例えば制御コードが“0′′のと
きはゲート4を開き、制御コードが“1”のときはゲー
ト5を開く。
制御コードを解読し、例えば制御コードが“0′′のと
きはゲート4を開き、制御コードが“1”のときはゲー
ト5を開く。
実装コード発生器7には、当該入出力ユニットの機能種
類を示す(例えば4ビツトの)実装コードが設定されて
おり、該実装コードはゲート4が開かれたときにデータ
バス上に送出される。4ビツトの実装コードによって1
6種類を指定することが可能であり、同一の実装コード
が付与された入出力ユニットは、マイクロプロセッサc
PUから見た機能が同じである。ゲート5には、監視情
報や。
類を示す(例えば4ビツトの)実装コードが設定されて
おり、該実装コードはゲート4が開かれたときにデータ
バス上に送出される。4ビツトの実装コードによって1
6種類を指定することが可能であり、同一の実装コード
が付与された入出力ユニットは、マイクロプロセッサc
PUから見た機能が同じである。ゲート5には、監視情
報や。
アナログ計測情報がデジタル変換された外部データ等の
実データが入力されていて、ゲート5が開いたときデー
タバス上に送出される。
実データが入力されていて、ゲート5が開いたときデー
タバス上に送出される。
マイクロプロセッサCPUは、第2図に示すような、ア
ドレスカウンタ8と、送信情報管理テーブルポインタ9
と送信情報管理テーブル10とを有し、送信情報管理テ
ーブルlOには、後述する初期動作時に、アドレス対応
に各入出力ユニットから返送された実装コードが格納さ
れる。送信情報管理テーブル10は、送信情報の管理を
行なうもので、データ送信の際に、後述の送信プログラ
ムで参照されるものである。マイクロプロセッサCPU
は、送信情報管理テーブル10に格納された実装コード
を参照することによって、対応する入出力ユニットの種
類を知ることができる。なお、未実装の入出力ユニット
からは実装コードが返送さす、対応する番地には実装コ
ードが格納されていないから、マイクロプロセッサCP
Uは送信情報管理テーブル10を参照することにより、
入出力ユニットの実装の有無とその種類を知ることが可
能となる。
ドレスカウンタ8と、送信情報管理テーブルポインタ9
と送信情報管理テーブル10とを有し、送信情報管理テ
ーブルlOには、後述する初期動作時に、アドレス対応
に各入出力ユニットから返送された実装コードが格納さ
れる。送信情報管理テーブル10は、送信情報の管理を
行なうもので、データ送信の際に、後述の送信プログラ
ムで参照されるものである。マイクロプロセッサCPU
は、送信情報管理テーブル10に格納された実装コード
を参照することによって、対応する入出力ユニットの種
類を知ることができる。なお、未実装の入出力ユニット
からは実装コードが返送さす、対応する番地には実装コ
ードが格納されていないから、マイクロプロセッサCP
Uは送信情報管理テーブル10を参照することにより、
入出力ユニットの実装の有無とその種類を知ることが可
能となる。
第3図は、電源投入時とか、リセットスタート時に、実
行されるマイクロプロセッサGPUのイニシャル処理プ
ログラムを示すフローチャートである。すなわち、アド
レスカウンタ8に“l ”を設定し、送信情報管理テー
ブルポインタ9に送信情報管理テーブル10の先頭アド
レス(STABL)を設定する。次に、制御コード゛O
“を送出し、アドレス“1′°の入出力ユニットから実
装コードを返送させる。返送された実装コードは、送信
情報管理テーブルポインタ9が指す送信情報管理テーブ
ル10の番地にストアする。次にアドレスカウンタ8お
よび送信情報管理テーブルポインタ9の内容を+1し、
アドレスカウンタ8の内容が64に達するまで上記動作
を繰返すことにより、順次各入出力ユニットのアドレス
対応に実装コードを格納し、アドレスカウンタ8のカウ
ント値が64に達すると初期動作を終了し、以下に述べ
る通常の動作に移行する。なお、未実装の入出力ユニッ
トのアドレスに対応しては、実装コードが返送されない
から、送信情報管理テーブル10の対応する番地の内容
は0000である。
行されるマイクロプロセッサGPUのイニシャル処理プ
ログラムを示すフローチャートである。すなわち、アド
レスカウンタ8に“l ”を設定し、送信情報管理テー
ブルポインタ9に送信情報管理テーブル10の先頭アド
レス(STABL)を設定する。次に、制御コード゛O
“を送出し、アドレス“1′°の入出力ユニットから実
装コードを返送させる。返送された実装コードは、送信
情報管理テーブルポインタ9が指す送信情報管理テーブ
ル10の番地にストアする。次にアドレスカウンタ8お
よび送信情報管理テーブルポインタ9の内容を+1し、
アドレスカウンタ8の内容が64に達するまで上記動作
を繰返すことにより、順次各入出力ユニットのアドレス
対応に実装コードを格納し、アドレスカウンタ8のカウ
ント値が64に達すると初期動作を終了し、以下に述べ
る通常の動作に移行する。なお、未実装の入出力ユニッ
トのアドレスに対応しては、実装コードが返送されない
から、送信情報管理テーブル10の対応する番地の内容
は0000である。
第4図は、マイクロプロセッサCPUの送信処理プログ
ラムのフローチャートである。すなわち、先ず送信情報
管理テーブルポインタ9に送信情報管理テーブル10の
先頭アドレスを設定し、アドレスカウンタ8を“O”に
クリヤし、送信情報管理テーブルポインタ9の指す送信
情報管理テーブル10の番地から実装コードを読出した
後に、アドレスカウンタ8および送信情報管理テーブル
ポインタ9を+1しておき、上記実装コードが0000
であれば上記動作を繰返すことにより、順次送信情報管
理テーブルlOを読出し、実装コードがoooo以外で
あれば、実装コードによって対応する入出力ユニットの
種類を判定する0例えば、実装コードが0001であれ
ば監視情報入出力ユニツ) DISVが実装されている
ものとし、監視情報入力専用の入力サブルーチンを呼出
して、データ入力処理を行なう。処理結果のデータには
、そのときのアドレスカウンタ8の内容(読出した入出
力ユニットのアドレス)を付加して、変調送信ユニツ)
N0D−PSに転送する。実装コードが0010であ
れば、アナログ情報ユニットが実装されているものと判
断して、同様にしてアナログ情報の入力処理および処理
結果データの転送処理を行なう、他の種類の入出力ユニ
ットからの入力データ処理および転送処理も同様にして
行なう。
ラムのフローチャートである。すなわち、先ず送信情報
管理テーブルポインタ9に送信情報管理テーブル10の
先頭アドレスを設定し、アドレスカウンタ8を“O”に
クリヤし、送信情報管理テーブルポインタ9の指す送信
情報管理テーブル10の番地から実装コードを読出した
後に、アドレスカウンタ8および送信情報管理テーブル
ポインタ9を+1しておき、上記実装コードが0000
であれば上記動作を繰返すことにより、順次送信情報管
理テーブルlOを読出し、実装コードがoooo以外で
あれば、実装コードによって対応する入出力ユニットの
種類を判定する0例えば、実装コードが0001であれ
ば監視情報入出力ユニツ) DISVが実装されている
ものとし、監視情報入力専用の入力サブルーチンを呼出
して、データ入力処理を行なう。処理結果のデータには
、そのときのアドレスカウンタ8の内容(読出した入出
力ユニットのアドレス)を付加して、変調送信ユニツ)
N0D−PSに転送する。実装コードが0010であ
れば、アナログ情報ユニットが実装されているものと判
断して、同様にしてアナログ情報の入力処理および処理
結果データの転送処理を行なう、他の種類の入出力ユニ
ットからの入力データ処理および転送処理も同様にして
行なう。
アドレスカウンタの内容(読出した入出力ユニットのア
ドレス)とデータを変調送信ユニットに転送することに
よってデータの送出処理を行なった後、アドレスカウン
タ8の内容が83でないときは、前記送信管理テーブル
の読出しに戻る。以下同様にして送信情報管理テーブル
lOに実装コードが格納されている各入出力ユニットか
ら順次データを読出して、その種類に応じて所定の処理
を行ない、処理結果のデータは当該入出力ユニットのア
ドレスと同一のワード番号を付加した蓬信情報フレーム
を通信線に送出する。そして、アドレスカウンタ8の内
容が83に達すると一連のデータ転送処理を完了し、再
び送信情報管理テーブルポインタ9に送信情報管理テー
ブル10の先頭アドレスを設定し、アドレスカウンタ8
をクリアして上述の動作を繰返す。第5図には、送信情
報フレーム構成の一例を示す。
ドレス)とデータを変調送信ユニットに転送することに
よってデータの送出処理を行なった後、アドレスカウン
タ8の内容が83でないときは、前記送信管理テーブル
の読出しに戻る。以下同様にして送信情報管理テーブル
lOに実装コードが格納されている各入出力ユニットか
ら順次データを読出して、その種類に応じて所定の処理
を行ない、処理結果のデータは当該入出力ユニットのア
ドレスと同一のワード番号を付加した蓬信情報フレーム
を通信線に送出する。そして、アドレスカウンタ8の内
容が83に達すると一連のデータ転送処理を完了し、再
び送信情報管理テーブルポインタ9に送信情報管理テー
ブル10の先頭アドレスを設定し、アドレスカウンタ8
をクリアして上述の動作を繰返す。第5図には、送信情
報フレーム構成の一例を示す。
以上の動作により、本情報伝送装置に実装されている各
入出力装置のアドレス番号と同じ番号の送信情報アドレ
ス(ワード番号)を持った、第5図に示すような送信情
報フレームが自動的に構築されて通信線に送出され、情
報伝送の目的が実現される。
入出力装置のアドレス番号と同じ番号の送信情報アドレ
ス(ワード番号)を持った、第5図に示すような送信情
報フレームが自動的に構築されて通信線に送出され、情
報伝送の目的が実現される。
本実施例においては、入出力ユニットを増設するときは
、単に、増設ユニットに未使用のアドレス番号を付与し
て、当該増設ユニットのアドレス設定スイッチ1に設定
し、その種類を示す実装コードを実装コード発生器7に
設定するだけでよい。入出力ユニットの変更や、廃止に
ついても同様であり、マイクロプロセッサCPUのプロ
グラムは変更を要しない。増設や変更されたユニットに
ついては、前記イニシャル処理ルーチンの実行により、
自動的に送信情報管理テーブルlOの対応する番地に当
該ユニットの種類を示す実装コードが格納されるからで
ある。また、複数の各種入出力ユニットの実装位置等は
自由であり、異なる種類の入出力ユニットを混在させて
順不同のアドレス番号を付与しても問題はない。すなわ
ち、本実施例は、拡張、変更等に対して、容易かつ柔軟
に対処することができるという効果がある。
、単に、増設ユニットに未使用のアドレス番号を付与し
て、当該増設ユニットのアドレス設定スイッチ1に設定
し、その種類を示す実装コードを実装コード発生器7に
設定するだけでよい。入出力ユニットの変更や、廃止に
ついても同様であり、マイクロプロセッサCPUのプロ
グラムは変更を要しない。増設や変更されたユニットに
ついては、前記イニシャル処理ルーチンの実行により、
自動的に送信情報管理テーブルlOの対応する番地に当
該ユニットの種類を示す実装コードが格納されるからで
ある。また、複数の各種入出力ユニットの実装位置等は
自由であり、異なる種類の入出力ユニットを混在させて
順不同のアドレス番号を付与しても問題はない。すなわ
ち、本実施例は、拡張、変更等に対して、容易かつ柔軟
に対処することができるという効果がある。
発明の効果
以上のように、本発明においては、各入出力ユニットに
、固有のアドレスと入出力ユニットの種類を示す実装コ
ードを設定しておき、本情報伝送装置の初期動作で、順
次者アドレスの入出力ユニットから前記実装コードを返
送させて、送信情報管理テーブルの対応する番地に格納
しておき、本動作時においては、マイクロプロセッサが
前記送信情報管理テーブルを参照することによって各ア
ドレス番号の実装状態とその入出力ユニットの種類を知
り、その種類に対応したデータ入力処理を行ない、処理
結果のデータに当該入出力ユニットのアドレス番号と同
じ番号の送信情報アドレスを付加した送信フレームを構
築して通信線に送出するように構成したから、入出力ユ
ニットの増設や、システム変更に伴なう割付は変更等に
際しても、従来のようにROMを再作成して取換えると
いう必要がなく、単に入出力ユニットのアドレス設定お
よびその種類を示す実装コードの設定または変更だけで
すみ、容易かつ柔軟に対処することが可能であるという
効果がある。
、固有のアドレスと入出力ユニットの種類を示す実装コ
ードを設定しておき、本情報伝送装置の初期動作で、順
次者アドレスの入出力ユニットから前記実装コードを返
送させて、送信情報管理テーブルの対応する番地に格納
しておき、本動作時においては、マイクロプロセッサが
前記送信情報管理テーブルを参照することによって各ア
ドレス番号の実装状態とその入出力ユニットの種類を知
り、その種類に対応したデータ入力処理を行ない、処理
結果のデータに当該入出力ユニットのアドレス番号と同
じ番号の送信情報アドレスを付加した送信フレームを構
築して通信線に送出するように構成したから、入出力ユ
ニットの増設や、システム変更に伴なう割付は変更等に
際しても、従来のようにROMを再作成して取換えると
いう必要がなく、単に入出力ユニットのアドレス設定お
よびその種類を示す実装コードの設定または変更だけで
すみ、容易かつ柔軟に対処することが可能であるという
効果がある。
第1図は本発明の一実施例における各入出力ユニットの
構成を示すブロック図、第2図は上記実施例におけるマ
イクロプロセッサのアドレスカウンタ、送信情報管理テ
ーブルポインタおよび送信情報管理テーブルを示す図、
第3図は上記実施例のイニシャル処理プログラムのフロ
ーチャート、第4図は送信処理プログラムのフローチャ
ート、第5図は送信情報フレームの構成を示す図、第6
図(A)、(B)、(C)はそれぞれ従来の情報伝送装
置の構成、従来の入出力ユニットの構成および従来の送
信情報テーブルの一例を示す図である。 図において、1ニアドレス設定スイツチ、2ニアドレス
−数構出回路、3:デコーダ、4,5:ゲート、7:実
装コード発生器、8ニアドレスカウンタ、9:送信情報
管理テーブルポインタ、lO:送信情報管理テーブル。
構成を示すブロック図、第2図は上記実施例におけるマ
イクロプロセッサのアドレスカウンタ、送信情報管理テ
ーブルポインタおよび送信情報管理テーブルを示す図、
第3図は上記実施例のイニシャル処理プログラムのフロ
ーチャート、第4図は送信処理プログラムのフローチャ
ート、第5図は送信情報フレームの構成を示す図、第6
図(A)、(B)、(C)はそれぞれ従来の情報伝送装
置の構成、従来の入出力ユニットの構成および従来の送
信情報テーブルの一例を示す図である。 図において、1ニアドレス設定スイツチ、2ニアドレス
−数構出回路、3:デコーダ、4,5:ゲート、7:実
装コード発生器、8ニアドレスカウンタ、9:送信情報
管理テーブルポインタ、lO:送信情報管理テーブル。
Claims (1)
- 監視情報、計測情報等を入力する各種入出力ユニットと
、各入出力ユニットから入力された情報を通信回線に送
出する送出ユニット等をバスを介してマイクロプロセッ
サに接続し、マイクロプロセッサの制御によつて各種入
力情報を通信回線に送出する情報伝送装置において、前
記入出力ユニットに、それぞれに固有のアドレスとそれ
ぞれの種類を示す実装コードを割当て、各入出力ユニッ
トは、アドレスバス上に送出されたアドレス信号と自己
に割当てられた固有のアドレスとの一致を検出するアド
レス一致回路と、該アドレス一致回路の一致出力によつ
て活性化され前記マイクロプロセッサから入力される制
御コードを解読して対応する後記ゲートを開くデコーダ
と、外部データまたは前記実装コード発生器の出力とデ
ータバス間に接続され前記デコーダ出力によつて開かれ
るゲートとを備え、前記マイクロプロセッサは、各入出
力ユニットのアドレスに対応して当該入出力ユニットの
実装コードを記憶させるための送信情報管理テーブルを
備えて、初期動作時に順次アドレス信号および制御コー
ドによつて各入出力ユニットから前記実装コードを返送
させて、各入出力ユニットから返送された実装コードを
上記送信情報管理テーブルの対応する番地に格納してお
き、本動作に移行した後は、前記送信情報管理テーブル
を参照して実装された各入出力ユニットからデータを返
送させ、該返送データに所定の処理を施したデータに当
該入出力ユニットのアドレスと同じワード番号を付加し
た送信情報フレームを送出するように構成したことを特
徴とする情報伝送装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14713784A JPS6126158A (ja) | 1984-07-16 | 1984-07-16 | 情報伝送装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP14713784A JPS6126158A (ja) | 1984-07-16 | 1984-07-16 | 情報伝送装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6126158A true JPS6126158A (ja) | 1986-02-05 |
| JPH0376508B2 JPH0376508B2 (ja) | 1991-12-05 |
Family
ID=15423405
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP14713784A Granted JPS6126158A (ja) | 1984-07-16 | 1984-07-16 | 情報伝送装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS6126158A (ja) |
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62245461A (ja) * | 1986-04-18 | 1987-10-26 | Fanuc Ltd | ボ−ドスロツト番号の割当方法 |
| JPS6488862A (en) * | 1987-09-30 | 1989-04-03 | Sony Corp | Printed board circuit |
| JPH02133852A (ja) * | 1988-11-15 | 1990-05-23 | Hitachi Ltd | 情報処理システム |
| JPH03198447A (ja) * | 1989-12-26 | 1991-08-29 | Nec Corp | 集合変復調装置制御回路 |
| JPH08180010A (ja) * | 1994-07-29 | 1996-07-12 | Lg Ind Syst Co Ltd | コンピューター用データの入出力制御回路及び入出力制御方法 |
-
1984
- 1984-07-16 JP JP14713784A patent/JPS6126158A/ja active Granted
Cited By (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS62245461A (ja) * | 1986-04-18 | 1987-10-26 | Fanuc Ltd | ボ−ドスロツト番号の割当方法 |
| JPS6488862A (en) * | 1987-09-30 | 1989-04-03 | Sony Corp | Printed board circuit |
| JPH02133852A (ja) * | 1988-11-15 | 1990-05-23 | Hitachi Ltd | 情報処理システム |
| JPH03198447A (ja) * | 1989-12-26 | 1991-08-29 | Nec Corp | 集合変復調装置制御回路 |
| JPH08180010A (ja) * | 1994-07-29 | 1996-07-12 | Lg Ind Syst Co Ltd | コンピューター用データの入出力制御回路及び入出力制御方法 |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH0376508B2 (ja) | 1991-12-05 |
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