JPS61271848A - 半導体パツケ−ジの製法 - Google Patents
半導体パツケ−ジの製法Info
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- JPS61271848A JPS61271848A JP60113569A JP11356985A JPS61271848A JP S61271848 A JPS61271848 A JP S61271848A JP 60113569 A JP60113569 A JP 60113569A JP 11356985 A JP11356985 A JP 11356985A JP S61271848 A JPS61271848 A JP S61271848A
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- Wire Bonding (AREA)
- Encapsulation Of And Coatings For Semiconductor Or Solid State Devices (AREA)
Abstract
(57)【要約】本公報は電子出願前の出願データであるた
め要約のデータは記録されません。
め要約のデータは記録されません。
Description
【発明の詳細な説明】
〔技術分野〕
この発明は、半導体パッケージの製法に関する〔背景技
術〕 半導体パッケージの製法としては極々あるが、その1つ
に、第3図(alにみるように、半導体素子10がダイ
ボンディングされ、半導体素子lOの電極とリードフレ
ーム端子部1)aとがワイヤ12によって接続(ワイヤ
ボンディング)されたリードフレーム(42Alloy
等)1)をトランスファ成形法によって樹脂封止した後
、リードフレーム加工を施し、例えば、第3図(blに
みるようなりIP形パッケージとする方法がある。この
ようにして作られたDIP形パッケージは、一般に広く
用いられており、量産向きであるが、樹脂封止するため
に成型金型および成型機等の設備が必要であった。
術〕 半導体パッケージの製法としては極々あるが、その1つ
に、第3図(alにみるように、半導体素子10がダイ
ボンディングされ、半導体素子lOの電極とリードフレ
ーム端子部1)aとがワイヤ12によって接続(ワイヤ
ボンディング)されたリードフレーム(42Alloy
等)1)をトランスファ成形法によって樹脂封止した後
、リードフレーム加工を施し、例えば、第3図(blに
みるようなりIP形パッケージとする方法がある。この
ようにして作られたDIP形パッケージは、一般に広く
用いられており、量産向きであるが、樹脂封止するため
に成型金型および成型機等の設備が必要であった。
これとは別の製法として、第4図(al、 (b)にみ
るように、ポンディングパッドにAu等のバンプ13が
形成された半導体素子14を用意しておき、これを銅箔
のリード15が接合されたフィルム16の前記リード内
側端に熱圧着し、樹脂封止した後、フィルム切断加工を
する方法がある。このようなフィルムキャリアによる実
装方式をTAB (Tape Automated B
onding)方式と呼ぶ、このTAB方式は、複数の
リードを半導体素子に一度にボンディング(「ギヤング
ボンディング」という)できるが、反面、半導体素子に
バンプ処理を施す必要があり、バンプ無しの半導体素子
を使用することができなかった。
るように、ポンディングパッドにAu等のバンプ13が
形成された半導体素子14を用意しておき、これを銅箔
のリード15が接合されたフィルム16の前記リード内
側端に熱圧着し、樹脂封止した後、フィルム切断加工を
する方法がある。このようなフィルムキャリアによる実
装方式をTAB (Tape Automated B
onding)方式と呼ぶ、このTAB方式は、複数の
リードを半導体素子に一度にボンディング(「ギヤング
ボンディング」という)できるが、反面、半導体素子に
バンプ処理を施す必要があり、バンプ無しの半導体素子
を使用することができなかった。
(発明の目的〕
以上の事情に鑑みて、この発明は、バンプ無しの半導体
素子を使用することができ、樹脂封止するための成型金
型および成型機等の設備を必要としない半導体パッケー
ジの製法を提供することを目的とする。
素子を使用することができ、樹脂封止するための成型金
型および成型機等の設備を必要としない半導体パッケー
ジの製法を提供することを目的とする。
前記目的を達成するため、この発明は、絶縁材からなる
基材表面にダイボンド部とリードとが設けられていて、
前記ダイボンド部に半導体素子を固着し、かつ、前記半
導体素子と前記リードとをワイヤによって接続するとと
もに、ワイヤが接続されるリードの一部とダイボンド部
とを枠で囲んでおいて、枠内に封止樹脂を注入し、硬化
させる工程を含む半導体パッケージの製法をその要旨と
する。
基材表面にダイボンド部とリードとが設けられていて、
前記ダイボンド部に半導体素子を固着し、かつ、前記半
導体素子と前記リードとをワイヤによって接続するとと
もに、ワイヤが接続されるリードの一部とダイボンド部
とを枠で囲んでおいて、枠内に封止樹脂を注入し、硬化
させる工程を含む半導体パッケージの製法をその要旨と
する。
以下にこれを、その一実施例をあられす図面に基づいて
詳しく説明する。
詳しく説明する。
この半導体パッケージの製法は、以下のようにして行う
。
。
■第2図にみるように、長尺の樹脂フィルム(図ではそ
の一部のみをあられしている)10表面にダイボンド部
2とリード3とが設けられていて、これに樹脂枠4を接
着またはモールドにより固着し、後の工程においてワイ
ヤが接続されるリードの一部3aとダイボンド部2とを
枠4で囲んでおく、樹脂フィルム1は、ポリアミド、ポ
リエステル、ガラス布基材エポキシ樹脂などからなり、
その厚みが0.05〜0.15mmのものを用いている
、リード3は、銅箔等から形成されている。
の一部のみをあられしている)10表面にダイボンド部
2とリード3とが設けられていて、これに樹脂枠4を接
着またはモールドにより固着し、後の工程においてワイ
ヤが接続されるリードの一部3aとダイボンド部2とを
枠4で囲んでおく、樹脂フィルム1は、ポリアミド、ポ
リエステル、ガラス布基材エポキシ樹脂などからなり、
その厚みが0.05〜0.15mmのものを用いている
、リード3は、銅箔等から形成されている。
■第1図(a)にみるように、ダイボンド部lに導電性
ペースト(たとえば、Agペースト)または半田ペース
ト5を塗布する。
ペースト(たとえば、Agペースト)または半田ペース
ト5を塗布する。
■第1図世)にみるように、半導体素子6をペースト5
が塗布されたダイボンド部2に載せ、ペースト5を加熱
硬化させて、半導体素子6をダイボンド部2に固着する
(グイボンディイング工程)。
が塗布されたダイボンド部2に載せ、ペースト5を加熱
硬化させて、半導体素子6をダイボンド部2に固着する
(グイボンディイング工程)。
■第1図(C)にみるように、半導体素子6とり−ド3
とをワイヤ7によって接続する(ワイヤボンディング工
程)。
とをワイヤ7によって接続する(ワイヤボンディング工
程)。
■第1図(dlにみるように、枠4内に封止樹脂8を注
入(充填)し、硬化させる。
入(充填)し、硬化させる。
■打ち抜き加工によって単体に切断し、第1図(a)に
みるような半導体パッケージが完成する。
みるような半導体パッケージが完成する。
以上のような工程をフィルムを送りつつ、連続して行う
ようにする。生産性を上げるために、複数個同時に行う
ようにしてもよい。
ようにする。生産性を上げるために、複数個同時に行う
ようにしてもよい。
枠4は、封止樹脂8の流れ止めの役目をするが、この実
施例のように、ワイヤボンディング工程に先だって、枠
4が樹脂フィルムlに固着されていれば、ワイヤボンデ
ィングの際に、ワイヤが接続されるリードの一部3aと
半導体素子6との間に剛性をもたせることができ、ワイ
ヤボンディングの信頼性を向上させることができる。
施例のように、ワイヤボンディング工程に先だって、枠
4が樹脂フィルムlに固着されていれば、ワイヤボンデ
ィングの際に、ワイヤが接続されるリードの一部3aと
半導体素子6との間に剛性をもたせることができ、ワイ
ヤボンディングの信頼性を向上させることができる。
以上にみたように、この半導体パッケージの製法は、半
導体素子をボンディングする際、半導体素子にバンプ処
理を施す必要がな(、バンプ無しの半導体素子を用いる
ことができ、樹脂封止する際には、樹脂封止する部分を
枠で囲んでおき、枠内に封止樹脂を注入し、硬化させる
だけでよいため、成型金型および成型機等の設備を必要
としないのである。
導体素子をボンディングする際、半導体素子にバンプ処
理を施す必要がな(、バンプ無しの半導体素子を用いる
ことができ、樹脂封止する際には、樹脂封止する部分を
枠で囲んでおき、枠内に封止樹脂を注入し、硬化させる
だけでよいため、成型金型および成型機等の設備を必要
としないのである。
前記実施例では、絶縁材からなる基材に長尺の樹脂フィ
ルムを用いている。従来、長尺の樹脂フィルムを用いた
ものに、前述したTAB方式がある。このTAB方式の
長所としては、半導体素子がボンディングされる樹脂フ
ィルムが軽量で可撓性を存し、長尺のものであるため、
樹脂フィルムをリールに巻いた状態で提供することがで
き、ボンディング後も別のリールに巻き取っておけば良
く、自動化が容易にできることであった。また、リード
フレームの場合、ワイヤボンディングされたリードフレ
ーム端子部が樹脂で成形された後に切り離されて初めて
、半導体素子の電気特性がチェックできるのに対し、T
AB方式では各リードがフィルム上で各々独立している
為、半導体素子をボンディングしたのち、すぐに電気特
性のチェックができるという長所もあった。
ルムを用いている。従来、長尺の樹脂フィルムを用いた
ものに、前述したTAB方式がある。このTAB方式の
長所としては、半導体素子がボンディングされる樹脂フ
ィルムが軽量で可撓性を存し、長尺のものであるため、
樹脂フィルムをリールに巻いた状態で提供することがで
き、ボンディング後も別のリールに巻き取っておけば良
く、自動化が容易にできることであった。また、リード
フレームの場合、ワイヤボンディングされたリードフレ
ーム端子部が樹脂で成形された後に切り離されて初めて
、半導体素子の電気特性がチェックできるのに対し、T
AB方式では各リードがフィルム上で各々独立している
為、半導体素子をボンディングしたのち、すぐに電気特
性のチェックができるという長所もあった。
前記実施例においても、長尺の樹脂フィルムを用い、そ
のフィルム上に各々独立したリードを形成するようにし
て、従来のTAB方式の長所を生かすようにしているた
め、従来のTAB方式と同じく、自動化が容易にできる
とともに、ボンディング後、すぐに半導体素子の電気特
性をチェックすることが可能になる。
のフィルム上に各々独立したリードを形成するようにし
て、従来のTAB方式の長所を生かすようにしているた
め、従来のTAB方式と同じく、自動化が容易にできる
とともに、ボンディング後、すぐに半導体素子の電気特
性をチェックすることが可能になる。
この発明にかかる半導体パッケージの製法は、前記実施
例に限定されない、枠は、基材に固着されていなくても
よく、樹脂封止の際にワイヤが接続されるリードの一部
とダイボンド部とを囲むように設置されるようになって
いるだけでもよい。
例に限定されない、枠は、基材に固着されていなくても
よく、樹脂封止の際にワイヤが接続されるリードの一部
とダイボンド部とを囲むように設置されるようになって
いるだけでもよい。
封止樹脂が硬化した後に枠を取り除くようにしてもよい
し、そのままにして使用してもよい、枠の材質は、樹脂
に限定されるものではなく、他の絶縁材、たとえば、セ
ラミックなどでもよい、基材も同じく、樹脂フィルムに
限定されず、他の絶縁材であってもよい、また、半導体
パッケージは、個々単体で製造されてもよい。
し、そのままにして使用してもよい、枠の材質は、樹脂
に限定されるものではなく、他の絶縁材、たとえば、セ
ラミックなどでもよい、基材も同じく、樹脂フィルムに
限定されず、他の絶縁材であってもよい、また、半導体
パッケージは、個々単体で製造されてもよい。
以上にみてきたように、この発明にかかる半導体パッケ
ージの製法は、絶縁材からなる基材表面にダイボンド部
とリードとが設けられていて、前記ダイボンド部に半導
体素子を固着し、かつ、前記半導体素子と前記リードと
をワイヤによって接続するとともに、ワイヤが接続され
るリードの一部とダイボンド部とを枠で囲んでおいて、
枠内に封止樹脂を注入し、硬化させることを特徴として
いる。すなわち、半導体素子をボンディングする際には
、半導体素子をダイボンド部に固着し、半導体素子とリ
ードとをワイヤによって接続するようにしている。その
ため、半導体素子にバンブ処理を施す必要がなく、バン
ブ無しの半導体素子を使用することができる。また、樹
脂封止する際には、樹脂封止する部分を枠で囲んでおき
、枠内に樹脂を注入し、硬化させるようにしている。そ
のため、成型金型および成型機等の設備が不要となる。
ージの製法は、絶縁材からなる基材表面にダイボンド部
とリードとが設けられていて、前記ダイボンド部に半導
体素子を固着し、かつ、前記半導体素子と前記リードと
をワイヤによって接続するとともに、ワイヤが接続され
るリードの一部とダイボンド部とを枠で囲んでおいて、
枠内に封止樹脂を注入し、硬化させることを特徴として
いる。すなわち、半導体素子をボンディングする際には
、半導体素子をダイボンド部に固着し、半導体素子とリ
ードとをワイヤによって接続するようにしている。その
ため、半導体素子にバンブ処理を施す必要がなく、バン
ブ無しの半導体素子を使用することができる。また、樹
脂封止する際には、樹脂封止する部分を枠で囲んでおき
、枠内に樹脂を注入し、硬化させるようにしている。そ
のため、成型金型および成型機等の設備が不要となる。
第1図(a)、 (b)、 (C)、 (d)、 (e
)および第2図はこの発明にかかる半導体パフケージの
製法の一実施例をあられす説明図、第3図(a)はリー
ドフレームを用いた半導体パッケージの製法の従来例を
あられす斜視図、第3図(b)は同上の製法によって得
られた半導体パッケージの従来例をあられす斜視図、第
4図(a)は別の製法の従来例をあられす斜視図、第4
図(blは同上の製法におけるボンディング前の半導体
素子とリードとをあられす側面図である。 l・・・樹脂フィルム 2・・・ダイボンド部 3・・
・リード 4・・・枠 6・・・半導体素子 7・・・
ワイヤ 8・・・封止樹脂 代理人 弁理士 松 本 武 彦 第2図 第4図 (a) 弓稿植沖市正書(自発 1.事件の表示 昭和60年特許願第1)3569号 2、発明の名称 半胡ψ陸マフケージの製法 3、補正をする者 事件との関係 特許出願人 件 所 大阪府門真市大字門真1048番地
名 称(583)松下電工株式会社 代表者 ((JJM帝役藤井 貞 夫4、代理人 5、補正の対象 明細書 補正の内容 (1)明III書第5頁第5行に「ポリアミド」とあ6
を、「ポリイミド」と訂正する。
)および第2図はこの発明にかかる半導体パフケージの
製法の一実施例をあられす説明図、第3図(a)はリー
ドフレームを用いた半導体パッケージの製法の従来例を
あられす斜視図、第3図(b)は同上の製法によって得
られた半導体パッケージの従来例をあられす斜視図、第
4図(a)は別の製法の従来例をあられす斜視図、第4
図(blは同上の製法におけるボンディング前の半導体
素子とリードとをあられす側面図である。 l・・・樹脂フィルム 2・・・ダイボンド部 3・・
・リード 4・・・枠 6・・・半導体素子 7・・・
ワイヤ 8・・・封止樹脂 代理人 弁理士 松 本 武 彦 第2図 第4図 (a) 弓稿植沖市正書(自発 1.事件の表示 昭和60年特許願第1)3569号 2、発明の名称 半胡ψ陸マフケージの製法 3、補正をする者 事件との関係 特許出願人 件 所 大阪府門真市大字門真1048番地
名 称(583)松下電工株式会社 代表者 ((JJM帝役藤井 貞 夫4、代理人 5、補正の対象 明細書 補正の内容 (1)明III書第5頁第5行に「ポリアミド」とあ6
を、「ポリイミド」と訂正する。
Claims (1)
- 【特許請求の範囲】 (1)絶縁材からなる基材表面にダイボンド部とリード
とが設けられていて、前記ダイボンド部に半導体素子を
固着し、かつ、前記半導体素子と前記リードとをワイヤ
によって接続するとともに、ワイヤが接続されるリード
の一部とダイボンド部とを枠で囲んでおいて、枠内に封
止樹脂を注入し、硬化させる工程を含む半導体パッケー
ジの製法(2)枠が基材に固着されており、この固着が
半導体素子とリードとをワイヤによって接続することに
先だってなされる特許請求の範囲第1項記載の半導体パ
ッケージの製法。 (3)絶縁材からなる枠が樹脂からなるものである特許
請求の範囲第1項または第2項記載の半導体パッケージ
の製法。 (4)絶縁材からなる基材が樹脂フィルムである特許請
求の範囲第1項ないし第3項のいずれかに記載の半導体
パッケージの製法。 (5)樹脂フィルムが長尺物であり、このフィルムを送
りつつ、封止樹脂を硬化させた後、このフィルムを単体
に切断するまでを連続して行うようにする特許請求の範
囲第4項記載の半導体パッケージの製法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60113569A JPS61271848A (ja) | 1985-05-27 | 1985-05-27 | 半導体パツケ−ジの製法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP60113569A JPS61271848A (ja) | 1985-05-27 | 1985-05-27 | 半導体パツケ−ジの製法 |
Publications (1)
| Publication Number | Publication Date |
|---|---|
| JPS61271848A true JPS61271848A (ja) | 1986-12-02 |
Family
ID=14615572
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP60113569A Pending JPS61271848A (ja) | 1985-05-27 | 1985-05-27 | 半導体パツケ−ジの製法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS61271848A (ja) |
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01287934A (ja) * | 1988-05-13 | 1989-11-20 | Minolta Camera Co Ltd | フレキシブルプリント基板へのicチツプ搭載構造 |
| JPH03173459A (ja) * | 1989-12-01 | 1991-07-26 | Fujitsu Ltd | 半導体装置 |
-
1985
- 1985-05-27 JP JP60113569A patent/JPS61271848A/ja active Pending
Cited By (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPH01287934A (ja) * | 1988-05-13 | 1989-11-20 | Minolta Camera Co Ltd | フレキシブルプリント基板へのicチツプ搭載構造 |
| JPH03173459A (ja) * | 1989-12-01 | 1991-07-26 | Fujitsu Ltd | 半導体装置 |
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