JPS6141462B2 - - Google Patents

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Publication number
JPS6141462B2
JPS6141462B2 JP7720277A JP7720277A JPS6141462B2 JP S6141462 B2 JPS6141462 B2 JP S6141462B2 JP 7720277 A JP7720277 A JP 7720277A JP 7720277 A JP7720277 A JP 7720277A JP S6141462 B2 JPS6141462 B2 JP S6141462B2
Authority
JP
Japan
Prior art keywords
signal
ami
binary
modulated
modulation
Prior art date
Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
Expired
Application number
JP7720277A
Other languages
English (en)
Other versions
JPS5412610A (en
Inventor
Yukio Minami
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Hitachi Ltd
Original Assignee
Hitachi Ltd
Priority date (The priority date is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the date listed.)
Filing date
Publication date
Application filed by Hitachi Ltd filed Critical Hitachi Ltd
Priority to JP7720277A priority Critical patent/JPS5412610A/ja
Publication of JPS5412610A publication Critical patent/JPS5412610A/ja
Publication of JPS6141462B2 publication Critical patent/JPS6141462B2/ja
Granted legal-status Critical Current

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Classifications

    • HELECTRICITY
    • H04ELECTRIC COMMUNICATION TECHNIQUE
    • H04LTRANSMISSION OF DIGITAL INFORMATION, e.g. TELEGRAPHIC COMMUNICATION
    • H04L25/00Baseband systems
    • H04L25/38Synchronous or start-stop systems, e.g. for Baudot code
    • H04L25/40Transmitting circuits; Receiving circuits
    • H04L25/49Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems
    • H04L25/4917Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using multilevel codes
    • H04L25/4923Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using multilevel codes using ternary codes
    • H04L25/4925Transmitting circuits; Receiving circuits using code conversion at the transmitter; using predistortion; using insertion of idle bits for obtaining a desired frequency spectrum; using three or more amplitude levels ; Baseband coding techniques specific to data transmission systems using multilevel codes using ternary codes using balanced bipolar ternary codes

Landscapes

  • Physics & Mathematics (AREA)
  • Spectroscopy & Molecular Physics (AREA)
  • Engineering & Computer Science (AREA)
  • Computer Networks & Wireless Communication (AREA)
  • Signal Processing (AREA)
  • Detection And Prevention Of Errors In Transmission (AREA)
  • Dc Digital Transmission (AREA)

Description

【発明の詳細な説明】 本発明は、2値AMI符号列の変調方式に関す
るものである。
2値AMI符号はNRZ符号“1”に“0,1”ま
たは“1,0”を、“0”に“1,1”または
“0,0”を対応させる符号形式であり、これは
タイミング情報が豊富であること、直流成分を含
まないこと、3/2スロツト以上同一レベルが連続
しないことおよび上下レベルの入替えにより元の
情報を失なわないこと等の特長を有し、多くの分
野に渡つて応用されている。しかし、この符号形
式は、NRZ符号に比べ必要とする周波数帯域が2
倍になることであり、伝送路の帯域が小さい場合
は利用しにくく、また、2値AMI信号に監視信
号等、他の信号を時分割で重畳するような場合に
は更に大きな伝送路帯域が必要となる等の欠点が
ある。
本発明の目的は、上記した2値AMI符号の欠
点を補い、2値AMI符号の必要周波数帯域を増
すことなく、他の信号重畳を可能にすることにあ
る。
そこで本発明は、2値AMI信号(NRZの“1”
に“1,0”または“0,1”が対応し、“0”
に“1,1”または“0,0”が対応するような
符号列)に変調信号を重畳して、この2値AMI
信号を強制的に誤らせることにより変調し、この
被変調信号を伝送し、受信側においてこの被変調
信号から復調信号を得、かつ該復調信号を用いて
受信した被変調信号を復調し、送信側における当
初の2値AMI信号を得るようにしたものであ
る。以下その具体的実施例を添付図に従つて詳述
する。
第1図は本発明の符号変調方式を説明するため
のタイムチヤートであり、第2図に示す符号変調
回路並びに第3図に示す復調回路の各部の出力波
形を示してある。
第2図において、1は2値AMI信号発生器、
2は2値AMI信号発生器1から出力される2値
AMI信号aの信号単位Sの前半位相のタイミン
グで変調信号を発生する変調信号発生器であつ
て、2値AMI信号発生器1の出力クロツクで同
期がとられるものである。なお本実施例では変調
信号bのパルス幅は2値AMI信号aの信号単位
Sの半分である。3は2値AMI信号発生器1と
変調信号発生器2の出力信号a,bの排他的論理
和をとり2値AMI符号に誤まりを与える変調器
である。4は受信側に設けられる復調器で、その
具体的構成は第3図の如きである。5は変調器3
からの2値AMI信号cと復調器4からの出力g
との排他的論理和をとり、変調器3では付与され
た誤まりを除去する誤まり補正器である。また、
第3図の復調回路において、6は受信した2値
AMI信号cを半ビツト遅延させる遅延回路、7
はクロツク信号fを出力するタイミング抽出回
路、8は遅延回路6の出力dと2値AMI信号c
との排他的論理和をとる排他的論理素子、9は排
他的論理和素子8の出力を否定するNOR素子、
10はそのNOR素子9の出力とタイミング抽出
回路7の出力との論理積をとるAND素子であ
る。
第2図において、いま、変調信号発生器2の出
力bに対応して2値AMI信号発生器1の出力a
を変調器3において半ビツトだけ反転させると、
第1図に示すような信号cとなつて出力される。
これを伝送線を介して伝送し、受信側において、
第3図に示す復調器の遅延回路6により半ビツト
遅延させた信号と受信信号とを8の排他的論理和
素子により論理和をとり、出力eを得る。この出
力eをNOR素子9により反転し、AND素子10
においてその否定出力とタイミング抽出回路7か
らのクロツク信号fとの論理積をとり、復調信号
gを得る。
一方、誤まり補正器5により、受信した2値
AMI信号eと復調器4からの復調信号gとの排
他的論理和をとることによつて第1図に示すよう
な信号hが得られるが、この信号hは元の2値
AMI信号aに等しいので、2値AMI信号の誤ま
りを補することができる。なお、上記のように2
値AMI信号の半ビツトを反転させると2値AMI
信号をNRZ信号に変える際にNRZ信号は必ず1ビ
ツト誤まることになるので、変換されたNRZ信号
を復調器4の出力gに対応して反転させても元の
誤まりのないNRZ信号が得られる。
また、復調器4は伝送路符号の誤まり監視には
是非必要な回路であるが、第2図に示す誤まり補
正器5を構成する排他的論理素子及び第3図に示
す排他的論理素子8を付加するだけで2値AMI
信号に他信号を重畳することができる。
以上の説明からも明らかなように本発明によれ
ば、2値AMI符号のもつ長所をそのままにして
周波数帯域を増すことなく簡単な回路を付加する
だけで他の信号を重畳することができる。
【図面の簡単な説明】
添付図は本発明の一実施例を示すものであつ
て、第1図は本発明の2値AMI符号変調を説明
するためのタイムチヤート、第2図は符号変調回
路の具体的ブロツク構成図、第3図は第2図の一
部詳細回路図である。 1……2値AMI信号発生器、2……変調信号
発生器、3……変調器、4……復調器、5……誤
まり補正器、6……遅延回路、7……タイミング
抽出回路、8……排他的論理和素子、9……
NOR素子、10……AND素子。

Claims (1)

    【特許請求の範囲】
  1. 1 2値AMI信号を発生する2値AMI信号発生
    器と、該2値AMI信号の信号単位の前半位相に
    変調信号を発生する変調信号発生器と、前記2値
    AMI信号と変調信号の排他的論理和をとり、前
    記2値AMI信号発生器の2値AMI信号を強制的
    に誤らせることによつて変調して被変調信号を形
    成し、伝送路へ送出する変調器と、伝送路から受
    信した被変調信号とその被変調信号を半ビツト遅
    らせた信号との排他的論理和をとつて反転し、そ
    の出力とクロツク信号との論理積をとることによ
    つて復調信号を得る復調器と、前記被変調信号と
    前記復調信号の排他的論理和をとつて前記2値
    AMI信号を出力する誤まり補正器とから構成さ
    れていることを特徴とする2値AMI符号の変調
    方式。
JP7720277A 1977-06-30 1977-06-30 Modulation system for binary ami code Granted JPS5412610A (en)

Priority Applications (1)

Application Number Priority Date Filing Date Title
JP7720277A JPS5412610A (en) 1977-06-30 1977-06-30 Modulation system for binary ami code

Applications Claiming Priority (1)

Application Number Priority Date Filing Date Title
JP7720277A JPS5412610A (en) 1977-06-30 1977-06-30 Modulation system for binary ami code

Publications (2)

Publication Number Publication Date
JPS5412610A JPS5412610A (en) 1979-01-30
JPS6141462B2 true JPS6141462B2 (ja) 1986-09-16

Family

ID=13627231

Family Applications (1)

Application Number Title Priority Date Filing Date
JP7720277A Granted JPS5412610A (en) 1977-06-30 1977-06-30 Modulation system for binary ami code

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JP (1) JPS5412610A (ja)

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JPS5412610A (en) 1979-01-30

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