JPS6145194B2 - - Google Patents
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- Publication number
- JPS6145194B2 JPS6145194B2 JP55188146A JP18814680A JPS6145194B2 JP S6145194 B2 JPS6145194 B2 JP S6145194B2 JP 55188146 A JP55188146 A JP 55188146A JP 18814680 A JP18814680 A JP 18814680A JP S6145194 B2 JPS6145194 B2 JP S6145194B2
- Authority
- JP
- Japan
- Prior art keywords
- signal
- output
- gate
- correction
- frequency divider
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired
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-
- G—PHYSICS
- G04—HOROLOGY
- G04G—ELECTRONIC TIME-PIECES
- G04G5/00—Setting, i.e. correcting or changing, the time-indication
- G04G5/04—Setting, i.e. correcting or changing, the time-indication by setting each of the displayed values, e.g. date, hour, independently
- G04G5/043—Setting, i.e. correcting or changing, the time-indication by setting each of the displayed values, e.g. date, hour, independently using commutating devices for selecting the value, e.g. hours, minutes, seconds, to be corrected
Landscapes
- Physics & Mathematics (AREA)
- General Physics & Mathematics (AREA)
- Electric Clocks (AREA)
Description
【発明の詳細な説明】
本発明はデジタル表示電子式腕時計に関する。
本発明は前記デジタル表示電子式腕時計に表示
される時刻の秒桁の修正に、秒桁の歩進機能を持
つデジタル表示電子式腕時計に関する。
される時刻の秒桁の修正に、秒桁の歩進機能を持
つデジタル表示電子式腕時計に関する。
本発明の目的は、デジタル表示電子式腕時計に
おける時刻合せを容易に行なえるようにすること
である。
おける時刻合せを容易に行なえるようにすること
である。
従来、デジタル表示電子式腕時計では、時刻の
修正すなわち時刻合せを行なう場合、分の桁ある
いは時の桁等に関しては時刻修正用スイツチを押
す毎に、分桁あるいは時刻等の表示数が１ずつ増
えるようになつているが、秒の桁に関しては時刻
修正用スイツチを押した場合には00秒にリセツト
するようになつている。従来の時分秒を表示する
デジタル表示電子式腕時計の一例のブロツク図を
第１図に示す。１は発振器で水晶振動子により
32768Hzの発振をする。２は1/512分周器で発振器
１の発振周波数を1/512にする。３は1/64分周器
で1/512分周器２の出力周波数を更に1/64にす
る。４は秒桁カウンタで1/64分周器３の出力の１
Hzの信号によりカウントアツプする。６は分桁カ
ウンタで秒桁カウンタ出力の1/60Hzの信号により
カウントアツプする。８は時桁カウンタで分桁カ
ウンタ出力の1/3600Hzの信号によりカウントアツ
プする。９は時刻修正用スイツチで、このスイツ
チを押すとゲート１３，１４およびＤタイプフリ
ツプフロツプ１１，１２、インバータ２０の働き
により1/512分周器２の出力パルス巾に等しいパ
ルスを１パルス、ゲート１４より出力する。なお
１１ａ，１２ａはクロツク入力端子、１１ｂ，１
２ｂはデータ入力端子、１１ｃは出力端子、１２
ｃは反転出力端子、１１ｄ，１２ｄはリセツト入
力端子である。１０は時刻修正桁選択用スイツチ
であり、このスイツチを押す毎に修正桁カウンタ
１５がカウントアツプする。この修正桁カウンタ
１５の出力は修正桁デコーダ１６でデコーダされ
１７，１８，１９のゲートに信号を送る。ゲート
１７は秒桁カウンタ４および1/64分周器３にリセ
ツトをかけるためのものであり、修正桁デコーダ
１６の端子１６ａがハイレベルのときゲート１４
からの信号を1/64分周器３および秒桁カウンタ４
に伝える。なお３ａ，４ａは1/64分周器３および
秒桁カウンタ４のリセツト端子である。ゲート１
８は端子１６ｂがハイレベルのとき分桁カウンタ
６を１進めるためのパルスをゲート５に伝える。
またゲート１９は端子１６ｃがハイレベルのとき
時桁カウンタ８を１進める信号をゲート７に伝え
る。このような時刻修正方式であると、何時何分
00秒という具合に時刻合せをする場合には容易に
修正することができるが、一方秒カウンタを00以
外の数字にセツトすることができないため任意の
秒に時刻合せすることができない。このため秒の
時刻合せをするためには00秒になるまで待たねば
ならず、秒の時刻合せに時間を要した。本発明は
かかる欠点を除去したものである。
修正すなわち時刻合せを行なう場合、分の桁ある
いは時の桁等に関しては時刻修正用スイツチを押
す毎に、分桁あるいは時刻等の表示数が１ずつ増
えるようになつているが、秒の桁に関しては時刻
修正用スイツチを押した場合には00秒にリセツト
するようになつている。従来の時分秒を表示する
デジタル表示電子式腕時計の一例のブロツク図を
第１図に示す。１は発振器で水晶振動子により
32768Hzの発振をする。２は1/512分周器で発振器
１の発振周波数を1/512にする。３は1/64分周器
で1/512分周器２の出力周波数を更に1/64にす
る。４は秒桁カウンタで1/64分周器３の出力の１
Hzの信号によりカウントアツプする。６は分桁カ
ウンタで秒桁カウンタ出力の1/60Hzの信号により
カウントアツプする。８は時桁カウンタで分桁カ
ウンタ出力の1/3600Hzの信号によりカウントアツ
プする。９は時刻修正用スイツチで、このスイツ
チを押すとゲート１３，１４およびＤタイプフリ
ツプフロツプ１１，１２、インバータ２０の働き
により1/512分周器２の出力パルス巾に等しいパ
ルスを１パルス、ゲート１４より出力する。なお
１１ａ，１２ａはクロツク入力端子、１１ｂ，１
２ｂはデータ入力端子、１１ｃは出力端子、１２
ｃは反転出力端子、１１ｄ，１２ｄはリセツト入
力端子である。１０は時刻修正桁選択用スイツチ
であり、このスイツチを押す毎に修正桁カウンタ
１５がカウントアツプする。この修正桁カウンタ
１５の出力は修正桁デコーダ１６でデコーダされ
１７，１８，１９のゲートに信号を送る。ゲート
１７は秒桁カウンタ４および1/64分周器３にリセ
ツトをかけるためのものであり、修正桁デコーダ
１６の端子１６ａがハイレベルのときゲート１４
からの信号を1/64分周器３および秒桁カウンタ４
に伝える。なお３ａ，４ａは1/64分周器３および
秒桁カウンタ４のリセツト端子である。ゲート１
８は端子１６ｂがハイレベルのとき分桁カウンタ
６を１進めるためのパルスをゲート５に伝える。
またゲート１９は端子１６ｃがハイレベルのとき
時桁カウンタ８を１進める信号をゲート７に伝え
る。このような時刻修正方式であると、何時何分
00秒という具合に時刻合せをする場合には容易に
修正することができるが、一方秒カウンタを00以
外の数字にセツトすることができないため任意の
秒に時刻合せすることができない。このため秒の
時刻合せをするためには00秒になるまで待たねば
ならず、秒の時刻合せに時間を要した。本発明は
かかる欠点を除去したものである。
本発明による時刻修正方法の一実施例を第２図
のブロツク図を用いて説明する。３１は発振器、
３２は1/512分周器、３４は秒桁カウンタ、３５
は秒桁カウンタ３４からの桁上げパルスとゲート
４８からの分修正パルスの論理和をとるためのゲ
ート、３６は分桁カウンタ、３７は分桁カウンタ
３６からの桁上げパルスとゲート４９からの時修
正パルスの論理和をとるためのゲート、３９は時
刻修正用スイツチ、４０は時刻修正桁選択用スイ
ツチ、４１，４２はＤタイプフリツプフロツプ、
４３，４４はゲート、５０はインバータ、４５は
修正桁カウンタ、４６は修正桁デコーダ、４７は
秒桁リセツトのためのゲート、４８は分桁を歩進
するためのゲート、４９は時桁を歩進するための
ゲートである。なお３３ａ，３４ａはリセツト端
子、４１ａ，４２ａはクロツク入力端子、４１
ｂ，４２ｂはデータ入力端子、４１ｃは出力端
子、４２Ｃは反転出力端子、４１ｄ，４２ｄはリ
セツト入力である。以上述べた部分は第１図の従
来のデジタル表示電子式腕時計の時刻修正回路と
同様である。尚、時刻修正スイツチ３９を入力し
たときにはゲート４３、デイレイフリツプフロツ
プ４１，４２、ゲート４４、インバータ５０によ
つて修正信号が形成される。即ちスイツチ３９を
ONにしたときにゲート４３からのクロツク信号
によりフリツプフロツプ４１の出力４１ｃに
Highが出力されゲート４４を開状態にする。次
のブロツク信号によりゲート４４にHigh信号
（修正信号）が出力される。ゲート４４の出力信
号はインバータ５０を介してフリツプフロツプ４
２のクロツク信号となり、出力４２ｃがLowとな
るのでゲート４３を閉状態になる。スイツチ３９
がオフになつたときフリツプフロツプ４１，４２
はリセツトされ初期状態に戻る。このようにゲー
ト４３、デイレイフリツプフロツプ４１，４２、
ゲート４４、インバータ５０が修正信号形成回路
６０を構成している。
のブロツク図を用いて説明する。３１は発振器、
３２は1/512分周器、３４は秒桁カウンタ、３５
は秒桁カウンタ３４からの桁上げパルスとゲート
４８からの分修正パルスの論理和をとるためのゲ
ート、３６は分桁カウンタ、３７は分桁カウンタ
３６からの桁上げパルスとゲート４９からの時修
正パルスの論理和をとるためのゲート、３９は時
刻修正用スイツチ、４０は時刻修正桁選択用スイ
ツチ、４１，４２はＤタイプフリツプフロツプ、
４３，４４はゲート、５０はインバータ、４５は
修正桁カウンタ、４６は修正桁デコーダ、４７は
秒桁リセツトのためのゲート、４８は分桁を歩進
するためのゲート、４９は時桁を歩進するための
ゲートである。なお３３ａ，３４ａはリセツト端
子、４１ａ，４２ａはクロツク入力端子、４１
ｂ，４２ｂはデータ入力端子、４１ｃは出力端
子、４２Ｃは反転出力端子、４１ｄ，４２ｄはリ
セツト入力である。以上述べた部分は第１図の従
来のデジタル表示電子式腕時計の時刻修正回路と
同様である。尚、時刻修正スイツチ３９を入力し
たときにはゲート４３、デイレイフリツプフロツ
プ４１，４２、ゲート４４、インバータ５０によ
つて修正信号が形成される。即ちスイツチ３９を
ONにしたときにゲート４３からのクロツク信号
によりフリツプフロツプ４１の出力４１ｃに
Highが出力されゲート４４を開状態にする。次
のブロツク信号によりゲート４４にHigh信号
（修正信号）が出力される。ゲート４４の出力信
号はインバータ５０を介してフリツプフロツプ４
２のクロツク信号となり、出力４２ｃがLowとな
るのでゲート４３を閉状態になる。スイツチ３９
がオフになつたときフリツプフロツプ４１，４２
はリセツトされ初期状態に戻る。このようにゲー
ト４３、デイレイフリツプフロツプ４１，４２、
ゲート４４、インバータ５０が修正信号形成回路
６０を構成している。
本発明では、時刻修正時に秒桁の歩進を行なう
ために修正桁デコーダ４６の出力端子４６ｄから
の信号を用い、同信号がハイレベルのとき時刻修
正用スイツチ３９を操作するとゲート５１、ゲー
ト５３を経て秒桁カウンタ３４を１進めるように
してある。なお５２は秒桁歩進のモードすなわち
入力端子４６ｄがハイレベルのとき、時刻修正用
スイツチ３９を押し続けている間1/64分周器３３
をリセツトしておくための信号を発生するゲー
ト、５４はゲート５２の出力とゲート４７の出力
である秒リセツト信号の論理和を作るためのゲー
トである。このような回路を用いることにより、
秒桁歩進モードでは時刻修正用スイツチ３９を操
作すると秒針が１進み、該スイツチ３９を操作し
続ける間1/64分周器３３にリセツトがかかつてい
るため、秒桁カウントは停止している。時刻修正
用スイツチ３９の操作をやめるとその時点で1/64
分周器３３のリセツト状態が終了し1/64分周器３
３は作動を再開する。すなわち時刻修正用スイツ
チ３９の操作をやめて約１秒後に秒桁カウントを
開始する。例えば本発明を用いた時計で現在の秒
桁の表示が15秒のものを、現在20秒を表示してい
る正確な時計に合せるための修正を行なう方法に
つき述べる。まず時刻修正桁選択用スイツチ４０
により秒歩進モードにしておき、時刻修正用スイ
ツチ３９を手早く10回押し、10回目に押したとき
には該スイツチ３９を押し続ける。この状態では
秒桁の表示は25秒となりかつ秒桁カウンタ３４が
停している。一方正確な時刻を表示している時計
はしばらくすると25秒を表示するようになる。こ
の時点で被修正時計の時刻修正用スイツチ３９の
操作をやめると被修正時計も25秒以降作動を開始
し時刻合せが終了する。
ために修正桁デコーダ４６の出力端子４６ｄから
の信号を用い、同信号がハイレベルのとき時刻修
正用スイツチ３９を操作するとゲート５１、ゲー
ト５３を経て秒桁カウンタ３４を１進めるように
してある。なお５２は秒桁歩進のモードすなわち
入力端子４６ｄがハイレベルのとき、時刻修正用
スイツチ３９を押し続けている間1/64分周器３３
をリセツトしておくための信号を発生するゲー
ト、５４はゲート５２の出力とゲート４７の出力
である秒リセツト信号の論理和を作るためのゲー
トである。このような回路を用いることにより、
秒桁歩進モードでは時刻修正用スイツチ３９を操
作すると秒針が１進み、該スイツチ３９を操作し
続ける間1/64分周器３３にリセツトがかかつてい
るため、秒桁カウントは停止している。時刻修正
用スイツチ３９の操作をやめるとその時点で1/64
分周器３３のリセツト状態が終了し1/64分周器３
３は作動を再開する。すなわち時刻修正用スイツ
チ３９の操作をやめて約１秒後に秒桁カウントを
開始する。例えば本発明を用いた時計で現在の秒
桁の表示が15秒のものを、現在20秒を表示してい
る正確な時計に合せるための修正を行なう方法に
つき述べる。まず時刻修正桁選択用スイツチ４０
により秒歩進モードにしておき、時刻修正用スイ
ツチ３９を手早く10回押し、10回目に押したとき
には該スイツチ３９を押し続ける。この状態では
秒桁の表示は25秒となりかつ秒桁カウンタ３４が
停している。一方正確な時刻を表示している時計
はしばらくすると25秒を表示するようになる。こ
の時点で被修正時計の時刻修正用スイツチ３９の
操作をやめると被修正時計も25秒以降作動を開始
し時刻合せが終了する。
本発明の他の一実施例を第３図について説明す
る。第２図のブロツク図中、時刻修正部の時刻修
正パルス発生装置部分1/N分周器５５、インバー
タ５６、およびゲート５７，５８，５９を設ける
ことにより秒桁歩進モードにおいて時刻修正用ス
イツチ３９を操作する毎にＮ発の秒歩進パルスを
出力するようになる。この場合時刻修正用スイツ
チ３９を操作する毎に秒桁の表示はＮ秒進むこと
になる。第２図のブロツク図の時計の場合時刻修
正用スイツチ３９を操作したときの歩進は１秒分
しか行なわれないため、20〜60秒時刻が違つてい
る場合の時刻合せに手間がかかる。一方第３図に
示すブロツク図の時計の場合には時刻修正用スイ
ツチ３９を操作する回数が少なくて済むため、秒
桁の歩進モードで時刻合せを行なう手間が少なく
てよい。実用上1/N分周器５５のＮは２，５，１
０，２０，３０にするのが適当であろうが、１〜
60のいかなる数字をあてはめることも可能であ
る。第３図ではゲート４３，４４，５７，５８，
５９、インバータ５０，５６、フリツプフロツプ
４１，４２。1/N分周器５５が修正信号形成回路
６１を構成している。
る。第２図のブロツク図中、時刻修正部の時刻修
正パルス発生装置部分1/N分周器５５、インバー
タ５６、およびゲート５７，５８，５９を設ける
ことにより秒桁歩進モードにおいて時刻修正用ス
イツチ３９を操作する毎にＮ発の秒歩進パルスを
出力するようになる。この場合時刻修正用スイツ
チ３９を操作する毎に秒桁の表示はＮ秒進むこと
になる。第２図のブロツク図の時計の場合時刻修
正用スイツチ３９を操作したときの歩進は１秒分
しか行なわれないため、20〜60秒時刻が違つてい
る場合の時刻合せに手間がかかる。一方第３図に
示すブロツク図の時計の場合には時刻修正用スイ
ツチ３９を操作する回数が少なくて済むため、秒
桁の歩進モードで時刻合せを行なう手間が少なく
てよい。実用上1/N分周器５５のＮは２，５，１
０，２０，３０にするのが適当であろうが、１〜
60のいかなる数字をあてはめることも可能であ
る。第３図ではゲート４３，４４，５７，５８，
５９、インバータ５０，５６、フリツプフロツプ
４１，４２。1/N分周器５５が修正信号形成回路
６１を構成している。
以上の如く本発明の構成によれば、秒桁カウン
タを任意の値に簡単に設定できるとともに、秒桁
カウンタ修正状態で外部操作部材からの出力信号
を分周器のリセツト端子に入力できるゲート５２
を構成してあるので、使用者はある程度余裕のあ
る秒位置まで表示を進めておき、そこで外部操作
部材を入力しつづけることにより秒表示を訂止さ
せておき、基準時刻がその待期時刻に一致したと
きに外部操作部材の入力をオフすることにより時
計は正確な時刻を刻み始めるものであり、修正操
作を著しく容易にした。
タを任意の値に簡単に設定できるとともに、秒桁
カウンタ修正状態で外部操作部材からの出力信号
を分周器のリセツト端子に入力できるゲート５２
を構成してあるので、使用者はある程度余裕のあ
る秒位置まで表示を進めておき、そこで外部操作
部材を入力しつづけることにより秒表示を訂止さ
せておき、基準時刻がその待期時刻に一致したと
きに外部操作部材の入力をオフすることにより時
計は正確な時刻を刻み始めるものであり、修正操
作を著しく容易にした。
又、修正信号形成回路は２個のＤタイプフリツ
プフロツプを用いて、一方のＤタイプフリツプフ
ロツプでは時刻修正スイツチの出力信号を読み込
み、他方のＤタイプフリツプフロツプでは修正信
号が出力されたのをクロツク入力として用いて、
分周器からの信号入力を遮断するものなので、チ
ヤタリング等があつても確実に所望の修正信号を
出力できるものである。
プフロツプを用いて、一方のＤタイプフリツプフ
ロツプでは時刻修正スイツチの出力信号を読み込
み、他方のＤタイプフリツプフロツプでは修正信
号が出力されたのをクロツク入力として用いて、
分周器からの信号入力を遮断するものなので、チ
ヤタリング等があつても確実に所望の修正信号を
出力できるものである。
第１図は従来のデジタル表示電子式腕時計の時
刻修正部分の一例のブロツク図。第２図は本発明
によるデジタル表示電子式腕時計の時刻修正部分
の一実施例のブロツク図。第３図は本発明の他の
実施例による時刻修正部の時刻修正パルス発生回
路のブロツク図である。 １，３１……発振器、２，３２……1/512分周
器、３，３３……1/64分周器、４，３４……秒桁
カウンタ、６，３６……分桁カウンタ、８，３８
……時桁カウンタ、９，３９……時刻修正用スイ
ツチ、１０，４０……時刻修正桁選択用スイツ
チ、１１，１２，４１，４２……Ｄタイプフリツ
プフロツプ、１５，４５……修正桁カウンタ、１
６，４６……修正桁デコーダ、５５……1/N分周
器。
刻修正部分の一例のブロツク図。第２図は本発明
によるデジタル表示電子式腕時計の時刻修正部分
の一実施例のブロツク図。第３図は本発明の他の
実施例による時刻修正部の時刻修正パルス発生回
路のブロツク図である。 １，３１……発振器、２，３２……1/512分周
器、３，３３……1/64分周器、４，３４……秒桁
カウンタ、６，３６……分桁カウンタ、８，３８
……時桁カウンタ、９，３９……時刻修正用スイ
ツチ、１０，４０……時刻修正桁選択用スイツ
チ、１１，１２，４１，４２……Ｄタイプフリツ
プフロツプ、１５，４５……修正桁カウンタ、１
６，４６……修正桁デコーダ、５５……1/N分周
器。
Claims (1)
- １ 発振器１、前記発振器の出力にもとづいて秒
信号を形成する分周器３３、前記分周器からの秒
信号を計数する秒桁カウンタ３４、前記秒桁カウ
ンタから出力される分信号を計数する分桁カウン
タ３６、前記分桁カウンタから出力される時信号
を計数する時桁カウンタ３８とを有するデジタル
表示電子式腕時計において、開閉スイツチからな
り閉状態のとき出力信号が継続して出力される時
刻修正用スイツチ３９と、時刻修正桁選択用スイ
ツチ４０と、前記時刻修正用スイツチ３９の出力
信号に応じて所定の数の修正信号を出力する修正
信号形成回路６０，６１と、前記時刻修正選択用
スイツチ４０の出力信号に応じて修正桁を選択す
るデコーダ４６と、前記デコーダの出力に応じて
前記修正信号を所望の桁カウンタに振り分けて入
力させるために前記デコーダと前記秒桁カウン
タ、前記分桁カウンタ及び前記時桁カウンタの
各々の間に接続される第１ゲート５１、第２ゲー
ト４８、第３ゲート４９、前記分周器３３及び前
記秒桁カウンタの各々のリセツト端子と前記デコ
ーダの間に接続され前記デコーダの出力に応じて
前記修正信号を前記リセツト端子に出力する第４
ゲート４７と、前記デコーダと前記分周器３３の
リセツト端子の間に接続され前記デコーダが前記
秒桁カウンタを歩進するための第１ゲートを選択
したとき前記時刻修正用スイツチ３９の出力信号
を前記分周器３３のリセツト端子に出力する第５
ゲート５２とを備えており、且つ前記修正信号形
成回路は、前記時刻修正用スイツチ３９の出力信
号をデータ入力とし前記秒信号出力段より前段の
分周器からの出力信号をクロツク入力とする第
1Dタイプフリツプフロツプ４１と、前記第1Dタ
イプフリツプフロツプと前記第１乃至第４ゲート
の間に接続され前記時刻修正スイツチ３９の出力
信号が第1Dタイプフリツプフロツプに入力され
たとき前記分周器からの出力信号を修正信号とし
て前記第１乃至第４ゲートに出力する第６ゲート
４４と、前記第1Dタイプフリツプフロツプの出
力をデータ入力として前記第６ゲート４４の出力
信号をクロツク入力とする第2Dタイプフリツプ
フロツプ４２と、前記分周器と前記第６ゲートの
間に接続され前記第1Dタイプフリツプフロツプ
の出力信号が前記修正信号によつて前記第2Dタ
イプフリツプフロツプに入力されたとき前記分周
器からの出力信号を遮断する第７ゲート４３から
なることを特徴とするデジタル表示電子式腕時
計。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55188146A JPS57111499A (en) | 1980-12-29 | 1980-12-29 | Electronic wrist watch with digital display |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP55188146A JPS57111499A (en) | 1980-12-29 | 1980-12-29 | Electronic wrist watch with digital display |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS57111499A JPS57111499A (en) | 1982-07-10 |
| JPS6145194B2 true JPS6145194B2 (ja) | 1986-10-07 |
Family
ID=16218546
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP55188146A Granted JPS57111499A (en) | 1980-12-29 | 1980-12-29 | Electronic wrist watch with digital display |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JPS57111499A (ja) |
Family Cites Families (3)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS5219977B2 (ja) * | 1972-04-13 | 1977-05-31 | ||
| JPS50107973A (ja) * | 1974-01-30 | 1975-08-25 | ||
| JPS50142078A (ja) * | 1974-05-01 | 1975-11-15 |
-
1980
- 1980-12-29 JP JP55188146A patent/JPS57111499A/ja active Granted
Also Published As
| Publication number | Publication date |
|---|---|
| JPS57111499A (en) | 1982-07-10 |
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