JPS6161475B2 - - Google Patents

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JPS6161475B2
JPS6161475B2 JP2372380A JP2372380A JPS6161475B2 JP S6161475 B2 JPS6161475 B2 JP S6161475B2 JP 2372380 A JP2372380 A JP 2372380A JP 2372380 A JP2372380 A JP 2372380A JP S6161475 B2 JPS6161475 B2 JP S6161475B2
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JP
Japan
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magnetic
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divider
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Expired
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JP2372380A
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English (en)
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JPS56119985A (en
Inventor
Mikio Segawa
Current Assignee (The listed assignees may be inaccurate. Google has not performed a legal analysis and makes no representation or warranty as to the accuracy of the list.)
Fujitsu Ltd
Original Assignee
Fujitsu Ltd
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Publication date
Application filed by Fujitsu Ltd filed Critical Fujitsu Ltd
Priority to JP2372380A priority Critical patent/JPS56119985A/ja
Publication of JPS56119985A publication Critical patent/JPS56119985A/ja
Publication of JPS6161475B2 publication Critical patent/JPS6161475B2/ja
Granted legal-status Critical Current

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    • GPHYSICS
    • G11INFORMATION STORAGE
    • G11CSTATIC STORES
    • G11C19/00Digital stores in which the information is moved stepwise, e.g. shift registers
    • G11C19/02Digital stores in which the information is moved stepwise, e.g. shift registers using magnetic elements
    • G11C19/08Digital stores in which the information is moved stepwise, e.g. shift registers using magnetic elements using thin films in plane structure
    • G11C19/0875Organisation of a plurality of magnetic shift registers

Description

【発明の詳細な説明】 本発明は磁気バブルメモリ装置に関するもので
あり、更に詳しくはシリアル転送路を情報蓄積路
とした磁気バブルメモリ装置の改良に関する。
半導体集積回路技術をはじめとする電子技術の
著しい発展に支えられて、電子計算機は急速に小
型化し高速度化されている。またその信頼度も回
路素子のソリツドステート化によつて著しく向上
している。さらに、電子計算機の利用が進むにつ
れて記憶装置の記憶容量も年々増加の一途を辿つ
ており、記憶に要する単価の低減とアクセス時間
の短縮が強く要望されている。
大容量の情報を確実に記憶保持するためには信
頼度の高い不揮発性の大容量メモリ装置が必要で
あるが、揮発性の半導体メモリをもつて実現する
ことは不可能であり、また、不揮発性ながらも磁
気テープ装置、磁気デイスク装置などは可動部分
を有するという致命的な欠陥を有しており、これ
も信頼度の面でニーズに適合したメモリ装置と言
い難い。
以上のような技術的背景に鑑みて発明されたの
が磁気バブルである。
一軸磁気異方性を有するガーネツトまたはオル
ソフエライト等の磁性薄板面に垂直に適当な大き
さのバイアス磁界を印加すると円筒状磁区所謂磁
気バブルが発生する。
この磁気バブルを利用して情報の蓄積、論理演
算等を行う磁気バブル利用装置は、不揮発性であ
ること、全固体素子であること、大容量化が可能
であること、比較的高速であること等の理由から
これらの特性を生かした分野においてその実用化
が急速に進められている。
この磁気バブル利用装置においては、磁気バブ
ルの発生、転送、分割、拡大、検出、消去等の各
種機能が必要とされる。さらにはまた磁気バブル
を磁性薄板内において安定に存在させるためのバ
イアス磁界印加手段、磁気バブルを磁性薄板内に
おいて磁性薄板上に形成された磁性体パターンの
基に移動させるための回転磁界印加手段を必要と
する。
磁気バブルメモリ装置の記憶形態として次の2
つが挙げられる。
その1つはメジヤー/マイナーループ方式と称
され、情報蓄積路として多数のマイナーループを
設ける一方、マイナーループへの情報の書込み、
あるいはマイナーループからの情報の読出しをマ
イナーループに対してゲートを介して接続された
メジヤーループあるいはメジヤーラインにより行
うものである。
この方式は、蓄積情報が多数のマイナーループ
に分割されて記憶され、所定のマイナーループ上
のアドレスがゲートにさしかかるタイミングでゲ
ートを駆動して情報を書込みあるいは読出すこと
ができる。従つてこの方式は大容量で且つ短いア
クセス時間の要求される磁気バブルメモリ装置に
よく採用される。
他の1つはシングルループ方式と称され、情報
蓄積路としてシリアル転送路を用い、シリアル転
送路上に上記各機能部を設け、シリアル転送路に
対して直接情報を書込みあるいは分割し、あるい
は消滅させる方式である。
この方式は、一連の蓄積情報を連続して読出す
ような用途、例えば制御プログラム等の蓄積に用
いて便利である。
本発明は、上述した二方式のうち、特にシング
ルループ方式の改良に関するものである。
第1図は、従来より行われているシングルルー
プ方式を適用した磁気バブルメモリ装置の一構成
例である。
図において、1は情報蓄積路、2はバブル発生
器、3はバブル伝播路、4はバブル複製器、5は
バブル伝播路、6はバブル検出器、7はバブル消
去器である。
従来のシングルループ方式は図示の如く構成さ
れ、発生器2より発生する磁気バブル情報列(以
下バブル列と称する)は伝播路3を介して蓄積路
1内に連続して書込まれる。バブル列は蓄積路1
内を巡回し、所望のバブル列が複製器4にさしか
かるタイミングを図示されざる外部制御回路によ
りとらえて該複製器4を駆動し、複製器4によつ
て分割された2個のバブルの一方を伝播路5を介
して検出器6へ、また他方を再び蓄積路1内に送
り出すことで非破壊の情報読出しを行う。バブル
列は必要に応じて消去器7によつて消去され、そ
の消去された蓄積路上のアドレス位置に新たなバ
ブル列が入るよう同じく外部制御回路で発生器2
の駆動タイミングを判断することで情報の書換え
を行う。
しかし、この方式はその構成から必然的に次の
ような欠点を有する。すなわち、情報読出しの際
読出すべき所望の情報が複製器4を通過した後
は、その情報が蓄積路1を一周する間待たねばな
らないことである。従つて、この方式における平
均アクセス時間は大きくならざるを得ない。
ちなみに64kbitの容量を有する蓄積路1を駆動
周波数100kHzで駆動した場合のアクセス時間は
約640msec.maxとかなり大きい。
本発明は叙上の欠点に鑑みなされたもので、そ
の目的とするところは、上述のシングルループ方
式の磁気バブルメモリ装置において、平均アクセ
ス時間の短い磁気バブルメモリ装置を実現するに
ある。
本発明の目的は、情報蓄積路としてシリアル転
送路を用い該転送路内の蓄積情報を該転送路より
分割器を介して伝播路で結合された検出器によつ
て読出すようにしてなる磁気バブルメモリ装置に
おいて、該シリアル転送路上の少なくとも2箇所
に分割器を設けるとともに該各分割器と該検出器
間の各伝播路のビツト長を等しく設定し、読出す
べき所望の情報が最初に到達する分割器を分割器
制御手段により作動させ以て所望の情報を該伝播
路を介して該検出器に導くことを特徴とする磁気
バブルメモリ装置とすることにより達成すること
ができる。
以下本発明を図面により説明する。
第2図は本発明にかかる磁気バブルメモリ装置
の一実施例である。
図において、10は情報蓄積路、20はバブル
発生器、30はバブル伝播路、40は第1のバブ
ル複製器、41は第2のバブル複製器、50は第
1のバブル伝播路、51は第2のバブル伝播路、
60はバブル検出器、70はバブル消去器であ
る。
本発明の第1図図示の従来の構成と異なるとこ
ろは、蓄積路10上に複数個の複製器を配置した
点にある。本実施例では蓄積路1上に2個の複製
器40,41を配置し、各複製器40,41より
1個の検出器60迄を各伝播路50,51で接続
したものである。2個の複製器40,41は蓄積
路10をほぼ二分する位置に配置されている。動
作は第1図図示の従来例とほぼ同等であるので詳
しい説明は省略するが、2個の複製器40,41
の駆動タイミングの制御に相違があるため、これ
を第3図と併用して以下にその動作説明を行う。
第3図は、第2図に示す磁気バブルメモリチツ
プを制御する外部制御回路の一実施例を示すブロ
ツク図であり、図中71はアドレスレジスタ、7
2は磁気バブルメモリチツプを覆い、該チツプに
対して回転磁界を発生する駆動コイルを駆動する
コイルドライバ、73はコイルドライバ72に接
続されたカウンタ、74はレジスタ、比較回路、
ゲート制御回路等を含んで構成された演算回路、
75は演算回路からの出力信号により駆動される
ゲートドライバである。
先ず、上位装置より読出したい情報のアドレス
が磁気バブルメモリ装置の外部制御回路に与えら
れ、該アドレス情報がアドレスレジスタ71に蓄
積される。
一方、カウンタ73は、蓄積路10の先頭アド
レスでリセツトされた後コイルドライバ72から
の出力により順次カウントアツプされ、その計数
値は常に停止している蓄積路10内のバブル列の
先頭アドレスが現在どの位置にあるかを表示し保
持している。従つてカウンタ73の計数値とアド
レスレジスタ71に蓄積されたアドレス情報を演
算回路74に入力することで読出したい所望のバ
ブル列が現在どの位置に存在しているかを認識す
ることができる。一方、蓄積路10上に配置され
た2箇の複製器40,41には何番目のアドレス
のバブル列が対応しているかを、カウンタ73か
らの計数値により認識することが可能であるた
め、現在読出したい所望のバブル列がどちらの複
製器に近いかを演算により求めることができる。
すなわち読出したい所望のバブル列のアドレス
と複製器40にあるバブル列のアドレスから求め
た差分のビツト数N1と、読出したい所望のバブ
ル列のアドレスと複製器41にあるバブル列のア
ドレスとから求めた差分のビツト数N2を演算回
路74により求め、さらに求めたビツト数N1
N2の大小関係を演算しその小さい方のビツト数
だけコイルドライバ72を駆動させるとともにそ
のビツト数だけ蓄積路10内のバブル列をシフト
させた後に対応する一方の複製器に電流を供給す
るべく演算回路74よりゲートドライバ75に駆
動信号を送出する。
このようにして読出したい所望のバブル列を近
い側の複製器により検出器60に導くことができ
る。
従つて、本実施例の場合、装置全体よりみた平
均アクセス時間は従来種のものに比較して約半分
に短縮される。例えば蓄積路容量64kbit、駆動周
波数100kHzの場合、そのアクセス時間は約320m
sec.maxですむ。
尚、第2図において各複製器と検出器を結ぶ伝
播路50,51の各ビツト数は等しく設定されて
いる。
また、本実施例にあつては、蓄積路10に対し
て2個の複製器を配置したが、さらに多数の複製
器を配置することによりさらに平均アクセス時間
の短縮を図ることができる。
さらにはまた、本実施例にあつては2個の複製
器につながる伝播路50,51を合流回路により
1つの伝播路として1つの検出器60にバブル列
を導くものであるが、合流回路を用いずに用意さ
れた2個の検出器の夫々にバブル列を導いても勿
論支障ない。
ただこの場合、スプリツター等比較的大面積を
必要とする検出器を複数設けることからチツプス
ペースの有効利用に供し得ないことは否めない。
以上説明したように本発明によれば、平均アク
セス時間の大きいシングルループ方式の磁気バブ
ルメモリ装置にあつて、駆動周波数を上げる等に
よる駆動回路への回路上の負担を与えることな
く、平均アクセス時間の短縮を図ることができ、
その実用上の効果は非常に大きい。
【図面の簡単な説明】
第1図は従来の磁気バブルメモリ装置の構成
図、第2図は本発明にかかる磁気バブルメモリ装
置の一実施例、第3図は本発明の磁気バブルメモ
リ装置に適用される外部制御回路の一実施例であ
る。 図において、10は蓄積路、20は発生器、3
0,50,51は伝播路、40,41は複製器、
60は検出器、70は消去器、71はアドレスレ
ジスタ、72はコイルドライバ、73はカウン
タ、74は演算回路、75はゲートドライバであ
る。

Claims (1)

    【特許請求の範囲】
  1. 1 情報蓄積路としてシリアル転送路を用い該転
    送路内の蓄積情報を該転送路より分割器を介して
    伝播路で結合された検出器によつて読出すように
    してなる磁気バブルメモル装置において、該シリ
    アル転送路上の少なくとも2箇所に分割器を設け
    るとともに該各分割器と該検出器間の各伝播路の
    ビツト長を等しく設定し、読出すべき所望の情報
    が最初に到達する分割器を分割器制御手段により
    作動させ以て所望の情報を該伝播路を介して該検
    出器に導くことを特徴とする磁気バブルメモリ装
    置。
JP2372380A 1980-02-27 1980-02-27 Magnetic bubble memory device Granted JPS56119985A (en)

Priority Applications (1)

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JP2372380A JPS56119985A (en) 1980-02-27 1980-02-27 Magnetic bubble memory device

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JP2372380A JPS56119985A (en) 1980-02-27 1980-02-27 Magnetic bubble memory device

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Publication Number Publication Date
JPS56119985A JPS56119985A (en) 1981-09-19
JPS6161475B2 true JPS6161475B2 (ja) 1986-12-25

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ID=12118233

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